CN109412897A - 基于多核处理器及fpga的共享mac实现系统及方法 - Google Patents

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Abstract

本发明公开了一种基于多核处理器及FPGA的共享MAC实现系统及方法，包括多核处理器端和FPGA端；多核处理器端包括n个独立内核和n个FPGA接口配置寄存器，在每个独立内核内设有一个开源操作系统Linux驱动模块或一个实时中断服务模块；FPGA端包括n个数据包收发模块、一个数据仲裁模块和一个MAC模块；每个数据包收发模块分别与对应的独立内核进行数据交互，并对网络数据包进行缓存；n个数据包收发模块均与数据仲裁模块进行数据交互，并对网络数据包进行缓存；数据仲裁模块分别与n个数据包收发模块、MAC模块进行网络数据包交互，并对网络数据包进行数据处理及优先级仲裁；MAC模块提供与网络收发器硬件接口。

Description

基于多核处理器及FPGA的共享MAC实现系统及方法
技术领域
本发明属于电力系统技术领域，尤其涉及一种基于多核处理器及FPGA的共享MAC实现系统及方法。
背景技术
近年来，随着电力系统发展，对继电保护装置的数字化、智能化的要求不断加深。国际电工委员会制定的IEC61850标准，实现了智能变电站的工程运作标准化，使得智能变电站的工程实施变得规范、统一和透明，同时对继电保护装置提出了更高的网络处理性能要求。
目前大部分厂家使用实时操作系统完成实时网络数据包处理，成本高且平台通用性较差，不利于产品移植；网络数据包处理由处理器完成，效率低。
发明内容
针对现有技术存在的问题，通过多核处理器异构方式，将实时数据包和非实时数据包分别由独立内核处理，提高数据包处理速度；使用FPGA技术，实时解析数据包，对数据包进行分类处理，优先级调度；本发明提出了一种基于多核处理器及FPGA的共享MAC实现系统及方法。
本发明的目的之一在于提供一种基于多核处理器及FPGA的共享MAC实现系统，至少包括：多核处理器端和FPGA端；其中：
所述多核处理器端包括：n个独立内核和n个FPGA接口配置寄存器，在每个独立内核内设有一个开源操作系统Linux驱动模块或一个实时中断服务模块；每个独立内核内的开源操作系统Linux驱动模块、实时中断服务模块分别与一个FPGA接口配置寄存器进行数据交换；n为大于1的自然数；
所述FPGA端包括n个数据包收发模块、一个数据仲裁模块和一个MAC模块；每个数据包收发模块分别与一个FPGA接口配置寄存器进行数据交互，并对网络数据包进行缓存；n个数据包收发模块均与数据仲裁模块进行数据交互，并对网络数据包进行缓存；所述数据仲裁模块分别与n个数据包收发模块、MAC模块进行网络数据包交互，并对网络数据包进行数据处理及优先级仲裁；所述MAC模块提供与网络收发器硬件接口，进而实现数据链路层功能。
进一步：上述数据处理具体包括：对MAC模块接收的数据进行流量统计，重复帧过滤，内容过滤及数据包解析。
进一步：所述收发数据模块包括数据包接收模块和数据包发送模块，所述数据包接收模块用于接收FPGA接口配置寄存器的网络数据包和数据仲裁模块的网络数据包，并对接收到的网络数据包进行缓存；所述数据包发送模块用于向FPGA接口配置寄存器和数据仲裁模块发送网络数据包。
更进一步：所述数据包接收模块包括接收FIFO模块、重复帧过滤模块、流量统计模块、内容过滤模块和数据包解析模块；所述接收FIFO模块与FPGA接口配置寄存器进行数据交互；所述接收FIFO模块、重复帧过滤模块、流量统计模块、内容过滤模块、数据包解析模块、MAC模块依次进行数据交互，数据流由MAC模块依次经过各个模块处理后，最终流向接收FIFO模块；所述接收FIFO模块对网络数据进行缓存；所述重复帧过滤模块检测重复的网络数据包并进行过滤；所述流量统计模块检测网络数据流量且在流量异常时关闭网络数据包接收；所述内容过滤模块对网络数据包进行过滤，按内核配置过滤规则。
更进一步：所述数据包发送模块包括发送FIFO模块，所述发送FIFO模块对网络数据进行缓存。
本发明的目的之二在于提供一种基于多核处理器及FPGA的共享MAC实现系统的方法，其特征在于：包括如下步骤：
步骤一、初始化所需内核寄存器，包括且不限于配置定时器中断及服务模块；根据需求配置定时器中断周期，达到实时处理网络数据包要求；
步骤二、初始化FPGA分配给该内核的寄存器，用于完成MAC操作，读写网络数据包，监视数据流量；
步骤三、使能定时器中断服务，开始处理网络数据包；
步骤四、判断接收FIFO模块是否有新的数据包，如果有，则处理数据包；否则，执行步骤五；
步骤五、判断是否有需要发送的数据包，如果有，则将数据包写入发送FIFO模块，使能发送寄存器；否则返回步骤三；
步骤六、定时器中断服务模块按照中断周期循环执行。
本发明的目的之三在于提供一种基于多核处理器及FPGA的共享MAC实现方法的计算机程序。
本发明的目的之四在于提供一种基于多核处理器及FPGA的共享MAC实现方法的信息数据处理终端。
本发明的目的之五在于提供一种计算机可读存储介质，包括指令，当其在计算机上运行时，使得计算机执行基于多核处理器及FPGA的共享MAC实现方法。
综上所述，本发明的优点及积极效果为：
本发明通过多核处理器异构方式，将实时数据包和非实时数据包分别由独立内核处理，提高数据包处理速度；使用FPGA技术，实时解析数据包，对数据包进行分类处理，优先级调度；该技术方案推荐使用开源免费的Linux操作系统，降低了操作系统使用成本。
附图说明
图1是本发明优选实施例的结构框图；
图2是本发明优选实施例中多核处理器端实时内核模块实现流程图；
图3是本发明优选实施例中的FPGA端数据包接收逻辑图；
图4是本发明优选实施例中的FPGA端数据包发送逻辑图。
具体实施方式
为了使本发明的目的、技术方案及优点更加清楚明白，以下结合实施例，对本发明进行进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。
首先对本发明中多个简写进行注释：
FPGA(Field－Programmable Gate Array)，即现场可编程门阵列。
MAC(medium access control)属于LLC(Logical Link Control)下的一个子层。作为以太网设备的一部分，MAC是数据链路层的一个子层。MAC负责执行带冲突检测的载波侦听多路访问协议，即CSMA/CD协议。它完成以下功能：
把数据封装成帧，包括对帧进行界定，实现帧同步，对目的MAC地址和源MAC地址进行处理，在与PHY发生传输错误时对帧进行处理；
对PHY的控制；
FIFO(First Input First Output)为先入先出队列，这是一种传统的按序执行方法，先进入的指令先完成并引退，跟着才执行第二条指令。在FPGA编程中使用IP核进行实现。
请参阅图1至图4，一种基于多核处理器及FPGA的共享MAC实现系统，
包括多核处理器端和FPGA端；
多核处理器端根据处理网络数据包的不同分为实时内核和非实时内核两种，不限制具体个数，与FPGA配置寄存器组数一致；实时内核通过定时器中断服务模块处理网络数据包，不使用操作系统或免费的小型操作系统(如FreeRTOS等)；非实时内核使用开源Linux系统；
多核处理器端通过总线方式与FPGA端硬件连接，通过总线映射寄存器与FPGA端进行数据通讯。
所述多核处理器端包括：开源操作系统Linux驱动模块、实时中断服务模块、FPGA接口配置寄存器；所述开源操作系统Linux驱动模块、实时中断服务模块操作运行于多核处理器的独立内核中，通过FPGA接口配置寄存器，与FPGA端进行数据交换。
所述FPGA端包括：数据包接收模块、数据包发送模块、MAC模块。
所述FPGA端数据包接收模块包括：接收FIFO模块、重复帧过滤模块、流量统计模块、内容过滤模块、数据包解析模块；所述接收FIFO模块与多核处理器端FPGA接口配置寄存器连接；所述接收FIFO模块、重复帧过滤模块、流量统计模块、内容过滤模块、数据包解析模块、MAC模块依次连接，数据流由MAC模块依次经过各个模块处理，最终流向接收FIFO模块。
所述FPGA端数据发送模块包括：发送FIFO模块、发送优先级仲裁模块；所述发送FIFO模块与多核处理器端FPGA接口配置寄存器和发送优先级仲裁模块连接；所述发送优先级仲裁模块与发送FIFO模块和FPGA端MAC模块连接。
所述FPGA端MAC模块与数据包接收模块的数据包解析模块和数据包发送模块的发送优先级仲裁模块连接。
FPGA端包括收发FIFO数据、数据仲裁模块、MAC模块；收发FIFO数据、数据仲裁模块、MAC模块依次连接，进行网络数据包的交换处理；所述收发FIFO数据负责多核处理器的网络数据包的缓存；所述数据仲裁模块包括接收数据包仲裁及发送数据数据包仲裁；MAC模块提供与网络收发器硬件接口，负责实现数据链路层功能。
参照图3，FPGA端网络数据包接收方案包括：MAC模块、内容过滤模块、流量统计模块、重复帧过滤模块、接收FIFO数据；上述模块依次处理网络数据包，将最终网络数据包发送到多核处理器端。
所述MAC模块接收来自数据链路层的网络数据包，将数据包发送到内容过滤模块。
所述内容过滤模块按照内核数据包分类规则，将对应每个内核的不符合规则网络数据包过滤，其他符合规则的网络数据包发送到流量统计模块。
所述流量统计模块用于统计每个内核接收的网络数据包个数及流量，并配置流量监控功能，流量到达设定值时将关闭网络数据包的接收。
所述重复帧过滤模块根据网络数据包的CRC校验等方式，判断是否为重复的网络数据包，将重复网络数据包丢弃，可以防止来自网络中的DDOS类型攻击。
所述接收FIFO数据用于将处理过的网络数据包进行缓存，每个内核对应独立的接收FIFO数据。
参照图4，FPGA端网络数据包发送方案包括：发送数据FIFO、优先级仲裁模块、MAC模块。
所述发送数据FIFO缓存多核处理器需要发送的网络数据包，将网络数据包传递给优先级仲裁模块。
所述优先级仲裁模块根据内核的实时数据优先级别，判断网络数据包的发送顺序，依次将网络数据包传递给MAC模块。
所述MAC模块接收来自优先级仲裁模块的网络数据包，将数据包通过硬件接口发送到数据链路层。
优选实施例二、一种基于多核处理器及FPGA的共享MAC实现系统的方法，包括：
步骤一、初始化内核所需内核寄存器，包括且不限于配置定时器中断及服务模块；根据需求配置定时器中断周期，达到实时处理网络数据包要求；
步骤二、初始化FPGA分配给该内核的寄存器，用于完成MAC操作，读写网络数据包，监视数据流量；
步骤三、使能定时器中断服务，开始处理网络数据包；
步骤四、判断接收FIFO模块是否有新的数据包，如果有，则处理数据包；否则，执行步骤五；
步骤五、判断是否有需要发送的数据包，如果有，则将数据包写入发送FIFO模块，使能发送寄存器；否则返回步骤三；
步骤六、定时器中断服务模块按照中断周期循环执行。
优选实施例三、一种实现基于多核处理器及FPGA的共享MAC实现系统的计算机模块，所述基于多核处理器及FPGA的共享MAC实现方法包括如下步骤：
步骤一、初始化内核所需内核寄存器，包括且不限于配置定时器中断及服务模块；根据需求配置定时器中断周期，达到实时处理网络数据包要求；
步骤二、初始化FPGA分配给该内核的寄存器，用于完成MAC操作，读写网络数据包，监视数据流量；
步骤三、使能定时器中断服务，开始处理网络数据包；
步骤四、判断接收FIFO模块是否有新的数据包，如果有，则处理数据包；否则，执行步骤五；
步骤五、判断是否有需要发送的数据包，如果有，则将数据包写入发送FIFO模块，使能发送寄存器；否则返回步骤三；
步骤六、定时器中断服务模块按照中断周期循环执行。
优选实施例四、一种实现基于多核处理器及FPGA的共享MAC实现系统的信息数据处理终端。所述基于多核处理器及FPGA的共享MAC实现方法包括如下步骤：
步骤一、初始化内核所需内核寄存器，包括且不限于配置定时器中断及服务模块；根据需求配置定时器中断周期，达到实时处理网络数据包要求；
步骤二、初始化FPGA分配给该内核的寄存器，用于完成MAC操作，读写网络数据包，监视数据流量；
步骤三、使能定时器中断服务，开始处理网络数据包；
步骤四、判断接收FIFO模块是否有新的数据包，如果有，则处理数据包；否则，执行步骤五；
步骤五、判断是否有需要发送的数据包，如果有，则将数据包写入发送FIFO模块，使能发送寄存器；否则返回步骤三；
步骤六、定时器中断服务模块按照中断周期循环执行。
优选实施例五、一种计算机可读存储介质，包括指令，当其在计算机上运行时，使得计算机执行基于多核处理器及FPGA的共享MAC实现方法，所述基于多核处理器及FPGA的共享MAC实现方法包括如下步骤：
步骤一、初始化内核所需内核寄存器，包括且不限于配置定时器中断及服务模块；根据需求配置定时器中断周期，达到实时处理网络数据包要求；
步骤二、初始化FPGA分配给该内核的寄存器，用于完成MAC操作，读写网络数据包，监视数据流量；
步骤三、使能定时器中断服务，开始处理网络数据包；
步骤四、判断接收FIFO模块是否有新的数据包，如果有，则处理数据包；否则，执行步骤五；
步骤五、判断是否有需要发送的数据包，如果有，则将数据包写入发送FIFO模块，使能发送寄存器；否则返回步骤三；
步骤六、定时器中断服务模块按照中断周期循环执行。
在上述实施例中，可以全部或部分地通过软件、硬件、固件或者其任意组合来实现。当使用全部或部分地以计算机模块产品的形式实现，所述计算机模块产品包括一个或多个计算机指令。在计算机上加载或执行所述计算机模块指令时，全部或部分地产生按照本发明实施例所述的流程或功能。所述计算机可以是通用计算机、专用计算机、计算机网络、或者其他可编程装置。所述计算机指令可以存储在计算机可读存储介质中，或者从一个计算机可读存储介质向另一个计算机可读存储介质传输，例如，所述计算机指令可以从一个网站站点、计算机、服务器或数据中心通过有线(例如同轴电缆、光纤、数字用户线(DSL)或无线(例如红外、无线、微波等)方式向另一个网站站点、计算机、服务器或数据中心进行传输)。所述计算机可读取存储介质可以是计算机能够存取的任何可用介质或者是包含一个或多个可用介质集成的服务器、数据中心等数据存储设备。所述可用介质可以是磁性介质，(例如，软盘、硬盘、磁带)、光介质(例如，DVD)、或者半导体介质(例如固态硬盘SolidState Disk(SSD))等。
以上所述仅为本发明的较佳实施例而已，并不用以限制本发明，凡在本发明的精神和原则之内所作的任何修改、等同替换和改进等，均应包含在本发明的保护范围之内。

Claims (8)

1.一种基于多核处理器及FPGA的共享MAC实现系统，其特征在于：至少包括：多核处理器端和FPGA端；其中：
所述多核处理器端包括：n个独立内核和n个FPGA接口配置寄存器，在每个独立内核内设有一个开源操作系统Linux驱动模块或一个实时中断服务模块；每个独立内核内的开源操作系统Linux驱动模块、实时中断服务模块分别与一个FPGA接口配置寄存器进行数据交换；n为大于1的自然数；
所述FPGA端包括n个数据包收发模块、一个数据仲裁模块和一个MAC模块；每个数据包收发模块分别与一个FPGA接口配置寄存器进行数据交互，并对网络数据包进行缓存；n个数据包收发模块均与数据仲裁模块进行数据交互，并对网络数据包进行缓存；所述数据仲裁模块分别与n个数据包收发模块、MAC模块进行网络数据包交互，并对网络数据包进行数据处理及优先级仲裁；所述MAC模块提供与网络收发器硬件接口，进而实现数据链路层功能。
2.根据权利要求1所述基于多核处理器及FPGA的共享MAC实现系统，其特征在于：所述收发数据模块包括数据包接收模块和数据包发送模块，所述数据包接收模块用于接收FPGA接口配置寄存器的网络数据包和数据仲裁模块的网络数据包，并对接收到的网络数据包进行缓存；所述数据包发送模块用于向FPGA接口配置寄存器和数据仲裁模块发送网络数据包。
3.根据权利要求2所述基于多核处理器及FPGA的共享MAC实现系统，其特征在于：所述数据包接收模块包括接收FIFO模块、重复帧过滤模块、流量统计模块、内容过滤模块和数据包解析模块；所述接收FIFO模块与FPGA接口配置寄存器进行数据交互；所述接收FIFO模块、重复帧过滤模块、流量统计模块、内容过滤模块、数据包解析模块、MAC模块依次进行数据交互，数据流由MAC模块依次经过各个模块处理后，最终流向接收FIFO模块；所述接收FIFO模块对网络数据进行缓存；所述重复帧过滤模块检测重复的网络数据包并进行过滤；所述流量统计模块检测网络数据流量且在流量异常时关闭网络数据包接收；所述内容过滤模块对网络数据包进行过滤，按内核配置过滤规则。
4.根据权利要求3所述基于多核处理器及FPGA的共享MAC实现系统，其特征在于：所述数据包发送模块包括发送FIFO模块，所述发送FIFO模块对网络数据进行缓存。
5.一种基于权利要求4所述的基于多核处理器及FPGA的共享MAC实现系统的方法，其特征在于：包括如下步骤：
步骤一、初始化所需内核寄存器，包括且不限于配置定时器中断及服务模块；根据需求配置定时器中断周期，达到实时处理网络数据包要求；
步骤二、初始化FPGA分配给该内核的寄存器，用于完成MAC操作，读写网络数据包，监视数据流量；
步骤三、使能定时器中断服务，开始处理网络数据包；
步骤四、判断接收FIFO模块是否有新的数据包，如果有，则处理数据包；否则，执行步骤五；
步骤五、判断是否有需要发送的数据包，如果有，则将数据包写入发送FIFO模块，使能发送寄存器；否则返回步骤三；
步骤六、定时器中断服务模块按照中断周期循环执行。
6.一种实现权利要求5所述基于多核处理器及FPGA的共享MAC实现方法的计算机程序。
7.一种实现权利要求5所述基于多核处理器及FPGA的共享MAC实现方法的信息数据处理终端。
8.一种计算机可读存储介质，包括指令，当其在计算机上运行时，使得计算机执行如权利要求5所述的基于多核处理器及FPGA的共享MAC实现方法。
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