CN109119027B - 像素电路及其驱动方法以及显示面板 - Google Patents
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- G09G2320/02—Improving the quality of display appearance
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Abstract
本公开提供了一种像素电路及其驱动方法和显示面板。所述像素电路包括:发光元件;驱动子电路,被构造为产生用于使发光元件发光的电流;第一和第二发光控制子电路,分别被构造为接收第一控制信号和第二控制信号,并在第一控制信号和第二控制信号的控制下,将所述电流提供至发光元件的第一端;驱动控制子电路,被构造为接收第二控制信号,并在第二控制信号的控制下,将数据电压信号提供到驱动子电路;复位子电路,被构造为接收复位信号,并在复位信号的控制下使用第二电压对驱动子电路和发光元件的第一端进行复位。
Description
技术领域
本公开涉及显示技术领域,具体地涉及一种像素电路及其驱动方法以及显示面板。
背景技术
在例如AMOLED(有源矩阵有机发光二极管,Active Matrix Organic LightEmitting Diode)显示装置的像素驱动电路中,由于实际生产中使用的制造AMOLED显示屏中的TFT(Thin Film Transistor,薄膜晶体管)的ELA(Excimer Laser Annealing,准分子激光退火)及掺杂(Doping)工艺不能保证TFT的良好均一性,从而存在驱动晶体管的阈值电压Vth偏差现象。例如对于AMOLED显示屏中基本的2T1C(两个薄膜晶体管和一个电容)像素电路,当写入相同的数据信号(Data)时,由于发光元件的电流公式中存在不同的Vth而导致各像素亮度不均一。
发明内容
本公开提出了一种像素电路及其驱动方法以及显示面板。
根据本公开的一个方面,提出了一种像素电路。所述像素电路包括:发光元件;驱动子电路,被构造为产生用于使发光元件发光的电流;第一发光控制子电路和第二发光控制子电路,所述第一发光控制子电路电连接在第一电压线与所述驱动子电路之间,被构造为接收第一控制信号,所述第二发光控制子电路电连接在所述驱动子电路与所述发光元件的第一端之间,被构造为接收第二控制信号,所述第一发光控制子电路和所述第二发光控制子电路在第一控制信号和第二控制信号的控制下,将所述用于使发光元件发光的电流提供至所述发光元件的第一端;驱动控制子电路,电连接在数据电压线与所述驱动子电路之间,被构造为接收所述第二控制信号,并在所述第二控制信号的控制下,将所述数据电压信号提供到所述驱动子电路;复位子电路,电连接在第二电压线与所述驱动子电路之间,被构造为接收复位信号,并在所述复位信号的控制下使用所述第二电压对所述驱动子电路和所述发光元件的第一端进行复位。
在一些实施例中,所述第一控制信号与所述第二控制信号不同。
在一些实施例中,所述驱动子电路包括驱动晶体管、第一晶体管和存储电容。所述驱动晶体管的栅极电连接第二节点,第一极与所述第一发光控制子电路电连接于第一节点,第二极与所述第二发光控制子电路电连接于第三节点;所述第一晶体管的栅极接收第一控制信号,第一极电连接所述第二节点,第二极电连接所述第三节点;以及所述存储电容的第一极电连接所述第一电压线,第二极电连接所述第二节点。所述第一晶体管与所述驱动晶体管是不同类型的晶体管。
在一些实施例中,所述第一发光控制子电路包括第二晶体管,所述第二发光控制子电路包括第三晶体管。所述第二晶体管的栅极接收第一控制信号,第一极电连接所述第一电压线,第二极电连接所述第一节点;所述第三晶体管的栅极接收第二控制信号,第一极电连接所述第三节点,第二极电连接所述发光元件的第一端。所述第二晶体管与所述驱动晶体管是相同类型的晶体管,所述第三晶体管与所述驱动晶体管是不同类型的晶体管。
在一些实施例中,所述驱动控制子电路包括第四晶体管。所述第四晶体管的栅极接收第二控制信号,第一极电连接所述数据信号线,第二极电连接所述第二节点。所述第四晶体管与所述驱动晶体管是相同类型的晶体管。
在一些实施例中,所述复位子电路包括第五晶体管。所述第五晶体管的栅极接收复位信号,第一极电连接所述第二电压线,第二极电连接所述第三节点。所述第五晶体管与所述驱动晶体管是相同类型的晶体管。
在一些实施例中,所述复位子电路包括第五晶体管。所述第五晶体管的栅极接收复位信号,第一极电连接所述第二电压线,第二极电连接所述第二节点。所述第五晶体管与所述驱动晶体管是相同类型的晶体管。
根据本公开的另一方面,提供了一种显示面板。所述显示面板包括:多条扫描线;多条数据线,与所述多条扫描线纵横交叉设置;以及多个像素单元,以矩阵的形式设置在每个数据线和每个扫描线交叉处,并与对应的数据线和扫描线电连接,每个像素单元包括根据上述任一实施例所述的像素电路。所述像素电路所电连接的数据电压线由所述像素单元的对应数据线充当,所述像素电路所接收的第二控制信号由所述像素单元的对应扫描线提供。
在一些实施例中,所述显示面板还包括多条发光控制线。所述多条发光控制线与所述多条扫描线或所述多条数据线平行的布置,并与所述多条扫描线或所述多条数据线分别电连接到相同的像素单元。所述像素电路所接收的第一控制信号由所述像素单元的对应发光控制线提供。
在一些实施例中,所述像素电路所接收的复位信号由所述像素单元的对应扫描线的按照扫描顺序的前一扫描线提供。
根据本公开的又一方面,提供了一种对根据上述任一实施例的像素电路进行驱动的方法。所述方法包括:在第一时段,提供具有第一电平的第一控制信号和第二控制信号,提供具有第二电平的复位信号;在第二时段,提供具有第一电平的第一控制信号和复位信号,提供具有第二电平的第二控制信号;在第三时段,提供具有第一电平的第二控制信号和复位信号,提供具有第二电平的第一控制信号。所述第一电平是与驱动晶体管的无效电平相对应的电平,所述第二电平是与驱动晶体管的有效电平相对应的电平。
本公开实施例提供了了一种像素电路及其驱动方法以及显示面板。根据本公开的像素电路,能够在实现对阈值电压Vth进行补偿的同时尽可能减少像素电路中晶体管的数量,有利于分辨率的改善。
附图说明
为了更清楚地说明本公开实施例或现有技术中的技术方案,下面将对实施例描述中所需要使用的附图作简单地介绍。显而易见地,下面描述中的附图仅仅是本公开的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图,图中:
图1示出了根据本公开实施例的像素电路的示意方框图。
图2示出了图1的像素电路的根据本公开的一个实施例的更为详细的结构。
图3A示出了图2的像素电路的信号时序图。
图3B-图3D示出了图2的像素电路的各阶段原理示意图。
图4示出了图1的像素电路的根据本公开的另一实施例的更为详细的结构。
图5A示出了图4的像素电路的信号时序图。
图5B-图5D示出了图4的像素电路的各阶段原理示意图。
图6示出了根据本公开实施例的显示面板的示意方框图。
图7示出了根据本公开实施例的像素电路的驱动方法的流程图。
具体实施方式
为使本公开实施例的目的、技术方案和优点更加清楚,下面将结合本公开实施例中的附图,对本公开实施例中的技术方案进行清楚、完整的描述。显然,所描述的实施例是本公开的一部分实施例,而不是全部。基于所描述的本公开实施例,本领域普通技术人员在无需创造性劳动的前提下获得的所有其他实施例都属于本公开保护的范围。应注意,贯穿附图,相同的元素由相同或相近的附图标记来表示。在以下描述中,一些具体实施例仅用于描述目的,而不应该理解为对本公开有任何限制,而只是本公开实施例的示例。在可能导致对本公开的理解造成混淆时,将省略常规结构或构造。应注意,图中各部件的形状和尺寸不反映真实大小和比例,而仅示意本公开实施例的内容。
除非另外定义,本公开实施例使用的技术术语或科学术语应当是本领域技术人员所理解的通常意义。本公开实施例中使用的“第一”、“第二”以及类似词语并不表示任何顺序、数量或重要性,而只是用于区分不同的组成部分。
此外,在本公开实施例的描述中,术语“电连接”可以是指两个组件直接电连接,也可以是指两个组件之间经由一个或多个其他组件电连接。此外,这两个组件可以通过有线或无线方式电连接或耦接。
本公开实施例中采用的晶体管均可以为薄膜晶体管或场效应管或其他特性相同的器件。根据在电路中的作用,本公开实施例使用的晶体管主要为开关晶体管。由于这里采用的薄膜晶体管的源极、漏极是对称的,所以其源极、漏极可以互换。在本公开实施例中,将源极和漏极中的一个称为第一极,将源极和漏极中的另一个称为第二极。在以下示例中以驱动晶体管为P型薄膜晶体管的情况进行描述,其他晶体管根据电路设计与驱动晶体管具有相同或不同的类型。类似地,在其他实施例中,驱动晶体管也可以被示为N型薄膜晶体管。本领域技术人员能够理解的是,通过将其他晶体管的类型相应地改变并将各驱动信号和电平信号进行反相(和/或进行其他附加的适应性修改),同样能够实现本公开的技术方案。
此外,在本公开实施例的描述中,术语“第一电平”和“第二电平”仅用于区别两个电平的幅度不同。在一些实施例中,“第一电平”可以是使相关晶体管截止的无效电平,“第二电平”可以是使相关晶体管导通的有效电平。下文中,由于驱动晶体管被示例为P型薄膜晶体管,因此“第一电平”被示例为高电平,“第二电平”被示例为低电平。
以下参考附图对本公开进行具体描述。
图1示出了根据本公开实施例的像素电路100的示意方框图。
如图1所示,像素电路100可以包括发光元件110、驱动子电路120、第一发光控制子电路130、第二发光控制子电路140、驱动控制子电路150和复位子电路160。
发光元件110可以是任何以电流驱动的发光元件,如OLED或AMOLED发光单元。发光元件110具有第一端和第二端,第一端连接第二发光控制子电路140,第二端连接固定电压端ELVSS。在一些实施例中,第一端为发光元件110的阳极,第二端为发光元件110的阴极。
驱动子电路120产生用于使发光元件110发光的电流。
第一发光控制子电路130电连接在第一电压线与驱动子电路120之间,并且被构造为接收第一控制信号Con1,第一发光控制子电路130在第一控制信号Con1的控制下将从所述第一电压线接收第一电压V1并将该第一电压V1传递到驱动子电路120。在一些实施例中,第一电压V1可以是电源电压ELVDD。在一些实施例中,ELVDD高于第一电平(即高电平)。
第二发光控制子电路140电连接在驱动子电路120与发光元件110的第一端之间,并且被构造为接收第二控制信号Con2,第二发光控制子电路140在第二控制信号Con2的控制下将驱动子电路120产生的用于使发光元件110发光的电流提供至发光元件110的第一端。
在一些实施例中,第二控制信号Con2与第一控制信号Con1不同。
驱动控制子电路150电连接在数据电压线与驱动子电路120之间,并且被构造为接收第二控制信号Con2,驱动控制子电路150在第二控制信号Con2的控制下将来自数据电压线的数据电压信号Data提供到驱动子电路120。
在一些实施例中,驱动控制子电路150与第一发光控制子电路130通过相同的节点N1(第一节点)与驱动子电路120电连接。
复位子电路160电连接在第二电压线与驱动子电路120之间,并且被构造为接收复位信号Reset,复位电路160在复位信号Reset的控制下使用来自第二电压线的第二电压V2对驱动子电路120和发光元件110的第一端进行复位。在一些实施例中,第二电压V2可以具有第一电平。
图2示出了图1的像素电路100的根据本公开的一个实施例的更为详细的结构。
如图2所示,驱动子电路120包括驱动晶体管Md、第一晶体管M1和存储电容Cst。
驱动晶体管Md的栅极电连接第二节点N2,第一极与第一发光控制子电路130电连接于第一节点N1,第二极与第二发光控制子电路140电连接于第三节点N3。
第一晶体管M1的栅极接收第一控制信号Con1,第一极电连接第二节点N2,第二极电连接第三节点N3。
存储电容Cst的第一极电连接第一电压线以接收第一电压V1,第二极电连接第二节点N2。
第一晶体管M1与驱动晶体管Md是不同类型的晶体管。具体地,在本示例性实施例中,以驱动晶体管Md为P型晶体管进行描述,因此,第一晶体管M1示例性地为N型晶体管。
第一发光控制子电路130包括第二晶体管M2,并且第二发光控制子电路140包括第三晶体管M3。
具体地,第二晶体管M2的栅极接收第一控制信号Con1,第一极电连接第一电压线以接收第一电压V1,第二极电连接第一节点N1。
第三晶体管M3的栅极接收第二控制信号Con2,第一极电连接第三节点N3,第二极电连接所述发光元件110的第一端,
第二晶体管M2与驱动晶体管Md是相同类型的晶体管,第三晶体管M3与驱动晶体管Md是不同类型的晶体管。在本示例性实施例中,第二晶体管M2是P型晶体管,第三晶体管M3是N型晶体管。
驱动控制子电路150包括第四晶体管M4。
第四晶体管M4的栅极接收第二控制信号Con2,第一极电连接数据信号线以接收数据电压信号Data,第二极电连接第二节点N2。
第四晶体管M4与驱动晶体管Md是相同类型的晶体管。在本示例性实施例中,第四晶体管M4是P型晶体管。
复位子电路160包括第五晶体管M5。
第五晶体管M5的栅极接收复位信号Reset,第一极电连接第二电压线以接收第二电压V2,第二极电连接第三节点N3。
第五晶体管M5与驱动晶体管Md是相同类型的晶体管。在本示例性实施例中,第五晶体管M5是P型晶体管。
图3A示出了图2的像素电路100的信号时序图。
具体地,参见图3A,在第一阶段T1期间,提供具有第一电平(即高电平)的第一控制信号Con1和第二控制信号Con2,并且提供具有第二电平(即低电平)的复位信号Reset。
由此,在第一阶段T1期间,在第一控制信号Con1的控制下,第一晶体管M1导通,第二晶体管M2截止;在第二控制信号Con2的控制下,第三晶体管M3导通,第四晶体管M4截止;在复位信号Reset的控制下,第五晶体管M5导通。此时像素电路100的原理示意图如图3B所示,应该指出的是,图3B中将本阶段截止的晶体管通过斜十字“×”标记。
在第一晶体管M1、第三晶体管M3和第五晶体管M5导通的情况下,低电平的V2传输到第二节点N2和第三节点N3,从而驱动晶体管Md的栅极变为低电平,这将使得驱动晶体管Md导通。发光元件110的阳极也变为低电平。从而,驱动晶体管Md和发光元件110的阳极均被低电平V2复位。因此,第一阶段T1也被称为“复位阶段”。
在第二阶段T2期间,提供具有第一电平(即高电平)的第一控制信号Con1和复位信号Reset,并且提供具有第二电平(即低电平)的第二控制信号Con2。
由此,在第二阶段T2期间,在第一控制信号Con1的控制下,第一晶体管M1导通,第二晶体管M2截止;在第二控制信号Con2的控制下,第三晶体管M3截止,第四晶体管M4导通;在复位信号Reset的控制下,第五晶体管M5截止。此时像素电路100的原理示意图如图3C所示,应该指出的是,图3C中将本阶段截止的晶体管通过斜十字“×”标记。
在第四晶体管M4导通的情况下,高电平的数据电压信号Data第一节点N1。由于在上一阶段中驱动晶体管Md处于导通状态,此时驱动晶体管Md仍处于导通状态,从而高电平的数据电压信号Data继续传输到第三节点N3。在第一晶体管M1导通的情况下,高电平的数据电压信号Data(电压Vdata)继续传输到第二节点N2对处于低电平的第二节点N2进行充电。随着第二节点N2的电压不断上升,驱动晶体管Md的栅源电压Vgs从V2-Vdata逐渐增加,直到Vgs=-Vth为止,其中Vth为驱动晶体管Md的阈值电压。此时,驱动晶体管Md不再导通,同时停止对第二节点N2进行充电。此时,第二节点N2处(即Md的栅极)的电压为Vg=Vgs+Vs=Vdata-Vth。数据电压Vdata已经写入第二节点N2。因此,此第二阶段T2也可以称为“数据电压写入阶段”。在一些实施例中,Vdata可以具有第一电平(即高电平)。
在第三阶段T3期间,提供具有第一电平(即高电平)的第二控制信号Con2和复位信号Reset,并且提供具有第二电平(即低电平)的第一控制信号Con1。
由此,在第三阶段T3期间,在第一控制信号Con1的控制下,第一晶体管M1截止,第二晶体管M2导通;在第二控制信号Con2的控制下,第三晶体管M3导通,第四晶体管M4截止;在复位信号Reset的控制下,第五晶体管M5截止。此时像素电路100的原理示意图如图3D所示,应该指出的是,图3D中将本阶段截止的晶体管通过斜十字“×”标记。
在第二晶体管M2导通的情况下,第一电压V1(即ELVDD)传输到第一节点N1,即驱动晶体管Md的源极电压Vs=ELVDD。此时,由于第一晶体管M1和第五晶体管M5都截止,第二节点N2的电压保持为Vdata-Vth,即驱动晶体管Md的栅极电压Vg=Vdata-Vth,从而,Vgs=Vdata-Vth-ELVDD,其小于-Vth,使得驱动晶体管Md导通。在第三晶体管M3导通的情况下,驱动晶体管Md产生的驱动电流Id施加到发光单元110的阳极,并驱动发光单元发光。因此,第三阶段T3也被称为“发光阶段”。
具体地,驱动电流Id的表达式为:
Id=K·(Vsg-Vth)2
=K·(Vth+ELVDD-Vdata-Vth)2
=K·(ELVDD-Vdata)2
其中,K为关联于驱动晶体管Md的电流常数,与驱动晶体管Md的工艺参数和几何尺寸有关。由以上公式可知,用于驱动发光元件110进行发光的驱动电流Id与驱动晶体管Md的阈值电压Vth无关,从而可以消除由于驱动晶体管Md的阈值电压Vth存在差异而导致的发光元件亮度不均的现象。
图4示出了图1的像素电路100的根据本公开的另一实施例的更为详细的结构。图4所示的像素电路的结构与图2所示的像素电路的结构的区别在于复位子电路160的位置不同。
具体地,在图4中,复位子电路160包括第五晶体管M5。第五晶体管M5的栅极接收复位信号Reset,第一极电连接第二电压线以接收第二电压V2,第二极电连接第二节点N2(而不是图2中的第三节点N3)。
此外,第五晶体管M5与驱动晶体管Md是相同类型的晶体管。在本示例性实施例中,第五晶体管M5是P型晶体管。
关于图4中的像素电路的其他结构,可参考上文中结合图2进行的描述,在此不再赘述。
图5A示出了图4的像素电路100的信号时序图。
具体地,参见图5A,在第一阶段T1期间,提供具有第一电平(即高电平)的第一控制信号Con1和第二控制信号Con2,并且提供具有第二电平(即低电平)的复位信号Reset。
由此,在第一阶段T1期间,在第一控制信号Con1的控制下,第一晶体管M1导通,第二晶体管M2截止;在第二控制信号Con2的控制下,第三晶体管M3导通,第四晶体管M4截止;在复位信号Reset的控制下,第五晶体管M5导通。此时像素电路100的原理示意图如图5B所示,应该指出的是,图5B中将本阶段截止的晶体管通过斜十字“×”标记。
在第一晶体管M1、第三晶体管M3和第五晶体管M5导通的情况下,低电平的V2传输到第二节点N2和第三节点N3,从而驱动晶体管Md的栅极变为低电平,这将使得驱动晶体管Md导通。发光元件110的阳极也变为低电平。从而,驱动晶体管Md和发光元件110的阳极均被低电平V2复位。
在第二阶段T2期间,提供具有第一电平(即高电平)的第一控制信号Con1和复位信号Reset,并且提供具有第二电平(即低电平)的第二控制信号Con2。
由此,在第二阶段T2期间,在第一控制信号Con1的控制下,第一晶体管M1导通,第二晶体管M2截止;在第二控制信号Con2的控制下,第三晶体管M3截止,第四晶体管M4导通;在复位信号Reset的控制下,第五晶体管M5截止。此时像素电路100的原理示意图如图5C所示,应该指出的是,图5C中将本阶段截止的晶体管通过斜十字“×”标记。
在第四晶体管M4导通的情况下,高电平的数据电压信号Data第一节点N1。由于在上一阶段中驱动晶体管Md处于导通状态,此时驱动晶体管Md仍处于导通状态,从而高电平的数据电压信号Data继续传输到第三节点N3。在第一晶体管M1导通的情况下,高电平的数据电压信号Data(电压Vdata)继续传输到第二节点N2对处于低电平的第二节点N2进行充电。随着第二节点N2的电压不断上升,驱动晶体管Md的栅源电压Vgs从V2-Vdata逐渐增加,直到Vgs=-Vth为止,其中Vth为驱动晶体管Md的阈值电压。此时,驱动晶体管Md不再导通,同时停止对第二节点N2进行充电。此时,第二节点N2处(即Md的栅极)的电压为Vg=Vgs+Vs=Vdata-Vth。数据电压Vdata已经写入第二节点N2。因此,此第二阶段T2也可以称为“数据电压写入阶段”。在一些实施例中,Vdata可以具有第一电平(即高电平)。
在第三阶段T3期间,提供具有第一电平(即高电平)的第二控制信号Con2和复位信号Reset,并且提供具有第二电平(即低电平)的第一控制信号Con1。
由此,在第三阶段T3期间,在第一控制信号Con1的控制下,第一晶体管M1截止,第二晶体管M2导通;在第二控制信号Con2的控制下,第三晶体管M3导通,第四晶体管M4截止;在复位信号Reset的控制下,第五晶体管M5截止。此时像素电路100的原理示意图如图5D所示,应该指出的是,图5D中将本阶段截止的晶体管通过斜十字“×”标记。
在第二晶体管M2导通的情况下,第一电压V1(即ELVDD)传输到第一节点N1,即驱动晶体管Md的源极电压Vs=ELVDD。此时,由于第一晶体管M1和第五晶体管M5都截止,第二节点N2的电压保持为Vdata-Vth,即驱动晶体管Md的栅极电压Vg=Vdata-Vth,从而,Vgs=Vdata-Vth-ELVDD,其小于-Vth,使得驱动晶体管Md导通。在第三晶体管M3导通的情况下,驱动晶体管Md产生的驱动电流Id施加到发光单元110的阳极,并驱动发光单元发光。具体地,驱动电流Id的表达式为:
Id=K·(Vsg-Vth)2
=K·(Vth+ELVDD-Vdata-Vth)2
=K·(ELVDD-Vdata)2
其中,K为关联于驱动晶体管Md的电流常数,与驱动晶体管Md的工艺参数和几何尺寸有关。由以上公式可知,用于驱动发光元件110进行发光的驱动电流Id与驱动晶体管Md的阈值电压Vth无关,从而可以消除由于驱动晶体管Md的阈值电压Vth存在差异而导致的发光元件亮度不均的现象。
图6示出了根据本公开实施例的显示面板600的示意方框图。如图6所示,显示面板600可以包括多条扫描线SL;多条数据线DL,与所述多条扫描信号线SL纵横交叉设置;以及多个像素单元610,以矩阵的形式设置在每个扫描信号线和每个数据信号线的交叉处,并且与对应的数据线DL和扫描线SL电连接。所述多个像素单元610中的每一个中设置有根据本公开实施例的像素电路,例如根据图1、图2或图4所示的像素电路100。
具体地,像素电路100所电连接的数据电压线由像素单元610的对应数据线DL充当,像素电路100所接收的第二控制信号Con2由像素单元610的对应扫描线SL提供。
在一些实施例中,所述显示面板600还可包括多条发光控制线EL,所述多条发光控制线EL与所述多条扫描线SL或所述多条数据线DL平行的布置,并与所述多条扫描线SL或所述多条数据线DL分别电连接到相同的像素单元610,
具体地,像素电路100所接收的第一控制信号Con1由像素单元610的对应发光控制线EL提供。
在一些实施例中,像素电路100所接收的复位信号Reset由像素单元610的对应扫描线SL的按照扫描顺序的前一扫描线SL提供。
图7示出了根据本公开实施例的像素电路的驱动方法700的流程图。所述驱动方法700可以用于驱动根据图1、图2或图4所示的像素电路100。
如图7所示,在步骤S710中,在第一时段,提供具有第一电平的第一控制信号和第二控制信号,提供具有第二电平的复位信号。
在步骤S720中,在第二时段,提供具有第一电平的第一控制信号和复位信号,提供具有第二电平的第二控制信号。
在步骤S730中,在第三时段,提供具有第一电平的第二控制信号和复位信号,提供具有第二电平的第一控制信号。
其中,第一电平是与驱动晶体管的无效电平相对应的电平,第二电平是与驱动晶体管的有效电平相对应的电平。
上文中结合图2和图4对所述方法700在不同实施例中的驱动过程进行了描述,在此不再赘述。
以上的详细描述通过使用示意图、流程图和/或示例,已经阐述了众多实施例。在这种示意图、流程图和/或示例包含一个或多个功能和/或操作的情况下,本领域技术人员应理解,这种示意图、流程图或示例中的每一功能和/或操作可以通过各种结构、硬件、软件、固件或实质上它们的任意组合来单独和/或共同实现。
虽然已参照几个典型实施例描述了本公开,但应当理解,所用的术语是说明和示例性、而非限制性的术语。由于本公开能够以多种形式具体实施而不脱离公开的精神或实质,所以应当理解,上述实施例不限于任何前述的细节,而应在随附权利要求所限定的精神和范围内广泛地解释,因此落入权利要求或其等效范围内的全部变化和改型都应为随附权利要求所涵盖。
Claims (11)
1.一种像素电路,包括:
发光元件;
驱动子电路,被构造为基于数据电压信号和第一电压产生用于使发光元件发光的电流;
第一发光控制子电路,所述第一发光控制子电路电连接在第一电压线与所述驱动子电路之间,被构造为接收第一控制信号,并在第一控制信号的控制下,将第一电压线的第一电压提供至所述驱动子电路;
第二发光控制子电路,所述第二发光控制子电路电连接在所述驱动子电路与所述发光元件的第一端之间,被构造为接收第二控制信号,并在第二控制信号的控制下,将所述用于使发光元件发光的电流提供至所述发光元件的第一端;
驱动控制子电路,电连接在数据信号线与所述驱动子电路之间,被构造为接收所述第二控制信号,并在所述第二控制信号的控制下,将所述数据信号线的数据电压信号提供到所述驱动子电路;
复位子电路,电连接在第二电压线与所述驱动子电路之间,被构造为接收复位信号,并在所述复位信号的控制下使用所述第二电压线的第二电压对所述驱动子电路和所述发光元件的第一端进行复位。
2.根据权利要求1所述的像素电路,其中,所述第一控制信号与所述第二控制信号不同。
3.根据权利要求1所述的像素电路,其中,所述驱动子电路包括驱动晶体管、第一晶体管和存储电容,其中,
所述驱动晶体管的栅极电连接第二节点,第一极与所述第一发光控制子电路电连接于第一节点,第二极与所述第二发光控制子电路电连接于第三节点;
所述第一晶体管的栅极接收第一控制信号,第一极电连接所述第二节点,第二极电连接所述第三节点;以及
所述存储电容的第一极电连接所述第一电压线,第二极电连接所述第二节点,
其中,所述第一晶体管与所述驱动晶体管是不同类型的晶体管。
4.根据权利要求3所述的像素电路,其中,所述第一发光控制子电路包括第二晶体管,所述第二发光控制子电路包括第三晶体管,其中
所述第二晶体管的栅极接收第一控制信号,第一极电连接所述第一电压线,第二极电连接所述第一节点;
所述第三晶体管的栅极接收第二控制信号,第一极电连接所述第三节点,第二极电连接所述发光元件的第一端,
其中,所述第二晶体管与所述驱动晶体管是相同类型的晶体管,所述第三晶体管与所述驱动晶体管是不同类型的晶体管。
5.根据权利要求3或4所述的像素电路,其中,所述驱动控制子电路包括第四晶体管,其中
所述第四晶体管的栅极接收第二控制信号,第一极电连接所述数据信号线,第二极电连接所述第二节点,
其中,所述第四晶体管与所述驱动晶体管是相同类型的晶体管。
6.根据权利要求3或4所述的像素电路,其中,所述复位子电路包括第五晶体管,其中
所述第五晶体管的栅极接收复位信号,第一极电连接所述第二电压线,第二极电连接所述第三节点,
其中,所述第五晶体管与所述驱动晶体管是相同类型的晶体管。
7.根据权利要求3或4所述的像素电路,其中,所述复位子电路包括第五晶体管,其中
所述第五晶体管的栅极接收复位信号,第一极电连接所述第二电压线,第二极电连接所述第二节点,
其中,所述第五晶体管与所述驱动晶体管是相同类型的晶体管。
8.一种显示面板,包括:
多条扫描线;
多条数据线,与所述多条扫描线纵横交叉设置;以及
多个像素单元,以矩阵的形式设置在每个数据线和每个扫描线交叉处,并与对应的数据线和扫描线电连接,每个像素单元包括根据权利要求1-6中任一项所述的像素电路,
其中,所述像素电路所电连接的数据信号线由所述像素单元的对应数据线充当,所述像素电路所接收的第二控制信号由所述像素单元的对应扫描线提供。
9.根据权利要求8所述的显示面板,还包括多条发光控制线,所述多条发光控制线与所述多条扫描线或所述多条数据线平行的布置,并与所述多条扫描线或所述多条数据线分别电连接到相同的像素单元,
其中,所述像素电路所接收的第一控制信号由所述像素单元的对应发光控制线提供。
10.根据权利要求8所述的显示面板,其中,所述像素电路所接收的复位信号由所述像素单元的对应扫描线的按照扫描顺序的前一扫描线提供。
11.一种对根据权利要求1-7中的任一项所述的像素电路进行驱动的方法,包括:
在第一时段,提供具有第一电平的第一控制信号和第二控制信号,提供具有第二电平的复位信号;
在第二时段,提供具有第一电平的第一控制信号和复位信号,提供具有第二电平的第二控制信号;
在第三时段,提供具有第一电平的第二控制信号和复位信号,提供具有第二电平的第一控制信号,
其中,所述第一电平是与驱动晶体管的无效电平相对应的电平,所述第二电平是与驱动晶体管的有效电平相对应的电平。
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
PB01 | Publication | ||
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SE01 | Entry into force of request for substantive examination | ||
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GR01 | Patent grant | ||
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