CN109036287A - 一种像素驱动电路、驱动方法及显示面板 - Google Patents

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Abstract

本发明提供一种像素驱动电路、驱动方法及显示面板，包括复位模块、补偿模块和发光模块；复位模块用于接收第一驱动信号，并在第一驱动信号的控制下将数据信号传输至补偿模块以复位补偿模块；补偿模块用于接收第二驱动信号，并在第二驱动信号的控制下写入数据信号并进行阈值电压补偿；发光模块用于接收第三驱动信号，并在第三驱动信号的控制下发光。通过上述方式，能够实现对阈值电压进行补偿的同时，减少显示面板上的金属走线，从而改善显示面板的显示特性。

Description

一种像素驱动电路、驱动方法及显示面板
技术领域
本发明涉及显示技术领域，尤其涉及一种像素驱动电路、驱动方法及显示面板。
背景技术
有机发光二极管(OLED)色域广、对比度高、节能、并具有可折叠性，因而在新世代显示器中具有强有力的竞争力。其中，有源矩阵有机发光二极管(AMOLED)技术是柔性显示重点发展方向之一。
AMOLED的基本驱动电路如图1所示，其为2T1C模式，即包括两个薄膜晶体管和一个存储电容，具体地，包括一个开关薄膜晶体管A1、一个驱动薄膜晶体管A2和一个存储电容C1。发光元件OLED的驱动电流由驱动薄膜晶体管A2控制，其电流大小为：IOLED＝k(Vgs-Vth)2；其中，k为驱动薄膜晶体管A2的电流放大系数，由驱动薄膜晶体管A2本身特性决定，Vth为驱动薄膜晶体管A2的阈值电压。由于长时间的操作，驱动薄膜晶体管A2的阈值电压Vth会发生漂移，从而导致发光元件OLED的驱动电流变化，使得OLED面板出现不良，影响画质。
另外，各公司提出了很多种补偿阈值电压漂移的像素驱动电路，然而，其会大大增加显示面板上金属走线的复杂程度，同时增加工艺难度。
发明内容
本发明提供一种像素驱动电路、驱动方法及显示面板，能够实现对阈值电压进行补偿的同时，减少显示面板上的金属走线，从而改善显示面板的显示特性。
本发明提供一种像素驱动电路，包括：复位模块、补偿模块和发光模块；
所述复位模块用于接收第一驱动信号，并在所述第一驱动信号的控制下将数据信号传输至所述补偿模块以复位所述补偿模块；
所述补偿模块用于接收第二驱动信号，并在所述第二驱动信号的控制下写入数据信号并进行阈值电压补偿；
所述发光模块用于接收第三驱动信号，并在所述第三驱动信号的控制下发光。
在本发明的像素驱动电路中，所述复位模块包括第四薄膜晶体管和第一存储电容；
所述第四薄膜晶体管的栅极接收所述第一驱动信号，源极与所述数据信号连接，漏极分别与所述补偿模块、所述第一存储电容的一端连接；所述第一存储电容的另一端与所述第二驱动信号连接。
在本发明的像素驱动电路中，所述补偿模块包括第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管和第二存储电容；
所述第一薄膜晶体管的栅极分别与所述第二存储电容的一端、所述第三薄膜晶体管的漏极、所述复位模块连接，所述第一薄膜晶体管的漏极分别与所述发光模块、所述第三薄膜晶体管的源极连接，所述第一薄膜晶体管的源极分别与所述发光模块、所述第二薄膜晶体管的漏极连接；
所述第二薄膜晶体管的栅极分别与所述第三薄膜晶体管的栅极、所述第二驱动信号、所述复位模块连接；
所述第二存储电容的另一端与所述发光模块连接。
在本发明的像素驱动电路中，所述发光模块包括包括第五薄膜晶体管、第六薄膜晶体管和发光元件；
所述第五薄膜晶体管的栅极分别与所述第三驱动信号、所述第六薄膜晶体管的栅极连接，所述第五薄膜晶体管的源极与第一电压连接，所述第五薄膜晶体管的漏极与所述补偿模块连接；
所述第六薄膜晶体管的源极与所述补偿模块连接，所述第六薄膜晶体管的漏极与所述发光元件的阳极连接；
所述发光元件的阴极与第二电压连接。
在本发明的像素驱动电路中，所述第一存储电容的电容值介于50fF至80fF之间；所述第二存储电容的电容值介于50fF至150fF之间；所述第二驱动信号的高电位介于6V至9V之间，所述第二驱动信号的低电位介于-5V至-6V之间。
在本发明的像素驱动电路中，所述第一电压的电压值介于3V至5V之间，所述第二电压的电压值介于-2V至-4V之间。
在本发明的像素驱动电路中，所述像素驱动电路的驱动时序包括：复位阶段、第一次电容耦合时刻、补偿阶段、第二次电容耦合时刻和发光阶段；
在所述复位阶段，所述第一驱动信号为低电平，所述第二驱动信号和所述第三驱动信号均为高电平，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值；
在所述第一次电容耦合时刻，所述第二驱动信号由高电平变为低电平，通过所述第一存储电容的耦合作用，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述耦合信号的电压值之间的差值；
在所述补偿阶段，所述第二驱动信号为低电平，所述第一驱动信号和所述第三驱动信号为高电平，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述第一薄膜晶体管的阈值电压之间的差值；
在所述第二次电容耦合时刻，所述第二驱动信号由低电平变为高电平，通过所述第一存储电容的耦合作用，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述第一薄膜晶体管的阈值电压之间的差值与所述耦合信号的电压值之和；
在所述发光阶段，所述第三驱动信号为低电平，所述第一驱动信号和所述第二驱动信号为高电平，所述像素驱动电路产生驱动电流并提供至所述发光元件，用于驱动所述发光元件的发光显示。
在本发明的像素驱动电路中，所述第一薄膜晶体管、所述第二薄膜晶体管、所述第三薄膜晶体管、所述第四薄膜晶体管、所述第五薄膜晶体管和所述第六薄膜晶体管均为P型薄膜晶体管。
在本发明的像素驱动电路中，所述第一驱动信号、所述第二驱动信号和所述第三驱动信号均由外部时序控制器提供。
本发明还提供一种像素驱动电路，包括：第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管、第四薄膜晶体管、第五薄膜晶体管、第六薄膜晶体管、第一存储电容、第二存储电容以及发光元件；
所述第一薄膜晶体管的栅极分别与所述第二存储电容的一端、所述第一存储电容的一端、所述第三薄膜晶体管的漏极、所述第四薄膜晶体管的漏极连接；所述第一薄膜晶体管的源极分别与所述第二薄膜晶体管的漏极、第五薄膜晶体管的漏极连接；所述第一薄膜晶体管的漏极分别与所述第三薄膜晶体管的源极、所述第六薄膜晶体管的源极连接；
所述第二薄膜晶体管的栅极分别与所述第三薄膜晶体管的栅极、所述第一存储电容的另一端、第二驱动信号连接；所述第二薄膜晶体管的源极与数据信号连接；
所述第四薄膜晶体管的栅极与第一驱动信号连接；所述第四薄膜晶体管的源极与所述数据信号连接；
所述第五薄膜晶体管的栅极分别与所述第六薄膜晶体管的栅极、第三驱动信号连接；所述第五薄膜晶体管的源极分别与所述第二存储电容的另一端、第一电压连接；
所述第六薄膜晶体管的漏极与所述发光元件的阳极连接；所述发光元件的阴极与第二电压连接。
本发明还提供一种像素驱动方法，用于以上所述的像素驱动电路，所述像素驱动方法包括：
复位阶段，第一驱动信号为低电平，第二驱动信号和第三驱动信号均为高电平，第一薄膜晶体管的栅极的电压值为数据信号的电压值；
在第一次电容耦合时刻，所述第二驱动信号由高电平变为低电平，通过第一存储电容的耦合作用，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与耦合信号的电压值之间的差值；
在补偿阶段，所述第二驱动信号为低电平，所述第一驱动信号和所述第三驱动信号为高电平，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述第一薄膜晶体管的阈值电压之间的差值；
在第二次电容耦合时刻，所述第二驱动信号由低电平变为高电平，通过所述第一存储电容的耦合作用，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述第一薄膜晶体管的阈值电压之间的差值与所述耦合信号的电压值之和；
在发光阶段，所述第三驱动信号为低电平，所述第一驱动信号和所述第二驱动信号为高电平，所述像素驱动电路产生驱动电流并提供至发光元件，用于驱动所述发光元件的发光显示。
本发明还提供一种显示面板，其包括如上所述的像素驱动电路。
本发明的有益效果为：本发明提供的像素驱动电路，包括复位模块、补偿模块和发光模块；复位模块用于接收第一驱动信号，并在第一驱动信号的控制下将数据信号传输至补偿模块以复位补偿模块；补偿模块用于接收第二驱动信号，并在第二驱动信号的控制下写入数据信号并进行阈值电压补偿；发光模块用于接收第三驱动信号，并在第三驱动信号的控制下发光。通过上述方式，能够实现对阈值电压进行补偿的同时，减少显示面板上的金属走线，从而改善显示面板的显示特性。
附图说明
为了更清楚地说明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单介绍，显而易见地，下面描述中的附图仅仅是发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为现有的像素驱动电路的电路原理图；
图2为本发明提供的像素驱动电路的结构示意图；
图3是图2所示像素驱动电路的电路原理图；
图4为图3所示像素驱动电路的驱动信号的时序图；
图5为本发明提供的像素驱动方法的流程示意图；
图6为本发明实施例的显示面板的示意图。
具体实施方式
以上对本发明实施例提供的液晶显示组件进行了详细介绍，本文中应用了具体个例对本发明的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本发明。同时，对于本领域的技术人员，依据本发明的思想，在具体实施方式及应用范围上均会有改变之处，综上所述，本说明书内容不应理解为对本发明的限制。以下各实施例的说明是参考附加的图示，用以例示本发明可用以实施的特定实施例。本发明所提到的方向用语，例如[上]、[下]、[前]、[后]、[左]、[右]、[内]、[外]、[侧面]等，仅是参考附加图式的方向。因此，使用的方向用语是用以说明及理解本发明，而非用以限制本发明。在图中，结构相似的单元是用以相同标号表示。
参阅图2，图2为本发明提供的像素驱动电路的结构示意图。如图2所示，该像素驱动电路10，包括：复位模块11、补偿模块12和发光模块13。其中，补偿模块12分别与复位模块11和发光模块13连接。
复位模块11用于接收第一驱动信号S1，并在第一驱动信号S1S1的控制下将数据信号Data输至补偿模块12以复位补偿模块12；
补偿模块12用于接收第二驱动信号S2，并在第二驱动信号S2的控制下写入数据信号Data并进行阈值电压补偿；
发光模块13用于接收第三驱动信号S3，并在第三驱动信号S3的控制下发光。
请一并参阅图3，图3是图2所示像素驱动电路的电路原理图。如图3所示，复位模块11包括第四薄膜晶体管T4和第一存储电容C1；补偿模块12包括第一薄膜晶体管T1、第二薄膜晶体管T2、第三薄膜晶体管T3和第二存储电容C2；发光模块13包括包括第五薄膜晶体管T5、第六薄膜晶体管T6和发光元件OLED。
具体的，在复位模块11中，第四薄膜晶体管T4的栅极接收第一驱动信号S1，源极与数据信号Data连接，漏极分别与补偿模块12、第一存储电容C1的一端连接；第一存储电容C1的另一端与第二驱动信号S2连接。
在补偿模块12中，第一薄膜晶体管T1的栅极分别与第二存储电容C2的一端、第三薄膜晶体管T3的漏极、复位模块11连接，第一薄膜晶体管T1的漏极分别与发光模块13、第三薄膜晶体管T3的源极连接，第一薄膜晶体管T1的源极分别与发光模块13、第二薄膜晶体管T2的漏极连接；第二薄膜晶体管T2的栅极分别与第三薄膜晶体管T3的栅极、第二驱动信号S2、复位模块11连接；第二存储电容的另一端与发光模块13连接。
在发光模块13中，第五薄膜晶体管T5的栅极分别与第三驱动信号S3、第六薄膜晶体管T6的栅极连接，第五薄膜晶体管T5的源极与第一电压Vdd连接，第五薄膜晶体管T5的漏极与补偿模块12连接；第六薄膜晶体管T6的源极与补偿模块12连接，第六薄膜晶体管T6的漏极与发光元件OLED的阳极连接；发光元件OLED的阴极与第二电压V连接。
在本发明实施例中，为了保证耦合信号的电压值大于第一薄膜晶体管T1的阈值电压，第一存储电容C1的电容值介于50fF至80fF之间；第二存储电容C2的电容值介于50fF至150fF之间；第二驱动信号S2的高电位介于6V至9V之间，第二驱动信号S2的低电位介于-5V至-6V之间。
进一步的，第一电压Vdd的电压值介于3V至5V之间，第二电压VSS的电压值介于-2V至-4V之间。
在本发明实施例中，第一薄膜晶体管T1、第二薄膜晶体管T2、第三薄膜晶体管T3、第四薄膜晶体管T4、第五薄膜晶体管T5和第六薄膜晶体管T6均为P型薄膜晶体管。当然，在实际电路设计中，本发明所用薄膜晶体管还可以采用N型薄膜晶体管或者N型薄膜晶体管与P型薄膜晶体管的混合方式，并且所用薄膜晶体管在作为开关晶体管时，源极和漏极的功能可以互换，在此不做具体的区分。
请一并参阅图4，图4为图3所示像素驱动电路的驱动信号的时序图。在本实施例中，第一驱动信号S1S1、第二驱动信号S2S2和第三驱动信号S3S3均由外部时序控制器提供。如图4所示，该像素驱动电路10的驱动时序包括：复位阶段t1、第一次电容耦合时刻a、补偿阶段t2、第二次电容耦合时刻b和发光阶段t3
请继续参阅图5，图5为本发明提供的像素驱动方法的流程示意图。如图5所示，该像素驱动方法包括：
101，复位阶段，第一驱动信号为低电平，第二驱动信号和第三驱动信号均为高电平，第一薄膜晶体管的栅极的电压值为数据信号的电压值；
102，第一次电容耦合时刻，所述第二驱动信号由高电平变为低电平，通过第一存储电容的耦合作用，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与耦合信号的电压值之间的差值；
103，补偿阶段，所述第二驱动信号为低电平，所述第一驱动信号和所述第三驱动信号为高电平，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述第一薄膜晶体管的阈值电压之间的差值；
104，第二次电容耦合时刻，所述第二驱动信号由低电平变为高电平，通过所述第一存储电容的耦合作用，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述第一薄膜晶体管的阈值电压之间的差值与所述耦合信号的电压值之和；
105，发光阶段，所述第三驱动信号为低电平，所述第一驱动信号和所述第二驱动信号为高电平，所述像素驱动电路产生驱动电流并提供至发光元件，用于驱动所述发光元件的发光显示。
在复位阶段t1，第一驱动信号S1为低电平，第二驱动信号S2和第三驱动信号S3均为高电平，第一薄膜晶体管T1的栅极的电压值为数据信号Data的电压值；在第一次电容耦合时刻a，第二驱动信号S2由高电平变为低电平，通过第一存储电容C1的耦合作用，第一薄膜晶体管T1的栅极的电压值为数据信号Data的电压值与耦合信号的电压值之间的差值；在补偿阶段t2，第二驱动信号S2为低电平，第一驱动信号S1和第三驱动信号S3为高电平，第一薄膜晶体管T1的栅极的电压值为数据信号Data的电压值与第一薄膜晶体管T1的阈值电压之间的差值；在第二次电容耦合时刻b，第二驱动信号S2由低电平变为高电平，通过第一存储电容C1的耦合作用，第一薄膜晶体管T1的栅极的电压值为数据信号Data的电压值与第一薄膜晶体管T1的阈值电压之间的差值与耦合信号的电压值之和；在发光阶段t3，第三驱动信号S3为低电平，第一驱动信号S1和第二驱动信号S2为高电平，像素驱动电路产生驱动电流并提供至发光元件，用于驱动发光元件的发光显示。
具体的，在复位阶段t1，第一驱动信号S1为低电平，第二驱动信号S2和第三驱动信号S3均为高电平，此时，第四薄膜晶体管T4导通，从第四薄膜晶体管T4的源极接收的数据信号Data经第四薄膜晶体管T4的漏极输出，第一薄膜晶体管T1的栅极与第四薄膜晶体管T4的漏极连接，因此，第一薄膜晶体管T1的栅极被复位到数据信号Data的电压值。
在第一次电容耦合时刻a，第二驱动信号S2由高电平变为低电平，通过第一存储电容C1的耦合作用，第一薄膜晶体管T1的栅极的电压值为数据信号Data的电压值与耦合信号的电压值之间的差值。需要说明的是，耦合信号的电压值由第一存储电容C1、第二存储电容C2以及第二驱动信号S2的高、低电平变化幅度决定，在所有周期内保持不变。
在补偿阶段t2，第二驱动信号S2为低电平，第一驱动信号S1和第三驱动信号S3为高电平，此时，第三薄膜晶体管T3导通，使得第一薄膜晶体管T1的栅极和漏极短接形成了diode connect(二极管)结构。第二薄膜晶体管T2导通，从第二薄膜晶体管T2的源极接收的数据信号Data经第二薄膜晶体管T2的漏极写入第一薄膜晶体管T1的源极，经过第一薄膜晶体管T1的diode connect结构，将第一薄膜晶体管T1的栅极充电至接近Vdata-|Vth|，其中，Vth为第一薄膜晶体管T1的阈值电压，Vdata为数据信号Data的电压。
在第二次电容耦合时刻b，第二驱动信号S2由低电平变为高电平，通过第一存储电容C1的耦合作用，第一薄膜晶体管T1的栅极的电压值为数据信号Data的电压值与第一薄膜晶体管T1的阈值电压之间的差值与耦合信号的电压值之和。同样，耦合信号的电压值由第一存储电容C1、第二存储电容C2以及第二驱动信号S2的高、低电平变化幅度决定，在所有周期内保持不变。
在发光阶段t3，第三驱动信号S3为低电平，第一驱动信号S1和第二驱动信号S2为高电平，第五薄膜晶体管T5、第六薄膜晶体管T6导通时，发光元件OLED流经的驱动电流满足如下公式：
其中，IOLED为驱动电流，Vdd为第一电压，Vdata为数据信号Data的电压，K为第一薄膜晶体管T1的电流放大系数，Vcouple为耦合信号的电压，Vth为第一薄膜晶体管T1的阈值电压。
从上述公式可以看出，驱动电流IOLED基本上与第一薄膜晶体管T1的阈值电压Vth无关，从而可以消除第一薄膜晶体管T1的阈值电压Vth漂移引起画面显示不良的问题。
本发明提供的像素驱动电路，包括复位模块、补偿模块和发光模块；复位模块用于接收第一驱动信号，并在第一驱动信号的控制下将数据信号传输至补偿模块以复位补偿模块；补偿模块用于接收第二驱动信号，并在第二驱动信号的控制下写入数据信号并进行阈值电压补偿；发光模块用于接收第三驱动信号，并在第三驱动信号的控制下发光。通过上述方式，能够实现对阈值电压进行补偿的同时，减少显示面板上的金属走线，从而改善显示面板的显示特性。
请参阅图6，图6为本发明实施例的显示面板的示意图。如图5所示，本发明还提供一种显示面板1，该显示面板1包括以上的像素驱动电路10，具体可参照以上，在此不做赘述。
综上所述，虽然本发明已以优选实施例揭露如上，但上述优选实施例并非用以限制本发明，本领域的普通技术人员，在不脱离本发明的精神和范围内，均可作各种更动与润饰，因此本发明的保护范围以权利要求界定的范围为准。

Claims (12)

1.一种像素驱动电路，其特征在于，包括：复位模块、补偿模块和发光模块；
所述复位模块用于接收第一驱动信号，并在所述第一驱动信号的控制下将数据信号传输至所述补偿模块以复位所述补偿模块；
所述补偿模块用于接收第二驱动信号，并在所述第二驱动信号的控制下写入数据信号并进行阈值电压补偿；
所述发光模块用于接收第三驱动信号，并在所述第三驱动信号的控制下发光。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述复位模块包括第四薄膜晶体管和第一存储电容；
所述第四薄膜晶体管的栅极接收所述第一驱动信号，源极与所述数据信号连接，漏极分别与所述补偿模块、所述第一存储电容的一端连接；所述第一存储电容的另一端与所述第二驱动信号连接。
3.根据权利要求2所述的像素驱动电路，其特征在于，所述补偿模块包括第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管和第二存储电容；
所述第一薄膜晶体管的栅极分别与所述第二存储电容的一端、所述第三薄膜晶体管的漏极、所述复位模块连接，所述第一薄膜晶体管的漏极分别与所述发光模块、所述第三薄膜晶体管的源极连接，所述第一薄膜晶体管的源极分别与所述发光模块、所述第二薄膜晶体管的漏极连接；
所述第二薄膜晶体管的栅极分别与所述第三薄膜晶体管的栅极、所述第二驱动信号、所述复位模块连接；
所述第二存储电容的另一端与所述发光模块连接。
4.根据权利要求3所述的像素驱动电路，其特征在于，所述发光模块包括包括第五薄膜晶体管、第六薄膜晶体管和发光元件；
所述第五薄膜晶体管的栅极分别与所述第三驱动信号、所述第六薄膜晶体管的栅极连接，所述第五薄膜晶体管的源极与第一电压连接，所述第五薄膜晶体管的漏极与所述补偿模块连接；
所述第六薄膜晶体管的源极与所述补偿模块连接，所述第六薄膜晶体管的漏极与所述发光元件的阳极连接；
所述发光元件的阴极与第二电压连接。
5.根据权利要求4所述的像素驱动电路，其特征在于，所述第一存储电容的电容值介于50fF至80fF之间；所述第二存储电容的电容值介于50fF至150fF之间；所述第二驱动信号的高电位介于6V至9V之间，所述第二驱动信号的低电位介于-5V至-6V之间。
6.根据权利要求4所述的像素驱动电路，其特征在于，所述第一电压的电压值介于3V至5V之间，所述第二电压的电压值介于-2V至-4V之间。
7.根据权利要求4所述的像素驱动电路，其特征在于，所述像素驱动电路的驱动时序包括：复位阶段、第一次电容耦合时刻、补偿阶段、第二次电容耦合时刻和发光阶段；
在所述复位阶段，所述第一驱动信号为低电平，所述第二驱动信号和所述第三驱动信号均为高电平，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值；
在所述第一次电容耦合时刻，所述第二驱动信号由高电平变为低电平，通过所述第一存储电容的耦合作用，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述耦合信号的电压值之间的差值；
在所述补偿阶段，所述第二驱动信号为低电平，所述第一驱动信号和所述第三驱动信号为高电平，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述第一薄膜晶体管的阈值电压之间的差值；
在所述第二次电容耦合时刻，所述第二驱动信号由低电平变为高电平，通过所述第一存储电容的耦合作用，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述第一薄膜晶体管的阈值电压之间的差值与所述耦合信号的电压值之和；
在所述发光阶段，所述第三驱动信号为低电平，所述第一驱动信号和所述第二驱动信号为高电平，所述像素驱动电路产生驱动电流并提供至所述发光元件，用于驱动所述发光元件的发光显示。
8.根据权利要求4所述的像素驱动电路，其特征在于，所述第一薄膜晶体管、所述第二薄膜晶体管、所述第三薄膜晶体管、所述第四薄膜晶体管、所述第五薄膜晶体管和所述第六薄膜晶体管均为P型薄膜晶体管。
9.根据权利要求1所述的像素驱动电路，其特征在于，所述第一驱动信号、所述第二驱动信号和所述第三驱动信号均由外部时序控制器提供。
10.一种像素驱动电路，其特征在于，包括：第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管、第四薄膜晶体管、第五薄膜晶体管、第六薄膜晶体管、第一存储电容、第二存储电容以及发光元件；
所述第一薄膜晶体管的栅极分别与所述第二存储电容的一端、所述第一存储电容的一端、所述第三薄膜晶体管的漏极、所述第四薄膜晶体管的漏极连接；所述第一薄膜晶体管的源极分别与所述第二薄膜晶体管的漏极、第五薄膜晶体管的漏极连接；所述第一薄膜晶体管的漏极分别与所述第三薄膜晶体管的源极、所述第六薄膜晶体管的源极连接；
所述第二薄膜晶体管的栅极分别与所述第三薄膜晶体管的栅极、所述第一存储电容的另一端、第二驱动信号连接；所述第二薄膜晶体管的源极与数据信号连接；
所述第四薄膜晶体管的栅极与第一驱动信号连接；所述第四薄膜晶体管的源极与所述数据信号连接；
所述第五薄膜晶体管的栅极分别与所述第六薄膜晶体管的栅极、第三驱动信号连接；所述第五薄膜晶体管的源极分别与所述第二存储电容的另一端、第一电压连接；
所述第六薄膜晶体管的漏极与所述发光元件的阳极连接；所述发光元件的阴极与第二电压连接。
11.一种像素驱动方法，其特征在于，用于权利要求4-10任一项所述的像素驱动电路，所述像素驱动方法包括：
复位阶段，第一驱动信号为低电平，第二驱动信号和第三驱动信号均为高电平，第一薄膜晶体管的栅极的电压值为数据信号的电压值；
在第一次电容耦合时刻，所述第二驱动信号由高电平变为低电平，通过第一存储电容的耦合作用，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与耦合信号的电压值之间的差值；
在补偿阶段，所述第二驱动信号为低电平，所述第一驱动信号和所述第三驱动信号为高电平，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述第一薄膜晶体管的阈值电压之间的差值；
在第二次电容耦合时刻，所述第二驱动信号由低电平变为高电平，通过所述第一存储电容的耦合作用，所述第一薄膜晶体管的栅极的电压值为所述数据信号的电压值与所述第一薄膜晶体管的阈值电压之间的差值与所述耦合信号的电压值之和；
在发光阶段，所述第三驱动信号为低电平，所述第一驱动信号和所述第二驱动信号为高电平，所述像素驱动电路产生驱动电流并提供至发光元件，用于驱动所述发光元件的发光显示。
12.一种显示面板，其特征在于，所述显示面板包括如权利要求1-9任一项所述的像素驱动电路。
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