CN108983858A - 一种高电源抑制比耗尽基准电压源 - Google Patents

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Abstract

本发明提出一种高电源抑制比耗尽基准电压源，包括NMOS管M1、M2、M3、M4、M5，M6、M7和电阻R1以及电容C1，将耗尽型NMOS管M3产生的电流作用到增强型NMOS管M4上，产生增强管M4的VGS，在传统耗尽基准的基础上，使用耗尽型NMOS管M1、M2、M3和M5、M6、M7两组三级套筒耗尽管结构，提高了电压基准的电源抑制比，扩展了高电源抑制比频率范围，并在此基础上设计了软启动电路，达到了基准电压上电平缓的目的。

Description

一种高电源抑制比耗尽基准电压源
技术领域
本发明涉及集成电路电源设计领域，特别涉及一种用于电源管理芯片的带有软启动功能的一种高电源抑制比耗尽基准电压源。
背景技术
电压基准是模拟电路中的重要部分，很多电源管理芯片为了使得输出信号获得较高的电源抑制比，需要其内部的基准电路也要具有较高的电源抑制比。为了实现电源管理芯片在上电过程中输出平稳，就需要设计基准电压软启动电路。传统的耗尽基准虽然相比带隙基准体现出了低功耗和结构简单的优点，但在一些需要同时具有高电源抑制比和软启动功能的电路中就无法满足要求。传统的耗尽基准在低频区间可以做到较高的电源抑制比，但随着频率提高，电源抑制比下降过快，而在一些频率较宽的应用环境中，需要获得较宽的高电源抑制比范围。需要新的电路设计来满足这些需求。
发明内容
本发明的目的在于，提供一种高电源抑制比耗尽基准电压源，将耗尽型MOS管的电流作用在增强型MOS管上，产生一个在较宽的频率范围内可以提供具有较高电源抑制比的基准电压源，同时此基准电压源还具有软启动功能，可以满足电源系统软启动的要求。
为实现上述目的，本发明的技术方案如下：一种高电源抑制比耗尽基准电压源，其特征在于：包括基准电压源主体和软启动电路两部分：
基准电压源主体部分包括NMOS管M1、M2、M3、M4、M5，M6、M7和电阻R1以及电容C1；NMOS管M1的漏级连接电源VDD，NMOS管M1的源极连接NMOS管M2的漏极，NMOS管M2的源极连接NMOS管M3的漏极和NMOS管M1的栅极，NMOS管M3的栅极与源极互连并与NMOS管M4的漏极、NMOS管M2的栅极、NMOS管M6的栅极以及NMOS管M7的栅极连接在一起，NMOS管M4的栅极连接电容C1的一端和电阻R1的一端以及NMOS管M7的源极并输出基准电压Vref，电容C1的另一端和NMOS管M4的源极均接地，NMOS管M5的源极连接NMOS管M6的漏极，NMOS管M5的栅极连接NMOS管M6的源极和NMOS管M7的漏极，NMOS管M1的衬底与NMOS管M2的衬底、NMOS管M3的衬底以及NMOS管M4的衬底连接在一起并接地，NMOS管M5的衬底与NMOS管M6的衬底以及NMOS管M7的衬底连接在一起并接地；
软启动电路部分包括PMOS管M9、M10、M11、M13和M14，NMOS管M8和M12以及反相器INV1，PMOS管M9的源极和衬底、PMOS管M10的源极和衬底、PMOS管M11的源极和衬底、PMOS管M13的源极和衬底以及PMOS管M14的源极和衬底均连接电源VDD，PMOS管M11的栅极与漏级互连并连接PMOS管M10的栅极和偏置电流Ibias，PMOS管M10的漏级连接PMOS管M13的漏级、NMOS管M5的漏级、PMOS管M9的漏级和反相器INV1的输入端，反相器INV1的输出端连接PMOS管M9的栅极，PMOS管M13的栅极与PMOS管M14的栅极互连并连接M14的漏级和NMOS管M12的漏级，NMOS管M8的栅极与漏级互连并连接NMOS管M12的栅极和基准电压源主体部分中电阻R1的另一端，NMOS管M8的源级和衬底以及NMOS管M12的源级和衬底均接地。
所述NMOS管M1、M2、M3、M5、M6及M7均为耗尽型晶体管，PMOS管M9、M10、M11、M13和M14以及NMOS管M4、M8和M12均为增强型晶体管。
所述偏置电流Ibias可由传统的电流偏置电路产生并提供。
本发明的优点及显著效果：本发明将耗尽型NMOS管M3产生的电流作用到增强型NMOS管M4上，产生增强管M4的VGS，在传统耗尽基准的基础上，使用耗尽型NMOS管M1、M2、M3和M5、M6、M7两组三级套筒耗尽管结构，提高了电压基准的电源抑制比，扩展了高电源抑制比频率范围，并在此基础上设计了软启动电路，达到了基准电压上电平缓的目的。
附图说明
图1是本发明高电源抑制比耗尽基准电压源的主体电路；
图2是本发明主体电路增加软启动功能的衍生电路；
图3是图1基准电压源电源抑制比曲线；
图4是图2基准电压源启动波形曲线。
具体实施方式
图1是本发明的耗尽型基准电压源的主体电路，包括电压源VDD，地电位GND，耗尽型NMOS管M1，M2，M3，M5，M6，M7，增强型NMOS管M4，电容C1，电阻R1。耗尽型NMOS管M3的栅极和源级短接，则流过M3的电流可以由MOS管饱和区电流公式确定，
其中ID为流过耗尽型NMOS管M3的电流，μn为电子载流子的迁移率，COX为单位面积的栅氧化层电容，W/L为M3的宽长比，VGS为NMOS管M3的栅源电压差，VTH为NMOS管M3的阈值。耗尽型NMOS管M1和M2与M3串联，起到提高输出阻抗进而提高电源抑制比的作用。耗尽型NMOS管M3的电流ID流过增强型NMOS管M4，同时与耗尽型NMOS管M7和电阻R1组成闭环反馈回路，产生稳定的NMOS管M4的栅极电压VGM4，M4的栅极即为耗尽基准的电压输出端Vref。
流过耗尽型NMOS管M7的电流IDSM7由下式确定：IDSM7＝VGM4/R1。耗尽型NMOS管M5和M6与M7串联，起到提高系统电源抑制比的作用。电容C1可以稳定基准电压，同时在软启动电路中作为软启动充电电容。在套筒式耗尽管结构M1，M2，M5，M6的作用下，基准电压对电源VDD的阻抗较高，因此其电源抑制比可以达到106dB，
如图3所示，此耗尽基准可以获得远高于传统基准60～80dB的电源抑制比，频率达到1kHz时电源抑制比也可达到100dB，当频率达到10kHz时电源抑制比依然高达82dB，电源抑制比的频率范围也比较宽。
图2是图1耗尽基准电路增加软启动功能后的电路。引入开关管增强型PMOS管M9，电流镜增强型PMOS管M10和M11、M8和M12、M13和M14。系统上电后，Vref和PMOS管M13的漏端均为低电位，PMOS管M13的漏端低电位通过反相器INV1后变为高电位，进而控制PMOS管M9的栅极，使M9截止，由传统的电流偏置电路提供Ibias电流，为增强型PMOS管M11提供电流偏置，增强型PMOS管M10镜像M11的电流，流过M10的电流IDSM10＝Ibias，流过耗尽型NMOS管M5，M6，M7的电流为PMOS管M10和M13的集电极电流之和，PMOS管M13的电流IDSM13是由NMOS管M8的电流经过NMOS管M12和PMOS管M14镜像而来，NMOS管M8和PMOS管M13的电流分别设为IDSM8和IDSM13，由镜像关系得IDSM8＝IDSM13。
设IC1为流入电容的电流，则充电电流部分可以表示为IDSM10+IDSM13＝IC1+IDSM8。由IDSM8＝IDSM13可得IC1＝IDSM10，即流入电容C1的电流全部为PMOS管M10的电流，等于由外部传统电流偏置模块提供的电流Ibias。则软启动时间表示为Tstart＝Vref/IC1＝Vref/Ibias。通过外部电流偏置电路调节偏置电流Ibias就可以调节软启动时间。
如图4所示，基准电压在启动阶段波形平稳上升。当基准电压升高达到正常基准电压值后启动完成，此时PMOS管M10仍然有电流流入耗尽型NMOS管M5、M6和M7，导致NMOS管M5的漏端电压也就是反相器INV1的输入信号升高，使得反相器发生翻转，输出电位翻转为低电平，也就使得PMOS管M9的栅极电压翻转为低电平，PMOS管M9导通，M9的漏端电压被进一步拉高到接近电源电压VDD，这使得PMOS管M10和M13截止，维持耗尽型NMOS管M5、M6和M7的电流完全由PMOS管M9提供。软启动阶段完成，基准进入正常工作状态。

Claims (3)

1.一种高电源抑制比耗尽基准电压源，其特征在于：包括基准电压源主体和软启动电路两部分：
基准电压源主体部分包括NMOS管M1、M2、M3、M4、M5，M6、M7和电阻R1以及电容C1；NMOS管M1的漏级连接电源VDD，NMOS管M1的源极连接NMOS管M2的漏极，NMOS管M2的源极连接NMOS管M3的漏极和NMOS管M1的栅极，NMOS管M3的栅极与源极互连并与NMOS管M4的漏极、NMOS管M2的栅极、NMOS管M6的栅极以及NMOS管M7的栅极连接在一起，NMOS管M4的栅极连接电容C1的一端和电阻R1的一端以及NMOS管M7的源极并输出基准电压Vref，电容C1的另一端和NMOS管M4的源极均接地，NMOS管M5的源极连接NMOS管M6的漏极，NMOS管M5的栅极连接NMOS管M6的源极和NMOS管M7的漏极，NMOS管M1的衬底与NMOS管M2的衬底、NMOS管M3的衬底以及NMOS管M4的衬底连接在一起并接地，NMOS管M5的衬底与NMOS管M6的衬底以及NMOS管M7的衬底连接在一起并接地；
软启动电路部分包括PMOS管M9、M10、M11、M13和M14，NMOS管M8和M12以及反相器INV1，PMOS管M9的源极和衬底、PMOS管M10的源极和衬底、PMOS管M11的源极和衬底、PMOS管M13的源极和衬底以及PMOS管M14的源极和衬底均连接电源VDD，PMOS管M11的栅极与漏级互连并连接PMOS管M10的栅极和偏置电流Ibias，PMOS管M10的漏级连接PMOS管M13的漏级、NMOS管M5的漏级、PMOS管M9的漏级和反相器INV1的输入端，反相器INV1的输出端连接PMOS管M9的栅极，PMOS管M13的栅极与PMOS管M14的栅极互连并连接M14的漏级和NMOS管M12的漏级，NMOS管M8的栅极与漏级互连并连接NMOS管M12的栅极和基准电压源主体部分中电阻R1的另一端，NMOS管M8的源级和衬底以及NMOS管M12的源级和衬底均接地。
2.根据权利要求1所述的一种高电源抑制比耗尽基准电压源，其特征在于：所述NMOS管M1、M2、M3、M5、M6及M7均为耗尽型晶体管，PMOS管M9、M10、M11、M13和M14以及NMOS管M4、M8和M12均为增强型晶体管。
3.根据权利要求1所述的一种高电源抑制比耗尽基准电压源，其特征在于：所述偏置电流Ibias由电流偏置电路产生并提供。
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