CN107783862A - 一种基于pca9555的8路服务器主从bmc复位控制方法 - Google Patents

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Abstract

本发明涉及服务器控制领域，具体涉及一种基于PCA9555的8路服务器主从BMC复位控制方法。本发明利用PCA9555的特性，避免直接通过GPIO来控制较敏感BMC的REST pin，通过使用CPLD对计算节点BMC的复位进行进一步控制，从而实现8路服务器主从BMC间复位功能，有效的避免误触发的发生。

Description

一种基于PCA9555的8路服务器主从BMC复位控制方法
技术领域
本发明涉及服务器控制领域，具体涉及一种基于PCA9555的8路服务器主从BMC复位控制方法。本发明利用PCA9555的特性，避免直接通过GPIO来控制较敏感BMC的REST pin，通过使用CPLD对计算节点BMC的复位进行进一步控制，从而实现8路服务器主从BMC间复位功能，有效的避免误触发的发生。
背景技术
在高端服务器领域，8路服务器是比较常见的一种形态。相比其他服务器而言，8路服务器能发挥更强大的处理及运算能力，以及具有高度的可扩展性。8路服务器通常使用两块计算节点，每块计算节点上有4颗处理器，两块计算节点通过Backplate背板进行物理链路连接达到8颗处理器互联的目的。每个计算节点上有各自的BMC(Base Board Controller基板控制器)，即管理模块。BMC管理监控各自的计算节点上的设备和传感器信息。同时BMC之间也进行交互控制和状态感知，比如通过UART来进行心跳侦测，以便获取对方BMC实时状态。当其中一方出现故障，比如宕机时，正常的BMC会复位故障的BMC，以便达到功能恢复的目的。
现有技术方案是使用BMC的GPIO(通用输入/输出或总线扩展器利用工业标准接口简化了I/O口的扩展)来控制另一个计算节点上BMC的RESET pin，实现复位故障BMC的目的。但这种方式的缺点是在某些情况比如计算节点插拔、BMC在线更新固件等情况下，容易误触发另一个计算节点上BMC的RESET。
针对上述问题，本申请发明一种经由PCA9555来实现对另外节点复位的方法，有效地避免在计算节点插拔或BMC在线更新固件等情况下误触发RESET的情况，从而增强了服务器的稳定性和可靠性。
发明内容
PCA9555是德州仪器公司的16位I/O扩展器，这些器件能够为大多数微处理器系列提供通用I/O扩展，从而帮助设计人员能够节省微处理器上的GPIO以用于其它重要功能。本发明即利用PCA9555的特性，通过使用CPLD对计算节点BMC的复位进行进一步控制，避免直接通过GPIO来控制较敏感BMC的REST pin，有效的避免误触发的发生。
具体地，本申请请求保护一种基于PCA9555的8路服务器的主从BMC复位控制方法，其特征在于，该方法具体包括如下步骤：
设置8路服务器的两个计算节点通过背板连接；
计算节点上设置CPLD、BMC以及PCA9555；
其中，BMC通过I2C总线与PCA9555相连；
两个计算节点控制信号有两条，一条信号是由本节点的PCA9555输出，另外一条信号是从另外的节点输入进来到本节点的CPLD，两条信号在背板上呈交叉方式互联；
BMC通过I2C对PCA9555IO进行控制，使其输出相应电平，再经背板控制另外计算节点上的CPLD；
CPLD用于直接控制本计算节点BMC的RESET pin。
如上所述的基于PCA9555的8路服务器的主从BMC复位控制方法，其特征还在于，CPLD可以加入去抖逻辑，可以对来自另外计算节点的信号进行去抖处理，有效避免在计算节点插拔时引入的抖动。
如上所述的基于PCA9555的8路服务器的主从BMC复位控制方法，其特征还在于，两个计算节点互为主从。
附图说明
图1、本发明所述的复位控制方法框图
具体实施方式
如附图1所示，本发明的整套硬件环境由计算节点NODE0、NODE1以及背板Backplate组成。NODE0、NODE1是计算节点部分，两者硬件组成完全相同。在计算节点NODE0、NODE1上面的器件是CPLD(Complex Programmable Logic Device复杂可编程逻辑器件)、BMC以及PCA9555。
两个计算节点控制信号有两条，一条信号是由本节点的PCA9555输出。另外一条信号是从另外的节点输入进来到本节点的CPLD。背板Backplate用于连接两个计算节点间控制信号。两条信号在背板backplate上呈交叉方式互联。
其中，BMC通过I2C(Inter-Integrated Circuit连接微控制器及其外围设备)总线与PCA9555相连。
I2C总线支持任何IC生产过程(NMOS CMOS、双极性)。两线-串行数据(SDA)和串行时钟(SCL)线在连接到总线的器件间传递信息。每个器件都有一个唯一的地址识别，无论是微控制器-MCU、LCD驱动器、存储器或键盘接口，而且都可以作为一个发送器或接收器，这由器件的功能决定。但是LCD驱动器只是一个接收器，而存储器则既可以接收又可以发送数据。除了发送器和接收器外器件在执行数据传输时也可以被看作是主机或从机。主机是初始化总线的数据传输并产生允许传输的时钟信号的器件，此时，任何被寻址的器件都被认为是从机。
PCA9555是I2C接口的expander，BMC可通过I2C来实现对PCA9555 IO的控制，使其输出相应电平。PCA9555途经背板backplate控制另外计算节点上的CPLD，然后CPLD直接控制BMC的RESET pin。
CPLD加入去抖逻辑，可以对来自另外计算节点的信号进行去抖处理。有效避免在计算节点插拔时引入的抖动。由于PCA9555是一个受BMC控制的被动器件，同时具有数据锁存的作用，只有当BMC下发命令时，PCA9555的IO才能输出复位信号。所以在BMC在线更新固件时，尽管BMC自身的所有外部接口处于不可控状态。但是PCA9555仍然可以锁存最后一次来自BMC的控制信息，并保持输出不变，避免了触发另外计算节点上的BMC RESET。
显而易见地，上面所示的仅仅是本发明的一个具体实施方式，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据该实施方式获得其他的技术方案，都属于本发明保护的范围。
综上所述，根据本发明所述的节点复位控制方法，能够有效地避免在计算节点插拔或BMC在线更新固件等情况下误触发RESET的情况，增强了服务器的稳定性和可靠性。

Claims (3)

1.一种基于PCA9555的8路服务器的主从BMC复位控制方法，其特征在于，该方法具体包括如下步骤：
设置8路服务器的两个计算节点通过背板连接；
计算节点上设置CPLD、BMC以及PCA9555；
其中，BMC通过I2C总线与PCA9555相连；
两个计算节点控制信号有两条，一条信号是由本节点的PCA9555输出，另外一条信号是从另外的节点输入进来到本节点的CPLD，两条信号在背板上呈交叉方式互联；
BMC通过I2C对PCA9555IO进行控制，使其输出相应电平，再经背板控制另外计算节点上的CPLD；
CPLD用于直接控制本计算节点BMC的RESET pin。
2.如权利要求1所述的基于PCA9555的8路服务器的主从BMC复位控制方法，其特征还在于，CPLD可以加入去抖逻辑，可以对来自另外计算节点的信号进行去抖处理，有效避免在计算节点插拔时引入的抖动。
3.如权利要求2所述的基于PCA9555的8路服务器的主从BMC复位控制方法，其特征还在于，两个计算节点互为主从。
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