CN107094118B - 利用1200m传输速率模块搭配成无线2400m传输速率的无线路由器 - Google Patents

利用1200m传输速率模块搭配成无线2400m传输速率的无线路由器 Download PDF

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Abstract

本发明公开了一种利用1200M传输速率模块搭配成无线2400M传输速率的无线路由器，包括主CPU、次CPU、第一PHY芯片、第二PHY芯片和LOGIC芯片；所述主CPU的GPIO6端口、GPIO7端口、GPIO8端口和GPIO9端口分别连接至次CPU的GPIO4端口、GPIO3端口、GPIO3端口和GPIO1端口，主CPU的GPIO1端口、GPIO端口分别连接至次CPU的SCL端口、SDA端口，主CPU的GPIO3端口、GPIO4端口分别连接至第二PHY芯片的SPI_DO端口、SPI_CS端口。本发明的作用是减少成本，提升产品价值，满足高速高传输性能,2T2R可以做成4T4R，使1200Mbps传输速率提升到2400Mbps的高传输速率,将2T2R技术拓展到4T4R三频同用性能。

Description

利用1200M传输速率模块搭配成无线2400M传输速率的无线路 由器
技术领域
本发明涉及一种利用1200M传输速率模块搭配成无线2400M传输速率的无线路由器。
背景技术
随着网络的发展，网络带宽在不断的拓宽，网络资源也随之增加。相应的作为网络传输中极为关键的无线路由器也需要随之升级。
但是目前的无线双频路由器802.11AC 2T2R技术最高速率为1200Mbps,在企业级及家庭使用中会存在多用户使用资源限制，对于速率的要求更高，同频之间的信号干扰会更加严重，资源利用率不高，无法满足多网络端口的市场需求和市场应用。当然现在也有速率更高的无线路由器，但需要重新购置，原路由器没又没有损坏，无论是对于消费者还是生产厂家都是一种资源浪费。
发明内容
本发明的目的在于提供一种利用1200M传输速率模块搭配成无线2400M传输速率的无线路由器，解决了目前1200M传输速率的无线路由器无法满足使用者的需求，而直接整机更换购置，又造成浪费，增加成本的问题。
为解决上述的技术问题，本发明采用以下技术方案：
一种利用1200M传输速率模块搭配成无线2400M传输速率的无线路由器，包括两个1200M无线路由器和LOGIC芯片，其中一个1200M无线路由器内的CPU为主CPU，PHY芯片为第一PHY芯片，另一个1200M无线路由器内的CPU为次CPU，PHY芯片为第二PHY芯片；
所述主CPU的GPIO6端口、GPIO7端口、GPIO8端口和GPIO9端口分别连接至次CPU的GPIO4端口、GPIO3端口、GPIO3端口和GPIO1端口，
主CPU的GPIO1端口、GPIO端口分别连接至次CPU的SCL端口、SDA端口，
主CPU的GPIO3端口、GPIO4端口分别连接至第二PHY芯片的SPI_DO端口、SPI_CS端口；
其中所述主CPU的SDA端口连接至第一PHY芯片的SDA端口，
主CPU的SCL端口连接至LOGIC芯片的Z端口，
主CPU的GPIO5端口连接至LOGIC芯片的S端口，
所述次CPU的SCL端口连接至第二PHY芯片的SCL端口，
次CPU的SDA端口连接至第二PHY芯片的SDA端口，
所述主CPU和次CPU均和4路2.4G天线相连接，主CPU还通过第一5.2G集成芯片连接2路5.2G天线，次CPU通过第二5.2G集成芯片连接2路2.8G天线。
进一步的，所述第一PHY芯片的P0端口、P1端口、P2端口、P3端口、P4端口均连接至路由器的LAN1接口、LAN2接口、LAN3接口、LAN4接口，所述第二PHY芯片的P0端口、P1端口、P2端口、P3端口、P4端口均连接至路由器的WAN4接口、WAN3接口、WAN2接口和WAN1接口。
与现有技术相比，本发明的有益效果是：减少成本，提升产品价值，满足高速高传输性能,2T2R可以做成4T4R，将使用多种SPI.I2C串行总线，逻辑线路进行连接配置，使用软件控制GPIO端口进行数据的传输，同时采用MIMO技术做多天线输出，使1200Mbps传输速率提升到2400Mbps的高传输速率,将2T2R技术拓展到4T4R三频同用性能。
附图说明
图1为本发明利用1200M传输速率模块搭配成无线2400M传输速率的无线路由器的系统连接图。
具体实施方式
为了使本发明的目的、技术方案及优点更加清楚明白，以下结合附图及实施例，对本发明进行进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。
图1示出了本发明利用1200M传输速率模块搭配成无线2400M传输速率的无线路由器的一个实施例：一种利用1200M传输速率模块搭配成无线2400M传输速率的无线路由器，其特征在于：包括两个1200M无线路由器和LOGIC芯片，其中一个1200M无线路由器内的CPU为主CPU，PHY芯片为第一PHY芯片，另一个1200M无线路由器内的CPU为次CPU，PHY芯片为第二PHY芯片；所述主CPU的GPIO6端口、GPIO7端口、GPIO8端口和GPIO9端口分别连接至次CPU的GPIO4端口、GPIO3端口、GPIO3端口和GPIO1端口，主CPU的GPIO1端口、GPIO端口分别连接至次CPU的SCL端口、SDA端口，主CPU的GPIO3端口、GPIO4端口分别连接至第二PHY芯片的SPI_DO端口、SPI_CS端口；其中所述主CPU的SDA端口连接至第一PHY芯片的SDA端口，主CPU的SCL端口连接至LOGIC芯片的Z端口，主CPU的GPIO5端口连接至LOGIC芯片的S端口，所述次CPU的SCL端口连接至第二PHY芯片的SCL端口，次CPU的SDA端口连接至第二PHY芯片的SDA端口，所述主CPU和次CPU均和4路2.4G天线相连接，主CPU还通过第一5.2G集成芯片连接2路5.2G天线，次CPU通过第二5.2G集成芯片连接2路2.8G天线。
根据本发明利用1200M传输速率模块搭配成无线2400M传输速率的无线路由器的一个优选实施例：一种利用1200M传输速率模块搭配成无线2400M传输速率的无线路由器，其特征在于：包括两个1200M无线路由器和LOGIC芯片，其中一个1200M无线路由器内的CPU为主CPU，PHY芯片为第一PHY芯片，另一个1200M无线路由器内的CPU为次CPU，PHY芯片为第二PHY芯片；所述主CPU的GPIO6端口、GPIO7端口、GPIO8端口和GPIO9端口分别连接至次CPU的GPIO4端口、GPIO3端口、GPIO3端口和GPIO1端口，主CPU的GPIO1端口、GPIO端口分别连接至次CPU的SCL端口、SDA端口，主CPU的GPIO3端口、GPIO4端口分别连接至第二PHY芯片的SPI_DO端口、SPI_CS端口；其中所述主CPU的SDA端口连接至第一PHY芯片的SDA端口，主CPU的SCL端口连接至LOGIC芯片的Z端口，主CPU的GPIO5端口连接至LOGIC芯片的S端口，所述次CPU的SCL端口连接至第二PHY芯片的SCL端口，次CPU的SDA端口连接至第二PHY芯片的SDA端口，所述主CPU和次CPU均和4路2.4G天线相连接，主CPU还通过第一5.2G集成芯片连接2路5.2G天线，次CPU通过第二5.2G集成芯片连接2路2.8G天线；所述第一PHY芯片的P0端口、P1端口、P2端口、P3端口、P4端口均连接至路由器的LAN1接口、LAN2接口、LAN3接口、LAN4接口，所述第二PHY芯片的P0端口、P1端口、P2端口、P3端口、P4端口均连接至路由器的WAN4接口、WAN3接口、WAN2接口和WAN1接口。
本发明的工作原理是：
使用同一型号的芯片作为一个主CPU处理器和次CPU处理器；每一颗CPU处理器再分别控制一颗千兆网络PHY芯片；主次CPU需要分别配置使用一颗Flash做读写控制；网络端口PHY芯片之间使用物理层做端口连接，保持数据同处理；主次CPU之间使用4组SPI进行连接，保证两颗芯片之间的数据源控制；主CPU使用I2C分别控制两颗网络PHY，并且使用逻辑门线路做片选，保持多种线路之间的数据控制；两组5G分别做band1 5.2G和band4 5.8G的频率控制，保证多用户的传输效率两组2.4G模块分别作了4RX+4TX设计，提升了TX和RX的抗干扰能力，保证在弱信号下多用户高辐射能力。
尽管这里参照本发明的多个解释性实施例对本发明进行了描述，但是，应该理解，本领域技术人员可以设计出很多其他的修改和实施方式，这些修改和实施方式将落在本申请公开的原则范围和精神之内。更具体地说，在本申请公开、附图和权利要求的范围内，可以对主题组合布局的组成部件和/或布局进行多种变型和改进。除了对组成部件和/或布局进行的变形和改进外，对于本领域技术人员来说，其他的用途也将是明显的。

Claims (2)

1.一种利用1200M传输速率模块搭配成无线2400M传输速率的无线路由器，其特征在于：包括两个1200M无线路由器和LOGIC芯片，其中一个1200M无线路由器内的CPU为主CPU，PHY芯片为第一PHY芯片，另一个1200M无线路由器内的CPU为次CPU，PHY芯片为第二PHY芯片；
所述主CPU的GPIO6端口、GPIO7端口、GPIO8端口和GPIO9端口分别连接至次CPU的GPIO4端口、GPIO3端口、GPIO3端口和GPIO1端口，
主CPU的GPIO1端口、GPIO端口分别连接至次CPU的SCL端口、SDA端口，
主CPU的GPIO3端口、GPIO4端口分别连接至第二PHY芯片的SPI_DO端口、SPI_CS端口；
其中所述主CPU的SDA端口连接至第一PHY芯片的SDA端口，
主CPU的SCL端口连接至LOGIC芯片的Z端口，
主CPU的GPIO5端口连接至LOGIC芯片的S端口，
所述次CPU的SCL端口连接至第二PHY芯片的SCL端口，
次CPU的SDA端口连接至第二PHY芯片的SDA端口，
所述主CPU和次CPU均和4路2.4G天线相连接，主CPU还通过第一5.2G集成芯片连接2路5.2G天线，次CPU通过第二5.2G集成芯片连接2路2.8G天线。
2.根据权利要求1所述的利用1200M传输速率模块搭配成无线2400M传输速率的无线路由器，其特征在于：所述第一PHY芯片的P0端口、P1端口、P2端口、P3端口、P4端口均连接至路由器的LAN1接口、LAN2接口、LAN3接口、LAN4接口，所述第二PHY芯片的P0端口、P1端口、P2端口、P3端口、P4端口均连接至路由器的WAN4接口、WAN3接口、WAN2接口和WAN1接口。
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