CN106941617B - 视频处理装置和多窗口画面显示方法 - Google Patents

视频处理装置和多窗口画面显示方法 Download PDF

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Abstract

本发明实施例公开了一种视频处理装置，例如包括：控制单元，用于发送混合叠加处理信号；缩放单元，用于对接收到的多路视频信号进行图像缩放处理，得到缩放处理后的多路视频数据；混合叠加单元，用于在接收到所述混合叠加处理信号后，对所述缩放处理后的多路视频数据进行图像混合叠加处理，得到多窗口混合叠加视频数据；以及输出接口，用于单通道输出所述多窗口混合叠加视频数据。如此一来，本发明实施例可以实现显示屏上的多窗口画面显示。此外，本发明实施例还提供一种多窗口画面显示方法，以丰富显示屏的显示信息。

Description

视频处理装置和多窗口画面显示方法
技术领域
本发明涉及显示控制技术领域，尤其涉及一种视频处理装置以及一种多窗口画面显示方法。
背景技术
显示系统可以显示单通道视频输入图像，也可以同时显示多组视频输入图像且这些视频输入图像可以平铺形成多宫格、也可以相互覆盖分层显示。这种显示效果多用于监控系统、户外或室内屏幕广告、舞台屏幕显示等应用场景。
传统的单输出口-多窗口显示系统采用的专用处理器芯片内部一般最多只有两个缩放器(Scaler)算法模块，如果在单输出口输出显示多于两个窗口，则需要采用多片专用处理器芯片级联并且还需要配置图像混合叠加用器件来进行图像混合叠加处理。
然而，采用多片专用处理器芯片级联除了会大大提高处理器芯片成本外还会增加电路板制版成本，而且专用处理器芯片之间的数据共享对电路板的要求也更高，整个硬件、处理器软件系统都会非常复杂，研发周期会更长，出现BUG(漏洞)的概率会大大增加。
发明内容
本发明的实施例提供一种视频处理装置和一种多窗口画面显示方法，解决多窗口画面显示所需系统复杂、成本高的问题，以实现简化系统、降低成本的技术效果。
一方面，提供了一种视频处理装置，包括：控制单元，用于发送混合叠加处理信号；缩放单元，用于对接收到的多路视频信号进行图像缩放处理，得到缩放处理后的多路视频数据；混合叠加单元，用于在接收到所述混合叠加处理信号后，对所述缩放处理后的多路视频数据进行图像混合叠加处理，得到多窗口混合叠加视频数据；以及输出接口，用于单通道输出所述多窗口混合叠加视频数据。。
再一方面，提供了一种视频处理装置，包括：第一图像处理器；第二图像处理器，与所述第一图像处理器通过各自配置的数据收发单元相连；至少一个控制器，连接所述第一图像处理器和所述第二图像处理器；以及输出接口，连接所述第一图像处理器。其中，所述至少一个控制器用于向所述第一图像处理器发送混合叠加处理信号；所述第一图像处理器包括缩放单元和混合叠加单元，所述缩放单元用于对接收到的多路第一视频信号进行图像缩放处理，得到缩放处理后的多路第一视频数据；所述第二图像处理器用于对接收到的多路第二视频信号进行图像缩放处理，得到缩放处理后的多路第二视频数据；所述混合叠加单元用于在接收到所述混合叠加处理信号后，对所述缩放处理后的多路第一视频数据进行图像混合叠加处理，或者对所述缩放处理后的多路第一视频数据中的至少部分路第一视频数据和所述缩放处理后的多路第二视频数据中经由所述第一图像处理器的所述数据收发单元输入至所述第一图像处理器的至少部分路第二视频数据进行图像混合叠加处理，得到多窗口混合叠加视频数据；以及所述输出接口用于单通道输出所述多窗口混合叠加视频数据。
另一方面，提供了一种视频处理装置，包括：多个可编程逻辑器件，每一个所述可编程逻辑器件用于对接收到的多路视频信号进行图像缩放处理，得到多路视频数据；至少一个控制器，连接所述多个可编程逻辑器件，用于向所述多个可编程逻辑器件发送混合叠加处理信号；以及输出接口，连接所述多个可编程逻辑器件中的一个第一可编程逻辑器件。其中，所述多个可编程逻辑器件之间通过各自配置的数据收发器级联在一起；所述第一可编程逻辑器件用于在接收到所述混合叠加处理信号后，通过自己的数据收发器接收所述多个可编程逻辑器件中除所述第一可编程逻辑器件之外的其它可编程逻辑器件中的一个或多个可编程逻辑器件进行图像缩放处理得到的多路视频数据，从自己进行图像缩放处理得到的多路视频数据和通过数据收发器接收到的多路视频数据中选择多路目标视频数据进行图像混合叠加处理，得到多窗口混合叠加视频数据；以及所述输出接口用于单通道输出所述多窗口混合叠加视频数据。
又一方面，提供了一种多窗口画面显示方法，包括：接收多路视频信号；对所述多路视频信号进行图像缩放处理得到多路视频数据；对所述多路视频数据中的至少部分路视频数据进行图像混合叠加处理，得到多窗口混合叠加视频数据；以及单通道输出所述多窗口混合叠加视频数据至显示屏进行画面显示。。
上述技术方案中的一个技术方案具有如下优点或有益效果：因为利用图像处理器既进行图像缩放处理又进行图像混合叠加处理来得到多窗口混合叠加视频数据并从单通道输出至显示屏进行多窗口画面显示，因而可以在一个显示屏上同时显示多路视频信号对应的图像，使得用户可以从一个显示屏上得到更多的信息，丰富了显示屏的显示信息；从另一个角度来讲，单通道输出多窗口画面可以节省多个显示屏的开销，降低系统复杂度和成本。
上述技术方案中的另一个技术方案具有如下优点或有益效果：因为多个图像处理器之间的图像缩放处理后视频数据可以通过数据收发器/单元进行共享并且可以指定任意一个图像处理器进行单通道输出多窗口混合叠加视频数据上屏显示，因而可以实现更多甚至无限窗口混合叠加的显示效果例如平铺成多宫格显示或叠加显示。
附图说明
为了更清楚地说明本发明实施例的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本发明第一实施例中的视频处理器的结构示意图；
图2为本发明第二实施例中的视频处理器的结构示意图；
图3A为本发明第三实施例中的视频处理器的结构示意图；
图3B为本发明第三实施例中的视频处理器输出的多窗口混合叠加视频数据的一种显示效果图；
图4A为本发明第四实施例中的视频处理器的结构示意图；
图4B为本发明第四实施例中的视频处理器输出的多窗口混合叠加视频数据的一种显示效果图；
图5为本发明第五实施例中的多窗口画面显示方法的流程示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
第一实施例
如图1所示，本发明第一实施例中提供的一种视频处理装置10，包括：图像处理器11、控制单元13、存储器15以及输出接口17。其中，控制单元13连接图像处理器11，例如用于发送混合叠加处理信号至图像处理器11，本实施例的控制单元13例如是基于ARM内核的MCU或者其它类似微控制器像DSP处理器、ARM处理器等；存储器15连接图像处理器11而可以作为图像处理器11进行图像数据处理时的缓存；以及输出接口17连接图像处理器11的输出通道，其可以是标准视频接口例如DVI、HDMI等接口，也可以是其它自定义接口，只要能输出视频数据并符合实际需要的接口均可。图像处理器11被配置成接受控制单元13发送的混合叠加处理信号的控制对从外部输入的多路视频信号0,1，…,n进行图像缩放处理、对图像缩放处理后得到的多路视频数据进行图像混合叠加处理得到多窗口混合叠加视频数据、并通过输出接口17单通道输出所述多窗口混合叠加视频数据。
在本发明第一实施例中，由于外部输入的多路视频信号0,1，…,n可以送至同一个图像处理器11中进行图像缩放处理和图像混合叠加处理来得到多窗口混合叠加视频数据并通过输出接口17单通道输出至显示屏进行多窗口画面显示。如此一来，可以在一个显示屏上同时显示多路视频信号对应的图像，使得用户可以从一个显示屏上得到更多的信息，丰富了显示屏的显示信息；从另一个角度来讲，单通道输出多窗口画面可以节省多个显示屏的开销，降低系统复杂度和成本。
第二实施例
如图2所示，本发明第二实施例中提供的一种视频处理装置20，包括：图像处理器21、控制器23、存储器25以及输出接口27。其中，控制器23连接图像处理器21，例如用于发送混合叠加处理信号至图像处理器21；存储器25连接图像处理器21而可以作为图像处理器21进行图像数据处理时的缓存；以及输出接口27连接图像处理器11的输出通道，其可以是标准视频接口例如DVI、HDMI等接口，也可以是其它自定义接口，只要能输出视频数据并符合实际需要的接口均可。图像处理器21被配置成接受控制器23发送的混合叠加处理信号的控制对从外部输入的多路视频信号0,1，…,n进行图像缩放处理、对图像缩放处理后得到的多路视频数据进行图像混合叠加处理得到多窗口混合叠加视频数据、并通过输出接口27单通道输出所述多窗口混合叠加视频数据。
更具体地，图像处理器21包括缩放单元211和混合叠加单元213。缩放单元211用于内部调用多路图像缩放处理核(或称Scaler IP核)分别对外部输入的多路视频信号0,1，…,n进行图像缩放处理得到多路缩放处理后视频数据，每路视频信号对应调用一路图像缩放处理核，再利用混合叠加单元213(或称Blend模块)将各路缩放处理后视频数据进行混合叠加处理，最后通过输出接口27单通道输出多窗口混合叠加的完整视频数据。控制器23负责进行人机交互等工作。举例来讲，本实施例的图像处理器21是可编程逻辑器件，例如单片FPGA(Field Programmable Gate Array，现场可编程门阵列)器件；控制器23是微控制器，例如基于ARM内核的MCU、DSP处理器或ARM处理器等；存储器25是动态随机存储器，例如DDR RAM(Double Data Rate Random Access Memory，双倍速率同步动态随机存储器)等。
在本发明第二实施例中，由于外部输入的多路视频信号0,1，…,n可以由同一个图像处理器21使用缩放单元211对各路视频信号0,1,…,n进行图像缩放处理以及使用混合叠加单元213对缩放处理后的各路视频数据进行图像混合叠加处理来得到多窗口混合叠加视频数据并通过输出接口27单通道输出至显示屏进行多窗口画面显示,因此可以简化系统、降低成本并丰富显示屏的显示信息。
第三实施例
如图3A所示，本发明第三实施例中提供的一种视频处理装置30，包括：图像处理器31、控制器33、存储器35以及输出接口37。其中，控制器33连接图像处理器31，例如用于发送混合叠加处理信号至图像处理器31；存储器35连接图像处理器31而可以作为图像处理器31进行图像数据处理时的缓存；以及输出接口37连接图像处理器31的输出通道，其可以是标准视频接口例如DVI、HDMI等接口，也可以是其它自定义接口，只要能输出视频数据并符合实际需要的接口均可。图像处理器31被配置成接受控制器33发送的混合叠加处理信号的控制对从外部输入的多路视频信号0,1，…,n进行图像缩放处理、对图像缩放处理后得到的多路视频数据进行图像混合叠加处理得到多窗口混合叠加视频数据、并通过输出接口37单通道输出所述多窗口混合叠加视频数据。
更具体地，图像处理器31包括缩放单元、存储器存取控制单元312和混合叠加单元313；且缩放单元包括缩小模块311a和放大模块311b。缩放单元用于内部调用多路图像缩放处理核,此处每一路图像缩放处理核分为两部分：供缩小模块311a调用的图像缩小处理核和供放大模块311b调用的图像放大处理核，每路视频信号对应一路图像缩小处理核和一路图像放大处理核,分别用于外部输入视频信号的缩小和放大。这里的图像缩小处理主要由于存储器35带宽的限制。每路图像缩小处理核输出的缩小处理后视频数据经过存储器存取控制单元312的仲裁处理后缓存进存储器35中，存储器存取控制单元312还会仲裁读取出缓存进存储器35中的各路缩小处理后视频数据，然后分别送给对应的图像放大处理核以进行图像的放大处理。之后,混合叠加单元313负责将各路放大处理后的视频数据进行图像混合叠加处理，最后通过输出接口37单通道输出多窗口混合叠加的完整视频数据以供上屏显示。控制器33负责进行人机交互等工作。举例来讲，本实施例的图像处理器31是可编程逻辑器件，例如单片FPGA器件；控制器33是微控制器，例如基于ARM内核的MCU、DSP处理器或ARM处理器等；存储器35是动态随机存储器，例如DDR等。
在本发明第三实施例中，由于外部输入的多路视频信号0,1，…,n在图像处理器31中的图像缩小和放大是通过调用图像缩小处理核和图像放大处理核依序进行，因而可以有效提升数据的处理速度。
图3B为图3A所示视频处理器输出的多窗口混合叠加视频数据的一种显示效果图。从图3B可以看出，对应多路外部输入视频信号的多个窗口画面在显示屏上进行叠加显示。当然可以理解的是，多个窗口画面的混合叠加方式并不限于图3B所示，也可以是平铺成多宫格形式显示在显示屏上。
第四实施例
如图4A所示，本发明第四实施例中提供的一种视频处理装置40，包括：多个图像处理器41、一个控制器43、一个存储器45以及多个输出接口47。其中，控制器43连接各个图像处理器41，例如用于发送混合叠加处理信号至各个图像处理器41；以及存储器45连接各个图像处理器41而作为图像数据处理时的缓存；多个输出接口47分别连接各个图像处理器41的输出通道，其可以是标准视频接口例如DVI、HDMI等接口，也可以是其它自定义接口，只要能输出视频数据并符合实际需要的接口均可，。
在图4A中，各个图像处理器41除了配置例如图2或图3A所示的缩放单元和和混合叠加单元之外，还配置有数据收发器(或称数据收发单元)415；从而多个例如n个图像处理器41通过各自配置的数据收发器415级联在一起。
每一个图像处理器41的缩放单元内部调用一定量的图像缩放处理核，各个图像处理器41之间可以通过数据收发器415进行缩放处理后视频数据共享，以及通过控制器43发送的混合叠加处理信号的控制可以选择任意一个图像处理器41进行单通道叠加输出，图4A所示视频处理装置40的系统总共n路输出；至于所选择的图像处理器41中被叠加以供输出的多路缩放处理后视频数据可以是所选择的图像处理器41本地进行图像缩放处理后得到的多路视频数据，也可以是部分路视频数据为所选择的图像处理器41本地进行图像缩放处理后得到的视频数据且其它路视频数据为级联的其它图像处理器41中的一个或多个进行图像缩放处理后得到的视频数据。所选择的图像处理器41内部的图像混合叠加模块负责将所需的各路视频数据进行图像混合叠加处理，最后通过相应的输出接口47单通道输出多窗口混合叠加的完整视频数据。此处可以理解的是，需要单通道显示的窗口数越多，图像处理器41级联的越多。例如在一个显示屏上同时显示多宫格甚至无限宫格图像，如图4B所示。当然，多个窗口画面的混合叠加方式并不限于图4B所示的多宫格形式，也可以是例如图3B所示的多窗口叠加显示。
承上述，各个图像处理器41例如是可编程逻辑器件，像FPGA器件等；控制器43例如是微控制器，像基于ARM内核的MCU、DSP处理器或ARM处理器等；存储器45例如是动态随机存储器，像DDR等。再者，数据收发器415优选为高速收发器，例如吉比特收发器(Gigabittransceiver)，像Rocket I/O收发器、RapidIO收发器、PCI-Express收发器等。
再者，值得一提的是，多个图像处理器41并不限于图4A所示共用一个控制器41，其也可以是每一个图像处理器41配备一个控制器41并设置某一个控制器41为主控制器来决定选择哪一个图像处理器41来输出目标多窗口混合叠加视频数据以及叠加哪些外部视频输入信号所对应的图像缩放处理后视频数据。另外，多个图像处理器41也并不限于如图4A所示共用一个物理存储器45且共用的物理存储器45可以在逻辑上划分成多个存储器，也可以是每一个图像处理器41配备一个物理存储器。
因而，在本发明第四实施例中，因为多个图像处理器41之间的图像缩放处理后视频数据可以通过数据收发器415进行共享并且可以指定任意一个图像处理器41进行单通道输出多窗口混合叠加视频数据上屏显示，因而可以实现更多甚至无限窗口混合叠加的显示效果例如平铺成多宫格显示或叠加显示。
第五实施例
如图5所示，本发明第五实施例中提供的一种多窗口画面显示方法，例如包括以下步骤：
步骤S51：接收多路视频信号；
步骤S53：对所述多路视频信号进行图像缩放处理得到多路视频数据；
步骤S55：对所述多路视频数据中的至少部分路视频数据进行图像混合叠加处理，得到多窗口混合叠加视频数据；以及
步骤S57：单通道输出所述多窗口混合叠加视频数据至显示屏进行画面显示，此处的单通道输出例如是通过视频接口，像DVI、HDMI等数字视频接口等输出，当然也可以通过自定义接口输出或其它类型视频接口输出。
更具体地，在一个举例中，本实施例的多窗口画面显示方法在图1、图2或图3A所示的视频处理装置10、20或30上实现。相应地，步骤S51是由单个图像处理器11、21或31接收多路视频信号，步骤S53和步骤S55也是在在同一个图像处理器11、21或31内实现且具体实现方式可以参见前述第一实施例、第二实施例或第三实施例中的相关说明，在此不再赘述。
在另一个举例中，本实施例的多窗口画面显示方法在图4A所示的视频处理装置40上实现。相应地，步骤S51是由多个图像处理器41接收多路视频信号，此处的多个图像处理器41可以是图4A中的n个的全部，也可以是部分；从而在步骤S53中，由多个图像处理器41中的一个图像处理器41(此处为方便后续描述，将其命名为第一图像处理器)对所述多路视频信号中的部分路视频信号进行图像缩放处理得到多路视频数据中的部分路视频数据，以及由所述多个图像处理器41中的其它图像处理器41对所述多路视频信号中的其它路视频信号进行图像缩放处理得到多路视频数据中的其它路视频数据。接下来，所述多个图像处理器41中的所述其它图像处理器41通过其数据收发器将所述其它路视频数据中的部分路或全部路视频数据提供给所述第一图像处理器41，以便于后续进行步骤S55,由所述第一图像处理器41对多路视频数据进行图像混合叠加处理得到多窗口混合叠加视频数据。
承上述，在本发明第五实施例中，各个图像处理器41之间通过各自配置的数据收发器形成级联，以便于相互之间图像缩放处理后视频数据的共享。本实施例的数据收发器优选为高速收发器，例如吉比特收发器，像Rocket I/O收发器、RapidIO收发器、PCI-Express收发器等。如此一来，前述第一图像处理器41就可以通过吉比特收发器接收所述其它图像处理器41提供的所述其它路视频数据。
在本申请所提供的几个实施例中，应该理解到，所揭露的系统，装置和方法，可以通过其它的方式实现。例如，以上所描述的装置实施例仅仅是示意性的，例如，所述单元的划分，仅仅为一种逻辑功能划分，实际实现时可以有另外的划分方式，例如多路单元或组件可以结合或者可以集成到另一个系统，或一些特征可以忽略，或不执行。另一点，所显示或讨论的相互之间的耦合或直接耦合或通信连接可以是通过一些接口，装置或单元的间接耦合或通信连接，可以是电性，机械或其它的形式。
所述作为分离部件说明的单元可以是或者也可以不是物理上分开的，作为单元显示的部件可以是或者也可以不是物理单元，即可以位于一个地方，或者也可以分布到多路网络单元上。可以根据实际的需要选择其中的部分或者全部单元来实现本实施例方案的目的。
最后应说明的是：以上实施例仅用以说明本发明的技术方案，而非对其限制；尽管参照前述实施例对本发明进行了详细的说明，本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本发明各实施例技术方案的精神和范围。

Claims (7)

1.一种视频处理装置，其特征在于，包括：
第一图像处理器；
第二图像处理器，与所述第一图像处理器通过各自配置的数据收发单元相连；
至少一个控制器，连接所述第一图像处理器和所述第二图像处理器；
输出接口，连接所述第一图像处理器；
其中，所述至少一个控制器用于向所述第一图像处理器发送混合叠加处理信号，
所述第一图像处理器包括缩放单元和混合叠加单元，所述缩放单元用于对接收到的多路第一视频信号进行图像缩放处理，得到缩放处理后的多路第一视频数据，
所述第二图像处理器用于对接收到的多路第二视频信号进行图像缩放处理，得到缩放处理后的多路第二视频数据，
所述混合叠加单元用于在接收到所述混合叠加处理信号后，对所述缩放处理后的多路第一视频数据进行图像混合叠加处理，或者对所述缩放处理后的多路第一视频数据中的至少部分路第一视频数据和所述缩放处理后的多路第二视频数据中经由所述第一图像处理器的所述数据收发单元输入至所述第一图像处理器的至少部分路第二视频数据进行图像混合叠加处理，得到多窗口混合叠加视频数据；
所述输出接口用于单通道输出所述多窗口混合叠加视频数据。
2.根据权利要求1所述的视频处理装置，其特征在于，所述缩放单元用于调用内部多路图像缩放处理核分别对所述多路第一视频信号进行图像缩放处理，所述第一图像处理器为可编程逻辑器件，所述至少一个控制器为微控制器。
3.根据权利要求2所述的视频处理装置，其特征在于，所述视频处理装置还包括：至少一个存储器，连接所述第一图像处理器和所述第二图像处理器；所述第一图像处理器还包括存储器存取控制单元；
所述缩放单元包括：缩小模块，用于调用内部多路图像缩小处理核分别对所述多路第一视频信号进行图像缩小处理，得到多路缩小处理后视频数据；
所述存储器存取控制单元，用于将所述多路缩小处理后视频数据缓存至所述存储器；
所述缩放单元还包括：放大模块，用于调用多路图像放大处理核对利用所述存储器存取控制单元从所述存储器读取的所述多路缩小处理后视频数据分别进行图像放大处理，得到所述多路第一视频数据。
4.一种视频处理装置，其特征在于，包括：
多个可编程逻辑器件，每一个所述可编程逻辑器件用于对接收到的多路视频信号进行图像缩放处理，得到多路视频数据；
至少一个控制器，连接所述多个可编程逻辑器件，用于向所述多个可编程逻辑器件发送混合叠加处理信号；
输出接口，连接所述多个可编程逻辑器件中的一个第一可编程逻辑器件；
其中，所述多个可编程逻辑器件之间通过各自配置的数据收发器级联在一起，
所述第一可编程逻辑器件用于在接收到所述混合叠加处理信号后，通过自己的数据收发器接收所述多个可编程逻辑器件中除所述第一可编程逻辑器件之外的其它可编程逻辑器件中的一个或多个可编程逻辑器件进行图像缩放处理得到的多路视频数据，从自己进行图像缩放处理得到的多路视频数据和通过数据收发器接收到的多路视频数据中选择多路目标视频数据进行图像混合叠加处理，得到多窗口混合叠加视频数据，
所述输出接口用于单通道输出所述多窗口混合叠加视频数据。
5.根据权利要求4所述的视频处理装置，其特征在于，所述可编程逻辑器件为FPGA器件，所述数据收发器为吉比特收发器。
6.一种多窗口画面显示方法，其特征在于，包括：
接收多路视频信号；
对所述多路视频信号进行图像缩放处理得到多路视频数据；
对所述多路视频数据中的至少部分路视频数据进行图像混合叠加处理，得到多窗口混合叠加视频数据；
单通道输出所述多窗口混合叠加视频数据至显示屏进行画面显示，
其中，所述对所述多路视频信号进行图像缩放处理得到多路视频数据包括：
由多个可编程逻辑器件中的一个第一可编程逻辑器件对所述多路视频信号中的部分路视频信号进行图像缩放处理，得到所述多路视频数据中的部分路视频数据，
由所述多个可编程逻辑器件中的其它可编程逻辑器件对所述多路视频信号中的其它路视频信号进行图像缩放处理，得到所述多路视频数据中的其它路视频数据；
所述多窗口画面显示方法还包括：在对所述多路视频数据中的至少部分路视频数据进行图像混合叠加处理，得到多窗口混合叠加视频数据之前，所述多个可编程逻辑器件中的所述其它可编程逻辑器件将所述其它路视频数据中的至少部分路视频数据提供给所述第一可编程逻辑器件，以供第一可编程逻辑器件进行所述图像混合叠加处理。
7.根据权利要求6所述的多窗口画面显示方法，其特征在于，所述第一可编程逻辑通过吉比特收发器接收所述其它可编程逻辑器件提供的所述其它路视频数据中的至少部分路视频数据。
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