CN106227557B - 一种基于gpon、epon的可编程逻辑器件加载flash的硬件电路与方法 - Google Patents

一种基于gpon、epon的可编程逻辑器件加载flash的硬件电路与方法 Download PDF

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Abstract

本发明公开一种基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路与方法，其硬件电路包括PC通过USB BLASTER线缆通过JTAG接口和FPGA/CPLD连接，在对被加载的FLASH芯片进行在线升级时，开关电路保证可编程逻辑器件正常工作，被加载的FLASH芯片片选信号处于手动选中状态，CPU小系统电源处于手动断电不工作状态，待该在线升级完成后，该片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作，本发明通过可编程逻辑器件加载FLASH，不需要手动取下FLASH重新烧录启动文件和重新焊接，提高效率，通过配套的开关电路和JTAG接口加载FLASH文件，不需要配套PCI接口的JTAG测试卡，能正常使用，占用资源少。

Description

一种基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路 与方法
技术领域
本发明涉及FLASH芯片技术领域，尤其涉及一种基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路与方法。
背景技术
现有技术的EPON OLT/GPON OLT设备启动文件都是存储在FLASH中，一般的生产过程中都是通过对FLASH进行先烧后贴的方式，但是在单板CPU小系统调试或实际使用过程中，会发生启动文件破坏的情况，需要手动取下FLASH重新烧录好启动文件，重新焊接设备小系统才能正常工作，这种方式效率低下；或者通过配套PCI接口的JTAG测试卡和测试环境，对FLASH进行在线烧录，效率有所提高，但占用资源多，投入费用大。
发明内容
本发明要解决的技术问题是提供一种基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路与方法。
本发明的目的在于提供一种基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路，包括：JTAG接口、可编程逻辑器件、被加载的FLASH芯片、CPU小系统；PC通过USBBLASTER线缆通过JTAG接口和FPGA/CPLD型可编程逻辑器件连接，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片的地址总线、数据总线、控制总线共用，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片都挂在CPU小系统的LOCALBUS上，在对被加载的FLASH芯片进行在线升级时，通过开关电路保证可编程逻辑器件正常工作，被加载的FLASH芯片片选信号一直处于手动选中状态，CPU小系统电源处于手动断电不工作状态，待被加载的FLASH芯片启动文件在线升级完成后，被加载的FLASH芯片片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作。
本发明的目的在于还提供一种基于GPON、EPON的可编程逻辑器件加载FLASH的方法，包括：
PC通过USB BLASTER线缆通过JTAG接口和FPGA/CPLD型可编程逻辑器件连接，通过开关电路插上第一短路塞，保证被加载的FLASH芯片片选信号一直处于手动选中状态，插上第二短路塞，CPU小系统电源处于手动断电不工作状态，FPGA和FLASH一对一通信；
待被加载的FLASH芯片启动文件在线升级完成后，拔掉两个短路塞，被加载的FLASH芯片片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作。
本发明提供的基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路，包括PC通过USB BLASTER线缆通过JTAG接口和FPGA/CPLD型可编程逻辑器件连接，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片的地址总线、数据总线、控制总线共用，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片都挂在CPU小系统的LOCALBUS上，在对被加载的FLASH芯片进行在线升级时，通过开关电路保证FPGA/CPLD型可编程逻辑器件正常工作，被加载的FLASH芯片片选信号一直处于手动选中状态，CPU小系统电源处于手动断电不工作状态，待被加载的FLASH芯片启动文件在线升级完成后，被加载的FLASH芯片片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作，本发明通过可编程逻辑器件加载FLASH，不需要手动取下FLASH重新烧录启动文件和重新焊接，提高效率，通过配套的开关电路和JTAG接口加载FLASH文件，不需要配套PCI接口的JTAG测试卡，能正常使用，占用资源少。
本发明提供的基于GPON、EPON的可编程逻辑器件加载FLASH的方法，包括PC通过USB BLASTER线缆通过JTAG接口和FPGA/CPLD型可编程逻辑器件连接，通过开关电路(设备PCB上预留如2.54MM的短路塞)插上第一短路塞保证被加载的FLASH芯片片选信号一直处于手动选中状态，插上第二短路塞，CPU小系统电源处于手动断电不工作状态，这样FPGA/CPLD型可编程逻辑器件和FLASH实现一对一通信；待被加载的FLASH芯片启动文件在线升级完成后，拔掉两个短路塞，被加载的FLASH芯片片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作，本发明通过可编程逻辑器件加载FLASH，不需要手动取下FLASH重新烧录启动文件和重新焊接，提高效率，通过配套的开关电路和JTAG接口加载FLASH文件，不需要配套PC I接口的JTAG测试卡，能正常使用，占用资源少。
附图说明
图1，为本发明基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路的示意图；
图2，为本发明基于GPON、EPON的可编程逻辑器件加载FLASH的方法的示意图。
具体实施方式
本发明提供一种基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路与方法，应用于FLASH芯片技术领域，其硬件电路包括PC通过USB BLASTER线缆经由JTAG接口和FPGA/CPLD型可编程逻辑器件连接，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片的地址总线、数据总线、控制总线共用，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片都挂在CPU小系统的LOCALBUS上，在对被加载的FLASH芯片进行在线升级时，通过开关电路保证可编程逻辑器件正常工作，被加载的FLASH芯片片选信号一直处于手动选中状态，CPU小系统电源处于手动断电不工作状态，待被加载的FLASH芯片启动文件在线升级完成后，被加载的FLASH芯片片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作，本发明通过可编程逻辑器件加载FLASH，不需要手动取下FLASH重新烧录启动文件和重新焊接，提高效率，通过配套的开关电路和JTAG接口加载FLASH文件，不需要配套PC I接口的JTAG测试卡，能正常使用，占用资源少。
为了使本发明的目的、技术方案及优点更加清楚明白，以下结合附图及实施例，对本发明进行进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。
本发明提供一种基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路。
请参见图1，图1为本发明基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路的示意图，包括：JTAG接口、可编程逻辑器件、被加载的FLASH芯片、CPU小系统；
PC通过USB BLASTER线缆通过JTAG接口和FPGA/CPLD型可编程逻辑器件连接，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片的地址总线、数据总线、控制总线共用，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片都挂在CPU小系统的LOCALBUS上，在对被加载的FLASH芯片进行在线升级时，通过开关电路保证FPGA/CPLD型可编程逻辑器件正常工作，被加载的FLASH芯片片选信号一直处于手动选中状态，CPU小系统电源处于手动断电不工作状态，待被加载的FLASH芯片启动文件在线升级完成后，被加载的FLASH芯片片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作。
本发明还提供一种基于GPON、EPON的可编程逻辑器件加载FLASH的方法。
请参见图2，图2为本发明基于GPON、EPON的可编程逻辑器件加载FLASH的方法的示意图，包括：
PC通过USB BLASTER线缆通过JTAG接口和FPGA/CPLD型可编程逻辑器件连接，通过开关电路(设备PCB上预留如2.54MM的短路塞)插上第一短路塞保证被加载的FLASH芯片片选信号一直处于手动选中状态，插上第二短路塞，CPU小系统电源处于手动断电不工作状态，这样FPGA/CPLD型可编程逻辑器件和FLASH实现一对一通信；
待被加载的FLASH芯片启动文件在线升级完成后，拔掉两个短路塞，被加载的FLASH芯片片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作。
本发明提供的基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路，包括PC通过USB BLASTER线缆通过JTAG接口和FPGA/CPLD型可编程逻辑器件连接，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片的地址总线、数据总线、控制总线共用，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片都挂在CPU小系统的LOCALBUS上，在对被加载的FLASH芯片进行在线升级时，通过开关电路保证FPGA/CPLD型可编程逻辑器件正常工作，被加载的FLASH芯片片选信号一直处于手动选中状态，CPU小系统电源处于手动断电不工作状态，待被加载的FLASH芯片启动文件在线升级完成后，被加载的FLASH芯片片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作，本发明通过FPGA/CPLD型可编程逻辑器件加载FLASH，不需要手动取下FLASH重新烧录启动文件和重新焊接，提高效率，通过配套的开关电路和JTAG接口加载FLASH文件，不需要配套PCI接口的JTAG测试卡，能正常使用，占用资源少。
本发明提供的基于GPON、EPON的可编程逻辑器件加载FLASH的方法，包括PC通过USB BLASTER线缆通过JTAG接口和FPGA/CPLD型可编程逻辑器件连接，通过开关电路(设备PCB上预留如2.54MM的短路塞)插上第一短路塞保证被加载的FLASH芯片片选信号一直处于手动选中状态，插上第二短路塞，CPU小系统电源处于手动断电不工作状态，这样FPGA/CPLD型可编程逻辑器件和FLASH实现一对一通信；待被加载的FLASH芯片启动文件在线升级完成后，拔掉两个短路塞，被加载的FLASH芯片片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作，本发明通过FPGA/CPLD型可编程逻辑器件加载FLASH，不需要手动取下FLASH重新烧录启动文件和重新焊接，提高效率，通过配套的开关电路和JTAG接口加载FLASH文件，不需要配套PCI接口的JTAG测试卡，能正常使用，占用资源少。
需要说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或者操作之间存在任何这种实际的关系或者顺序。而且，术语“包含”、“包括”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系统要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括一个、、、、、、”限定的要素，并不排除在包括所述要素的过程、方法、物品、设备或者装置中还存在另外的相同要素。
对于本发明基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路与方法，实现的形式是多种多样的。凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (2)

1.一种基于GPON、EPON的可编程逻辑器件加载FLASH的硬件电路，其特征在于，包括：JTAG接口、可编程逻辑器件、被加载的FLASH芯片、CPU小系统；PC通过USB BLASTER线缆经由JTAG接口和FPGA/CPLD型可编程逻辑器件连接，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片的地址总线、数据总线、控制总线共用，FPGA/CPLD型可编程逻辑器件和被加载的FLASH芯片都挂在CPU小系统的LOCALBUS上，在对被加载的FLASH芯片进行在线升级时，通过开关电路保证可编程逻辑器件正常工作，被加载的FLASH芯片片选信号一直处于手动选中状态，CPU小系统电源处于手动断电不工作状态，待被加载的FLASH芯片启动文件在线升级完成后，被加载的FLASH芯片片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作。
2.一种基于GPON、EPON的可编程逻辑器件加载FLASH的方法，其特征在于，包括：PC通过USB BLASTER线缆通过JTAG接口和FPGA/CPLD型可编程逻辑器件连接，通过开关电路插上第一短路塞，保证被加载的FLASH芯片片选信号一直处于手动选中状态，插上第二短路塞，CPU小系统电源处于手动断电不工作状态，FPGA/CPLD型可编程逻辑器件和FLASH一对一通信；待被加载的FLASH芯片启动文件在线升级完成后，拔掉两个短路塞，被加载的FLASH芯片片选信号解除手动一直选中状态，被加载的FLASH芯片片选信号交由CPU小系统自身控制，CPU小系统电源解除手动断电，CPU小系统电源处于工作状态，系统正常工作。
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