CN105759524A - 阵列基板及其电路驱动方法、显示装置 - Google Patents

阵列基板及其电路驱动方法、显示装置 Download PDF

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Abstract

本发明涉及一种阵列基板及其电路驱动方法、显示装置，其中的阵列基板中的每一行像素单元由多组像素单元组成，每组像素单元包括一个第一像素单元和一个第二像素单元；每一行像素单元所对应的第一扫描线连接第一像素单元内的开关模块的第一端；每一行像素单元所对应的第二扫描线连接第二像素单元内的开关模块的第一端；所有的数据线连接数据驱动电路，该数据驱动电路用于在任一行像素单元所对应的第一扫描线或第二扫描线加载有效电平时，向该行的每一组像素单元所对应的两条数据线分别输出大小相同而极性相反的两个数据电压。基于此，本发明可以实现在极性反转的基础上水平串扰的进一步消除，有利于取得更优的显示性能。

Description

阵列基板及其电路驱动方法、显示装置
技术领域
本发明涉及显示技术领域，具体涉及一种阵列基板及其电路驱动方法、显示装置。
背景技术
现有的液晶显示器中，水平串扰(HorizontalCrosstalk)是一种普遍存在的现象，其会引发画面亮暗不均、闪烁(Flicker)等显示问题，对显示质量造成不良影响。产生这种现象的原因主要在于公共电极所具有的电阻过大、以及公共电极与数据线之间所具有的耦合电容过大，从而会使得数据线上的电压跳变引起公共电极上的电压不稳，进而使得不同行的像素在相同灰阶电压的驱动下呈现不同的灰阶值，引发显示问题。对此，现有技术采用点反转或者列反转的方式，使得同一行中相邻数据线具有相反的电压极性，从而在总体上抵消对公共电极上电压的影响，可以在很大程度上抑制水平串扰的产生。然而在一些比较特殊的情况下，具有相反电压极性的灰阶电压在幅值上的差异也会导致公共电极上电压的跳变，从而导致水平串扰的产生。
发明内容
针对现有技术中的缺陷，本发明提供一种阵列基板及其电路驱动方法、显示装置，可以实现在极性反转的基础上进一步消除水平串扰。
第一方面，一种阵列基板，其特征在于，包括行列设置的若干个像素单元；对应于每一行像素单元设有一条第一扫描线和一条第二扫描线，对应于每一列像素单元设有一条数据线；
所述像素单元内设有像素电极与开关模块，所述开关模块用于在第一端处为有效电平时导通第二端与第三端；所述开关模块的第三端连接所在像素单元内的像素电极；所述开关模块的第二端连接所在像素单元所对应的数据线；
每一行像素单元由多组像素单元组成，每组像素单元包括一个第一像素单元和一个第二像素单元；每一行像素单元所对应的第一扫描线连接所述第一像素单元内的开关模块的第一端；每一行像素单元所对应的第二扫描线连接所述第二像素单元内的开关模块的第一端；
所有的数据线连接数据驱动电路，该数据驱动电路用于在任一行像素单元所对应的第一扫描线或第二扫描线加载所述有效电平时，向该行的每一组像素单元所对应的两条数据线分别输出大小相同而极性相反的两个数据电压。
可选地，所有的第一扫描线和所有的第二扫描线连接扫描驱动电路，该扫描驱动电路用于按照第一扫描线加载有效电平的第一时间段在先，第二扫描线加载有效电平的第二时间段在后的顺序，逐行地向每一行像素单元所对应的第一扫描线及第二扫描线施加有效电平。
可选地，对应于任意一行像素单元，所述第一时间段的结束时刻不晚于所述第二时间段的开始时刻。
可选地，所述像素单元内还设有存储电容，该存储电容的两端分别连接所述像素电极和公共电压线。
可选地，在任一列像素单元中，全部的像素单元为第一像素单元，或者全部的像素单元为第二像素单元。
可选地，每一列像素单元中，所述第一像素单元与所述第二像素单元交替排列。
可选地，每一行像素单元中，所述第一像素单元与所述第二像素单元交替排列。
可选地，每一行像素单元中，k个相邻的第一像素单元与k个相邻的第二像素单元交替排列；所述k为大于1的整数。
第二方面，本发明还提供了一种阵列基板的电路驱动方法，所述阵列基板包括行列设置的若干个像素单元；对应于每一行像素单元设有一条第一扫描线和一条第二扫描线，对应于每一列像素单元设有一条数据线；
所述像素单元内设有像素电极与开关模块，所述开关模块用于在第一端处为有效电平时导通第二端与第三端；所述开关模块的第三端连接所在像素单元内的像素电极；所述开关模块的第二端连接所在像素单元所对应的数据线；
每一行像素单元由多组像素单元组成，每组像素单元包括一个第一像素单元和一个第二像素单元；每一行像素单元所对应的第一扫描线连接所述第一像素单元内的开关模块的第一端；每一行像素单元所对应的第二扫描线连接所述第二像素单元内的开关模块的第一端；
所述电路驱动方法包括：
按照第一扫描线加载有效电平的第一时间段在先，第二扫描线加载有效电平的第二时间段在后的顺序，逐行地向每一行像素单元所对应的第一扫描线及第二扫描线施加有效电平；
在任一行像素单元所对应的第一扫描线或第二扫描线加载所述有效电平时，向该行的每一组像素单元所对应的两条数据线分别输出大小相同而极性相反的两个数据电压。
可选地，对应于任意一行像素单元，所述第一时间段的结束时刻不晚于所述第二时间段的开始时刻。
第三方面，本发明还提供了一种显示装置，该显示装置包括上述任意一种的阵列基板。
由上述技术方案可知，本发明利用每行像素单元对应两条扫描线的设计，使得一行像素电极在两个不同的时间段进行充电，从而在一部分数据线在加载数据电压以向像素电极充电的同时，另一部分数据线可以加载大小相同而极性相反的数据电压。从而，每一对像素单元都可以互相进行极性补偿而使得两条数据线的总体电压保持在恒定水平上，因而公共电极上的电压可以在任何一种显示画面下都保持稳定，实现在极性反转的基础上水平串扰的进一步消除。相对于现有技术，本发明可以将水平串扰从根本上消除，因此可以取得更优的显示性能。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作一简单的介绍，显而易见地，下面描述中的附图是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明一个实施例中一种阵列基板的结构示意图；
图2是本发明一个实施例中一种阵列基板中数据驱动电路的输出时序示意图；
图3是本发明另一实施例中一种阵列基板的结构示意图；
图4本发明一个实施例中一种阵列基板的电路驱动方法的步骤流程示意图。
具体实施方式
为使本发明实施例的目的、技术方案和优点更加清楚，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
图1是本发明一个实施例中一种阵列基板的结构示意图。参见图1，该阵列基板包括行列设置的若干个像素单元(例如图1示出了四行六列的像素单元)。对应于每一行的像素单元，设有一条第一扫描线(例如图1示出了四行第一扫描线G1a、G2a、G3a、G4a)和一条第二扫描线(例如图1示出了四行第二扫描线G1b、G2b、G3b、G4b)。对应于每一列的像素单元，设有一条数据线(例如图1示出了六列数据线D1、D2、D3、D4、D5、D6)。为表示方便，约定图1中的四行像素单元按照从上至下的顺序分别称为第一至第四行的像素单元，六列像素单元按照从左至右的顺序分别称为第一至第六列的像素单元。
具体来说，像素单元内设有像素电极11a与开关模块11b，其中的开关模块11b用于在第一端处为有效电平时导通第二端与第三端，比如可以由现有技术中的任意一种电控开关器件来形成。可以理解的是，有效电平可以是预先设定的电平范围，比如可以是数字电路中常用的高电平与低电平中的一种。在连接关系上，所有开关模块11b的第三端(例如图1中作标注的开关模块11b的左端)各自连接所在像素单元内的像素电极11a，而所有开关模块11b的第二端各自连接所在像素单元所对应的数据线(例如图1中作标注的开关模块11b的右端连接数据线D6)。
进一步地，上述若干个像素单元中，每一行像素单元由多组像素单元组成。其中，每组像素单元包括一个第一像素单元PA和一个第二像素单元PB。例如图1所示，从左至右的第一、二、五、六列的像素单元均为第一像素单元PA，而第三、四列的像素单元均为第二像素单元PA。作为一种示例，每一行像素单元中的第一、三列的两个像素单元组成一组像素单元，而第二、四列的两个像素单元组成另一组像素单元。可以理解的是，与第五、六列的第一像素单元PA同组的第二像素单元PB未在图1中示出。而在连接关系上，每一行像素单元所对应的第一扫描线连接第一像素单元PA内的开关模块11b的第一端，每一行像素单元所对应的第二扫描线连接第二像素单元PB内的开关模块11b的第一端，例如第一行第一列的第一像素单元PA内的开关模块11b的下端连接第一扫描线G1a，而同组的第一行第三列的第二像素单元PB内的开关模块11b的下端连接第二扫描线G1b。
基于上述连接关系，本发明实施例中所有的数据线连接一数据驱动电路12，该数据驱动电路12用于在任一行像素单元所对应的第一扫描线或第二扫描线加载有效电平时，向该行的每一组像素单元所对应的两条数据线分别输出大小相同而极性相反的两个数据电压。可以理解的是，例如数据驱动芯片(DataDriverIC)一类的现有电路结构可以实现该数据驱动电路12的功能，在此不再赘述。
作为一种示例，图2是本发明一个实施例中一种阵列基板中数据驱动电路的输出时序示意图。参见图2，图2示出了一种第一扫描线G1a、第二扫描线G1b、第一扫描线G2a和第二扫描线G2b上依次加载有效电平(高电平)的信号时序。可以理解的是，第一端处于有效电平的开关模块11b可以导通第二端与第三端，因此可以用于在所连接的扫描线上加载有效电平的期间将所连接的数据线上的数据电压以充电电流的形式写入至所连接的像素电极11a上。具体地，按照图2所示的时序，第一行与第二行的像素单元将经历下述过程：
在第一扫描线G1a上加载高电平的期间，第一行第一列的第一像素单元(以下简称“A1”)内的开关模块11b可以导通A1内的像素电极11a与数据线D1。从而，数据线D1上此时的数据电压为具有正极性且电压幅值为U1的“﹢U1”。而同组的第一行第三列的第二像素单元(以下简称“A2”)内的开关模块11b，由于第二扫描线G1b上没有加载高电平而不进行数据电压的写入。此时，虽然数据线D3上的数据电压为具有负极性且电压幅值为U1的“﹣U1”，但该数据电压并不会写入至任何一个像素电极11a上。可以理解的是，在此期间数据驱动电路12向由A1和A2组成的一组像素单元所对应的数据线D1和D3分别输出了大小相同而极性相反的两个数据电压“﹢U1”和“﹣U1”。并且可以理解的是，因为只有“﹢U1”才会被写入至A1的像素电极11a上，而“﹣U1”不会被写入至A2的像素电极11a上，因此电压幅值U1是根据A1所对应的灰阶值进行设定的。
在第二扫描线G1b上加载高电平的期间，A2内的开关模块11b可以导通A2内的像素电极11a与数据线D3。从而，数据线D3上此时的数据电压为具有正极性且电压幅值为U2的“﹢U2”。而A1内的开关模块11b由于第一扫描线G1a上没有加载高电平而不进行数据电压的写入。此时，虽然数据线D1上的数据电压为具有负极性且电压幅值为U2的“﹣U2”，但该数据电压并不会写入至任何一个像素电极11a上。可以理解的是，电压幅值U2是根据A2所对应的灰阶值进行设定的。
在第一扫描线G2a上加载高电平的期间，第二行第一列的第一像素单元(以下简称“A3”)内的开关模块11b可以导通A3内的像素电极11a与数据线D1。从而，数据线D1上此时的数据电压为具有正极性且电压幅值为U3的“﹢U3”。而同组的第二行第三列的第二像素单元(以下简称“A4”)内的开关模块11b，由于第二扫描线G2b上没有加载高电平而不进行数据电压的写入。此时，虽然数据线D3上的数据电压为具有负极性且电压幅值为U3的“﹣U3”，但该数据电压并不会写入至任何一个像素电极11a上。可以理解的是，在此期间数据驱动电路12向由A3和A4组成的一组像素单元所对应的数据线D1和D3分别输出了大小相同而极性相反的两个数据电压“﹢U3”和“﹣U3”。并且可以理解的是，因为只有“﹢U3”才会被写入至A3的像素电极11a上，而“﹣U3”不会被写入至A4的像素电极11a上，因此电压幅值U3是根据A3所对应的灰阶值进行设定的。
在第二扫描线G2b上加载高电平的期间，A4内的开关模块11b可以导通A4内的像素电极11a与数据线D3。从而，数据线D3上此时的数据电压为具有正极性且电压幅值为U4的“﹢U4”。而A3内的开关模块11b由于第一扫描线G2a上没有加载高电平而不进行数据电压的写入。此时，虽然数据线D1上的数据电压为具有负极性且电压幅值为U4的“﹣U4”，但该数据电压并不会写入至任何一个像素电极11a上。可以理解的是，电压幅值U4是根据A4所对应的灰阶值进行设定的。
可以理解的是，对于每一组像素单元内的第一像素单元PA和第二像素单元PB，都可以按照上述流程先后完成像素电极11a上数据电压的写入。而且，由于数据驱动电路12可以在任一行像素单元所对应的第一扫描线或第二扫描线加载有效电平时向该行的每一组像素单元所对应的两条数据线分别输出大小相同而极性相反的两个数据电压，因此在任意一个第一像素单元PA进行数据电压写入的同时，同组的第二像素单元PB所连接的数据线都会加载大小相同而极性相反的数据电压，使得两条数据线的总体电压等于公共电极上的公共电压。而且，由于同组中第一像素单元PA和第二像素单元PB的充电时间短可以由第一扫描线与第二扫描线上的信号设置相互错开，因此上述方式不会导致第一像素单元PA与第二像素单元PB的数据电压写入过程的相互影响。从而，在每一组像素单元都可以按照上述流程依次完成数据电压的写入的情况下，本发明实施例可以将所有数据线的总体电压保持在公共电压上，使得公共电极上的电压可以在任何一种显示画面下都保持稳定，实现在极性反转的基础上水平串扰的进一步消除。相对于现有技术，本发明实施例可以将水平串扰从根本上消除，因此可以取得更优的显示性能。
应理解的是，优选条件下的一行像素单元中像素单元的总数为偶数，从而其能够划分为若干组像素单元。但是即使一行像素单元中像素单元的总数为奇数m，本发明实施例也可以应用于其中的m-1个像素单元上，并同样可以起到在极性反转的基础上进一步消除水平串扰的作用，本发明对此不做限制。
还应理解的是，图2示出的数据电压的输出方式可以是属于点反转或者行反转的反转类型，而在本发明的其他实施例中，根据具体的应用条件还可以替换为例如Z反转或者列反转等的反转类型，其同样可以实现上述水平串扰的进一步消除，本发明对此不做限制。而且，在保证数据驱动电路12的输出时序与第一扫描线、第二扫描线上加载有效电平的时序相适应的情况下，本发明的其他实施例中可以根据应用需要按照任意的方式来设定第一扫描线和第二扫描线上加载有限电平的时序，由于数据驱动电路对于每一组像素单元而言可以至少在有效电平彼此错开的时间段内保持公共电极上的电压的稳定，因此同样可以在极性反转的基础上进一步消除水平串扰，本发明对此不做限制。
作为一种示例，如图2所示的第一扫描线和第二扫描线上加载有限电平的时序可以利用与所有的第一扫描线和所有的第二扫描线相连接的扫描驱动电路(未在附图中示出)实现。更广义来说，该扫描驱动电路用于按照第一扫描线加载有效电平的第一时间段在先，第二扫描线加载有效电平的第二时间段在后的顺序(即第一时间段先于第二时间段，但第一时间段与第二时间段可以具有重叠部分)，逐行地向每一行像素单元所对应的第一扫描线及第二扫描线施加有效电平。其中对于任一行像素单元而言，第一时间段与第二时间段的先后顺序可以保障彼此间的有效电平在至少部分错开，从而使得上述数据驱动电路可以在错开的时间段内将上述总体电压保持在公共电压上，以达到在极性反转的基础上进一步消除水平串扰的目的。而在优选条件下，对应于任意一行像素单元，第一时间段的结束时刻不晚于第二时间段的开始时刻。可以理解的是，该条件可使得第一时间段与第二时间段不具有重叠部分，从而数据驱动电路可以较大程度地消除水平串扰。更具体地，图2所示的时序可以视为该扫描驱动电路的一种输出时序示例。而可以理解的是，例如栅极驱动芯片(GateDriverIC)或者阵列基板行驱动(GateDriverOnArray，GOA)电路一类的现有电路结构可以实现该扫描驱动电路的功能，在此不再赘述。
还应理解的是，图1示出的第一像素单元PA与第二像素单元PB之间的排列设置方式仅是一种示例。在该排列设置方式中可以看出的是：在任一列像素单元中，全部的像素单元为第一像素单元PA，或者全部的像素单元为第二像素单元PB。基于此，可以使得同一列的像素单元具有同等的结构，从而降低制作难度并提高良率。另一方面，在该排列方式中还可以看出的是：每一行像素单元中，两个相邻的第一像素单元PA与两个相邻的第二像素单元PB交替排列。而在本发明的其他实施例中，也可以推广为下述设置：每一行像素单元中，k个相邻的第一像素单元PA与k个相邻的第二像素单元PB交替排列(k为大于1的整数)。基于此，可以使得同一行中的第一像素单元PA与第二像素单元PB各自集中地设置，从而降低制作难度并提高良率。另外可以理解的是，类似于图1所示的排列设置方式可以使至少两列素单元具有同等的结构，因此可以进一步地降低制作难度并提高良率。
作为另一种第一像素单元与第二像素单元之间的排列设置方式的示例，图3是本发明另一实施例中一种阵列基板的结构示意图。参见图3，在其他条件均相同的情况下，该阵列基板仅在第一像素单元与第二像素单元之间的排列设置方式上与图1所示的不同。具体来说，在本发明实施例中：每一行像素单元中，第一像素单元与第二像素单元交替排列；而且，每一列像素单元中，第一像素单元与第二像素单元交替排列。其中，每一行像素单元中第一像素单元与第二像素单元的交替排列可以将每组像素单元内的两个像素单元设置在相邻的位置上，从而可以使得每组像素单元所对应的两条数据线被设置在相邻的位置。基于此，当两条数据线上沿相反的方向跳变为大小相同而极性相反的数据电压时，公共电极上与这两条数据线所对应的位置处会在寄生电容的作用下发生类似的电位跳变；而由于这两个数据线的位置接近，因而发生电位跳变的两个位置上的电荷会很快地相互补充而使得两个位置处很快地回到公共电压。所以，每一行像素单元中第一像素单元与第二像素单元的交替排列有助于公共电极上列向局部电压差的快速消除，达到更佳的水平串扰的消除效果。另一方面，每一列像素单元中第一像素单元与第二像素单元的交替排列可以与极性反转方式相互配合，而实现同一列中相邻像素单元之间的数据电压的极性反转，以避免配向膜的直流阻绝效应和直流残留效应、保障显示效果。
此外，在上述任意一种的阵列基板的像素单元中，除了上述开关模块11b和像素电极11a之外，可以还包括未予图示的存储电容，并使得该存储电容的两端分别连接像素电极和公共电压线。由此，可以增大像素电极可以存储的电荷总量，提高像素电极上的电压的稳定程度。
基于同样的发明构思，图4本发明一个实施例中一种阵列基板的电路驱动方法的步骤流程示意图。参见图4，该电路驱动方法包括：
步骤401：按照第一扫描线加载有效电平的第一时间段在先，第二扫描线加载有效电平的第二时间段在后的顺序，逐行地向每一行像素单元所对应的第一扫描线及第二扫描线施加有效电平；
步骤402：在任一行像素单元所对应的第一扫描线或第二扫描线加载有效电平时，向该行的每一组像素单元所对应的两条数据线分别输出大小相同而极性相反的两个数据电压。
需要说明的是，本发明实施例中的阵列基板包括行列设置的若干个像素单元；对应于每一行像素单元设有一条第一扫描线和一条第二扫描线，对应于每一列像素单元设有一条数据线。其中，像素单元内设有像素电极与开关模块，开关模块用于在第一端处为有效电平时导通第二端与第三端；开关模块的第三端连接所在像素单元内的像素电极；开关模块的第二端连接所在像素单元所对应的数据线。另外，每一行像素单元由多组像素单元组成，每组像素单元包括一个第一像素单元和一个第二像素单元；每一行像素单元所对应的第一扫描线连接第一像素单元内的开关模块的第一端；每一行像素单元所对应的第二扫描线连接第二像素单元内的开关模块的第一端。
可以理解的是，上述步骤401可以是上述任意一种扫描驱动电路的具体工作流程，因此可以在各方面具有相应的具体实现方式，例如对应于任意一行像素单元，上述第一时间段的结束时刻可以不晚于上述第二时间段的开始时刻，以较大程度地消除水平串扰，在此不再赘述。另一方面，上述步骤402则可以是上述任意一种数据驱动电路的具体工作流程，因此可以在各方面具有相应的具体实现方式，在此不再赘述。
可以看出，本发明实施例利用每行像素单元对应两条扫描线的设计，使得一行像素电极在两个不同的时间段进行充电，从而在一部分数据线在加载数据电压以向像素电极充电的同时，另一部分数据线可以加载大小相同而极性相反的数据电压。从而，每一对像素单元都可以互相进行极性补偿而使得两条数据线的总体电压保持在恒定水平上，因而公共电极上的电压可以在任何一种显示画面下都保持稳定，实现在极性反转的基础上水平串扰的进一步消除。相对于现有技术，本发明实施例可以将水平串扰从根本上消除，因此可以取得更优的显示性能。
基于同样的发明构思，本发明实施例提供了一种显示装置，该显示装置包括上述任意一种的阵列基板。需要说明的是，本发明实施例中的显示装置可以为：显示面板、电子纸、手机、平板电脑、电视机、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。可以理解的是，由于该显示装置包括上述任意一种的阵列基板，因而可以实现在极性反转的基础上水平串扰的进一步消除，有利于取得更优的显示性能。
在本发明的描述中需要说明的是，术语“上”、“下”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本发明和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本发明的限制。除非另有明确的规定和限定，术语“安装”、“相连”、“连接”应做广义理解，例如，可以是固定连接，也可以是可拆卸连接，或一体地连接；可以是机械连接，也可以是电连接；可以是直接相连，也可以通过中间媒介间接相连，可以是两个元件内部的连通。对于本领域的普通技术人员而言，可以根据具体情况理解上述术语在本发明中的具体含义。
本发明的说明书中，说明了大量具体细节。然而，能够理解，本发明的实施例可以在没有这些具体细节的情况下实践。在一些实例中，并未详细示出公知的方法、结构和技术，以便不模糊对本说明书的理解。
类似地，应当理解，为了精简本发明公开并帮助理解各个发明方面中的一个或多个，在上面对本发明的示例性实施例的描述中，本发明的各个特征有时被一起分组到单个实施例、图、或者对其的描述中。然而，并不应将该公开的方法解释呈反映如下意图：即所要求保护的本发明要求比在每个权利要求中所明确记载的特征更多的特征。更确切地说，如权利要求书所反映的那样，发明方面在于少于前面公开的单个实施例的所有特征。因此，遵循具体实施方式的权利要求书由此明确地并入该具体实施方式，其中每个权利要求本身都作为本发明的单独实施例。
应该注意的是上述实施例对本发明进行说明而不是对本发明进行限制，并且本领域技术人员在不脱离所附权利要求的范围的情况下可设计出替换实施例。在权利要求中，不应将位于括号之间的任何参考符号构造成对权利要求的限制。单词“包含”不排除存在未列在权利要求中的元件或步骤。位于元件之前的单词“一”或“一个”不排除存在多个这样的元件。本发明可以借助于包括有若干不同元件的硬件以及借助于适当编程的计算机来实现。在列举了若干装置的单元权利要求中，这些装置中的若干个可以是通过同一个硬件项来具体体现。单词第一、第二、以及第三等的使用不表示任何顺序。可将这些单词解释为名称。
最后应说明的是：以上各实施例仅用以说明本发明的技术方案，而非对其限制；尽管参照前述各实施例对本发明进行了详细的说明，本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分或者全部技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本发明各实施例技术方案的范围，其均应涵盖在本发明的权利要求和说明书的范围当中。

Claims (11)

1.一种阵列基板，其特征在于，包括行列设置的若干个像素单元；对应于每一行像素单元设有一条第一扫描线和一条第二扫描线，对应于每一列像素单元设有一条数据线；
所述像素单元内设有像素电极与开关模块，所述开关模块用于在第一端处为有效电平时导通第二端与第三端；所述开关模块的第三端连接所在像素单元内的像素电极；所述开关模块的第二端连接所在像素单元所对应的数据线；
每一行像素单元由多组像素单元组成，每组像素单元包括一个第一像素单元和一个第二像素单元；每一行像素单元所对应的第一扫描线连接所述第一像素单元内的开关模块的第一端；每一行像素单元所对应的第二扫描线连接所述第二像素单元内的开关模块的第一端；
所有的数据线连接数据驱动电路，该数据驱动电路用于在任一行像素单元所对应的第一扫描线或第二扫描线加载所述有效电平时，向该行的每一组像素单元所对应的两条数据线分别输出大小相同而极性相反的两个数据电压。
2.根据权利要求1所述的阵列基板，其特征在于，所有的第一扫描线和所有的第二扫描线连接扫描驱动电路，该扫描驱动电路用于按照第一扫描线加载有效电平的第一时间段在先，第二扫描线加载有效电平的第二时间段在后的顺序，逐行地向每一行像素单元所对应的第一扫描线及第二扫描线施加有效电平。
3.根据权利要求2所述的阵列基板，其特征在于，对应于任意一行像素单元，所述第一时间段的结束时刻不晚于所述第二时间段的开始时刻。
4.根据权利要求1所述的阵列基板，其特征在于，所述像素单元内还设有存储电容，该存储电容的两端分别连接所述像素电极和公共电压线。
5.根据权利要求1所述的阵列基板，其特征在于，在任一列像素单元中，全部的像素单元为第一像素单元，或者全部的像素单元为第二像素单元。
6.根据权利要求1所述的阵列基板，其特征在于，每一列像素单元中，所述第一像素单元与所述第二像素单元交替排列。
7.根据权利要求1至6中任意一项所述的阵列基板，其特征在于，每一行像素单元中，所述第一像素单元与所述第二像素单元交替排列。
8.根据权利要求1至6中任意一项所述的阵列基板，其特征在于，每一行像素单元中，k个相邻的第一像素单元与k个相邻的第二像素单元交替排列；所述k为大于1的整数。
9.一种阵列基板的电路驱动方法，其特征在于，所述阵列基板包括行列设置的若干个像素单元；对应于每一行像素单元设有一条第一扫描线和一条第二扫描线，对应于每一列像素单元设有一条数据线；
所述像素单元内设有像素电极与开关模块，所述开关模块用于在第一端处为有效电平时导通第二端与第三端；所述开关模块的第三端连接所在像素单元内的像素电极；所述开关模块的第二端连接所在像素单元所对应的数据线；
每一行像素单元由多组像素单元组成，每组像素单元包括一个第一像素单元和一个第二像素单元；每一行像素单元所对应的第一扫描线连接所述第一像素单元内的开关模块的第一端；每一行像素单元所对应的第二扫描线连接所述第二像素单元内的开关模块的第一端；
所述电路驱动方法包括：
按照第一扫描线加载有效电平的第一时间段在先，第二扫描线加载有效电平的第二时间段在后的顺序，逐行地向每一行像素单元所对应的第一扫描线及第二扫描线施加有效电平；
在任一行像素单元所对应的第一扫描线或第二扫描线加载所述有效电平时，向该行的每一组像素单元所对应的两条数据线分别输出大小相同而极性相反的两个数据电压。
10.根据权利要求9所述的电路驱动方法，其特征在于，对应于任意一行像素单元，所述第一时间段的结束时刻不晚于所述第二时间段的开始时刻。
11.一种显示装置，其特征在于，包括如权利要求1至8中任意一项所述的阵列基板。
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