CN105096868B - 一种驱动电路 - Google Patents
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Abstract
本发明公开一种时序控制芯片，包括脉冲信号生成模块、数据信号发送模块及合成模块，脉冲信号生成模块第一及第二脉冲信号，数据信号发送模块具有数据信号，数据信号包括有效及无效数据段，合成模块将第一及第二脉冲信号合成至数据信号的无效数据段中，以形成合成数据信号，并将合成数据信号传输至数据信号发送模块；数据信号发送模块用于连接至数据驱动芯片，以使数据驱动芯片分解出第一及第二脉冲信号，从而在第一脉冲信号的处于第一沿时抓取第二脉冲信号的状态，进而根据抓取到的第二脉冲信号的状态控制输出的驱动电压的极性。因此，本发明减少时序控制芯片的引脚数量、面积及成本。本发明还提供了一种数据驱动芯片及驱动电路。
Description
技术领域
本发明涉及液晶显示领域，尤其涉及一种驱动电路。
背景技术
在液晶的生成过程中，由于无法将液晶完全纯化，而带入一些可移动离子。当施加电压时，这些可移动离子会受到电极上与其极性相反的电荷吸引而向电极移动。当施加电压的平均值不为零时，离子会趋向其中一个电极移动，直到移动至液晶与取向膜的界面而被固定。固定在液晶与取向膜界面的离子会与电极上相反极性的电荷形成内部电场，改变透射率-电压关系曲线。若液晶面板采用直流电压驱动，当屏幕较长时间保持一幅静止画面或变动较少画面时，即使改变显示画面的内容，液晶屏幕上仍然可以看到之前图像痕迹的现象。这种现象称为“直流残留”。扫描驱动芯片输出引脚连接至每一行薄膜电晶体的栅极、使得每行薄膜电晶体开启、关断时间一致。而时序控制芯片持续输出数据信号给数据驱动芯片，若数据驱动芯片每接到一笔数据，就推出驱动电压、将导致数据驱动芯片输出的驱动电压时间不一致。为解决直流残留、驱动电压时间不一致，业界在时序控制芯片、数据驱动芯片中引入脉冲信号TP、POL信号。时序控制芯片、数据驱动芯片的TP、POL信号的引入，导致时序控制芯片及数据驱动芯片的引脚数量增加、两种芯片成本上升，同时承载该两芯片的印刷电路板的面积增加。
发明内容
本发明所要解决的技术问题在于提供一种时序控制芯片、数据驱动芯片及驱动电路，以达到减少时序控制芯片及数据驱动芯片的芯片引脚数量、面积、成本，同时还可以减小承载时序控制芯片及数据驱动芯片的印刷电路板的面积。
为了实现上述目的，本发明实施方式提供如下技术方案：
本发明供了一种时序控制芯片，应用于液晶显示器的驱动电路中，以连接所述驱动电路中的数据驱动芯片，其特征在于：所述时序控制芯片包括：
脉冲信号生成模块，所述脉冲信号生成模块用于生成第一脉冲信号及第二脉冲信号；
数据信号发送模块，所述数据信号发送模块具有数据信号，所述数据信号发送模块包括数据输出引脚，所述数据信号包括有效数据段及无效数据段；
合成模块，所述合成模块连接至所述脉冲信号生成模块及所述数据信号发送模块之间，用于将第一及第二脉冲信号合成至所述数据信号的无效数据段中，以形成合成数据信号，并将所述合成数据信号传输至所述数据信号发送模块；其中，所述第一及第二脉冲信号与所述有效数据段至少具有预设第一时间间隔，所述第一及第二脉冲信号之间具有预设第二时间间隔；其中，所述数据信号发送模块的数据输出引脚用于连接至所述数据驱动芯片，以将所述合成数据信号发送至所述数据驱动芯片，使得所述数据驱动芯片分解出第一及第二脉冲信号，以在所述第一脉冲信号的处于第一沿时抓取所述第二脉冲信号的状态，从而根据抓取到的所述第二脉冲信号的状态控制输出的驱动电压的极性。
其中，所述合成模块包括第一合成单元及第二合成单元，所述第一及第二合成单元均连接至所述脉冲信号生成模块及所述数据信号发送模块之间，所述第一合成单元用于将第一脉冲信号合成至所述数据信号中，所述第二合成单元用于将第二脉冲信号合成至所述数据信号中，从而形成所述合成数据信号。
其中，所述第一及第二脉冲信号的占空比不同。
其中，所述第一脉冲信号为TP信号，所述第二脉冲信号为POL信号。
其中，所述数据信号还包括复位段，所述复位段位于所述无效数据段与有效数据段之间。
其中，与所述复位段相连的第一或第二脉冲数据与所述复位数据段之间具有预设第三时间间隔。
本发明还提供了一种数据驱动芯片，应用于液晶显示器的驱动电路中，以连接时序控制芯片，其特征在于：所述数据驱动芯片包括：
数据接收模块，所述数据接收模块包括数据接收引脚，所述数据接收引脚用于连接至所述时序控制芯片的数据输出引脚，以接收时序控制芯片输出的合成数据信号；其中，所述合成数据信号的无效数据段中具有第一脉冲信号及第二脉冲信号，所述第一及第二脉冲信号与所述有效数据段至少具有预设第一时间间隔，且所述第一及第二脉冲信号之间具有第二预设时间间隔；
分解模块，所述分解模块连接所述数据接收模块，以对所述合成数据信号进行分解，以分别得到所述第一及第二脉冲信号；
电压输出控制模块，所述电压数据控制模块连接至所述分解模块，以接收所述第一及第二脉冲信号，以在所述第一脉冲信号的处于第一沿时抓取所述第二脉冲信号的状态，从而根据抓取到的所述第二脉冲信号的状态控制输出的驱动电压的极性。
其中，所述分解模块包括第一分解单元及第二分解单元，所述第一及第二分解单元均连接至所述数据接收模块，所述第一分解单元用于对所述合成数据信号进行分解，以得到所述第一脉冲信号，所述第二分解单元用于对所述合成数据信号进行分解，以得到所述第二脉冲信号。
其中，所述第一及第二脉冲信号的占空比不同。
其中，所述第一脉冲信号为TP信号，所述第二脉冲信号为POL信号。
本发明还提供了一种驱动电路，应用于液晶显示器中，所述驱动电路包括：
时序控制芯片，所述时序控制芯片包括:
脉冲信号生成模块，所述脉冲信号生成模块用于生成第一脉冲信号及第二脉冲信号；
数据信号发送模块，所述数据信号发送模块具有数据信号，所述数据信号发送模块包括数据输出引脚，所述数据信号包括有效数据段及无效数据段；
合成模块，所述合成模块连接至所述脉冲信号生成模块及所述数据信号发送模块之间，用于将第一及第二脉冲信号合成至所述数据信号的无效数据段中，以形成合成数据信号，并将所述合成数据信号传输至所述数据信号发送模块；其中，所述第一及第二脉冲信号与所述有效数据段至少具有预设第一时间间隔，所述第一及第二脉冲信号之间具有预设第二时间间隔；
数据驱动芯片，所述数据驱动芯片包括：
数据接收模块，所述数据接收模块包括数据接收引脚，所述数据接收引脚用于连接至所述时序控制芯片的数据输出引脚，以接收时序控制芯片输出的合成数据信号；
分解模块，所述分解模块连接所述数据接收模块，以对所述合成数据信号进行分解，以分别得到所述第一及第二脉冲信号；
电压输出控制模块，所述电压数据控制模块连接至所述分解模块，以接收所述第一及第二脉冲信号，以在所述第一脉冲信号的处于第一沿时抓取所述第二脉冲信号的状态，从而根据抓取到的所述第二脉冲信号的状态控制输出的驱动电压的极性。
其中，所述合成模块包括第一合成单元及第二合成单元，所述第一及第二合成单元均连接至所述脉冲信号生成模块及所述数据信号发送模块之间，所述第一合成单元用于将第一脉冲信号合成至所述数据信号中，所述第二合成单元用于将第二脉冲信号合成至所述数据信号中，从而形成所述合成数据信号。
其中，所述分解模块包括第一分解单元及第二分解单元，所述第一及第二分解单元均连接至所述数据接收模块，所述第一分解单元用于对所述合成数据信号进行分解，以得到所述第一脉冲信号，所述第二分解单元用于对所述合成数据信号进行分解，以得到所述第二脉冲信号。
其中，所述第一及第二脉冲信号的占空比不同。
其中，所述第一脉冲信号为TP信号，所述第二脉冲信号为POL信号。
其中，所述数据信号还包括复位段，所述复位段位于所述无效数据段与有效数据段之间。
本发明一种时序控制芯片，应用于液晶显示器的驱动电路中，以连接所述驱动电路中的数据驱动芯片，所述时序控制芯片包括脉冲信号生成模块、数据信号发送模块及合成模块。所述脉冲信号生成模块用于生成第一脉冲信号及第二脉冲信号；所述数据信号发送模块包括数据输出引脚，所述数据信号包括有效数据段及无效数据段；所述合成模块连接至所述脉冲信号生成模块及所述数据信号发送模块之间，用于将第一及第二脉冲信号合成至所述数据信号的无效数据段中，以形成合成数据信号，并将所述合成数据信号传输至所述数据信号发送模块；其中，所述第一及第二脉冲信号与所述有效数据段至少具有预设第一时间间隔，所述第一及第二脉冲信号之间具有预设第二时间间隔；其中，所述数据信号发送模块的数据输出引脚用于连接至所述数据驱动芯片，以将所述合成数据信号发送至所述数据驱动芯片，以使所述数据驱动芯片分解出第一及第二脉冲信号，从而在所述第一脉冲信号的处于第一沿时抓取所述第二脉冲信号的状态，进而根据抓取到的所述第二脉冲信号的状态控制输出的驱动电压的极性。因此，所述时序控制芯片相较于现有的时序控制芯片减少了脉冲信号输出引脚，从而达到了减少所述时序控制芯片的引脚数量，减小了时序控制芯片的面积及成本的目的，进而减少了承载所述时序控制芯片的印刷电路板的面积。
附图说明
为了更清楚地说明本发明的技术方案，下面将对实施方式中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施方式，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以如这些附图获得其他的附图。
图1是本发明第一方案实施例提供的一种时序控制芯片的框图；
图2是图1中脉冲信号生成模块产生的第一及第二脉冲信号的波形图；
图3是图1时序控制芯片输出的合成数据信号的数据段示意图；
图4是本发明第二方案实施例提供的一种数据驱动芯片的框图；
图5是本发明第三方案实施例提供的一种驱动电路的框图。
具体实施方式
下面将结合本发明实施方式中的附图，对本发明实施方式中的技术方案进行清楚、完整地描述。
请参阅图1至图3，本发明第一方案实施例提供一种时序控制芯片100。所述时序控制芯片100应用于液晶显示器的驱动电路中，以连接所述驱动电路中的数据驱动芯片。所述时序控制芯片100包括脉冲信号生成模块10、数据信号发送模块20及合成模块30。
所述脉冲信号生成模块10用于生成第一脉冲信号11及第二脉冲信号12。
其中，在本实施例中，所述第一脉冲信号11为TP信号。所述第二脉冲信号12为POL信号。
所述数据信号发送模块20具有数据信号21。所述数据信号发送模块20包括数据输出引脚22。所述数据输出引脚21用于输出所述数据信号。所述数据信号21包括有效数据段211及无效数据段212。
所述合成模块30连接至所述脉冲信号生成模块10及所述数据信号发送模块20之间，用于将第一及第二脉冲信号11及12合成至所述数据信号21的无效数据段212中，以形成合成数据信号31，并将所述合成数据信号31传输至所述数据信号发送模块20。其中，所述第一及第二脉冲信号11及12与所述有效数据段21至少具有预设第一时间间隔T1。所述第一及第二脉冲信号11及12之间具有预设第二时间间隔T2。其中，所述数据信号发送模块20的数据输出引脚22用于连接至所述数据驱动芯片，以将所述合成数据信号31发送至所述数据驱动芯片，以使所述数据驱动芯片分解出第一及第二脉冲信号11及12，从而在所述第一脉冲信号11的处于第一沿时抓取所述第二脉冲信号12的状态，进而根据抓取到的所述第二脉冲信号12的状态控制输出的驱动电压的极性。
需要说明的是，在本实施方式中，所述第一脉冲信号11及所述第二脉冲信号12的占空比不同。所述第一脉冲信号11的第一沿可以为上升沿。所述数据驱动芯片在所述第一脉冲信号11的处于上升沿时抓取所述第二脉冲信号12的状态，并根据抓取到的所述第二脉冲信号12的状态控制输出的驱动电压的极性。所述第一及第二脉冲信号11及12与所述有效数据段21至少具有预设第一时间间隔T1，以防止和有效数据段21中的有效数据混合。当所述第一及第二脉冲信号11及12中距离所述有效数据段211最近的脉冲信号与所述有效数据段211之间的时间间隔为所述预设第一时间间隔T1。
在本实施例中，所述合成模块30连接至所述脉冲信号生成模块10及所述数据信号发送模块20之间，用于将第一及第二脉冲信号合成至所述数据信号21的无效数据段212中，以形成合成数据信号31，并将所述合成数据信号31传输至所述数据信号发送模块20。其中，所述第一及第二脉冲信号11及12与所述有效数据段21具有预设第一时间间隔T1。所述第一及第二脉冲信号11及12之间具有预设第二时间间隔T2。其中，所述数据信号发送模块20的数据输出引脚22用于连接至所述数据驱动芯片，以将所述合成数据信号31发送至所述数据驱动芯片，以使所述数据驱动芯片分解出第一及第二脉冲信号11及12，从而在所述第一脉冲信号11的处于第一沿时抓取所述第二脉冲信号12的状态，进而根据抓取到的所述第二脉冲信号12的状态控制输出的驱动电压的极性。因此，所述时序控制芯片100相较于现有的时序控制芯片减少了脉冲信号输出引脚，从而达到了减少所述时序控制芯片100的引脚数量，减小了时序控制芯片100的面积及成本的目的，进而减少了承载所述时序控制芯片100的印刷电路板的面积。
可选地，所述合成模块30包括第一合成单元32及第二合成单元33。所述第一及第二合成单元32及33均连接至所述脉冲信号生成模块10及所述数据信号发送模块20之间。所述第一合成单元32用于将第一脉冲信号11合成至所述数据信号21中。所述第二合成单元12用于将第二脉冲信号12合成至所述数据信号21中，从而形成所述合成数据信号31。
需要说明的是，所述第一及第二脉冲信号11及12分别通过第一及第二合成单元32及33合成至所述数据信号21中，从而实现了分别独立控制，提供了合成的灵活性。
可选地，所述数据信号21还包括复位段213。所述复位段213位于所述无效数据段212与有效数据段211之间。
需要说明的是，所述复位段213的作用是当读取到所述复位段213时，即意味着需要读取的下一数据段为有效数据段211。
请参阅图4，本发明第二方案提供一种数据驱动芯片400。所述数据驱动芯片400应用于液晶显示器的驱动电路中，以连接时序控制芯片100。所述数据驱动芯片400包括数据接收模块410、分解模块412及电压输出控制模块413。
所述数据接收模块410包括数据接收引脚411。所述数据接收引脚411用于连接至所述时序控制芯片100的数据输出引脚22，以接收时序控制芯片100输出的合成数据信号31。其中，所述合成数据信号31的无效数据段212中具有第一脉冲信号11及第二脉冲信号12。所述第一及第二脉冲信号11及12与所述有效数据段211至少具有预设第一时间间隔T1。所述第一及第二脉冲信号11及12之间至少具有第二预设时间间隔T2。
所述分解模块412连接所述数据接收模块410，以对所述合成数据信号31进行分解，以分别得到所述第一及第二脉冲信号11及12。
所述电压数据控制模块413连接至所述分解模块412，以接收所述第一及第二脉冲信号11及12，以在所述第一脉冲信号11的处于第一沿时抓取所述第二脉冲信号12的状态，从而根据抓取到的所述第二脉冲信号12的状态控制输出的驱动电压的极性。
在本实施例中，由于第一及第二脉冲信号11及12合成在所述数据信号21中形成合成数据信号30，所述分解模块412连接所述数据接收模块410，以对所述合成数据信号31进行分解，以分别得到所述第一及第二脉冲信号11及12。所述电压数据控制模块413连接至所述分解模块412，以接收所述第一及第二脉冲信号11及12，以在所述第一脉冲信号11的处于第一沿时抓取所述第二脉冲信号12的状态，从而根据抓取到的所述第二脉冲信号12的状态控制输出的驱动电压的极性。因此，所述数据驱动芯片400相较于现有的数据驱动芯片减少了脉冲信号接收引脚，从而达到了减少所述数据驱动芯片400的引脚数量，减小了数据驱动芯片400的面积及成本的目的，进而减少了承载所述数据驱动芯片400的印刷电路板的面积。
可选地，所述分解模块412包括第一分解单元4121及第二分解单元4122。所述第一及第二分解单元4121及4122均连接至所述数据接收模块410。所述第一分解单元4121用于对所述合成数据信号31进行分解，以得到所述第一脉冲信号11。所述第二分解单元4122用于对所述合成数据信号12进行分解，以得到所述第二脉冲信号12。
需要说明的是，所述第一及第二脉冲信号11及12分别由第一及第二分解单元4121及4122分解出来，从而实现了分别独立控制，提供了分解的灵活性。
请参阅图5，本发明第三方案实施例提供了一种驱动电路500。所述驱动电路应用于液晶显示器中。所述驱动电路500包括时序控制芯片及数据驱动芯片。在本实施方式中，所述时序控制芯片为上述第一方案提供的时序控制芯片100。所述数据驱动芯片为上述第二方案提供的数据驱动芯片400。所述时序控制芯片100通过所述数据输出引脚22连接至所述数据驱动芯片400的数据接收引脚411，从而实现所述时序控制芯片100与所述数据驱动芯片400的连接。
其中，所述时序控制芯片100及所述数据驱动芯片400的结构及功能已在上述第一方案及第二方案中进行了详细的阐述，在此不再进行赘述。
在本实施中，所述合成模块30连接至所述脉冲信号生成模块10及所述数据信号发送模块20之间，用于将第一及第二脉冲信号合成至所述数据信号21的无效数据段212中，以形成合成数据信号31，并将所述合成数据信号31通过所述数据输出引脚22及所述数据驱动芯片400的数据接收引脚411传输至所述数据接收模块410。所述分解模块412连接所述数据接收模块410，以对所述合成数据信号31进行分解，以分别得到所述第一及第二脉冲信号11及12。所述电压数据控制模块413连接至所述分解模块412，以接收所述第一及第二脉冲信号11及12，以在所述第一脉冲信号11的处于第一沿时抓取所述第二脉冲信号12的状态，从而根据抓取到的所述第二脉冲信号12的状态控制输出的驱动电压的极性。因此，在本发明中，所述时序控制芯片100相较于现有的时序控制芯片减少了脉冲信号输出引脚、所述数据驱动芯片400相较于现有的数据驱动芯片减少了脉冲信号接收引脚，从而达到了减少所述时序控制芯片100及所述数据驱动芯片400的引脚数量，减小了所述时序控制芯片100及所述数据驱动芯片400的面积及成本的目的，进而减小了承载所述时序控制芯片100及所述数据驱动芯片400的印刷电路板的面积。
以上所述是本发明的优选实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本发明原理的前提下，还可以做出若干改进和润饰，这些改进和润饰也视为本发明的保护范围。
Claims (9)
1.一种时序控制芯片，应用于液晶显示器的驱动电路中，以连接所述驱动电路中的数据驱动芯片，其特征在于：所述时序控制芯片包括：
脉冲信号生成模块，所述脉冲信号生成模块用于生成第一脉冲信号及第二脉冲信号；
数据信号发送模块，所述数据信号发送模块具有数据信号，所述数据信号发送模块包括数据输出引脚，所述数据信号包括有效数据段、无效数据段及复位段，所述复位段位于所述无效数据段与所述有效数据段之间，当所述复位数据段被读取时，指示下一数据段为有效数据段；
合成模块，所述合成模块连接至所述脉冲信号生成模块及所述数据信号发送模块之间，用于将第一及第二脉冲信号合成至所述数据信号的无效数据段中，以形成合成数据信号，并将所述合成数据信号传输至所述数据信号发送模块；其中，所述第一及第二脉冲信号与所述有效数据段至少具有预设第一时间间隔，且所述第一及第二脉冲信号之间具有预设第二时间间隔；其中，所述数据信号发送模块的数据输出引脚用于连接至所述数据驱动芯片，以将所述合成数据信号发送至所述数据驱动芯片，使得所述数据驱动芯片从所述合成数据信号中分解出第一及第二脉冲信号，以在所述第一脉冲信号的处于第一沿时抓取所述第二脉冲信号的状态，从而根据抓取到的所述第二脉冲信号的状态控制输出的驱动电压的极性。
2.如权利要求1所述的时序控制芯片，其特征在于，所述合成模块包括第一合成单元及第二合成单元，所述第一及第二合成单元均连接至所述脉冲信号生成模块及所述数据信号发送模块之间，所述第一合成单元用于将第一脉冲信号合成至所述数据信号中，所述第二合成单元用于将第二脉冲信号合成至所述数据信号中，从而形成所述合成数据信号。
3.如权利要求1所述的时序控制芯片，其特征在于，所述第一及第二脉冲信号的占空比不同。
4.如权利要求1所述的时序控制芯片，其特征在于，所述第一脉冲信号为TP信号，所述第二脉冲信号为POL信号。
5.如权利要求1所述的时序控制芯片，其特征在于，与所述复位段相连的第一或第二脉冲数据与所述复位数据段之间具有预设第三时间间隔。
6.一种数据驱动芯片，应用于液晶显示器的驱动电路中，以连接时序控制芯片，其特征在于：所述数据驱动芯片包括：
数据接收模块，所述数据接收模块包括数据接收引脚，所述数据接收引脚用于连接至所述时序控制芯片的数据输出引脚，以接收时序控制芯片输出的合成数据信号；所述合成数据信号包括有效数据段、无效数据段及复位段，所述复位段位于所述无效数据段与所述有效数据段之间，当所述复位数据段被读取时，指示下一数据段位有效数据段，其中，所述合成数据信号的无效数据段中具有第一脉冲信号及第二脉冲信号，所述第一及第二脉冲信号与所述有效数据段至少具有预设第一时间间隔，且所述第一及第二脉冲信号之间具有第二预设时间间隔；
分解模块，所述分解模块连接所述数据接收模块，以对所述合成数据信号进行分解，以分别得到所述第一及第二脉冲信号；
电压输出控制模块，所述电压数据控制模块连接至所述分解模块，以接收所述第一及第二脉冲信号，以在所述第一脉冲信号的处于第一沿时抓取所述第二脉冲信号的状态，从而根据抓取到的所述第二脉冲信号的状态控制输出的驱动电压的极性。
7.如权利要求6所述的数据驱动芯片，其特征在于，所述分解模块包括第一分解单元及第二分解单元，所述第一及第二分解单元均连接至所述数据接收模块，所述第一分解单元用于对所述合成数据信号进行分解，以得到所述第一脉冲信号，所述第二分解单元用于对所述合成数据信号进行分解，以得到所述第二脉冲信号。
8.如权利要求6所述的数据驱动芯片，其特征在于，所述第一及第二脉冲信号的占空比不同。
9.如权利要求6所述的数据驱动芯片，其特征在于，所述第一脉冲信号为TP信号，所述第二脉冲信号为POL信号。
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