CN104900206A - 一种源极驱动线路板和显示装置 - Google Patents
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Abstract
本发明公开了一种源极驱动线路板和显示装置，以解决现有技术中，阵列基板上的GOA技术的栅极驱动电路的时钟信号线容易被外界静电放电破坏，并导致栅极驱动电路无法正常工作的问题。所述源极驱动线路板，包括布线基板和布设于所述布线基板上的源极驱动电路，还包括用于布设时钟信号线的布线区域，所述布线区域内布设至少一条用于为栅极驱动电路提供时钟信号的时钟信号线；以及，还包括布设于所述布线基板上的至少一个具有防护端和接地端的静电防护单元，所述静电防护单元包括防护端和接地端，所述静电防护单元的防护端耦接于所述时钟信号线。
Description
技术领域
本发明涉及显示技术领域，尤其涉及一种源极驱动线路板和显示装置。
背景技术
液晶显示器(Liquid Crystal Display，LCD)或有机发光二极管(OrganicLight-Emitting Diode,OLED)具有低辐射、体积小及低耗能等优点，已逐渐在部分应用中取代传统的阴极射线管显示器(Cathode Ray Tube display，CRT)，因而被广泛地应用在笔记本电脑、个人数字助理(Personal Digital Assistant，PDA)、平面电视或移动电话等信息产品上。传统液晶显示器的方式是利用外部驱动芯片来驱动面板上的芯片以显示图像，但为了减少元件数目并降低制造成本，近年来逐渐发展成将驱动电路结构直接制作于显示面板上，例如采用将栅极驱动电路(Gate Driver)整合于阵列基板上(Gate On Array，GOA)的技术。
GOA技术相比传统覆晶薄膜(Chip On Flex/Film，COF)和直接绑定在玻璃上(Chip On Glass，COG)的工艺，GOA技术不仅可以节省成本，而且面板可以做到两边对称美观设计，该技术的主要特点是依靠GOA单元连续触发实现其移位寄存的功能，省去了栅极集成电路(Gate IC)芯片的绑定(Bonding)区域以及Fan-out布线空间，利于窄边框的设计；同时由于可以省去Gate方向Bonding的工艺，对产能和良品率提升也比较有利。
GOA技术的栅极驱动电路中，栅极驱动电路由至少一个时钟信号配合触发信号实现阵列基板的栅极驱动，时钟信号是通过连接阵列基板之外的时钟信号源的时钟信号线传输，该时钟信号线位于阵列基板之外的部分很容易受到外界静电放电(Electrostatic Discharge，ESD)的破坏而无法正常传输时钟信号，导致栅极驱动电路无法正常工作。
发明内容
本发明的目的是提供一种源极驱动线路板和显示装置，以解决现有技术中，阵列基板上的GOA技术的栅极驱动电路的时钟信号线容易被外界静电放电破坏，并导致栅极驱动电路无法正常工作的问题。
本发明的目的是通过以下技术方案实现的：
本发明实施例提供一种源极驱动线路板，包括布线基板和布设于所述布线基板上的源极驱动电路，还包括用于布设时钟信号线的布线区域，所述布线区域内布设至少一条用于为栅极驱动电路提供时钟信号的时钟信号线；
以及，还包括布设于所述布线基板上的至少一个具有防护端和接地端的静电防护单元，所述静电防护单元包括防护端和接地端，所述静电防护单元的防护端耦接于所述时钟信号线。
本实施例中，通过在所述源极驱动线路板上设置布线区域，并布设时钟信号线为栅极驱动电路提供时钟信号，使所述源极驱动线路板上的所述静电防护单元为所述时钟信号线提供静电防护，确保所述时钟信号线不会受到静电放电的破坏，从而正常为所述栅极驱动电路提供时钟信号，保证所述栅极驱动电路的正常工作；同时，所述静电防护单元设置于所述源极驱动线路板上，而不改设置于阵列基板的GOA区域，可以减少阵列基板的空间占用，有利于窄边框显示面板的实现。
优选的，至少一个所述静电防护单元的防护端耦接于同一条所述时钟信号线。本实施例中，可以为所述时钟信号线供提供一个所述静电防护单元，也可以提供多个静电防护单元。
优选的，所述静电防护单元包括单向瞬变电压抑制二极管，所述单向瞬变电压抑制二极管的正极端作为所述静电防护单元的防护端，所述单向瞬变电压抑制二极管的负极端作为所述静电防护单元的接地端。本实施例中，以单向瞬变电压抑制二极管作为所述静电防护单元，能够对所述时钟信号线提供正向静电放电时的静电防护。
优选的，所述静电防护单元包括双向瞬变电压抑制二极管，所述双向瞬变电压抑制二极管的两端分别对应所述静电防护单元的防护端和接地端。本实施例中，以双向瞬变电压抑制二极管作为所述静电防护单元，能够对所述时钟信号线提供正向静电放电和负向静电放电时的静电防护。
优选的，所述静电防护单元包括多层压敏电阻，所述多层压敏电阻的两端分别对应所述静电防护单元的防护端和接地端。
优选的，所述静电防护单元包括第一薄膜晶体管和第二薄膜晶体管；
所述第一薄膜晶体管的栅电极和源电极与所述静电防护单元的防护端电连接，所述第一薄膜晶体管的漏电极与所述静电防护单元的接地端电连接；
所述第二薄膜晶体管的栅电极和源电极与所述静电防护单元的接地端电连接，所述第一薄膜晶体管的漏电极与所述静电防护单元的防护端电连接。
优选的，所述第一薄膜晶体管为P型薄膜晶体管，所述第二薄膜晶体管为N型薄膜晶体管。
本发明实施例有益效果如下：通过在所述源极驱动线路板上设置布线区域，并布设时钟信号线为栅极驱动电路提供时钟信号，使所述源极驱动线路板上的所述静电防护单元为所述时钟信号线提供静电防护，确保所述时钟信号线不会受到静电放电的破坏，从而正常为所述栅极驱动电路提供时钟信号，保证所述栅极驱动电路的正常工作；同时，所述静电防护单元设置于所述源极驱动线路板上，而不改设置于阵列基板的GOA区域，可以减少阵列基板的空间占用，有利于窄边框显示面板的实现。
本发明实施例还提供一种显示装置，包括如上实施例提供的所述源极驱动线路板。
优选的，所述显示装置还包括显示面板，所述显示面板包括对盒设置的阵列基板和彩膜基板，所述阵列基板上设置有栅极驱动电路，所述源极驱动线路板上的所述时钟信号线与所述栅极驱动电路的时钟信号输入端电性连接。
本发明实施例有益效果如下：通过在所述源极驱动线路板上设置布线区域，并布设时钟信号线为栅极驱动电路提供时钟信号，使所述源极驱动线路板上的所述静电防护单元为所述时钟信号线提供静电防护，确保所述时钟信号线不会受到静电放电的破坏，从而正常为所述栅极驱动电路提供时钟信号，保证所述栅极驱动电路的正常工作；同时，所述静电防护单元设置于所述源极驱动线路板上，而不改设置于阵列基板的GOA区域，可以减少阵列基板的空间占用，有利于窄边框显示面板的实现。
附图说明
图1为本发明实施例提供的源极驱动线路板的示意图；
图2为本发明实施例提供的第一种静电防护单元及其与时钟信号线连接的示意图；
图3为本发明实施例提供的第二种静电防护单元及其与时钟信号线连接的示意图；
图4为本发明实施例提供的第三种静电防护单元及其与时钟信号线连接的示意图；
图5为本发明实施例提供的第四种静电防护单元及其与时钟信号线连接的示意图。
具体实施方式
下面结合说明书附图对本发明实施例的实现过程进行详细说明。需要注意的是，自始至终相同或类似的标号表示相同或类似的元件或具有相同或类似功能的元件。下面通过参考附图描述的实施例是示例性的，仅用于解释本发明，而不能理解为对本发明的限制。
参见图1，本发明实施例提供一种源极驱动线路板，包括布线基板1和布设于布线基板1上的源极驱动电路2，还包括用于布设时钟信号线的布线区域3，布线区域3内布设至少一条用于为栅极驱动电路提供时钟信号的时钟信号线4；
以及，还包括布设于布线基板1上的至少一个具有防护端51和接地端52的静电防护单元5，静电防护单元5的防护端51耦接于时钟信号线4。
通过在源极驱动线路板上设置布线区域3，并布设时钟信号线4为栅极驱动电路提供时钟信号，使源极驱动线路板上的静电防护单元5为时钟信号线4提供静电防护，确保时钟信号线4不会受到静电放电的破坏，从而正常为栅极驱动电路提供时钟信号，保证栅极驱动电路的正常工作；同时，静电防护单元5设置于源极驱动线路板上，而不改设置于阵列基板的GOA区域，可以减少阵列基板的空间占用，有利于窄边框显示面板的实现。
当然，时钟信号线4可以与静电防护单元5一一对应的耦接，也可以两个或两个以上的静电防护单元5的防护端51耦接于同一条时钟信号线4上。本实施例中，可以为时钟信号线4供提供一个静电防护单元5，也可以提供多个静电防护单元5。
可以以多种器件作为静电防护单元5，详细举例如下：
例如，静电防护单元5包括单向瞬变电压抑制二极管，单向瞬变电压抑制二极管的正极端作为静电防护单元5的防护端51，单向瞬变电压抑制二极管的负极端作为静电防护单元5的接地端52，参见图2所示。本实施例中，以单向瞬变电压抑制二极管作为静电防护单元5，能够对时钟信号线4提供正向静电放电时的静电防护。
又例如，静电防护单元5包括双向瞬变电压抑制二极管，双向瞬变电压抑制二极管的两端分别对应静电防护单元5的防护端51和接地端52，参见图3所示。本实施例中，以双向瞬变电压抑制二极管作为静电防护单元5，能够对时钟信号线4提供正向静电放电和负向静电放电时的静电防护。
又例如，静电防护单元5包括多层压敏电阻，多层压敏电阻的两端分别对应静电防护单元5的防护端51和接地端52，参见图4所示。本实施例中，以多层压敏电阻作为静电防护单元5，能够对时钟信号线4提供正向静电放电的静电防护。
优选的，静电防护单元5包括第一薄膜晶体管M1和第二薄膜晶体管M2；
第一薄膜晶体管M1的栅电极和源电极与静电防护单元5的防护端51电连接，第一薄膜晶体管M1的漏电极与静电防护单元5的接地端52电连接；第二薄膜晶体管M2的栅电极和源电极与静电防护单元5的接地端52电连接，第二薄膜晶体管M2的漏电极与静电防护单元5的防护端51电连接，参见图5。本实施例中，以薄膜晶体管作为静电防护单元5，能够对时钟信号线4提供正向静电放电和负向静电放电时的静电防护。
优选的，第一薄膜晶体管M1为P型薄膜晶体管，第二薄膜晶体管M2为N型薄膜晶体管。
优选的，布线基板1可以是柔性线路板，也可以是印刷线路板，依具体的应用可以灵活选择。
本发明实施例有益效果如下：通过在源极驱动线路板上设置布线区域3，并布设时钟信号线4为栅极驱动电路提供时钟信号，使源极驱动线路板上的静电防护单元5为时钟信号线4提供静电防护，确保时钟信号线4不会受到静电放电的破坏，从而正常为栅极驱动电路提供时钟信号，保证栅极驱动电路的正常工作；同时，静电防护单元5设置于源极驱动线路板上，而不改设置于阵列基板的GOA区域，可以减少阵列基板的空间占用，有利于窄边框显示面板的实现。
本发明实施例还提供一种显示装置，包括如上实施例提供的源极驱动线路板。
优选的，显示装置还包括显示面板，显示面板包括对盒设置的阵列基板和彩膜基板，阵列基板上设置有栅极驱动电路，源极驱动线路板上的时钟信号线与栅极驱动电路的时钟信号输入端电性连接。
本发明实施例有益效果如下：通过在源极驱动线路板上设置布线区域，并布设时钟信号线为栅极驱动电路提供时钟信号，使源极驱动线路板上的静电防护单元为时钟信号线提供静电防护，确保时钟信号线不会受到静电放电的破坏，从而正常为栅极驱动电路提供时钟信号，保证栅极驱动电路的正常工作；同时，静电防护单元设置于源极驱动线路板上，而不改设置于阵列基板的GOA区域，可以减少阵列基板的空间占用，有利于窄边框显示面板的实现。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。
Claims (9)
1.一种源极驱动线路板，包括布线基板和布设于所述布线基板上的源极驱动电路，其特征在于，还包括用于布设时钟信号线的布线区域，所述布线区域内布设至少一条用于为栅极驱动电路提供时钟信号的时钟信号线；
以及，还包括布设于所述布线基板上的至少一个具有防护端和接地端的静电防护单元，所述静电防护单元的防护端耦接于所述时钟信号线。
2.如权利要求1所述的源极驱动线路板，其特征在于，至少一个所述静电防护单元的防护端耦接于同一条所述时钟信号线。
3.如权利要求1或2所述的源极驱动线路板，其特征在于，所述静电防护单元包括单向瞬变电压抑制二极管，所述单向瞬变电压抑制二极管的正极端作为所述静电防护单元的防护端，所述单向瞬变电压抑制二极管的负极端作为所述静电防护单元的接地端。
4.如权利要求1或2所述的源极驱动线路板，其特征在于，所述静电防护单元包括双向瞬变电压抑制二极管，所述双向瞬变电压抑制二极管的两端分别对应所述静电防护单元的防护端和接地端。
5.如权利要求1或2所述的源极驱动线路板，其特征在于，所述静电防护单元包括多层压敏电阻，所述多层压敏电阻的两端分别对应所述静电防护单元的防护端和接地端。
6.如权利要求1或2所述的源极驱动线路板，其特征在于，所述静电防护单元包括第一薄膜晶体管和第二薄膜晶体管；
所述第一薄膜晶体管的栅电极和源电极与所述静电防护单元的防护端电连接，所述第一薄膜晶体管的漏电极与所述静电防护单元的接地端电连接；
所述第二薄膜晶体管的栅电极和源电极与所述静电防护单元的接地端电连接，所述第一薄膜晶体管的漏电极与所述静电防护单元的防护端电连接。
7.如权利要求6所述的源极驱动线路板，其特征在于，所述第一薄膜晶体管为P型薄膜晶体管，所述第二薄膜晶体管为N型薄膜晶体管。
8.一种显示装置，其特征在于，包括如权利要求1至7任一项所述的源极驱动线路板。
9.如权利要求8所述的显示装置，其特征在于，还包括显示面板，所述显示面板包括对盒设置的阵列基板和彩膜基板，所述阵列基板上设置有栅极驱动电路，所述源极驱动线路板上的所述时钟信号线与所述栅极驱动电路的时钟信号输入端电性连接。
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