CN104795043B - 一种阵列基板、液晶显示面板及显示装置 - Google Patents
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Abstract
本发明公开了一种阵列基板、液晶显示面板及显示装置,该阵列基板包括:衬底基板、位于衬底基板上交叉而置且相互绝缘的多条栅线和多条数据线、以及位于衬底基板上用于驱动各栅线的栅极驱动电路;栅极驱动电路位于阵列基板的上边框区域内或下边框区域内,与现有的栅极驱动电路位于阵列基板的左边框区域内和右边框区域内的结构相比,可以使阵列基板实现左右无边框的设计。
Description
技术领域
本发明涉及显示技术领域,尤其涉及一种阵列基板、液晶显示面板及显示装置。
背景技术
在现有的显示装置中,液晶显示器件(LCD,Liquid Crystal Display)具有功耗低、显示质量高、无电磁辐射以及应用范围广等优点,是目前较为重要的显示装置。
目前,窄边框甚至无边框是现有的显示领域的发展趋势。为了使LCD实现窄边框的设计,一般采用将栅极驱动电路整合于LCD的阵列基板上(Gate On Array,GOA)的技术。如图1所示,在阵列基板100上设置有交叉而置且相互绝缘的多条栅线101和多条数据线102,为各栅线101依次加载栅极扫描信号的栅极驱动电路103位于阵列基板100的左右两个边框区域内,将各数据线102与数据驱动电路电性连接的数据线引脚104位于阵列基板100的下边框区域内。然而,集成在阵列基板100上的栅极驱动电路103仍然会占据一定的宽度,制约LCD超窄边框甚至无边框的发展。
因此,如何进一步减小LCD的边框的宽度,是本领域技术人员亟需解决的技术问题。
发明内容
有鉴于此,本发明实施例提供了一种阵列基板、液晶显示面板及显示装置,用以进一步减小LCD的边框的宽度。
因此,本发明实施例提供了一种阵列基板,包括:衬底基板、位于所述衬底基板上交叉而置且相互绝缘的多条栅线和多条数据线、以及位于所述衬底基板上用于驱动各所述栅线的栅极驱动电路;
所述栅极驱动电路位于所述阵列基板的上边框区域内或下边框区域内。
在一种可能的实现方式中,在本发明实施例提供的上述阵列基板中,还包括:与各所述栅线一一对应的多条连接线;
各所述连接线通过过孔仅与对应的所述栅线电性连接;各所述栅线通过对应的所述连接线与所述栅极驱动电路电性连接。
在一种可能的实现方式中,在本发明实施例提供的上述阵列基板中,在所述阵列基板的显示区域内,各所述连接线与各所述数据线相互平行。
在一种可能的实现方式中,在本发明实施例提供的上述阵列基板中,还包括:位于所述衬底基板上呈矩阵排列的多个像素单元;相邻的两条所述栅线和相邻的两条所述数据线限定一个像素单元;
所述连接线位于相邻的两列所述像素单元之间的间隙处。
在一种可能的实现方式中,在本发明实施例提供的上述阵列基板中,还包括:位于所述衬底基板上呈矩阵排列的多个像素单元;每行所述像素单元中相邻的两个所述像素单元分别与位于该行像素单元两侧的所述栅线电性连接;相邻的两列所述像素单元与同一条所述数据线电性连接;
所述连接线位于相邻的两列所述像素单元之间未设置所述数据线的间隙处。
在一种可能的实现方式中,在本发明实施例提供的上述阵列基板中,所述连接线与所述数据线同层设置。
在一种可能的实现方式中,在本发明实施例提供的上述阵列基板中,各所述连接线之间互不重叠。
在一种可能的实现方式中,在本发明实施例提供的上述阵列基板中,沿所述数据线的延伸方向,各所述连接线依次分别与对应的所述栅线电性连接。
在一种可能的实现方式中,在本发明实施例提供的上述阵列基板中,沿所述数据线的延伸方向,各所述过孔依次交错排布。
在一种可能的实现方式中,在本发明实施例提供的上述阵列基板中,还包括:位于所述衬底基板上与各所述数据线一一对应且电性连接的数据线引脚;
各所述数据线引脚和所述栅极驱动电路分别位于所述阵列基板的上边框区域内和下边框区域内;或者,
各所述数据线引脚和所述栅极驱动电路分别位于所述阵列基板的下边框区域内和上边框区域内。
本发明实施例还提供了一种液晶显示面板,包括:本发明实施例提供的上述阵列基板。
本发明实施例还提供了一种显示装置,包括:本发明实施例提供的上述液晶显示面板。
本发明实施例提供的上述阵列基板、液晶显示面板及显示装置,该阵列基板包括:衬底基板、位于衬底基板上交叉而置且相互绝缘的多条栅线和多条数据线、以及位于衬底基板上用于驱动各栅线的栅极驱动电路;栅极驱动电路位于阵列基板的上边框区域内或下边框区域内,与现有的栅极驱动电路位于阵列基板的左边框区域内和右边框区域内的结构相比,可以使阵列基板实现左右无边框的设计。
附图说明
图1为现有的阵列基板的结构示意图;
图2和图3分别为本发明实施例提供的阵列基板的结构示意图。
具体实施方式
下面结合附图,对本发明实施例提供的一种阵列基板、液晶显示面板及显示装置的具体实施方式进行详细地说明。
本发明实施例提供的一种阵列基板,如图2和图3所示,包括:衬底基板1、位于衬底基板1上交叉而置且相互绝缘的多条栅线2和多条数据线3、以及位于衬底基板1上用于驱动各栅线2的栅极驱动电路4;
栅极驱动电路4位于阵列基板的上边框区域内(如图2和图3所示)或下边框区域内。
本发明实施例提供的上述阵列基板,由于将栅极驱动电路设置在阵列基板的上边框区域内或下边框区域内,这样,与现有的栅极驱动电路位于阵列基板的左边框区域内和右边框区域内的结构相比,本发明实施例提供的上述阵列基板可以实现左右无边框的设计。
在具体实施时,在本发明实施例提供的上述阵列基板中,如图2和图3所示,还可以包括:与各栅线2一一对应的多条连接线5;各连接线5通过过孔7仅与对应的栅线2电性连接;各栅线2通过对应的连接线5与栅极驱动电路4电性连接,这样,栅极驱动电路4可以通过连接线5向各栅线2依次加载栅极扫描信号,实现对各栅线2的逐行驱动。
当然,在本发明实施例提供的上述阵列基板中,位于阵列基板的上边框区域内或下边框区域内的栅极驱动电路还可以通过其他类似的方式实现对各栅线依次加载栅极扫描信号,在此不做限定。
在具体实施时,在本发明实施例提供的上述阵列基板中,如图2和图3所示,在阵列基板的显示区域内,各连接线5可以与各数据线3相互平行;或者,各连接线也可以与各数据线交叉设置,此时,为了避免各连接线出现漏光的问题,需要满足各连接线的材料为透明导电材料,例如,氧化铟锡(Indium Tin Oxides,ITO)等。
在具体实施时,在本发明实施例提供的上述阵列基板中,如图2所示,还可以包括:位于衬底基板1上呈矩阵排列的多个像素单元6;每个像素单元6可以包括薄膜晶体管61和像素电极62,其中,薄膜晶体管61的栅极与栅线2电性连接,薄膜晶体管61的源极与数据线3电性连接,薄膜晶体管61的漏极与像素电极62电性连接;相邻的两条栅线2和相邻的两条数据线3限定一个像素单元6;在连接线5的材料为不透明的导电材料例如金属时,可以将连接线5设置于相邻的两列像素单元6之间的间隙处,即将连接线5设置于数据线3所在的相邻的两列像素单元6之间的间隙处,这样,可以避免各连接线5出现漏光的问题。
需要说明的是,在本发明实施例提供的上述阵列基板中,在栅线的数量大于数据线的数量时,连接线的数量与栅线的数量相同,即连接线的数量大于数据线的数量,此时,会出现一条数据线所在的相邻的两列像素单元之间的间隙处设置多条连接线的情况;在栅线的数量小于数据线的数量时,连接线的数量与栅线的数量相同,即连接线的数量小于数据线的数量,此时,可以在一条数据线所在的相邻的两列像素单元之间的间隙处设置一条连接线,并且会出现部分数据线所在间隙处不设置连接线的情况;在栅线的数量等于数据线的数量时,连接线的数量与栅线的数量相同,即连接线的数量等于数据线的数量,此时,可以在每条数据线所在间隙处设置一条连接线。
在具体实施时,在本发明实施例提供的上述阵列基板中,如图3所示,还可以包括:位于衬底基板1上呈矩阵排列的多个像素单元6;每个像素单元6可以包括薄膜晶体管61和像素电极62,其中,薄膜晶体管61的栅极与栅线2电性连接,薄膜晶体管61的源极与数据线3电性连接,薄膜晶体管61的漏极与像素电极62电性连接;每行像素单元6中相邻的两个像素单元6分别与位于该行像素单元6两侧的栅线2电性连接,例如,如图3所示,每行像素单元6中,偶数列的像素单元6分别通过各自的薄膜晶体管61的栅极与位于该行像素单元6上方的栅线2电性连接,奇数列的像素单元6分别通过各自的薄膜晶体管61的栅极与位于该行像素单元6下方的栅线2电性连接;相邻的两列像素单元6与同一条数据线3电性连接,例如,如图3所示,第一列像素单元6和第二列像素单元6均与位于该两列像素单元之间间隙处的数据线3电性连接;在连接线5的材料为不透明的导电材料例如金属时,可以将连接线5设置于相邻的两列像素单元6之间的间隙处,以避免各连接线5出现漏光的问题,进一步地,为了避免连接线5上加载的栅极扫描信号与数据线3上加载的灰阶信号之间相互干扰,如图3所示,可以将连接线5设置于相邻的两列像素单元6之间未设置数据线3的间隙处。
需要说明的是,在本发明实施例提供的上述阵列基板中,在每行像素单元中相邻的两个像素单元分别与位于该行像素单元两侧的栅线电性连接时,并非局限于如图3所示的结构,也可以在每行像素单元中,奇数列的像素单元与位于该行像素单元上方的栅线电性连接,偶数列的像素单元与位于该行像素单元下方的栅线电性连接,在此不做限定。
需要说明的是,在本发明实施例提供的上述阵列基板中,在栅线的数量大于数据线的数量时,由于连接线的数量与栅线的数量相同,相邻两列像素单元之间未设置数据线的间隙(即用于设置连接线的位置)的数量与数据线的数量相当,因此,连接线的数量大于相邻两列像素单元之间未设置数据线的间隙(即用于设置连接线的位置)的数量,此时,会出现一个未设置数据线的间隙处设置多条连接线的情况;在栅线的数量小于数据线的数量时,由于连接线的数量与栅线的数量相同,相邻两列像素单元之间未设置数据线的间隙(即用于设置连接线的位置)的数量与数据线的数量相当,因此,连接线的数量小于相邻两列像素单元之间未设置数据线的间隙(即用于设置连接线的位置)的数量,此时,可以在一个未设置数据线的间隙处设置一条连接线,并且会出现部分未设置数据线的间隙处不设置连接线的情况;在栅线的数量等于数据线的数量时,由于连接线的数量与栅线的数量相同,相邻两列像素单元之间未设置数据线的间隙(即用于设置连接线的位置)的数量与数据线的数量相当,因此,连接线的数量与相邻两列像素单元之间未设置数据线的间隙(即用于设置连接线的位置)的数量相当,此时,可以在一个未设置数据线的间隙处设置一条连接线。
较佳地,为了简化阵列基板的制作工艺,降低阵列基板的制作成本,在本发明实施例提供的上述阵列基板中,可以将各连接线与各数据线同层设置,即各连接线与各数据线位于同一膜层且两者材质相同,各连接线所在膜层与各栅线所在膜层之间具有绝缘层,各连接线通过贯穿该绝缘层的过孔仅与对应的栅线电性连接。
在具体实施时,在本发明实施例提供的上述阵列基板中,如图2和图3所示,各连接线5之间互不重叠,这样,可以避免各连接线5之间发生短路的问题。
较佳地,为了简化制作工艺,在本发明实施例提供的上述阵列基板中,如图2和图3所示,沿着数据线3的延伸方向,各连接线5依次分别与对应的栅线2电性连接,即第一条连接线与第一条栅线电性连接,第二条连接线与第二条栅线电性连接,以此类推。
最佳地,为了进一步地简化制作工艺,在本发明实施例提供的上述阵列基板中,如图2和图3所示,沿着数据线3的延伸方向,各过孔7依次交错排布。
当然,在本发明实施例提供的上述阵列基板中,各连接线与对应的栅线实现电性连接并非局限于如图2和图3所示的结构,还可以为其他可以将各连接线与对应的栅线电性连接的类似结构,在此不做限定。
在具体实施时,在本发明实施例提供的上述阵列基板中,如图2和图3所示,还可以包括:位于衬底基板1上与各数据线3一一对应且电性连接的数据线引脚8,各数据线3通过对应的数据线引脚8与数据驱动电路电性连接;可以将各数据线引脚和栅极驱动电路分别设置于阵列基板的上边框区域内和下边框区域内;或者,如图2和图3所示,也可以将各数据线引脚8和栅极驱动电路4分别设置于阵列基板的下边框区域内和上边框区域内,即栅极驱动电路4位于阵列基板的上边框区域内,各数据线引脚8位于阵列基板的下边框区域内,这样,可以避免各数据线引脚8和栅极驱动电路4之间发生短路的问题。
基于同一发明构思,本发明实施例还提供了一种液晶显示面板,包括本发明实施例提供的上述阵列基板,该液晶显示面板的实施可以参见上述阵列基板的实施例,重复之处不再赘述。
基于同一发明构思,本发明实施例还提供了一种显示装置,包括本发明实施例提供的上述液晶显示面板,该显示装置可以为:手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。该显示装置的实施可以参见上述液晶显示面板的实施例,重复之处不再赘述。
本发明实施例提供的一种阵列基板、液晶显示面板及显示装置,该阵列基板包括:衬底基板、位于衬底基板上交叉而置且相互绝缘的多条栅线和多条数据线、以及位于衬底基板上用于驱动各栅线的栅极驱动电路;栅极驱动电路位于阵列基板的上边框区域内或下边框区域内,与现有的栅极驱动电路位于阵列基板的左边框区域内和右边框区域内的结构相比,可以使阵列基板实现左右无边框的设计。
显然,本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样,倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内,则本发明也意图包含这些改动和变型在内。
Claims (11)
1.一种阵列基板,包括:衬底基板、位于所述衬底基板上交叉而置且相互绝缘的多条栅线和多条数据线、以及位于所述衬底基板上用于驱动各所述栅线的栅极驱动电路;其特征在于:
所述栅极驱动电路位于所述阵列基板的上边框区域内或下边框区域内;
还包括:与各所述栅线一一对应的多条连接线;各所述连接线通过过孔仅与对应的所述栅线电性连接;各所述栅线通过对应的所述连接线与所述栅极驱动电路电性连接;位于所述衬底基板上呈矩阵排列的多个像素单元;与一行像素单元的栅线连接的所有连接线位于相邻的两列所述像素单元之间的同一间隙处。
2.如权利要求1所述的阵列基板,其特征在于,在所述阵列基板的显示区域内,各所述连接线与各所述数据线相互平行。
3.如权利要求2所述的阵列基板,其特征在于,还包括:位于所述衬底基板上呈矩阵排列的多个像素单元;相邻的两条所述栅线和相邻的两条所述数据线限定一个像素单元;
所述连接线位于相邻的两列所述像素单元之间的间隙处。
4.如权利要求2所述的阵列基板,其特征在于,还包括:位于所述衬底基板上呈矩阵排列的多个像素单元;每行所述像素单元中相邻的两个所述像素单元分别与位于该行像素单元两侧的所述栅线电性连接;相邻的两列所述像素单元与同一条所述数据线电性连接;
所述连接线位于相邻的两列所述像素单元之间未设置所述数据线的间隙处。
5.如权利要求1-4任一项所述的阵列基板,其特征在于,所述连接线与所述数据线同层设置。
6.如权利要求5所述的阵列基板,其特征在于,各所述连接线之间互不重叠。
7.如权利要求6所述的阵列基板,其特征在于,沿所述数据线的延伸方向,各所述连接线依次分别与对应的所述栅线电性连接。
8.如权利要求7所述的阵列基板,其特征在于,沿所述数据线的延伸方向,各所述过孔依次交错排布。
9.如权利要求1-4任一项所述的阵列基板,其特征在于,还包括:位于所述衬底基板上与各所述数据线一一对应且电性连接的数据线引脚;
各所述数据线引脚和所述栅极驱动电路分别位于所述阵列基板的上边框区域内和下边框区域内;或者,
各所述数据线引脚和所述栅极驱动电路分别位于所述阵列基板的下边框区域内和上边框区域内。
10.一种液晶显示面板,其特征在于,包括:如权利要求1-9任一项所述的阵列基板。
11.一种显示装置,其特征在于,包括:如权利要求10所述的液晶显示面板。
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