CN104779196A - 一种集成电路及其金属层间介质层平坦化的方法 - Google Patents
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Abstract
本发明实施例涉及半导体制造领域,尤其涉及一种集成电路及其金属层间介质层平坦化的方法,以解决现有技术中对旋转涂布玻璃层进行回刻,造成金属层间介质层的表面平坦化效果较差,影响集成电路可靠性的问题。本发明实施例提供了一种集成电路及其金属层间介质层平坦化的方法,由于对两层SOG层分别进行离子固化处理,避免了两层SOG层厚度固化不完全,导致集成电路出现断层的问题,并且本发明实施例中不需要对第二层SOG层进行回刻处理,也就避免了由于刻蚀速度不同导致的金属层间介质层的表面平坦化程度恶化的问题,提高了金属层间介质层表面的平坦化效果,也增强了集成电路的可靠性。
Description
技术领域
本发明涉及半导体制造领域,尤其涉及一种集成电路及其金属层间介质层平坦化的方法。
背景技术
在集成电路的制造工艺中,金属层间介质层置于器件和互联金属层之间,作为使器件免受杂质粒子污染的保护层。随着CMOS(Complementary MetalOxide Semiconductor,互补金属氧化物半导体)器件特征尺寸越来越小,集成电路规模迅速提升,金属连线的层数不断增加,金属连线之间的间隙也越来越窄,对金属层间介质层的平坦化要求也越来越高。
现有技术中金属层间介质层的平坦化的方法包括:在含有金属连线的晶圆表面沉积二氧化硅层;在二氧化硅层表面涂覆第一旋转涂布玻璃SOG层;对含有第一SOG层的集成电路半成品进行热处理,使第一SOG层中的溶剂挥发;在热处理后的第一SOG层上涂覆第二SOG层;对含有第二SOG层的集成电路半成品进行热处理,使第二SOG层中的溶剂挥发;对热处理后的第二SOG层进行回刻处理;对回刻处理后的集成电路半成品进行离子注入处理,使旋转涂布玻璃SOG层固化;在固化的SOG层表面采用等离子化学气相沉积的方法沉积第二二氧化硅层,形成金属层间介质层。如图1所示为现有技术形成的金属层间介质层,其中101为介质层,102为金属连线。
上述金属层间介质层平坦化方法中,利用旋转涂布玻璃的回流性能,弥补金属连线之间产生的台阶,使金属层间介质层趋于平坦,但是由于离子注入固化SOG层时,其固化的厚度有限,因此SOG层的厚度不能过厚,否则会造成SOG层固化不完全,容易导致集成电路出现断层等问题。因此现有技术中采用对SOG层进行回刻处理,进而降低SOG层的厚度,使离子注入处理后SOG层能够完全固化;但由于对SOG层进行热处理时,金属连线处和金属连线之间的SOG层厚度不同,对应的SOG层的干燥程度也不相同,进而进行回刻处理时,SOG层的刻蚀速度也不相同,造成金属层间介质层的表面平坦化程度恶化,影响集成电路的可靠性。
发明内容
本发明实施例提供一种集成电路及其金属层间介质层平坦化的方法,以解决现有技术中金属层间介质层的表面平坦化效果较差,影响集成电路可靠性的问题。
本发明实施例提供了一种集成电路的金属层间介质层平坦化的方法,该方法包括:
在含有金属连线的晶圆表面沉积第一层二氧化硅层;
在所述第一层二氧化硅层表面涂覆第一旋转涂布玻璃SOG层,并对第一SOG层进行热处理;
对所述第一SOG层进行离子注入处理,形成第一固化SOG层;
在所述第一固化SOG层表面涂覆第二SOG层,并对第二SOG层进行热处理;
对所述第二SOG层进行离子注入处理,形成第二固化SOG层;
在所述第二固化SOG层表面沉积第二层二氧化硅层。
上述实施例中由于对第一SOG层和第二SOG层分别进行离子固化处理,避免了两层SOG层厚度过厚固化不完全,导致集成电路出现断层的问题,并且本发明实施例中不需要对第二SOG层进行回刻处理,也就避免了由于刻蚀速度不同导致的金属层间介质层的表面平坦化程度恶化的问题,提高了金属层间介质层表面的平坦化效果,也增强了集成电路的可靠性。
进一步的本发明实施例还包括对SOG层进行热处理之后,进行离子注入处理之前,还包括:
对热处理后的集成电路半成品进行冷却处理,将所述集成电路半成品冷却至室温。
所述冷却处理包括:空冷和/或采用冷却设备进行冷却。
由于热处理后集成电路半成品的温度较高,直接进行离子注入处理,操作温度较高,存在安全隐患,将集成电路半成品冷却至室温后,提高了离子注入处理的易操作性和安全性。
本发明实施例中所述离子注入处理,具体包括:
通过离子注入设备将氩气或砷注入SOG层,使SOG层固化;其中离子注入能量为70千电子伏~200千电子伏。
通过离子注入设备分别对两层SOG层进行离子注入处理,使两层SOG层固化,避免由于SOG层未固化造成集成电路断层的问题。
本发明实施例还包括所述热处理的温度范围为350℃~450℃,热处理时间范围为30min~90min。
对SOG层进行热处理的主要目的是去除旋转涂布玻璃中的溶剂形成多孔二氧化硅,当进行离子注入处理时,能够获得良好的固化效果,本发明实施例中由于分别对两层SOG层进行固化处理,因此可以适当降低对SOG层进行热处理的温度和热处理的时间。
本发明实施例还包括所述第一SOG层与所述第二SOG层的旋转涂布玻璃的厚度范围均为
本发明实施例中由于分别对两层SOG层进行固化处理,故每层SOG层能够完全固化,因此可使适当提高每层SOG层的厚度,进而利用SOG良好的回流性能,提高金属层间介质层的表面的平坦化的效果。
本发明实施例还包括所述第一层二氧化硅层的厚度为
本发明实施例还提供了一种集成电路,该集成电路包括上述任意一种方法获得的金属层间介质层。
本发明实施例提供了一种集成电路及其金属层间介质层平坦化的方法,该方法包括:在含有金属连线的晶圆表面沉积第一层二氧化硅层;在第一层二氧化硅层表面涂覆第一旋转涂布玻璃SOG层,并对第一SOG层进行热处理;对第一SOG层进行离子注入处理,形成第一固化SOG层;在第一固化SOG层表面涂覆第二SOG层,并对第二SOG层进行热处理;对第二SOG层进行离子注入处理,形成第二固化SOG层;在第二固化SOG层表面沉积第二层二氧化硅层。由于对第一SOG层和第二SOG层分别进行离子固化处理,避免了两层SOG层厚度固化不完全,导致集成电路出现断层的问题,并且本发明实施例中不需要对第二SOG层进行回刻处理,也就避免了由于刻蚀速度不同导致的金属层间介质层的表面平坦化程度恶化的问题,提高了金属层间介质层表面的平坦化效果,也增强了集成电路的可靠性。
附图说明
图1为背景技术中形成的金属层间介质层的示意图;
图2为本发明实施例中一种集成电路的金属层间介质层平坦化的方法的流程示意图;
图3为本发明实施例中集成电路的金属层间介质层平坦化的方法的实施例一的流程示意图;
图4为本发明实施例中晶圆表面沉积第一层二氧化硅层后的结构示意图;
图5为本发明实施例中晶圆表面形成第一固化SOG层后的结构示意图;
图6为本发明实施例中晶圆表面形成第二固化SOG层后的结构示意图;
图7为本发明实施例中金属层间介质层的结构示意图;
图8为本发明实施例中集成电路的金属层间介质层平坦化的方法的实施例二的流程示意图。
具体实施方式
本发明实施例提供了一种集成电路及其金属层间介质层平坦化的方法,以解决现有技术中对旋转涂布玻璃进行回刻处理时,由于刻蚀速度导致的金属层间介质层的表面平坦化程度恶化,影响集成电路可靠性的问题。
下面结合说明书附图进行进一步说明。
如图2所示为本发明实施例中一种集成电路的金属层间介质层平坦化的方法,该方法包括:
步骤201:在含有金属连线的晶圆表面沉积第一层二氧化硅层;
步骤202:在第一层二氧化硅层表面涂覆第一旋转涂布玻璃SOG层,并对含有第一SOG层的集成电路半成品进行热处理;
步骤203:对第一SOG层进行离子注入处理,形成第一固化SOG层;
步骤204:在第一固化SOG层表面涂覆第二SOG层,并对含有第二SOG层的集成电路半成品进行热处理;
步骤205:对第二SOG层进行离子注入处理,形成第二固化SOG层;
步骤206:在第一固化SOG层表面涂覆第二SOG层,并对第二SOG层进行热处理。
其中步骤201中在含有金属连线的晶圆表面沉积第一层二氧化硅层,具体包括:采用等离子化学气相沉积CVD的方法在含有金属连线的晶圆表面沉积第一层二氧化硅层,第一层二氧化硅层的厚度在本发明实施例中包括但不限于采用CVD沉积二氧化硅层,其他沉积二氧化硅层的方法同样适用于本发明,在此不再一一赘述。
步骤202中第一SOG层的厚度范围在由于分别对每层SOG层进行离子注入处理,使SOG层固化,避免了由于SOG层固化不完全导致的集成电路断层的问题,因此可以适当增加SOG层的厚度,利用旋转涂布玻璃良好的回流性,提高金属层间介质层的平坦化效果。
步骤202中对第一SOG层进行热处理时,热处理温度在350℃~450℃之间,热处理时间在30min~90min之间,其中热处理温度与SOG层的厚度相关,在SOG层厚度相同的条件下,热处理温度越高,热处理时间越短。其中涂覆的旋转涂布玻璃是液态溶液,热处理的主要目的是除去旋转涂布玻璃中的溶剂形成多孔二氧化硅,便于后续对SOG层进行固化处理,由于分别对每层SOG层进行固化处理,热处理后剩余的溶剂量对离子注入处理后的SOG层的固化程度的影响就会降低,因此可以根据需要适当降低热处理温度,减少热处理时间。
较佳的,步骤202中还包括:对热处理后的集成电路半成品进行冷却处理,将集成电路半成品冷却至室温。冷却处理包括:空冷和/或采用冷却设备进行冷却。将集成电路半成品放置在空气中进行冷却,冷却至室温,和/或借助冷却设备采用循环风冷的方式将集成电路半成品冷却至室温。由于热处理后集成电路半成品的温度较高,直接进行离子注入处理,操作温度较高,存在安全隐患,将集成电路半成品冷却至室温后,提高了离子注入处理的易操作性和安全性。
步骤203中对第一SOG层进行离子注入处理,形成第一固化SOG层具体包括:通过离子注入设备将氩气或砷注入到第一SOG层,注入能量为70KEV(千电子伏)~200KEV。由于旋转涂布玻璃溶液热处理以后的主要成分是二氧化硅,对第一SOG层进行离子注入处理后,第一SOG层由疏松多孔的二氧化硅层转变为致密非晶化的二氧化硅层,形成第一固化SOG层;第一固化SOG层相比于第一SOG层收缩20%左右。
步骤204中在第一固化SOG层表面涂覆第二SOG层,第二SOG层的厚度在之间。由于旋转涂布玻璃SOG良好的回流性能,能够对由金属连线产生的台阶产生良好的覆盖性能,金属连线位置处的SOG厚度较小,金属连线之间的SOG厚度较大,因此涂覆第二SOG层后,晶圆表面已经趋于平坦化。
步骤204中对第二SOG层进行热处理的温度在350℃~450℃之间,热处理时间在30min~90min之间,热处理温度越高,热处理时间越短。
步骤204中还包括:对热处理后的集成电路半成品进行冷却处理,将集成电路半成品冷却至室温。冷却处理包括:空冷和/或采用冷却设备进行冷却。
步骤205中通过离子注入设备将氩气或砷注入到第二SOG层,注入能量为70KEV(千电子伏)~200KEV。由于旋转涂布玻璃溶液的主要成分是二氧化硅,对第二SOG层进行离子注入处理后,第二SOG层由疏松多孔的二氧化硅层转变为致密非晶化的二氧化硅层,形成第二固化SOG层。
由于分别对两层SOG层进行离子注入处理,使SOG层固化,避免了由于SOG层固化不完全造成的集成电路断层的问题;并且由于分别对两层SOG层进行离子注入处理,能够完全将两层SOG层固化,也就不需要对第二SOG层进行回刻处理,提高了金属层间介质层的平坦化效果,也提高了集成电路的可靠性。
步骤206中在第二固化SOG层表面沉积第二层二氧化硅层的厚度在之间。
如图3所示,为本发明实施例中集成电路的金属层间介质层平坦化的方法的实施例一,该方法包括:
步骤301:在含有金属连线的晶圆表面沉积第一层厚度为的二氧化硅层;如图4所示本发明实施例中晶圆表面沉积第一层二氧化硅层后的结构示意图,其中401为第一层二氧化硅层,402为金属连线;
步骤302:在第一层二氧化硅层表面涂覆第一SOG层,第一SOG层的厚度为
步骤303:对第一SOG层进行热处理,其中热处理温度为350℃,热处理时间为30min;
步骤304:对热处理后的集成电路半成品进行冷却处理,将集成电路半成品冷却至室温;
步骤305:通过离子注入设备将氩气离子注入第一SOG层,注入能量为70KEV,形成第一固化SOG层;如图5所示为本发明实施例中晶圆表面形成第一固化SOG层后的结构示意图,其中501为第一SOG层;
步骤306:在第一固化SOG层表面涂覆第二SOG层,第二SOG层的厚度为
步骤307:对第二SOG层进行热处理,其中热处理温度为450℃,热处理时间为90min;
步骤308:对热处理后的集成电路半成品进行冷却处理,将集成电路半成品冷却至室温;
步骤309:通过离子注入设备将氩气离子注入第二SOG层,注入能量为200KEV,形成第二固化SOG层;如图6所示为本发明实施例中晶圆表面形成第二固化SOG层后的结构示意图,其中601为第二SOG层;
步骤310:在第二固化SOG层表面沉积第二层二氧化硅层,第二层二氧化硅层的厚度为图7所示为本发明实施例中金属层间介质层的结构示意图,其中701为第二层二氧化硅层。
如图8所示,为本发明实施例中集成电路的金属层间介质层平坦化的方法的实施例二,该方法包括:
步骤801:在含有金属连线的晶圆表面沉积第一层厚度为的二氧化硅层;
步骤802:在第一层二氧化硅层表面涂覆第一SOG层,第一SOG层的厚度为
步骤803:对第一SOG层进行热处理,其中热处理温度为375℃,热处理时间为45min;
步骤804:对热处理后的集成电路半成品进行冷却处理,将集成电路半成品冷却至室温;
步骤805:通过离子注入设备将氩气离子注入第一SOG层,注入能量为120KEV,形成第一固化SOG层;
步骤806:在第一固化SOG层表面涂覆第二SOG层,第二SOG层的厚度为
步骤807:对第二SOG层进行热处理,其中热处理温度为425℃,热处理时间为60min;
步骤808:对热处理后的集成电路半成品进行冷却处理,将集成电路半成品冷却至室温;
步骤809:通过离子注入设备将氩气离子注入第二SOG层,注入能量为150KEV,形成第二固化SOG层;
步骤810:在第二固化SOG层表面沉积第二层二氧化硅层,第二层二氧化硅层的厚度为
本发明实施例中热处理的温度受SOG层的厚度,SOG溶液的浓度等因素影响,因此热处理的温度以及时间长度根据实际需要进行确定,热处理的温度范围在350℃~450℃之间,热处理的时间在30min~90min之间。
对SOG层进行离子注入处理时,注入能量根据SOG层的厚度以及剩余的溶剂量进行确定,注入能量范围在70KEV~200KEV之间。
本发明实施例还提供了一种集成电路,该集成电路中的金属层间介质层根据本发明实施例中任一一种金属层间介质层平坦化的方法获得,在此不再赘述。
显然,本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样,倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内,则本发明也意图包含这些改动和变型在内。
Claims (8)
1.一种集成电路的金属层间介质层平坦化的方法,其特征在于,该方法包括:
在含有金属连线的晶圆表面沉积第一层二氧化硅层;
在所述第一层二氧化硅层表面涂覆第一旋转涂布玻璃SOG层,并对含有第一SOG层的集成电路半成品进行热处理;
对所述第一SOG层进行离子注入处理,形成第一固化SOG层;
在所述第一固化SOG层表面涂覆第二SOG层,并对含有第二SOG层的集成电路半成品进行热处理;
对所述第二SOG层进行离子注入处理,形成第二固化SOG层;
在所述第二固化SOG层表面沉积第二层二氧化硅层。
2.如权利要求1所述的方法,其特征在于,对SOG层进行热处理之后,进行离子注入处理之前,还包括:
对热处理后的集成电路半成品进行冷却处理,将所述集成电路半成品冷却至室温。
3.如权利要求2所述的方法,其特征在于,所述冷却处理包括:
空冷和/或采用冷却设备进行冷却。
4.如权利要求1所述的方法,其特征在于,所述离子注入处理,具体包括:
通过离子注入设备将氩气或砷注入SOG层,使SOG层固化;其中离子注入能量为70千电子伏~200千电子伏。
5.如权利要求1所述的方法,其特征在于,所述热处理的温度范围为350℃~450℃,热处理时间范围为30min~90min。
6.如权利要求1所述的方法,其特征在于,所述第一SOG层与所述二SOG层的旋转涂布玻璃的厚度范围均为
7.如权利要求1所述的方法,其特征在于,所述第一层二氧化硅层的厚度为
8.一种集成电路,其特征在于,所述集成电路含有权利要求1~7任一所述的方法获得的金属层间介质层。
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Cited By (1)
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---|---|---|---|---|
CN108470715A (zh) * | 2018-04-04 | 2018-08-31 | 华越微电子有限公司 | 一种双层布线平坦化加工工艺 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN1189243A (zh) * | 1995-05-08 | 1998-07-29 | 联合讯号公司 | 使用电子束辐照固化旋涂玻璃膜的方法 |
US20010055873A1 (en) * | 1998-05-29 | 2001-12-27 | Hiroyuki Watanabe | Semiconductor device and fabrication method thereof |
CN1423327A (zh) * | 2001-12-07 | 2003-06-11 | 三洋电机株式会社 | 半导体器件和其制造方法 |
US6831015B1 (en) * | 1996-08-30 | 2004-12-14 | Sanyo Electric Co., Ltd. | Fabrication method of semiconductor device and abrasive liquid used therein |
-
2014
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Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN1189243A (zh) * | 1995-05-08 | 1998-07-29 | 联合讯号公司 | 使用电子束辐照固化旋涂玻璃膜的方法 |
US6831015B1 (en) * | 1996-08-30 | 2004-12-14 | Sanyo Electric Co., Ltd. | Fabrication method of semiconductor device and abrasive liquid used therein |
US20010055873A1 (en) * | 1998-05-29 | 2001-12-27 | Hiroyuki Watanabe | Semiconductor device and fabrication method thereof |
CN1423327A (zh) * | 2001-12-07 | 2003-06-11 | 三洋电机株式会社 | 半导体器件和其制造方法 |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN108470715A (zh) * | 2018-04-04 | 2018-08-31 | 华越微电子有限公司 | 一种双层布线平坦化加工工艺 |
CN108470715B (zh) * | 2018-04-04 | 2020-08-28 | 华越微电子有限公司 | 一种双层布线平坦化加工工艺 |
Also Published As
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