CN104378172B - 数据信道干扰抵消的方法和系统 - Google Patents
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Abstract
本发明公开了一种数据信道干扰抵消的方法，包括：对接收到的传输块数据进行比特级信道重编码，再对所述编码后数据和复用的数据信道的天线数据进行信道估计，得到信道估计数据；利用所述信道估计数据将编码后数据以重构单元为单位进行数据信道重构；将得到的重构后数据与天线数据相减完成干扰抵消。本发明同时还公开了一种数据信道干扰抵消的系统，应用本发明的技术方案，能实现对数据信道干扰抵消整个处理流程的优化，从而提高了抵消效率和资源利用率。
Description
技术领域
本发明涉及通信领域中干扰抵消技术，尤其涉及一种宽带码分多址（Wide-bandCode Division Multiple Access，WCDMA）中数据信道干扰抵消的方法和系统。
背景技术
WCDMA技术是不同用户在同一时间以相同的频点进行传播，而不同用户的区分依靠不同的编码实现；具体的，对每个信道用正交可变扩频子码（Orthogonal VariableSpreading Factor（codes），OVSF）进行扩频，并用扰码进行加扰，只要OVSF码和扰码中有一个不同就可以区分相同频带和时隙内的不同信道。
多址干扰（Multiple Access Interference，MAI）是由于码的非正交性所导致的接收端无法完全消除其他用户干扰的现象；而且，用户越多，MAI越严重。如果通过某些途径正确解调出若干信道的信息比特，生成该若干信道的波形，此波形对于其它尚未解调用户来说就是干扰；那么，相应的，从总的接收波形中将干扰减掉，再对干净的信号进行解调或重解，就能获得更精确的结果，删除干扰以及重新解调的过程就称为干扰抵消。
目前，数据信道干扰抵消的相关技术仅基于干扰抵消的局部实现，如：仅涉及实现干扰抵消中的重构装置，或者仅涉及干扰抵消算法的改进，或者仅涉及干扰抵消在某方面的应用，并没有涉及对信道重编码、信道估计、信道重构整个流程的相关研究。
发明内容
有鉴于此，本发明的主要目的在于提供一种数据信道干扰抵消的方法和系统，能实现对数据信道干扰抵消整个处理流程的优化，从而提高抵消效率和资源利用率。
为达到上述目的，本发明的技术方案是这样实现的：
本发明提供了一种数据信道干扰抵消的方法，所述方法包括：
对接收到的传输块数据进行比特级信道重编码，再对所述编码后数据和复用的数据信道的天线数据进行信道估计，得到信道估计数据；
利用所述信道估计数据将编码后数据以重构单元为单位进行数据信道重构；
将得到的重构后数据与天线数据相减完成干扰抵消。
上述方案中，所述方法还包括：向构成天线对的天线下发不同的频偏参数。
上述方案中，所述进行数据信道重构为：根据径能量优先选择能量较大的径进行重构。
上述方案中，所述比特级信道重编码包括：
采用Turbo编码方式对接收到的传输块数据进行编码，得到Turbo编码数据；对Turbo编码数据执行第一次FIFO缓存；对第一次缓存的数据进行速率匹配后执行第二次FIFO缓存；对第二次缓存的数据进行比特收集后执行第三次FIFO缓存；对第三次缓存的数据进行二次交织处理，并输出重编码后数据和交织地址。
上述方案中，所述二次交织处理包括：
先对交织图样做行列变换，计算出当前编码后数据应该存储的交织地址；
输出比特收集后的数据，并将所述数据按照计算好的存储地址写入RAM；
在需要所述交织后的数据时，顺序读取RAM中存储的数据实现交织。
上述方案中，所述对所述编码后数据和复用的数据信道的天线数据进行信道估计包括：
接收数据包参数，收到数据包参数后申请天线数据；对获得的天线数据进行天线数据码片级处理后执行天线数据符号级处理；并行输出处理后的数据信道天线数据和控制信道天线数据；对所述数据信道天线数据做实时数据信道滤波处理；
接收到一个完整的数据包后，启动控制信道幅度偏移估计，开始执行控制信道的幅度偏移估计；计算出控制信道幅度偏移后，将数据信道滤波结果读出做截位处理得到数据信道的信道估计值，将得到的信道估计值与控制信道幅度偏移相乘得到控制信道的信道估计值。
上述方案中，所述数据信道重构发生重构冲突时，所述方法还包括：
滤波后数据经过滤波数据分支处理后分两路输出当前用户数据和前一用户数据，相邻两用户数据的时间延迟间隔等于数据冲突窗长度；
对所述当前用户数据、所述前一用户数据和原始重构数据进行累加、溢出、截位处理运算获得重构运算结果数据；
对所述重构运算结果数据进行存储，每个用户占用一个地址段空间，按系统时间的先后顺序，重构RAM地址依次递增。
上述方案中，对所述重构RAM进行读写控制包括：
根据当前重构数据对应的系统时间及用户偏移，到重构RAM对应位置读取相应的原始重构数据；然后对重构RAM的读出数据进行重构运算，并将更新后的重构数据输送至重构RAM相应的位置，更新旧的重构结果数据。
本发明还提供了一种数据信道干扰抵消的系统，所述系统包括：控制模块、比特级信道重编码模块、基于数据信道的信道估计模块、数据信道重构模块；其中，
控制模块，用于负责控制各个功能的执行模块，在需要时触发启动比特级信道重编码模块、基于数据信道的信道估计模块、数据信道重构模块；
所述比特级信道重编码模块，用于对接收到的传输块数据进行比特级信道重编码，并将得到的编码后数据发送给基于数据信道的信道估计模块和数据信道重构模块；
所述基于数据信道的信道估计模块，用于对所述编码后数据和复用的数据信道的天线数据进行信道估计，并将得到的信道估计数据发送给数据信道重构模块；
所述数据信道重构模块，用于利用所述信道估计数据将所述编码后数据以重构单元为单位进行数据信道重构，并将得到的重构后数据与天线数据相减完成干扰抵消。
上述方案中，所述控制模块，还用于向构成天线对的天线下发不同的频偏参数。
上述方案中，所述数据信道重构模块进行数据信道重构为：所述数据信道重构模块根据径能量优先选择能量较大的径进行重构。
上述方案中，所述比特级信道重编码模块包括：Turbo编码模块、多个FIFO缓存、速率匹配模块、比特收集模块、二次交织模块；
所述Turbo编码模块，用于采用Turbo编码方式对接收到的传输块数据进行编码，得到Turbo编码数据；
所述多个FIFO缓存，用于缓存Turbo编码数据、缓存速率匹配后数据以及缓存比特收集后数据；
所述速率匹配模块，用于将每个比特与传输信道进行匹配，确认是重复还是打孔；
所述比特收集模块，用于收集编码后的比特数据；
所述二次交织模块，用于对接收到FIFO缓存数据进行二次交织处理，并输出重编码后数据和交织地址。
上述方案中，所述比特级信道重编码模块中的二次交织模块，用于先对交织图样做行列变换，预先计算出当前编码后数据应该存储的交织地址，一边输出比特收集后的数据，一边将该数据按照计算好的存储地址写进RAM，在需要该交织后的数据时，通过顺序读RAM实现交织。
上述方案中，所述基于数据信道的信道估计模块包括：天线数据码片级处理模块、天线数据符号级处理模块、数据信道滤波模块和控制信道幅度偏移估计模块；其中，
所述天线数据码片级处理模块，用于接收数据包参数，收到数据包参数后申请天线数据，对所述天线数据进行天线数据码片级处理后发送至天线数据符号级处理模块；
所述天线数据符号级处理模块，用于对所述天线数据码片级处理模块处理后的数据进行符号级处理，并行输出处理后的数据信道天线数据和控制信道天线数据；
所述数据信道滤波模块，用于对所述数据信道天线数据做实时数据信道滤波处理；
所述控制信道幅度偏移估计模块，用于接收到一个完整的数据包后，启动控制信道幅度偏移估计，开始执行控制信道的幅度偏移估计，计算出控制信道幅度偏移后，将数据信道滤波结果读出做截位处理得到数据信道的信道估计值，将其与控制信道幅度偏移相乘得到控制信道的信道估计值。
上述方案中，所述数据信道重构模块包括重构累加模块，所述重构累加模块包括：滤波数据分支处理模块、重构运算处理模块、重构数据存储模块，其中，
所述滤波数据分支处理模块，用于接收滤波后数据，然后分两路输出当前用户数据和前一用户数据，相邻两用户数据的时间延迟间隔等于数据冲突窗长度；
所述重构运算处理模块，用于执行重构运算，具体为，对所述当前用户数据、所述前一用户数据和原始重构数据进行累加、溢出、截位处理运算获得重构运算结果数据；
所述重构数据存储模块，用于存放所述重构运算结果数据，每个用户占用一个地址段空间，按系统时间的先后顺序，重构RAM地址依次递增。
上述方案中，所述重构累加模块还包括重构数据读写控制模块，用于对重构RAM进行读写控制；
所述对重构RAM进行读写控制包括：根据当前重构数据对应的系统时间及其用户偏移，到重构RAM对应位置读取相应的原始重构数据；然后对重构RAM的读出数据进行重构运算，并将更新后的重构数据输送至重构RAM相应的位置，更新旧的重构结果数据。
本发明实施例提供的数据信道干扰抵消的方法和系统，涉及到WCDMA上行专用数据信道干扰抵消中包括比特级信道重编码、基于数据信道的信道估计、数据信道重构的整个干扰抵消流程；其中，比特级信道重编码过程采用全流水方式，使编码效率达到理论最优值；
基于数据信道的信道估计过程采用基于数据信道的天线数据计算信道估计值，通过复用数据信道的天线数据进行信道估计，从而能提高无线资源的利用率，并能更准确的反映信道状况，提高计算精度；
数据信道重构过程采用合理大小的重构单元（Reconstruction Unit，RU）为单位进行重构处理，重构完一个RU就可以直接进行干扰抵消，无需等待，如此，可大大提高抵消效率；并且，由于构成天线对的天线具有不同的频偏参数，天线对中的两个天线可以分离，因此，信道重构过程松绑了对天线对的限制，使得布置天线的顺序可以随意，不必成对；信道重构过程根据径能量优先选择能量较大的径进行重构，对小于规定的能量径不进行重构，这样，不仅能扩展应用场景并提高重构抵消效益，还能提高硬件资源利用率；信道重构过程采用一种在保持最大性能的情况下，降低控制复杂度和芯片面积成本消耗的方法，能解决重构运算中相邻用户数据发生的数据冲突问题，从而使得天线重构的顺序可以自由安排，这里的天线数据可以认为是多个单用户能量波形的累加和；
此外，比特级信道重编码、基于数据信道的信道估计、数据信道重构三个阶段均采用高效时分复用核心运算单元，进一步提高资源利用率、降低了成本。
附图说明
图1为本发明实施例中数据信道干扰抵消方法的处理流程示意图；
图2为本发明实施例中比特级信道重编码处理流程示意图；
图3为本发明实施例中二次交织处理流程示意图；
图4为本发明实施例中基于数据信道的信道估计处理流程示意图；
图5为本发明实施例中数据信道重构处理流程示意图；
图6为本发明实施例中解决重构冲突处理流程示意图；
图7为本发明实施例中数据信道干扰抵消系统的组成结构示意图；
图8为本发明实施例中比特级信道重编码模块结构示意图；
图9为本发明实施例中基于数据信道的信道估计模块结构示意图；
图10为本发明实施例中数据信道重构模块结构示意图；
图11为本发明实施例中解决重构冲突的重构累加模块结构示意图。
具体实施方式
本发明实施例的基本思想是：向构成天线对的天线下发不同的频偏参数，以重构单元为单位对数据信道进行重构；之后将得到的重构后数据与天线数据相减完成干扰抵消。
其中，所述对数据信道进行重构是根据径能量优先选择能量较大的径进行重构。
进一步的，在信道编码时采用全流水的比特级信道重编码，在信道估计时采用基于数据信道的天线数据计算信道估计值，通过复用数据信道的天线数据进行信道估计。
下面结合附图及具体实施例对本发明再作进一步详细的说明。
图1为本发明实施例中数据信道干扰抵消方法的处理流程示意图，如图1所示，本发明实施例数据信道干扰抵消方法包括以下步骤：
步骤101：对接收到的传输块数据进行比特级信道重编码，再对所述编码后数据和复用的数据信道的天线数据进行信道估计，得到信道估计数据；
其中，具体如何完成比特级信道重编码属于现有技术，在此不再赘述。
这里，所述复用的数据信道的天线数据由外部输入；所述数据信道主要是增强型专用信道（Enhanced Dedicated Channel，E-DCH），包括：增强型专用物理数据信道（Enhanced Dedicated Physical Data Channel，EDPDCH）和增强型专用物理控制信道（Enhanced Dedicated Physical Control Channel，EDPCCH）。
步骤102：利用所述信道估计数据将编码后数据以重构单元为单位进行数据信道重构；
本步骤中，所述进行数据信道重构是根据径能量优先选择能量较大的径进行重构。
本发明实施例中，由于会向构成天线对的天线下发不同的频偏参数，因此，一组天线对中的单个天线可以分属于不同的小区，而不像现有技术中一组天线对必须限制在特定的小区；也就是说，本发明实施例中的一组天线对中的两个天线可以实现分离，从而松绑了对天线对的限制、天线可以自由布置；
本发明实施例中，数据信道重构以RU为单位进行重构，而不像现有技术中以用户为单位进行重构；其中，所谓RU为一定时间内的所有用户数据；
对于多个用户组中的多个用户而言，先对一个用户组中的每个用户的第一个RU进行重构，重构完一个用户的第一个RU接着处理下一个用户的第一个RU，直到重构完当前用户组的所有第一个RU，此时重构完一个RU后就可以直接进行干扰抵消，无需等待；随后继续处理该用户组中每个用户的第二个RU，直到处理完当前用户组的所有用户的所有RU，再处理下一个用户组；这样，重构完一个RU就可以直接进行干扰抵消，无需等待，避免了现有技术传统实现方法中按用户为单位进行重构处理时，多个用户共用一段天线数据所导致的低抵消效率。
本发明实施例中，数据信道重构是根据径能量优先选择能量较大的径进行重构，对小于规定的能量径不进行重构，这样，可提高重构抵消效益和硬件资源利用率。
步骤103：将得到的重构后数据与天线数据相减完成干扰抵消。
图1所示的处理流程中，还可以包括：向构成天线对的天线下发不同的频偏参数。
这里，所述天线数据由外部输入。
图2为本发明实施例中比特级信道重编码处理流程示意图，如图2所示，本发明实施例的比特级信道重编码处理流程包括以下步骤：
步骤201：对接收到的传输块数据进行Turbo编码后执行第一次FIFO缓存；
步骤202：对步骤201中缓存的数据进行速率匹配后执行第二次FIFO缓存；
步骤203：对步骤202中缓存的数据进行比特收集后执行第三次FIFO缓存；
步骤204：对步骤203中缓存的数据进行二次交织处理，并输出重编码后数据和交织地址。
本发明实施例中，步骤201～步骤203的三次FIFO缓存过程，均利用FIFO的空满信号做流水控制，具体为利用FIFO的空满信号做缓存写入和读出的流水控制；
上述处理过程可以看出，比特级信道编码主要分为Turbo编码、速率匹配、比特收集、二次交织四个处理阶段，本发明实施例中，各个处理阶段内部均采用完全流水操作，如此，可提高编码速率、减少编码延时。
进一步的，在Turbo编码和速率匹配之间、速率匹配和Bit收集之间、比特收集和二次交织之间均采用FIFO缓存，用FIFO的空满信号作为流水控制信号，以提高前后级模块之间的耦合度，使整个比特级信道编码可以实现全流水。
图3为本发明实施例中二次交织处理流程示意图，如图3所示，本发明实施例二次交织处理流程包括以下步骤：
步骤301：对交织图样做行列变换，计算出当前编码后数据应存储的交织地址；
这里，所述交织图样是已有的。
步骤302：输出比特收集后的数据，并将该数据按计算好的存储地址写入随机存储器（Random Access Memory，RAM）；
这里，按计算好的存储地址写入RAM是指：写地址为交织计算后的存储地址，按bit为单位按顺序写入；所述RAM位于完成二次交织处理的模块中。
步骤303：在需要该交织后的数据时，顺序读取RAM中存储的数据实现交织；
这里，顺序读RAM为：读地址顺序递增，以32bit为单位读出。
图4为本发明实施例中基于数据信道的信道估计处理流程示意图，如图4所示，本发明实施例基于数据信道的信道估计处理流程包括以下步骤：
步骤401：接收数据包参数，收到数据包参数后申请天线数据；
这里，进行信道估计处理的模块从自身的上游模块接收各种数据包参数，收到后会再向自身的上游模块申请相关的天线数据。
步骤402：对获得的天线数据进行天线数据码片级处理，之后执行天线数据符号级处理；
这里，所述天线数据码片（chip）级处理是指，根据解扰解扩的采样编号，计算天线数据对应的上采样样本点；然后将计算出来的样本点进行解扰解扩，由于数据信道与控制信道的扩频因子不同，所以天线数据经过解扰解扩后分成数据信道和控制信道二路；
所述符号级处理是指，将码片级处理后输出的1chip天线数据经过逐级累加到256chip；累加完成后，先将输出的1chip天线数据累加到2chip做去极性处理；再将其累加到32chip做频偏补偿，最后将其累加到256chip做归一化处理，完成整个符号级处理过程，其中数据信道与控制信道并行处理。
本发明实施例中，直接利用数据信道的天线数据来计算数据信道的信道估计值，能更准确的反映信道状况，提高计算精度。
步骤403：并行输出处理后的数据信道天线数据和控制信道天线数据；
步骤404：对步骤403中的数据信道天线数据做实时数据信道滤波处理；
步骤405：接收到一个完整的数据包后，启动控制信道幅度偏移估计，开始执行控制信道的幅度偏移估计；
步骤406：计算出控制信道幅度偏移后，将数据信道滤波结果读出做截位处理得到数据信道的信道估计值，将得到的信道估计值与控制信道幅度偏移相乘得到控制信道的信道估计值。
本发明实施例中，步骤401～步骤403的处理过程在实际应用中属于前处理过程；步骤404～步骤406的处理过程在实际应用中属于后处理过程。
图5为本发明实施例中数据信道重构处理流程示意图，如图5所示，本发明实施例数据信道重构处理流程包括以下步骤：
步骤501：对信道估计数据进行频偏补偿处理，建立滤波系数，得到待滤波数据；
步骤502：对编码后数据依次进行扩频加扰、桶形位移处理，得到待滤波数据；
步骤503：对步骤501和步骤502得到的待滤波数据进行RC滤波处理；
步骤504：对步骤503中的滤波数据进行重构累加，将得到的重构后数据送到下游同天线数据相减完成干扰抵消流程。
在步骤504的重构累加过程中，如果相邻用户同时向RAM中的同一地址写入数据，就会出现数据冲突问题，本发明实施例中采用一种在保持最大性能的情况下，降低控制复杂度和芯片面积成本消耗的方法，来解决重构运算中相邻用户数据发生的数据冲突问题，具体处理流程如图6所示。
图6为本发明实施例中解决重构冲突处理流程示意图，如图6所示，本发明实施例解决重构冲突处理流程包括以下步骤：
步骤601：滤波后数据经过滤波数据分支处理后分两路输出当前用户数据和前一用户数据，相邻两用户数据的时间延迟间隔等于数据冲突窗长度；
步骤602：对当前用户数据、前一用户数据和原始重构数据进行累加、溢出、截位处理获得重构运算结果数据；
这里，由于要执行相邻用户并行运算，输入的用户数据有时可能是两路，包括当前用户数据和前一用户数据，再加上原始重构数据，运算单元要支持三路输入加法运算。
步骤603：对步骤602中获得的重构运算结果数据进行存储，每个用户占用一个地址段空间，按系统时间的先后顺序，重构RAM地址依次递增；
步骤604：对步骤603中的重构RAM进行读写控制，根据当前重构数据对应的系统时间及其用户偏移，到重构RAM对应位置读取相应的原始重构数据，然后对重构RAM的读出数据进行重构运算，并将更新后的重构数据输送至重构RAM相应的位置，更新旧的重构结果数据。
其中，步骤604中，所述对重构RAM的读出数据进行重构运算即为对原始重构数据进行重构运算，所述更新后的重构数据输即为重构运算的输出结果。
图7为本发明实施例中数据信道干扰抵消系统的组成结构示意图，如图7所示，本发明数据信道干扰抵消系统包括：控制模块71、比特级信道重编码模块72、基于数据信道的信道估计模块73、数据信道重构模块74；其中，
控制模块71，用于负责控制各个功能的执行模块，在需要时触发启动比特级信道重编码模块72、基于数据信道的信道估计模块73、数据信道重构模块74执行相应操作；
所述比特级信道重编码模块72，用于对接收到的传输块数据进行比特级信道重编码，并将得到的编码后数据发送给基于数据信道的信道估计模块73和数据信道重构模块74；
所述基于数据信道的信道估计模块73，用于对所述编码后数据和复用的数据信道的天线数据进行信道估计，并将得到的信道估计数据发送给数据信道重构模块74；
所述数据信道重构模块74，用于利用所述信道估计数据将所述编码后数据以重构单元为单位进行数据信道重构，并将得到的重构后数据与天线数据相减完成干扰抵消；
其中，所述进行数据信道重构是控制模块71控制所述数据信道重构模块74根据径能量优先选择能量较大的径进行重构。
本发明实施例中，所述控制模块71，还用于向构成天线对的天线下发不同的频偏参数。
图8为本发明实施例中比特级信道重编码模块结构示意图，如图8所示，本发明比特级信道重编码模块72包括：Turbo编码模块81、多个FIFO缓存82、速率匹配模块83、比特收集模块84、二次交织模块85；其中，
Turbo编码模块81，用于采用Turbo编码方式对接收到的传输块数据进行编码得到Turbo编码数据；
多个FIFO缓存82，用于缓存Turbo编码数据、缓存速率匹配后数据以及缓存比特收集后数据；这里，FIFO缓存82是利用FIFO的空满信号做流水控制；
速率匹配模块83，用于将每个比特与传输信道进行匹配，确认是重复还是打孔；
比特收集模块84，用于收集编码后的比特数据；
二次交织模块85，用于对接收到FIFO缓存数据进行二次交织处理，并输出重编码后数据和交织地址；
二次交织模块85在二次交织处理过程中实现的具体功能包括：先对交织图样做行列变换，预先计算出当前编码后数据应该存储的交织地址，一边输出比特收集后的数据，一边将该数据按照计算好的存储地址写进RAM，在需要该交织后的数据时，通过顺序读RAM实现交织。
Turbo编码模块81、速率匹配模块83、比特收集模块84、二次交织模块85在各自模块内部，采用完全流水操作；
多个FIFO缓存82分别设置于Turbo编码模块81和速率匹配模块83之间、速率匹配模块83和比特收集模块84之间、比特收集模块84和二次交织模块85之间；所述FIFO缓存82，采用FIFO的空满信号作流水控制，提高前后级模块之间的耦合度，使整个比特级编码实现全流水；
本发明实施例中，所述Turbo编码模块81在实际应用中，可采用Turbo编码器实现；二次交织模块85在实际应用中，可采用交织器实现；速率匹配模块83、比特收集模块84在实际应用中，可采用CPU、DSP、或FPGA等实现。
图9为本发明实施例中基于数据信道的信道估计模块结构示意图，基于数据信道的信道估计模块73主要是通过复用数据信道的天线数据计算信道估计值，如图9所示，本发明基于数据信道的信道估计模块系统包括：天线数据码片级处理模块91、天线数据符号级处理模块92、数据信道滤波模块93和控制信道幅度偏移估计模块94；其中，天线数据码片级处理模块91和天线数据符号级处理模块92构成前处理模块，数据信道滤波模块93和控制信道幅度偏移估计模块94构成后处理模块；
天线数据码片级处理模块91，用于接收数据包参数，收到数据包参数后申请天线数据，对所述天线数据进行天线数据码片级处理，并将处理后数据发送至天线数据符号级处理模块92；
天线数据符号级处理模块92，用于接收天线数据码片级处理模块91发来的数据并对数据进行符号级处理，并行输出处理后的数据信道天线数据和控制信道天线数据；
数据信道滤波模块93，用于对前处理模块输出的数据信道天线数据做实时滤波处理；
控制信道幅度偏移估计模块94，用于前处理模块处理完一个完整的数据包后，控制信道幅度偏移估计模块94开始执行控制信道的幅度偏移估计，计算出控制信道幅度偏移后，将数据信道滤波模块的滤波结果读出做截位处理得到数据信道的信道估计值，将其与控制信道幅度偏移相乘得到控制信道的信道估计值。
图10为本发明实施例中数据信道重构模块结构示意图，如图10所示，本发明数据信道重构模块结构包括：频偏补偿模块1001、扩频加扰模块1002、桶形移位模块1003、RC滤波模块1004和重构累加模块1005；其中，
频偏补偿模块1001，用于对信道估计数据进行频偏补偿处理，建立滤波系数，得到待滤波数据；
扩频加扰模块1002，用于对编码后数据进行扩频加扰处理；
桶形移位模块1003，用于对扩频加扰模块1002处理后的数据进行桶位移处理，得到待滤波数据；
RC滤波模块1004，用于对频偏补偿模块1001和桶形移位模块1003产生的待滤波数据进行RC滤波处理得到滤波数据；
重构累加模块1005，用于对RC滤波模块1004产生的滤波数据进行重构累加，将得到的重构后数据送到下游同天线数据相减完成干扰抵消流程。
图11为本发明实施例中解决重构冲突的重构累加模块结构示意图，重构累加模块1005，针对相邻用户同时向RAM中的同一地址写入数据时产生的数据冲突问题，在解决重构冲突中采用一种在保持最大性能的情况下，降低控制复杂度和芯片面积成本消耗的方法，如图11所示，本发明解决重构冲突的重构累加模块1005包括：滤波数据分支处理模块111、重构运算处理模块112、重构数据存储模块113、重构数据读写控制模块114；其中，
滤波数据分支处理模块111，用于接收滤波后数据，然后分两路输出当前用户数据和前一用户数据，相邻两用户数据的时间延迟间隔等于数据冲突窗长度；
重构运算处理模块112，用于执行重构运算，具体为，对所述当前用户数据、所述前一用户数据和原始重构数据进行累加、溢出、截位处理等相关运算获得重构运算结果数据；
重构数据存储模块113，用于存放所述重构运算结果数据，每个用户占用一个地址段空间，按系统时间的先后顺序，重构RAM地址依次递增；
重构数据读写控制模块114，用于对重构RAM进行读写控制；
其中，所述对重构RAM进行读写控制包括：根据当前重构数据对应的系统时间及其用户偏移，到重构RAM对应位置读取相应的原始重构数据，然后对重构RAM的读出数据进行重构运算，并将更新后的重构数据输送至重构RAM相应的位置，更新旧的重构结果数据；所述对重构RAM的读出数据进行重构运算即为对原始重构数据进行重构运算，所述更新后的重构数据输即为重构运算的输出结果。
以上所述，仅为本发明的较佳实施例而已，并非用于限定本发明的保护范围。
Claims (16)
1.一种数据信道干扰抵消的方法，其特征在于，所述方法包括：
对接收到的传输块数据进行比特级信道重编码，再对编码后数据和复用的数据信道的天线数据进行信道估计，得到信道估计数据；
利用所述信道估计数据将编码后数据以重构单元为单位进行数据信道重构；
将得到的重构后数据与天线数据相减完成干扰抵消。
2.根据权利要求1所述的方法，其特征在于，所述方法还包括：向构成天线对的天线下发不同的频偏参数。
3.根据权利要求1所述的方法，其特征在于，所述进行数据信道重构为：根据径能量优先选择能量较大的径进行重构。
4.根据权利要求1所述的方法，其特征在于，所述比特级信道重编码包括：
采用Turbo编码方式对接收到的传输块数据进行编码，得到Turbo编码数据；对Turbo编码数据执行第一次FIFO缓存；对第一次缓存的数据进行速率匹配后执行第二次FIFO缓存；对第二次缓存的数据进行比特收集后执行第三次FIFO缓存；对第三次缓存的数据进行二次交织处理，并输出重编码后数据和交织地址。
5.根据权利要求4所述的方法，其特征在于，所述二次交织处理包括：
先对交织图样做行列变换，计算出当前编码后数据应该存储的交织地址；
输出比特收集后的数据，并将所述数据按照计算好的存储地址写入RAM；
在需要交织后的数据时，顺序读取RAM中存储的数据实现交织。
6.根据权利要求1所述的方法，其特征在于，所述对所述编码后数据和复用的数据信道的天线数据进行信道估计包括：
接收数据包参数，收到数据包参数后申请天线数据；对获得的天线数据进行天线数据码片级处理后执行天线数据符号级处理；并行输出处理后的数据信道天线数据和控制信道天线数据；对所述数据信道天线数据做实时数据信道滤波处理；
接收到一个完整的数据包后，启动控制信道幅度偏移估计，开始执行控制信道的幅度偏移估计；计算出控制信道幅度偏移后，将数据信道滤波结果读出做截位处理得到数据信道的信道估计值，将得到的信道估计值与控制信道幅度偏移相乘得到控制信道的信道估计值。
7.根据权利要求1所述的方法，其特征在于，所述数据信道重构发生重构冲突时，所述方法还包括：
滤波后数据经过滤波数据分支处理后分两路输出当前用户数据和前一用户数据，相邻两用户数据的时间延迟间隔等于数据冲突窗长度；
对所述当前用户数据、所述前一用户数据和原始重构数据进行累加、溢出、截位处理运算获得重构运算结果数据；
对所述重构运算结果数据进行存储，每个用户占用一个地址段空间，按系统时间的先后顺序，重构RAM地址依次递增。
8.根据权利要求7所述的方法，其特征在于，对所述重构RAM进行读写控制，包括：
根据当前重构数据对应的系统时间及用户偏移，到重构RAM对应位置读取相应的原始重构数据；然后对重构RAM的读出数据进行重构运算，并将更新后的重构数据输送至重构RAM相应的位置，更新旧的重构结果数据。
9.一种数据信道干扰抵消的系统，其特征在于，所述系统包括：控制模块、比特级信道重编码模块、基于数据信道的信道估计模块、数据信道重构模块；其中，
控制模块，用于负责控制各个功能的执行模块，在需要时触发启动比特级信道重编码模块、基于数据信道的信道估计模块、数据信道重构模块；
所述比特级信道重编码模块，用于对接收到的传输块数据进行比特级信道重编码，并将得到的编码后数据发送给基于数据信道的信道估计模块和数据信道重构模块；
所述基于数据信道的信道估计模块，用于对所述编码后数据和复用的数据信道的天线数据进行信道估计，并将得到的信道估计数据发送给数据信道重构模块；
所述数据信道重构模块，用于利用所述信道估计数据将所述编码后数据以重构单元为单位进行数据信道重构，并将得到的重构后数据与天线数据相减完成干扰抵消。
10.根据权利要求9所述的系统，其特征在于，所述控制模块，还用于向构成天线对的天线下发不同的频偏参数。
11.根据权利要求9所述的系统，其特征在于，所述数据信道重构模块进行数据信道重构为：所述数据信道重构模块根据径能量优先选择能量较大的径进行重构。
12.根据权利要求9所述的系统，其特征在于，所述比特级信道重编码模块包括：Turbo编码模块、多个FIFO缓存、速率匹配模块、比特收集模块、二次交织模块；
所述Turbo编码模块，用于采用Turbo编码方式对接收到的传输块数据进行编码，得到Turbo编码数据；
所述多个FIFO缓存，用于缓存Turbo编码数据、缓存速率匹配后数据以及缓存比特收集后数据；
所述速率匹配模块，用于将每个比特与传输信道进行匹配，确认是重复还是打孔；
所述比特收集模块，用于收集编码后的比特数据；
所述二次交织模块，用于对接收到FIFO缓存数据进行二次交织处理，并输出重编码后数据和交织地址。
13.根据权利要求12所述的系统，其特征在于，所述比特级信道重编码模块中的二次交织模块，用于先对交织图样做行列变换，预先计算出当前编码后数据应该存储的交织地址，一边输出比特收集后的数据，一边将该数据按照计算好的存储地址写进RAM，在需要交织后的数据时，通过顺序读RAM实现交织。
14.根据权利要求9所述的系统，其特征在于，所述基于数据信道的信道估计模块包括：天线数据码片级处理模块、天线数据符号级处理模块、数据信道滤波模块和控制信道幅度偏移估计模块；其中，
所述天线数据码片级处理模块，用于接收数据包参数，收到数据包参数后申请天线数据，对所述天线数据进行天线数据码片级处理后发送至天线数据符号级处理模块；
所述天线数据符号级处理模块，用于对所述天线数据码片级处理模块处理后的数据进行符号级处理，并行输出处理后的数据信道天线数据和控制信道天线数据；
所述数据信道滤波模块，用于对所述数据信道天线数据做实时数据信道滤波处理；
所述控制信道幅度偏移估计模块，用于接收到一个完整的数据包后，启动控制信道幅度偏移估计，开始执行控制信道的幅度偏移估计，计算出控制信道幅度偏移后，将数据信道滤波结果读出做截位处理得到数据信道的信道估计值，将其与控制信道幅度偏移相乘得到控制信道的信道估计值。
15.根据权利要求9所述的系统，其特征在于，所述数据信道重构模块包括重构累加模块，所述重构累加模块包括：滤波数据分支处理模块、重构运算处理模块、重构数据存储模块，其中，
所述滤波数据分支处理模块，用于接收滤波后数据，然后分两路输出当前用户数据和前一用户数据，相邻两用户数据的时间延迟间隔等于数据冲突窗长度；
所述重构运算处理模块，用于执行重构运算，具体为，对所述当前用户数据、所述前一用户数据和原始重构数据进行累加、溢出、截位处理运算获得重构运算结果数据；
所述重构数据存储模块，用于存放所述重构运算结果数据，每个用户占用一个地址段空间，按系统时间的先后顺序，重构RAM地址依次递增。
16.根据权利要求15所述的系统，其特征在于，所述重构累加模块还包括重构数据读写控制模块，用于对重构RAM进行读写控制；
所述对重构RAM进行读写控制包括：根据当前重构数据对应的系统时间及其用户偏移，到重构RAM对应位置读取相应的原始重构数据；然后对重构RAM的读出数据进行重构运算，并将更新后的重构数据输送至重构RAM相应的位置，更新旧的重构结果数据。
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