CN104360933B - 一种记录板卡累计上电时间的装置 - Google Patents
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Abstract
本发明实施例提供的一种记录板卡累计上电时间的装置,包括与外部电源相连接的晶振模块,用于产生输入振荡频率;与晶振模块相连的处理模块,所述处理模块用于获取所述输入振荡频率,将所述输入振荡频率整数倍增加得到工作频率;利用所述工作频率进行计数计时,得到计时数据,并累加存储模块中存储的计时数据,得到当前的计时数据,并写入所述存储模块。可见,本发明实施例提供的一种记录板卡累计上电时间的装置,能记录板卡的上电时间,当外部电源掉电后,不能记录板卡的掉电时间。
Description
技术领域
本发明涉及嵌入式技术领域,更具体地说,涉及一种记录板卡累计上电时间的装置。
背景技术
在实际工程应用中,往往通过统计设备的累计运行时间,评估设备的性能和整体使用寿命和各个关键零部件的使用寿命和故障率。市面上成熟的时钟芯片一般是记录基本输入输出系统时间,板卡掉电后,配合备用电池继续走,同时继续计时,所以记录的是板卡的上电时间和掉电时间,无法区分出上电时间。
由于现阶段的工程应用中,成熟的时钟芯片不能记录板卡的上电时间,如何记录板卡的上电时间成为需要解决的问题。
发明内容
本发明的目的在于提供一种记录板卡累计上电时间的装置,能够实现记录板卡的累计上电时间。
为实现上述目的,本发明实施例提供了如下技术方案:
一种记录板卡累计上电时间的装置,包括:
与外部电源相连接的晶振模块,用于产生输入振荡频率;
与所述晶振模块相连的处理模块,所述处理模块还连接有存储模块,所述处理模块用于获取所述输入振荡频率,将所述输入振荡频率整数倍增加得到工作频率;利用所述工作频率进行计数计时,得到计时数据,并累加存储模块中存储的计时数据,得到当前的计时数据,并写入所述存储模块;
所述存储模块用于存储计时数据。
优选的,所述晶振模块与所述处理模块的全局时钟输入管脚相连。
优选的,所述存储模块与所述处理模块的串行外设接口总线相连。
优选的,所述处理模块利用所述工作频率进行计数计时,得到计时数据,并累加存储模块中存储的计时数据,得到当前的计时数据时,具体用于:
所述处理模块利用所述工作频率进行计数计时,得到计时数据;从所述存储模块当前存储页中提取计时数据,比较所述提取到的计时数据,将所述计时数据中的最大值累加所述处理模块得到的计时数据后写入所述存储模块的下一页。
优选地,所述处理模块从所述存储模块当前存储页中提取计时数据之后,还用于校验所述提取到的计时数据;
其中,所述比较所述提取到的计时数据,将所述计时数据中的最大值累加所述处理模块得到的计时数据后写入所述存储模块的下一页包括:
比较通过校验后的计时数据,将所述通过校验后的计时数据中的最大值累加所述处理模块得到的计时数据,并添加校验码后写入所述存储模块的下一页。
优选的,所述存储模块为用户可更改的只读存储器。
优选的,所述晶振模块为50MHz的晶振模块。
通过以上方案可知,本发明实施例提供的一种记录板卡累计上电时间的装置,包括与外部电源相连接的晶振模块,用于产生输入振荡频率;与晶振模块相连的处理模块,所述处理模块用于获取所述输入振荡频率,将所述输入振荡频率整数倍增加得到工作频率;利用所述工作频率进行计数计时,得到计时数据,并累加存储模块中存储的计时数据,得到当前的计时数据,并写入所述存储模块。可见,本发明实施例提供的一种记录板卡累计上电时间的装置,能记录板卡的上电时间,当外部电源掉电后,不能记录板卡的掉电时间。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为本发明实施例公开的一种记录板卡累计上电时间的装置的结构示意图;
图2为本发明实施例公开的处理模块的结构示意图。
具体实施方式
下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本发明一部分实施例,而不是全部的实施例。基于本发明中的实施例,本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例,都属于本发明保护的范围。
本发明实施例公开了一种记录板卡累计上电时间的装置,能够实现记录板卡的累计上电时间。
参见图1,本发明实施例提供的记录板卡累计上电时间的装置包括:
与外部电源相连接的晶振模块101,用于产生输入振荡频率;
与晶振模块101相连的处理模块102,处理模块102还连接有存储模块103,处理模块102用于获取所述输入振荡频率,将所述输入振荡频率整数倍增加得到工作频率;利用所述工作频率进行计数计时,得到计时数据,并累加存储模块中存储的计时数据,得到当前的计时数据,并写入存储模块103;
存储模块103用于存储计时数据。
具体的,晶振模块101、处理器模块102及存储模块103均是通过外部电源供电进行工作,当外部电源掉电时,所述装置停止工作,使本装置只能记录板卡的上电时间,不能记录板卡的掉电时间。
具体的,处理模块102可采用FPGA(Field-Programmable Gate Array,现场可编程门阵列),如图2所示,所述FPGA包含倍频单元201、计时单元202和寄存器单元203。处理模块102从晶振模块101获得输入振荡频率,经过倍频单元201整数倍增加得到工作频率,计时单元202利用工作频率进行计时,并把数据写入存储模块103。
本发明实施例提供的一种记录板卡累计上电时间的装置,包括与外部电源相连接的晶振模块,用于产生输入振荡频率;与晶振模块相连的处理模块,所述处理模块用于获取所述输入振荡频率,将所述输入振荡频率整数倍增加得到工作频率;利用所述工作频率进行计数计时,得到计时数据,并累加存储模块中存储的计时数据,得到当前的计时数据,并写入所述存储模块。可见,本发明实施例提供的一种记录板卡累计上电时间的装置,能记录板卡的上电时间,当外部电源掉电后,不能记录板卡的掉电时间。
为了使处理模块102获得输入振荡频率,进行计时工作,本装置的晶振模块101与处理模块102是通过全局时钟输入管脚相连。
具体的,晶振模块101产生输入振荡频率,可以通过FPGA的全局时钟输入管脚把振荡频率传给处理模块102FPGA的倍频单元201。
其中,FPGA的全局输入时钟管脚驱动能力比较强,并且,为了将计时数据存入存储模块103,本装置的存储模块103与处理模块102是通过串行外设接口总线相连。
具体的,只读存储器采用串行外设接口总线(SPI:Serial Peripheral Interface总线),寿命达到一百万次擦写次数,按每分钟记录一次,单页可以支持记录超过一万六千小时时间,8页轮循擦写可支持记录十二万八千小时,可远远满足实际需求。
优选地,在本发明的另一实施例中,处理模块102利用所述工作频率进行计数计时,得到计时数据,并累加存储模块中存储的计时数据,得到当前的计时数据时,具体用于:
处理模块102利用所述工作频率进行计数计时,得到计时数据;从所述存储模块当前存储页中提取计时数据,比较所述提取到的计时数据,将所述计时数据中的最大值累加所述处理模块得到的计时数据后写入所述存储模块的下一页。
具体的,处理模块102采用工作频率进行计数计时,得到计数的个数,将计数的个数和工作频率的乘积得到计时数据,即步进时间,并将该计时数据存入存储模块的一页。之后,处理模块102获取存储模块的当前存储页中的计时数据,比较得到值最大的计时数据,再累加处理模块102采用工作频率进行计数计时得到的计时数据(一般可以为1分钟),得到新的计时数据,将其写入存储模块中的下一页,以此类推,重复上述过程。
为了防止存储模块103在存储数据时出现数据错误,导致计时数据不准确,本发明另一实施例公开的记录板卡累计上电时间的装置中,所述处理模块102从所述存储模块当前存储页中提取计时数据之后,还用于:采用循环冗余校验方法校验所述提取到的计时数据。
其中,循环冗余校验(CRC:Cyclical Redundancy Check):是数据通信领域中最常用的一种差错校验码,其特征是信息字段和校验字段的长度可以任意选定,是一种数据传输检错功能,对数据进行多项式计算,并将得到的结果附在帧的后面,接收设备也执行类似的算法,以保证数据传输的正确性和完整性。
具体的,所述处理模块从所述存储模块当前存储页中提取计时数据,采用循环冗余校验方法校验所述提取到的计时数据,较通过校验后的计时数据,将所述通过校验后的计时数据中的最大值累加所述处理模块得到的计时数
据,并添加校验码后写入所述存储模块的一页。
以上实施例中,存储模块103为用户可更改的只读存储器。
其中,用户可更改的只读存储器(EEPROM:Electrically Erasable ProgrammableRead-Only Memory),可通过高于普通电压的作用来擦除和重写,不需从计算机中取出即可修改。
在以上实施例涉及到的晶振模块101产生的输入振荡频率为50MHz。
具体的,处理模块102获取晶振模块101产生的50MHz的输入振荡频率,通过处理模块102的倍频单元201整数倍增加得到100MHz的工作频率,并利用100MHz的工作频率对上电时间进行计时,得到计时数据。
本说明书中各个实施例采用递进的方式描述,每个实施例重点说明的都是与其他实施例的不同之处,各个实施例之间相同相似部分互相参见即可。
对所公开的实施例的上述说明,使本领域专业技术人员能够实现或使用本发明。对这些实施例的多种修改对本领域的专业技术人员来说将是显而易见的,本文中所定义的一般原理可以在不脱离本发明的精神或范围的情况下,在其它实施例中实现。因此,本发明将不会被限制于本文所示的这些实施例,而是要符合与本文所公开的原理和新颖特点相一致的最宽的范围。
Claims (6)
1.一种记录板卡累计上电时间的装置,其特征在于,包括:
与外部电源相连接的晶振模块,用于产生输入振荡频率;当外部电源掉电时,所述装置停止工作,使所述装置只能记录板卡的上电时间,不能记录板卡的掉电时间;
与所述晶振模块相连的处理模块,所述处理模块为FPGA,所述处理模块还连接有存储模块,所述处理模块用于获取所述输入振荡频率,将所述输入振荡频率整数倍增加得到工作频率;利用所述工作频率进行计数计时,得到计时数据,并累加存储模块中存储的计时数据,得到当前的计时数据,并写入所述存储模块;
所述存储模块用于存储计时数据;
所述处理模块利用所述工作频率进行计数计时,得到计时数据,并累加存储模块中存储的计时数据,得到当前的计时数据时,具体用于:
所述处理模块利用所述工作频率进行计数计时,得到计时数据;从所述存储模块当前存储页中提取计时数据,比较所述提取到的计时数据,将所述计时数据中的最大值累加所述处理模块得到的计时数据后写入所述存储模块的下一页。
2.根据权利要求1所述的装置,其特征在于,所述晶振模块与所述处理模块的全局时钟输入管脚相连。
3.根据权利要求1所述的装置,其特征在于,所述存储模块与所述处理模块的串行外设接口总线相连。
4.根据权利要求1所述的装置,其特征在于,所述处理模块从所述存储模块当前存储页中提取计时数据之后,还用于校验所述提取到的计时数据;
其中,所述比较所述提取到的计时数据,将所述计时数据中的最大值累加所述处理模块得到的计时数据后写入所述存储模块的下一页包括:
比较通过校验后的计时数据,将所述通过校验后的计时数据中的最大值累加所述处理模块得到的计时数据,并添加校验码后写入所述存储模块的下一页。
5.根据权利要求1-4中任意一项所述的装置,其特征在于,所述存储模块为用户可更改的只读存储器。
6.根据权利要求1-4中任意一项所述的装置,其特征在于,所述晶振模块为50MHz的晶振模块。
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