CN104269133A - 一种像素电路及有机电致发光显示面板 - Google Patents
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Abstract
本发明公开了一种像素电路及有机电致发光显示面板,在像素电路中增加了初始化模块,在初始化阶段,初始化模块对驱动模块和发光器件进行初始化,在写入阶段,充电模块将数据信号端的数据信号写入到驱动模块的控制端;在发光阶段,充电模块将数据信号端输入的第一参考信号加载到驱动模块的控制端,初始化模块将驱动模块的输出端与发光器件的输入端导通,使驱动模块驱动发光器件发光,相较于现有技术中的像素电路,本发明实施例提供的像素电路在初始化阶段对驱动模块和发光器件进行初始化,消除先前阶段压差对后续阶段的影响,在写入阶段为驱动模块提供补偿电压和驱动电压,避免了阈值电压的变化对发光器件发光亮度的影响,从而保证显示画面的质量。
Description
技术领域
本发明涉及显示技术领域,尤其涉及一种像素电路及有机电致发光显示面板。
背景技术
随着显示技术的进步,有机发光显示器(Organic Light Emitting Diode,OLED)是当今平板显示器研究领域的热点之一,越来越多的有源矩阵有机发光二极管(Active Matrix Organic Light Emitting Diode,AMOLED)显示面板进入市场,相对于传统的薄膜晶体管液晶显示面板(Thin Film Transistor LiquidCrystal Display,TFT LCD),AMOLED具有更快的反应速度,更高的对比度以及更广大的视角。
一般的AMOLED像素电路的电路结构,如图1所示,包括:驱动晶体管M1、开关晶体管M2、存储电容C,以及发光器件OLED;其中,驱动晶体管M1的栅极分别与开关晶体管M2的漏极和存储电容C的一端相连,源极与发光器件的一端相连,漏极分别与存储电容C的另一端和第一参考信号端VSS相连;开关晶体管M2的栅极与扫描信号输入端Scan相连,源极与数据信号端Data相连;发光器件另一端与第二参考信号端VDD相连。
图2为图1所示的像素电路的工作时序图,由图2可知,在t1时间段,扫描信号输入端Scan输入高电平信号,因此开关晶体管M2开启,此时数据信号端Data上的信号写入到存储电容C以及驱动晶体管M1的栅极,因此驱动晶体管M1开启,发光器件开始工作发光;在t2时间段,扫描信号输入端Scan输入低电平信号,因此开关晶体管M2关断,此时由于存储电容C的放电作用,驱动晶体管M1的栅极将维持高电平状态,驱动晶体管M1继续开启,OLED将继续工作发光。
由于驱动晶体管M1的阈值电压会随着显示面板的长时间工作而发生漂移,且OLED属于电流驱动,需要稳定的电流来控制发光,然而由于工艺制程和器件老化等原因,会使驱动OLED的驱动晶体管M1的阈值电压Vth存在不均匀性,这样就导致了流过每个像素点OLED的电流发生变化使得显示亮度不均,从而影响整个图像的显示效果。
因此,如何缓解像素电路中驱动晶体管的阈值电压的变化对发光器件的发光亮度产生影响,从而影响整个图像的显示效果的问题,是本领域技术人员亟需解决的问题。
发明内容
本发明实施例提供一种像素电路及有机电致发光显示面板,用以解决现有技术中存在的像素电路中驱动晶体管阈值电压的变化影响发光器件的发光亮度的问题。
本发明实施例提供了一种像素电路,包括:充电模块、驱动模块、初始化模块,以及发光器件;其中,
所述充电模块的输入端与数据信号端相连,控制端与扫描信号端相连,输出端分别与所述驱动模块的控制端和所述初始化模块的第一输出端相连;
所述驱动模块的输入端与第一参考信号端相连,输出端与所述初始化模块的第一输入端相连;
所述初始化模块的第一控制端与初始化信号端相连,第二控制端与控制信号端相连,第二输出端与所述发光器件的输入端相连,第二输入端分别与所述发光器件的输出端和第二参考信号端相连;
在初始化阶段,所述初始化模块用于在所述初始化信号端和所述控制信号端的控制下对所述驱动模块和发光器件进行初始化;在写入阶段,所述充电模块用于在所述扫描信号端的控制下将所述数据信号端输入的数据信号写入到所述驱动模块的控制端;在发光阶段,所述充电模块用于在所述扫描信号端的控制下将所述数据信号端输入的第一参考信号加载到所述驱动模块的控制端,所述初始化模块用于在控制信号端的控制下将所述驱动模块的输出端与所述发光器件的输入端导通,使所述驱动模块驱动所述发光器件发光。
在一种可能的实施方式中,本发明实施例提供的上述像素电路中,所述驱动模块,具体包括:驱动晶体管和存储电容;其中,
所述驱动晶体管的栅极分别与所述充电模块的输出端和所述初始化模块的第一输出端相连、源极与所述第一参考信号端相连、漏极与所述初始化模块的第一输入端;
所述存储电容连接于所述驱动晶体管的栅极和漏极之间。
在一种可能的实施方式中,本发明实施例提供的上述像素电路中,所述初始化模块,具体包括:重置单元和控制单元;其中,
所述重置单元的控制端与所述初始化信号端相连,第一输出端分别与所述充电模块的输出端和所述驱动晶体管的栅极相连,第一输入端分别与所述驱动晶体管的漏极和所述控制单元的输出端相连,第二输出端分别与所述控制单元的输入端和所述发光器件的输入端相连,第二输入端分别与所述发光器件的输出端和所述第二参考信号端相连;
所述控制单元的控制端与所述控制信号端相连;
在初始化阶段,所述重置单元在所述初始化信号端的控制下将所述驱动晶体管的栅极与漏极导通,并将所述发光器件的输入端与第二参考信号端导通;所述控制单元在所述控制信号端的控制下将所述驱动晶体管的漏极与所述重置单元的第二输出端导通;
在发光阶段,所述控制单元在所述控制信号端的控制下将所述驱动晶体管的漏极与所述发光器件的输入端导通。
在一种可能的实施方式中,本发明实施例提供的上述像素电路中,所述重置单元,具体包括:第一开关晶体管和第二开关晶体管;其中,
所述第一开关晶体管的栅极与所述初始化信号端相连、漏极分别与所述充电模块的输出端和所述驱动晶体管的控制端相连、源极分别与所述驱动晶体管的漏极和所述控制单元的输出端相连;
所述第二开关晶体管的栅极与所述初始化信号端相连、漏极分别与所述控制单元的输入端和所述发光器件的输入端相连、源极分别与所述发光器件的输出端和第二参考信号端相连。
在一种可能的实施方式中,本发明实施例提供的上述像素电路中,所述控制单元,具体包括:第三开关晶体管;
所述第三开关晶体管的栅极与所述控制信号端相连、漏极分别与所述驱动晶体管的漏极和所述第一开管晶体管的源极相连、源极分别与所述第二开关晶体管的漏极和所述发光器件的输入端相连。
在一种可能的实施方式中,本发明实施例提供的上述像素电路中,所述充电模块,具体包括:第四开关晶体管;
所述第四开关晶体管的栅极与所述扫描信号端相连、源极与所述数据信号端相连、漏极分别与所述第一开关晶体管的漏极和所述驱动晶体管的栅极相连。
在一种可能的实施方式中,本发明实施例提供的上述像素电路中,在写入阶段,所述充电模块具体用于:在数据信号写入到所述驱动模块的控制端之前,将所述驱动晶体管的阈值电压写入到所述存储电容。
本发明实施例提供了一种有机电致发光显示面板,包括本发明实施例提供的上述像素电路。
本发明实施例的有益效果包括:
本发明实施例提供了一种像素电路及有机电致发光显示面板,在像素电路中增加了初始化模块,在初始化阶段,初始化模块在初始化信号端和控制信号端的控制下对驱动模块和发光器件进行初始化;在写入阶段,充电模块在扫描信号端的控制下将数据信号端输入的数据信号写入到驱动模块的控制端;在发光阶段,充电模块在扫描信号端的控制下将数据信号端输入的第一参考信号加载到驱动模块的控制端,初始化模块在控制信号端的控制下将驱动模块的输出端与发光器件的输入端导通,使驱动模块驱动发光器件发光,实现了发光器件的正常发光功能,相较于现有技术中的像素电路,本发明实施例提供的像素电路能够在初始化阶段对驱动模块和发光器件进行初始化,消除了先前阶段压差对后续阶段的影响,在写入阶段为驱动模块提供了补偿电压和驱动电压,避免了阈值电压的变化对发光器件的发光亮度的影响,提高了发光器件发光亮度的均一性,从而保证了显示画面的质量。
附图说明
图1为现有技术中像素电路结构示意图;
图2为图1所示的像素电路的具体工作时序图;
图3为本发明实施例提供的像素电路结构示意图;
图4为本发明实施例提供的像素电路的具体结构示意图;
图5为本发明实施例提供的图4所示像素电路的具体工作时序图。
具体实施方式
下面结合附图,对本发明实施例提供的像素电路及有机电致发光显示面板的具体实施方式进行详细地说明。
本发明实施例提供了一种像素电路,如图3所示,包括:充电模块01、驱动模块02、初始化模块03,以及发光器件04;其中,
充电模块01的输入端与数据信号端Data相连,控制端与扫描信号端Scan相连,输出端分别与驱动模块02的控制端和初始化模块03的第一输出端相连;
驱动模块02的输入端与第一参考信号端Ref1相连,输出端与初始化模块03的第一输入端相连;
初始化模块03的第一控制端与初始化信号端Init相连,第二控制端与控制信号端Ctrl相连,第二输出端与发光器件04的输入端相连,第二输入端分别与发光器件04的输出端和第二参考信号端Ref2相连;
在初始化阶段,初始化模块03在初始化信号端Init和控制信号端Ctrl的控制下对驱动模块02和发光器件04进行初始化;在写入阶段,充电模块01在扫描信号端Scan的控制下将数据信号端Data输入的数据信号写入到驱动模块02的控制端;在发光阶段,充电模块01在扫描信号端Scan的控制下将数据信号端Data输入的第一参考信号加载到驱动模块02的控制端,初始化模块03在控制信号端Ctrl的控制下将驱动模块02的输出端与发光器件04的输入端导通,使驱动模块02驱动发光器件04发光。
本发明实施例提供的上述像素电路中,增加了初始化模块03,在初始化阶段,初始化模块03在初始化信号端Init和控制信号端Ctrl的控制下对驱动模块02和发光器件04进行初始化;在写入阶段,充电模块01在扫描信号端Scan的控制下将数据信号端Data输入的数据信号写入到驱动模块02的控制端;在发光阶段,充电模块01在扫描信号端Scan的控制下将数据信号端Data输入的第一参考信号加载到驱动模块02的控制端,初始化模块03在控制信号端Crtl的控制下将驱动模块02的输出端与发光器件04的输入端导通,使驱动模块02驱动发光器件发光,实现了发光器件04的正常发光功能,相较于现有技术中的像素电路,本发明实施例提供的像素电路能够在初始化阶段对驱动模块02和发光器件04进行初始化,消除了先前阶段压差对后续阶段的影响,在写入阶段为驱动模块02提供了补偿电压和驱动电压,避免了阈值电压的变化对发光器件04的发光亮度的影响,提高了发光器件04发光亮度的均一性,从而保证了显示画面的质量。
在具体实施时,本发明实施例提供的上述像素电路中,驱动模块02,如图4所示,可以具体包括:驱动晶体管D1和存储电容C1;其中,
驱动晶体管D1的栅极分别与充电模块01的输出端和初始化模块03的第一输出端相连、源极与第一参考信号端Ref1相连、漏极与初始化模块03的第一输入端;存储电容C1连接于驱动晶体管D1的栅极和漏极之间。
具体地,本发明实施例提供的上述像素电路中,驱动晶体管D1可以为N型晶体管,也可以为P型晶体管,在此不作限定。在初始化阶段,初始化模块03在初始化信号端Init和控制信号端Ctrl的控制下,将驱动晶体管D1的栅极与漏极导通,也将驱动晶体管D1的漏极与第二参考信号端Ref2导通,使存储电容C1两端的净电荷为零,同时使发光器件04两端短路,使发光器件04处于不发光的状态,既消除先前阶段存储电容C1的压差对后续阶段的影响,同时为驱动晶体管D1阈值电压恢复的过程提供时间。
在具体实施时,本发明实施例提供的上述像素电路中,为了避免在写入阶段写入的数据信号不足以开启驱动晶体管D1,因此在写入阶段充电模块01还可以具体用于在数据信号写入到驱动模块02的控制端之前,将驱动晶体管D1的阈值电压写入到存储电容C1中,即在写入阶段充电模块01在扫描信号端Scan的控制下,将数据信号端Data输入的大于驱动晶体管D1的栅极开启电压的信号写入到存储电容C1一端,也是驱动晶体管D1的栅极,此时驱动晶体管D1的栅极开启,对存储电容C1的另一端充电,直到存储电容C1两端的压差为驱动晶体管D1的阈值电压Vth为止,则驱动晶体管D1的阈值电压就被存储于存储电容C1中,实现了对驱动晶体管D1的阈值电压的补偿。
在具体实施时,本发明实施例提供的上述像素电路中,初始化模块03,如图4所示,可以具体包括:重置单元031和控制单元032;其中,
重置单元031的控制端与初始化信号端Init相连,第一输出端分别与充电模块01的输出端和驱动晶体管D1的栅极相连,第一输入端分别与驱动晶体管D1的漏极和控制单元032的输出端相连,第二输出端分别与控制单元032的输入端和发光器件04的输入端相连,第二输入端分别与发光器件04的输出端和第二参考信号端Ref2相连;控制单元032的控制端与控制信号端Ctrl相连。
在初始化阶段,重置单元031在初始化信号端Init的控制下将驱动晶体管D1的栅极与漏极导通,并将发光器件04的输入端与第二参考信号端Ref2导通;控制单元032在控制信号端Ctrl的控制下将驱动晶体管D1的漏极与重置单元031的第二输出端导通,使存储电容C1两端的净电荷为零,即消除先前阶段存储电容C1的压差对后续阶段的影响,同时为驱动晶体管D1阈值电压恢复的过程提供时间;在发光阶段,控制单元032在控制信号端Ctrl的控制下将驱动晶体管D1的漏极与发光器件04的输入端导通,使驱动晶体管D1在驱动电压的控制下驱动发光器件04实现正常发光。
在具体实施时,本发明实施例提供的上述像素电路中,重置单元031,如图4所示,可以具体包括:第一开关晶体管D1和第二开关晶体管D2;其中,
第一开关晶体管T1的栅极与初始化信号端Init相连、漏极分别与充电模块01的输出端和驱动晶体管D1的控制端相连、源极分别与驱动晶体管D1的漏极和控制单元032的输出端相连;第二开关晶体管T2的栅极与初始化信号端Init相连、漏极分别与控制单元032的输入端和发光器件04的输入端相连、源极分别与发光器件04的输出端和第二参考信号端Ref2相连。
具体地,本发明实施例提供的上述像素电路中,第一开关晶体管T1和第二开关晶体管T2可以同时为N型晶体管,也可以同时为P型晶体管,在此不作限定。在初始化阶段,第一开关晶体管T1和第二开关晶体管T2在初始化信号端Init的控制下导通,导通的第一开关晶体管T1将驱动晶体管D1的栅极和漏极导通,导通的第二开关晶体管T2将发光器件04的两端短路,使发光器件处于不发光状态。
在具体实施时,本发明实施例提供的上述像素电路中,控制单元032,如图4所示,可以具体包括:第三开关晶体管T3;第三开关晶体管T3的栅极与控制信号端Ctrl相连、漏极分别与驱动晶体D1的漏极和第一开管晶体管T1的源极相连、源极分别与第二开关晶体管T2的漏极和发光器件04的输入端相连。
具体地,本发明实施例提供的上述像素电路中,第三开关晶体管T3可以为N型晶体管,也可以为P型晶体管,在此不作限定。在初始化阶段,第三开关晶体管T3在控制信号端Ctrl的控制下导通,导通的第三开关晶体管T3将驱动晶体管D1的漏极与发光器件04的输入端导通,进而使驱动晶体管D1的漏极通过第二开关晶体管T2与第二参考信号端Ref2导通;在发光阶段,第三开关晶体管T3在控制信号端Ctrl的控制下导通,导通的第三开关晶体管T3将驱动晶体管D1的漏极与发光器件04的输入端导通,使驱动晶体管D1驱动发光器件04发光。
在具体实施时,本发明实施例提供的上述像素电路中,充电模块01,如图4所示,可以具体包括:第四开关晶体管T4;第四开关晶体管T4的栅极与扫描信号端Scan相连、源极与数据信号端Data相连、漏极分别与第一开关晶体管T1的漏极和驱动晶体管D1的栅极相连。
具体地,本发明实施例提供的上述像素电路中,第四开关晶体管T4可以为N型晶体管,也可以为P型晶体管,在此不作限定。在写入阶段,第四开关晶体管T4在扫描信号端Scan的控制下导通,导通的第四开关晶体管T4将数据信号端Data与驱动晶体管D1的栅极导通,将数据信号端Data的数据信号写入到驱动晶体管D1的栅极,同时也对存储电容C1充电,即将驱动晶体管的阈值电压存储到存储电容C1中;在发光阶段,同样导通的第四开关晶体管T4将数据信号端Data与驱动晶体管D1的栅极导通,使数据信号端Data输入的第一参考信号VDD加载到驱动晶体管D1的栅极,作为驱动晶体管D1驱动发光器件04发光的驱动电压。
需要说明的是本发明上述实施例中提到的开关晶体管和驱动晶体管可以是薄膜晶体管(TFT,Thin Film Transistor),也可以是金属氧化物半导体场效应管(MOS,Metal Oxide Scmiconductor),在此不做限定。在具体实施中,这些晶体管的源极和漏极可以互换,不做具体区分。在描述具体实施例时以薄膜晶体管为例进行说明。
下面结合本发明实施例提供的像素电路和工作时序对本发明实施例提供的像素电路的工作过程进行详细描述。以如图4所示的采用N型晶体管设计的像素电路以及图5所示的图4的输入输出时序图,对本发明实施例提供的像素电路的工作过程作以描述。具体地,选取如图5所示的输入输出时序图中的t1~t4四个阶段。下述描述中以1表示高电平信号,0表示低电平信号。
在t1阶段,Init=1,Ctrl=1,Scan=0,Ref1=1,Ref2=0。由于Init=1和Ctrl=1,因此第一开关晶体管T1、第二开关晶体管T2和第三开关晶体管T3导通;由于Scan=0,因此第四开关晶体管T4截止。导通的第一开关晶体管T1将驱动晶体管D1的栅极和漏极导通,导通的第三开关晶体管T3将驱动晶体管D1的漏极与发光器件04的输入端导通,导通的第二开关晶体管T2将发光器件04的两端短路,使发光器件04处于不发光状态,同时使驱动晶体管D1的漏极与第二参考信号端Ref2导通,将存储电容C1两端的净电荷清零。t1阶段为初始化阶段。
在t2阶段,Init=0,Ctrl=0,Scan=1,Ref1=1,Ref2=0。由于Init=0和Ctrl=0,因此第一开关晶体管T1、第二开关晶体管T2和第三开关晶体管T3截止,发光器件04仍处于不发光的状态;由于Scan=1,因此第四开关晶体管T4导通,导通的第四开关晶体管T4将数据信号端Data与驱动晶体管D1的栅极导通,将数据信号端Data输入的数据信号写入到存储电容C1的一端,此时数据信号端Data输入的数据信号为大于驱动晶体管D1栅极导通的电压信号,例如为第一参考信号VDD的一半,由于写入到存储电容C1的一端即驱动晶体管D1的栅极的数据信号为VDD/2,因此驱动晶体管D1的栅极导通,对存储电容C1另一端充电,通过驱动晶体管D1的导通调整,直到存储电容C1另一端的电压为VDD/2-Vth,其中Vth为驱动晶体管D1的阈值电压。这时驱动晶体管D1将处于临界导通的状态,阈值电压Vth被存储于存储电容C1中。t2阶段为补偿阶段。
在t3阶段,Init=0,Ctrl=0,Scan=1,Ref1=1,Ref2=0。由于Init=0和Ctrl=0,因此第一开关晶体管T1、第二开关晶体管T2和第三开关晶体管T3截止,发光器件04仍处于不发光状态;由于Scan=1,因此第四开关晶体管T4导通,导通的第四开关晶体管T4将数据信号端Data与驱动晶体管D1的栅极导通,将数据信号端Data输入的数据信号Vdata_n写入到存储电容C1的一端即驱动晶体管D1的栅极,此时,存储电容C1另一端为Vdata_n-Vth,驱动晶体管D1仍处于临界导通的状态,同时驱动晶体管D1的阈值电压Vth继续存储于存储电容C1中。t3阶段为数据信号的写入阶段。
在t4阶段,Init=0,Ctrl=1,Scan=1,Ref1=1,Ref2=0。由于Init=0,因此第一开关晶体管T1和第二开关晶体管T2截止;由于Ctrl=1,因此第三开关晶体管T3导通;由于Scan=1,因此第四开关晶体管T4导通,导通的第四开关晶体管T4将数据信号端Data与驱动晶体管D1的栅极导通,此时数据信号端Data输入的数据信号为第一参考信号VDD,并通过导通的第四开关晶体管T4写入到驱动晶体管D1的栅极,控制驱动晶体管D1导通并驱动发光器件04发光。t4阶段为发光阶段。
在驱动晶体管D1导通的瞬间,这时存储电容C1的另外一端电压为Vdata_n-Vth,因此发光器件04的导通电流:I=K(Vgs-Vth)2=K(VDD-(Vdata_n-Vth)-Vth)2=K(VDD-Vdata_n)2,其中,K是与驱动晶体管D1的工艺参数和几何尺寸有关的常数,Vgs为驱动晶体管D1的栅极和源极之间的电压差。由上述分析可知,发光器件04的导通电流确实与驱动晶体管D1的阈值电压无关,从而消除驱动晶体管D1的阈值电压的变化对发光器件04的发光亮度产生的影响,从而很好的提高发光器件04发光亮度的均一性。
在后续时间段,各个控制信号与时间段t4相同,因此发光器件04的发光状态保持,直到某个时间段初始化信号端Init再次输入高电平为止。
基于同一发明构思,本发明实施提提供了一种有机电致发光显示面板,包括本发明实施例提供的上述像素电路。该有机电致发光显示面板可以应用于手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。由于该有机电致发光显示面板解决问题的原理与像素电路相似,因此该有机电致发光显示面板的实施可以参见上述像素电路的实施,重复之处不再赘述。
本发明实施例提供了一种像素电路及有机电致发光显示面板,在像素电路中增加了初始化模块,在初始化阶段,初始化模块在初始化信号端和控制信号端的控制下对驱动模块和发光器件进行初始化;在写入阶段,充电模块在扫描信号端的控制下将数据信号端输入的数据信号写入到驱动模块的控制端;在发光阶段,充电模块在扫描信号端的控制下将数据信号端输入的第一参考信号加载到驱动模块的控制端,初始化模块在控制信号端的控制下将驱动模块的输出端与发光器件的输入端导通,使驱动模块驱动发光器件发光,实现了发光器件的正常发光功能,相较于现有技术中的像素电路,本发明实施例提供的像素电路能够在初始化阶段对驱动模块和发光器件进行初始化,消除了先前阶段压差对后续阶段的影响,在写入阶段为驱动模块提供了补偿电压和驱动电压,避免了阈值电压的变化对发光器件的发光亮度的影响,提高了发光器件发光亮度的均一性,从而保证了显示画面的质量。
显然,本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样,倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内,则本发明也意图包含这些改动和变型在内。
Claims (8)
1.一种像素电路,其特征在于,包括:充电模块、驱动模块、初始化模块,以及发光器件;其中,
所述充电模块的输入端与数据信号端相连,控制端与扫描信号端相连,输出端分别与所述驱动模块的控制端和所述初始化模块的第一输出端相连;
所述驱动模块的输入端与第一参考信号端相连,输出端与所述初始化模块的第一输入端相连;
所述初始化模块的第一控制端与初始化信号端相连,第二控制端与控制信号端相连,第二输出端与所述发光器件的输入端相连,第二输入端分别与所述发光器件的输出端和第二参考信号端相连;
在初始化阶段,所述初始化模块用于在所述初始化信号端和所述控制信号端的控制下对所述驱动模块和所述发光器件进行初始化;在写入阶段,所述充电模块用于在所述扫描信号端的控制下将所述数据信号端输入的数据信号写入到所述驱动模块的控制端;在发光阶段,所述充电模块用于在所述扫描信号端的控制下将所述数据信号端输入的第一参考信号加载到所述驱动模块的控制端,所述初始化模块用于在控制信号端的控制下将所述驱动模块的输出端与所述发光器件的输入端导通,使所述驱动模块驱动所述发光器件发光。
2.如权利要求1所述的像素电路,其特征在于,所述驱动模块,具体包括:驱动晶体管和存储电容;其中,
所述驱动晶体管的栅极分别与所述充电模块的输出端和所述初始化模块的第一输出端相连、源极与所述第一参考信号端相连、漏极与所述初始化模块的第一输入端;
所述存储电容连接于所述驱动晶体管的栅极和漏极之间。
3.如权利要求2所述的像素电路,其特征在于,所述初始化模块,具体包括:重置单元和控制单元;其中,
所述重置单元的控制端与所述初始化信号端相连,第一输出端分别与所述充电模块的输出端和所述驱动晶体管的栅极相连,第一输入端分别与所述驱动晶体管的漏极和所述控制单元的输出端相连,第二输出端分别与所述控制单元的输入端和所述发光器件的输入端相连,第二输入端分别与所述发光器件的输出端和所述第二参考信号端相连;
所述控制单元的控制端与所述控制信号端相连;
在初始化阶段,所述重置单元在所述初始化信号端的控制下将所述驱动晶体管的栅极与漏极导通,并将所述发光器件的输入端与第二参考信号端导通;所述控制单元在所述控制信号端的控制下将所述驱动晶体管的漏极与所述重置单元的第二输出端导通;
在发光阶段,所述控制单元在所述控制信号端的控制下将所述驱动晶体管的漏极与所述发光器件的输入端导通。
4.如权利要求3所述的像素电路,其特征在于,所述重置单元,具体包括:第一开关晶体管和第二开关晶体管;其中,
所述第一开关晶体管的栅极与所述初始化信号端相连、漏极分别与所述充电模块的输出端和所述驱动晶体管的控制端相连、源极分别与所述驱动晶体管的漏极和所述控制单元的输出端相连;
所述第二开关晶体管的栅极与所述初始化信号端相连、漏极分别与所述控制单元的输入端和所述发光器件的输入端相连、源极分别与所述发光器件的输出端和第二参考信号端相连。
5.如权利要求3所述的像素电路,其特征在于,所述控制单元,具体包括:第三开关晶体管;
所述第三开关晶体管的栅极与所述控制信号端相连、漏极分别与所述驱动晶体管的漏极和所述第一开管晶体管的源极相连、源极分别与所述第二开关晶体管的漏极和所述发光器件的输入端相连。
6.如权利要求1-5任一项所述的像素电路,其特征在于,所述充电模块,具体包括:第四开关晶体管;
所述第四开关晶体管的栅极与所述扫描信号端相连、源极与所述数据信号端相连、漏极分别与所述第一开关晶体管的漏极和所述驱动晶体管的栅极相连。
7.如权利要求2-5任一项所述的像素电路,其特征在于,在写入阶段,所述充电模块具体用于:在数据信号写入到所述驱动模块的控制端之前,将所述驱动晶体管的阈值电压写入到所述存储电容中。
8.一种有机电致发光显示面板,其特征在于,包括如权利要求1-7任一项所述的像素电路。
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