CN103489397B - 像素驱动器 - Google Patents

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Abstract

一种像素驱动器，包含输入单元、电源开关单元、分压单元、像素驱动单元以及短路单元。输入单元根据第一扫描信号以及数据信号输出数据电压。电源开关单元根据第一电源电压以及电源控制信号输出第一电源电压。分压单元根据第二扫描信号调整控制电压。像素驱动单元包含控制端、第一端以及第二端。像素驱动单元根据控制端及第二端的电压差提供驱动电流予发光二极管。短路单元根据第一扫描信号将控制端与第一端短路。

Description

像素驱动器
技术领域
本发明是有关于一种显示面板，且特别是有关于具有像素驱动器的显示面板。
背景技术
随着显示技术的蓬勃发展，平面显示器已普遍地应用于日常生活当中。其中，主动式有机发光二极管（ActiveMatrixOrganicLight-EmittingDiode,AMOLED）显示器更是因为具有高画质、高对比且高反应速度的特性而大受欢迎。
图1绘示一般像素驱动电路的示意图。施加电源电压OVDD以及OVSS以提供流过像素驱动电路10的驱动电流，而扫描信号SCAN根据数据电压Data驱动像素驱动电路10。像素驱动电路100为常见仅有二个晶体管与仅一个电容（onlytwotransistorswithonlyonecapacitor,2T1C）的传统架构。详细而言，其中一个晶体管的栅极直接连接扫描线（如图中所标的SCAN处），其中一个晶体管的漏极直接连接数据线（如图中所标的Data处）以及其中一个晶体管的源极，而另一个晶体管的栅极直接连接其中一个晶体管的源极与电容的其中一个电极，另一个晶体管的漏极直接连接电源线（如图中所标的OVDD处）与电容的另一个电极以及另一个晶体管的源极直接连接（如图中所标的OVDD处）与发光二极管的其中一个电极，且发光二极管的另一个电极直接连接接地线（如图中所标的OVSS处）。然而，由于工艺上的变异，导致面板中的各个像素的操作特性未必能完全相同。即使给予相同的数据电压Data至每一像素，各个像素仍可能形成不一致的驱动电流，造成AMOLED面板亮度的不均匀性。再者，电源电压OVDD因各个像素的压降（IRdrop）不一致亦会导致AMOLED面板不同位置的亮度不均匀，进而影响了显示品质。
为了解决各像素的驱动晶体管的门槛电压不一致而造成面板亮度不均匀的问题，就需要由各自独立且不同的控制电路（扫描驱动电路及时钟脉冲控制器等）来产生相互波形无相关联的扫描信号、发光信号以及重置信号，使得各信号需各自操作的移位缓存器、缓冲器以及电源、时钟脉冲信号拉线，导致整体电路布局面积庞大，进而使显示面板边框因整合电路布局于其中而占用大片面积，让窄边框面板难以实现。
因此，如何能改善面板亮度不均匀且同时减少整体电路布局面积，实属当前重要研发课题之一，亦成为当前相关领域极需改进的目标。
发明内容
为了解决上述的问题，本揭露内容提出了一种像素驱动器，用以驱动发光二极管。像素驱动器包含输入单元、电源开关单元、分压单元、像素驱动单元以及短路单元。输入单元用以根据第一扫描信号以及数据信号以输出数据电压。电源开关单元用以根据第一电源电压以及电源控制信号以输出第一电源电压。分压单元用以根据第二扫描信号以调整控制电压。像素驱动单元包含控制端、第一端以及第二端。像素驱动单元用以根据控制端及第二端的电压差以提供驱动电流予发光二极管。短路单元用以根据第一扫描信号将控制端与第一端短路。
上述的素驱动器，其中于一重置时段内，该短路单元根据该第一扫描信号将该控制端与该第一端短路以利用该第一电源电压重置该控制电压。
上述的素驱动器，其中于该重置时段之后的一充电时段内，该电源开关单元停止输出该第一电源电压，且该短路单元根据该第一扫描信号将该控制端与该第一端短路，该输入单元根据该第一扫描信号输出该数据电压至该第二端。
上述的素驱动器，其中于该充电时段之后的一发光时段内，该电源开关单元输出该第一电源电压，该分压单元根据该第二扫描信号以调整该控制电压，使得该像素驱动单元根据该控制端以及该第二端的电压差以提供该驱动电流予该发光二极管。
上述的素驱动器，其中该发光二极管具有一第三端以及一第四端，该第三端用以接收该数据电压，该第四端用以接收一第三电源电压，其中该数据电压与该第三电源电压的差值小于该发光二极管的门槛电压值。
上述的素驱动器，其中该输入单元包含一第一晶体管，该第一晶体管包含：一栅极端，用以接收该第一扫描信号；一第一端，用以接收该数据信号；以及一第二端，与该像素驱动单元的第二端电性连接以传送该数据电压予该像素驱动单元。
上述的素驱动器，其中该电源开关单元包含一第二晶体管，该第二晶体管包含：一栅极端，用以接收该电源控制信号；一第一端，用以接收该第一电源电压；以及一第二端，与该像素驱动单元的第一端电性连接以传送该第一电源电压予该像素驱动单元。
上述的素驱动器，其中该短路单元包含一第三晶体管，该第三晶体管包含：一栅极端，用以接收该第一扫描信号；一第一端，与该像素驱动单元的第一端电性连接；以及一第二端，与该像素驱动单元的控制端电性连接。
上述的素驱动器，其中该像素驱动单元包含一第四晶体管，该第四晶体管包含：一栅极端，与该像素驱动单元的控制端电性连接；一第一端，与该像素驱动单元的第一端电性连接；以及一第二端，与该像素驱动单元的第二端电性连接。
上述的素驱动器，其中该分压单元包含一第一电容器和一第二电容器，该第一电容器包含：一第一端，与该像素驱动单元的控制端电性连接；以及一第二端，用以接收该第二扫描信号，使得该第二扫描信号透过该第一电容器耦合，进而使得该分压单元根据该第二扫描信号以调整该控制电压；该第二电容器包含：一第一端，与该第一电容器的第一端电性连接；以及一第二端，用以接收该第一电源电压；其中该第二扫描信号根据该第一电容器以及该第二电容器的电容比例耦合至该控制电压。
与现有技术相比，本发明所示的像素驱动器的优点在于可避免各个驱动晶体管的差异造成驱动电流不一致，同时亦可避免电源电压的压降差异造成驱动电流不一致，进而避免显示面板亮度不均匀。
附图说明
图1绘示一般像素驱动电路的示意图；
图2A绘示依照本发明一实施例的显示面板示意图；
图2B绘示图2A的显示面板中控制模块的电路示意图；
图2C绘示依照图2B所示的控制模块的操作信号时序示意图；
图3绘示依照本发明一实施例的像素驱动器的电路示意图；
图4A绘示依照本发明另一实施例的像素驱动器的电路示意图；
图4B绘示本发明一实施例的操作信号时序示意图；
图5绘示图4A所示的驱动电流相对于数据电压的曲线示意图；
图6A绘示依照本发明另一实施例的像素驱动器的示意图；
图6B绘示依照本发明另一实施例的操作信号时序示意图。
其中，附图标记：
30：显示面板32：显示阵列
DL1～DLM：数据线SL1～SLW：扫描线
320：像素34：移位缓存器
322、422、522、722：像素驱动器。
4221：输入单元4222：电源开关单元
4223：分压单元4224：像素驱动单元
4225：短路单元801：反向器
901：电源控制信号产生器324、424、724：发光二极管
Q1～Q4、Qp1～Qp4、Q91、Q92：晶体管
C51、C52、C71、C72：电容器
Sc[n-1]、Sc[n]、Sc[n+1]、Data[n]、EM[n]、XSc[n]、Sc[k]、Data[k]、EM[k]、XSc[k]：信号
Vdata、OVDD、OVSS、Vctl、Vp、D0～D2、VDD：电压
Nd、Ns：节点Id：电流
A、B、C、T11～T13、T21～T23、T51～T53、T41～T43、T311、T312、T321、T322：端
CK、XCK、CK_h：时钟脉冲信号tr、ts、te：时段
VGH、VGL：电位
具体实施方式
下文举实施例配合所附附图作详细说明，但所提供的实施例并非用以限制本发明所涵盖的范围，而结构运作的描述非用以限制其执行的顺序，任何由元件重新组合的结构，所产生具有均等功效的装置，皆为本发明所涵盖的范围。此外，附图仅以说明为目的，并未依照原尺寸作图。为使便于理解，下述说明中相同元件将以相同的符号标示来说明。
关于本文中所使用的“耦接”或“连接”，均可指二或多个元件相互直接作实体或电性接触，或是相互间接作实体或电性接触，亦可指二或多个元件相互操作或动作。
图2A绘示依照本发明一实施例的显示面板30示意图。图2B绘示图2A的显示面板30中控制模块36的电路示意图。图2C绘示依照图2B所示的控制模块36的操作信号时序示意图。
如图2A所示，显示面板30包含多条数据线DL1～DLM、多条扫描线SL1～SLW、多个像素320以及多级串接的移位缓存器34。多个像素32以构成一显示阵列32，每个像素32电性连接相对应的数据线（其中一条数据线DL1～DLM）与相对应的扫描线（其中一组扫描线SL1～SLW）。每个像素320包含像素驱动器322以及发光二极管324。移位缓存器34提供扫描信号予相应的扫描线。其中，每个移位缓存器34的二个输入端分别接收时钟脉冲信号CK与XCK，且时钟脉冲信号XCK的波形相位相反于时钟脉冲信号CK。
以位于第n行上的移位缓存器34而言，移位缓存器34提供扫描信号Sc[n]予相应的扫描线SLN。于此实施例中，显示面板30更包含控制模块36耦接于每一行的移位缓存器34与相应的一组扫描线之间。以第n行举例，控制模块36用以根据移位缓存器34提供扫描信号Sc[n]产生反向的另一个扫描信号XSc[n]以及电源控制信号EM[n]，并将扫描信号Sc[n]、扫描信号XSc[n]以及电源控制信号EM[n]一并传送至相应的扫描线SLN（于此例中每一组扫描线SLN可包含三条实体线路）。
像素驱动器322与数据线DLN以及扫描线SLN电性连接，数据线DLN以及扫描线SLN分别提供扫描信号Sc[n]以及数据信号Data[n]予像素驱动器322，像素驱动器322用以根据扫描信号Sc[n]以及数据信号Data[n]驱动发光二极管324。
如图2B所示的实施例中，控制模块36中可包含反向器361以及电源控制信号产生器362。反向器361用以根据扫描信号Sc[n]产生反向的扫描信号XSc[n]。电源控制信号产生器362则根据两个扫描信号Sc[n]与XSc[n]以及时钟脉冲信号CK_h产生电源控制信号EM[n]，上述扫描信号Sc[n]、XSc[n]、时钟脉冲信号CK_h与电源控制信号EM[n]的相对关可参考图2C。
在本揭示内容所示的显示面板中，像素驱动器322所接收的两个扫描信号（Sc[n]及XSc[n]）须为波形同步且具有相反的相位。在实作上，扫描信号XSc[n]可由图2B中控制模块36的反向器361提供，反向器361可由一个P型晶体管以及一个N型晶体管串接组成，但不限于此。
须补充说明的是，当扫描信号Sc[n]由第N级移位缓存器34输出时可能须经过缓冲器（图中未示），而实际应用中缓冲器可由多个反向器串接组成，此时，反向器361可由输出扫描信号Sc[n]的缓冲器中其中一个反向器所实现，而无须在控制模块36中设置额外的反向器产生扫描信号XSc[n]。
如图2B所示，在一实施例中，电源控制信号产生器362包含两开关单元363与364。开关单元363根据扫描信号Sc[n]导通时钟脉冲信号CK_h以调整电源控制信号EM[n]。开关单元364用以根据扫描信号XSc[n]导通恒定电压VDD以调整电源控制信号EM[n]。两开关单元363与364电性连接，而二者相接的节点输出电源控制信号EM[n]。
操作上，参照图2B及图2C。如图2B所示，扫描信号Sc[n]维持为高电位，同时扫描信号XSc[n]维持为低电位，因此，在重置时段tr以及充电时段ts内的开关单元363导通而开关单元364关断。借此，在重置时段tr以及充电时段ts内，开关单元363导通传送时钟脉冲信号CK_h，使得电源控制信号EM[n]在重置时段tr以及充电时段ts内的波形与时钟脉冲信号CK_h的波形一致。而在发光时段te内，Sc[n]转态为低电位，同时XSc[n]转态为高电位，因此，在发光时段te内的开关单元363关断而开关单元364导通。借此，在发光时段te内，开关单元364导通传送恒定电压VDD，使得电源控制信号EM[n]在发光时段te内的波形电位为定值。
图3绘示依照本发明一实施例的像素驱动器422的电路示意图，其中像素驱动器422可应用于图2A所示的像素驱动器322，或用于其他类似的发光元件驱动器。像素驱动器422用以驱动发光二极管424。像素驱动器422包含输入单元4221、电源开关单元4222、分压单元4223、像素驱动单元4224以及短路单元4225。
输入单元4221用以根据扫描信号Sc[n]以及数据信号Data[n]以输出数据电压Vdata。电源开关单元4222用以根据电源电压OVDD以及电源控制信号EM[n]以输出电源电压Vp。分压单元4223用以根据扫描信号XSc[n]以调整控制电压Vctl。像素驱动单元4224包含控制端A、第一端B以及第二端C。像素驱动单元4224用以根据控制端A以及第二端C的电压差以提供驱动电流Id予发光二极管424。第一端B用以接收电源电压Vp。第二端C与发光二极管424连接，用以接收数据电压Vdata[n]以及输出驱动电流Id予发光二极管424。短路单元4225用以根据扫描信号Sc[n]将控制端A与第一端B短路。举例而言，像素驱动单元4224的第一端B连接电源开关单元4222的一端及短路单元4225的一端，像素驱动单元4224的控制端A连接短路单位4225的另一端及分压单元的一端，像素驱动单元4224的第二端C连接输入单元4221的一端及发光二极管424的一电极。其中，电源开关单元4222的另外二端分别连接电源电压OVDD及电源控制信号EM[n]，短路单元4225的第三端连接扫描信号Sc[n]，分压单元的另一端连接信号XSc[n]，输入单元4221的另外二端分别连接扫描信号Sc[n]及数据信号Data[n]，而发光二极管的另一电极连接电源电压OVSS，且电源电压OVDD不同于电源电压OVSS。
再者，像素驱动单元4224更用以将门槛电压与数据电压Vdata[n]叠加以进而储存于控制电压Vctl以用于像素补偿操作。举例来说，上述门槛电压为一晶体管的门槛电压，其具有值Vth，则像素驱动单元4224将晶体管的门槛电压Vth与数据电压Vdata[n]叠加以进而储存于控制电压Vctl，使得控制电压Vctl的电位等于（Vth＋Vdata[n]）。
在操作上，在一实施例中，于重置时段内（例如：图4B所示的重置时段tr），短路单元4225根据扫描信号Sc[n]将控制端A与第一端B短路以利用电源电压Vp重置控制电压Vctl。
于上述重置时段之后的充电时段内（例如：图4B所示的重置时段ts），电源开关单元4222停止输出电源电压Vp，输入单元4221输出数据电压Vdata[n]至第二端C，且短路单元4225根据扫描信号Sc[n]将控制端A与第一端B短路，使得像素驱动单元4224将门槛电压（例如：晶体管的门槛电压）与数据电压Vdata[n]叠加以进而储存于控制电压Vctl以用于像素补偿操作。
于上述充电时段的后的发光时段（例如：图4B所示的发光时段te）内，电源开关单元4222根据电源电压OVDD以及电源控制信号EM[n]以输出电源电压Vp，分压单元4223根据扫描信号XSc[n]以调整控制电压Vctl，使得像素驱动单元4224根据控制端A以及第二端C的电压差以提供驱动电流Id予发光二极管424，使得发光二极管424于上述发光时段内发光。
以图4A为例，具体说明像素驱动器中的各个元件，其中图4A绘示依照本发明另一实施例的像素驱动器的电路示意图，且图4A所示的像素驱动器522可应用于图2A所示的像素驱动器322，但不限于此，像素驱动器522亦可应用于其他类似的发光元件驱动器。相较于图3，输入单元4221包含晶体管Q1，晶体管Q1包含栅极端T13、第一端T11以及第二端T12。栅极端T13用以接收扫描信号Sc[n]。第一端T11用以接收数据信号Data[n]。第二端T12与像素驱动单元4224的第二端C连接于节点Ns，以在晶体管Q1导通时传送数据电压Vdata予像素驱动单元4224。
如图4A所示的实施例中，电源开关单元4222可包含晶体管Q2，晶体管Q2包含栅极端T23、第一端T21以及第二端T22。栅极端T23用以接收电源控制信号EM[n]。第一端T21用以接收电源电压OVDD。第二端T22与像素驱动单元4224的第一端B连接于节点Nd，以在晶体管Q2导通时传送电源电压Vp予像素驱动单元4224。
如图4A所示的实施例中，短路单元4225可包含晶体管Q4，晶体管Q4包含栅极端T53、第一端T51以及第二端T52。栅极端T53用以接收扫描信号Sc[n]。第一端T51连接于节点Nd，即第一端T51会连接像素驱动单元4224的第一端B及电源开关单元4222的第二端T22，且第二端T52与像素驱动单元4224的控制端A皆连接于控制电压Vctl，即节点，以在晶体管Q4导通时将像素驱动单元4224的第一端B与控制端A短路。
如图4A所示的实施例中，像素驱动单元4224可包含晶体管Q3，晶体管Q3包含栅极端T43、第一端T41以及第二端T42。栅极端T43与像素驱动单元4224的控制端A连接。第一端T41与像素驱动单元4224的第一端B连接。第二端T42与像素驱动单元4224的第二端C连接。在本实施例中，发光二极管424具有两端（例如：二电极），一端（一电极）连接节点Ns，即一端接收数据电压Vdata且与晶体管Q3电性连接，另一端（另一电极）接收电源电压OVSS。
如图4A所示的实施例中，分压单元4223可包含电容器C51，电容器C51包含第一端T311以及第二端T312。第一端T311与像素驱动单元4224的控制端A电性连接，即第一端T311会连接至控制电压Vctl（节点）。第二端T312用以接收扫描信号XSc[n]，使得扫描信号XSc[n]透过电容器C51耦合，进而使得分压单元4223根据扫描信号XSc[n]以调整控制电压Vctl。在另一实施例中，分压单元4223更包含电容器C52，电容器C52包含第一端T321以及第二端T322。电容器C52的第一端T321连接电容器C51的第一端T311且电容器C52的第一端T321与电容器C51的第一端T311皆连接于控制电压Vctl（节点），第二端T322用以接收电源电压OVDD。
针对扫描信号XSc[n]透过电容器C51耦合而言，更具体的说明，扫描信号XSc[n]根据电容器C51以及电容器C52的电容比例耦合至控制电压Vctl，例如：电容器C51具有电容量Cap1，电容器C52具有电容量Cap2，而在扫描信号XSc[n]由低电位VGL转态为高电位VGH时，分压单元4223将扫描信号XSc[n]的电位差（VGH－VGL）以的比例耦合至控制电压Vctl的电位。
下述将以图4A配合图4B说明本发明所示的像素驱动器的操作，其中图4B绘示本发明一实施例的操作信号时序示意图。在一实施例中，如图4B所示，于重置时段tr内，具有高电位的扫描信号Sc[n]提供予输入单元4221与短路单元4225，然后具高电位的电源控制信号EM[n]提供予电源开关单元4222，以透过短路单元4225利用电源电压Vp重置控制电压Vctl。
更具体的说明，于图4B所示的重置时段tr内，晶体管Q1导通而将节点Ns的电位重置为数据电压Vdata，且同时晶体管Q4导通而将控制电压Vctl与节点Nd短路，其中节点Nd的电位为电源电压Vp，电源电压Vp为晶体管Q2导通传送电源电压OVDD所提供。数据电压Vdata与电源电压OVSS之间的差值设定为小于发光二极管424的门槛电压值（例如：数据电压Vdata与电源电压OVSS之间的差值约在-1～2.5伏特，而发光二极管424的门槛电压值约为2.5伏特），使得在重置时段tr内的发光二极管424不被驱动发光。
接着，于重置时段tr之后的充电时段ts内，电源控制信号EM[n]从高电位切换为低电位以停止输出电源电压Vp，使得像素驱动单元4224执行电压补偿，然后具电位VGL的扫描信号XSc[n]提供予分压单元4223。
更具体的说明，于图4B所示的充电时段ts内，晶体管Q2关断而使得节点Nd以及控制电压Vctl的电位不钳位于电源电压Vp，又由于晶体管Q3的第一端T41与栅极端T43短路（节点Nd与控制电压Vctl短路）使得晶体管Q3以二极管的型态运作，晶体管Q3接着将控制电压Vctl与节点Ns之间的电位差充电至晶体管Q3的门槛电压值Vth。因为晶体管Q1仍旧导通，使得节点Ns的电位钳位于数据电压Vdata，进而使得控制电压Vctl的电位充电至电位（Vdata＋Vth）以完成像素补偿操作。再者，扫描信号XSc[n]的电位VGL的施加使得电容器C51以及电容器C52据以充电。
接着，于充电时段ts之后的发光时段te内，电源控制信号EM[n]从低电位切换为高电位以输出电源电压Vp，扫描信号Sc[n]从高电位切换为低电位以停止输出数据电压Vdata以及除能短路单元4225的短路操作，扫描信号XSc[n]从电位VGL切换为电位VGH以调整控制电压Vctl进而驱动发光二极管424。
更具体的说明，于图4B所示的发光时段te内，晶体管Q4关断，使得控制电压Vctl直接由电容器C51以及电容器C52所组成的分压单元4223所控制。扫描信号XSc[n]的转态使得电容器C51、C52据以充电而将扫描信号XSc[n]的电位差（VGH–VGL）耦合至控制电压Vctl的电位，进而使得控制电压Vctl的电位由电位（Vdata＋Vth）抬升至电位[Vdata＋Vth＋a×(VGH－VGL)]，其中a为电容比例： a = Cap 1 Cap 1 + Cap 2 , 单位:无。
于图4B所示的发光时段te内，由于晶体管Q1关断，使得节点Ns不再钳位于数据电压Vdata，进而使得节点Ns的电位调整为电位（OVSS＋Voled），其中Voled为发光二极管424的跨压。其次，由于晶体管Q2导通电源电压OVDD而传送电源电压Vp，使得晶体管Q3根据抬升后的控制电压Vctl输出驱动电流Id以驱动发光二极管424，其中驱动电流为Id=k[Vdata+a(VGH-VGL)-OVSS-Voled]2，Id的单位为安培（A），k为晶体管工艺常数，单位:无。
由上述可知，本发明所示的像素驱动器，其所提供的驱动电流无晶体管的门槛电压值Vth的因子，使得避免驱动电流不一致，如图5所示，图5绘示图4A所示的驱动电流Id相对于数据电压Vdata的曲线示意图。如图5所示，门槛电压值Vth在变化范围为正偏移约0.3伏特与负偏移约0.3伏特以内，驱动电流Id的变化曲线叠合在一起，换言之，驱动电流Id相对于门槛电压值Vth的变化均维持一致。
因此，采用本发明所示的像素驱动器可避免各个驱动晶体管的差异造成驱动电流不一致，同时亦可避免电源电压的压降差异造成驱动电流不一致，进而避免显示面板亮度不均匀。
图4A所示的像素驱动器522由N型晶体管所组成，但不限于此，换言之，本发明所示的像素驱动器亦可由P型晶体管所组成。其中，上述图示所述的晶体管类型可包含底栅型晶体管、顶栅型晶体管、或其它合适的类型，且构成晶体管的半导体材料，可包含氧化物半导体材料、有机半导体材料、多晶硅、非晶硅、单晶硅、微晶硅、纳米晶硅、或其它合适材料。以图6A为例，图6A绘示依照本发明另一实施例的像素驱动器的示意图。如图6A所示，像素驱动器722包含晶体管Qp1～Qp4以及电容C71与C72，其中晶体管Qp1～Qp4为P型晶体管。晶体管Qp1的栅极端由扫描信号Sc[k]所控制，晶体管Qp1的一端接收数据信号Data[k]，其另一端与发光二极管724的一端连接于节点Ns。晶体管Qp2的栅极端由电源控制信号EM[k]所控制，晶体管Qp2的一端接收电源电压OVSS，其另一端连接于节点Nd。晶体管Qp3的栅极端接收控制电压Vctl，晶体管Qp3的一端连接于节点Ns，其另一端连接于节点Nd。晶体管Qp4的栅极端由扫描信号Sc[k]所控制，晶体管Qp4的一端电性连接于节点Nd，其另一端连接于控制电压Vctl。电容C71的一端由扫描信号XSc[k]所控制，其另一端与控制电压Vctl电性连接。电容C72的一端接收电源电压OVSS且连接晶体管Qp2的一端，其另一端与控制电压Vctl连接。举例而言，电容72的另一端连接电容71的另一端、晶体管Qp4的另一端与晶体管Qp3的栅极端。
图6A所示的像素驱动器722可根据图6B所示的操作信号进行操作，其中图6B绘示依照本发明另一实施例的操作信号时序示意图。图6A所示的像素驱动器722的操作与图4A所示的像素驱动器522的操作类似，以下不再赘述。但是，图6B的控制信号EM[n]、扫描信号Sc[n]及XSc[n]的波形相位相反于图4B的控制信号EM[n]、扫描信号Sc[n]及XSc[n]的波形相位。
由上述实施例可知，如图2A及图2B所示，本发明中每一级移位缓存器34与相对应的扫描线SL1～SLW之间各自设置有控制模块36，控制模块36可采用简单的反向器361以及电源控制信号产生器362（仅须两个晶体管开关即可实现）。如图2A所绘示第N级移位缓存器34与相对应的扫描线SLN之间设置的控制模块36，反向器361可将其中一个扫描信号转换为另一个扫描信号，电源控制信号产生器362产生电源控制信号EM[n]藉以供第n行上的所有像素驱动器322接收使用。因此，本实施例不需要另一组移位缓存器、另一组缓冲器（以提供反向的扫描信号XSc[n]）以及额外的电源、时钟脉冲信号拉线（以提供电源控制信号EM[n]），进而减少整体电路布局所需面积，使得电路整合于其中的显示面板边框能设计的更窄。
由上述可知，采用本发明所示的像素驱动器可避免各个驱动晶体管的差异造成驱动电流不一致，同时亦可避免电源电压的压降差异造成驱动电流不一致，进而避免显示面板亮度不均匀。
本发明的另一态样关于一种像素驱动器的驱动方法，其中此驱动方法可应用于图3所示的像素驱动器422或者图4A所示的像素驱动器522，但不限于此。以下参照图3说明驱动方法。本驱动方法包含以下步骤：提供一如图3所示的像素驱动器422；接着，在重置时段内（如图4B所示的重置时段tr），使该电源开关单元导通以输出该第一电源电压至该第一端，由短路单元4225根据扫描信号Sc[n]将控制端A与第一端B短路，以利用电源电压Vp重置控制电压Vctl；然后，于上述重置时段之后的充电时段内（如图4B所示的充电时段ts），由电源开关单元4222停止输出电源电压Vp，且由短路单元4225根据扫描信号Sc[n]将控制端A与第一端B短路，输入单元4221根据扫描信号Sc[n]输出数据电压Vdata至该第二端C，使得像素驱动单元4224执行电压补偿；接着，于上述充电时段之后的发光时段内（如图4B所示的发光时段te），由电源开关单元4222根据电源电压OVDD以及电源控制信号EM[n]输出电源电压Vp，且由分压单元4223根据扫描信号XSc[n]调整控制电压Vctl，使得像素驱动单元4224根据控制端A以及该该第二端C的电压差以提供驱动电流Id予发光二极管424。
在一实施例中，像素驱动单元4224执行电压补偿的步骤更包含以下步骤：由像素驱动单元4224将门槛电压（例如：图4A所示的晶体管Q3的门槛电压）与数据电压Vdata叠加以进而储存于控制电压Vctl。
如图4B所示，在一实施例中，驱动方法在重置时段tr内更包含以下步骤：首先，提供具高电位的扫描信号Sc[n]至输入单元4221与短路单元4225；其次，提供具高电位的电源控制信号EM[n]至电源开关单元4222，以透过短路单元4225利用电源电压Vp重置控制电压Vctl。
如图4B所示，在一实施例中，驱动方法在充电时段ts内更包含以下步骤：首先，将电源控制信号EM[n]从高电位切换为低电位以停止输出电源电压Vp，使得像素驱动单元4224执行电压补偿；其次，提供具电位VGL的扫描信号XSc[n]至分压单元4223。
如图4B所示，在一实施例中，驱动方法在发光时段te内更包含以下步骤：首先，将电源控制信号EM[n]从低电位切换为高电位以输出电源电压Vp；其次，将扫描信号Sc[n]从高电位切换为低电位以停止输出数据电压Vdata以及除能短路单元4225的短路操作；接着，扫描信号XSc[n]从电位VGL切换为电位VGH以调整控制电压Vctl进而驱动发光二极管424。本发明所示的用于像素驱动器的具体驱动方法如图4A搭配图4B所示的实施例的操作，以下不再赘述。
由以上实施例可知，采用本发明所示的用于像素驱动器的驱动方法可通过电压补偿操作避免各个驱动晶体管的差异造成驱动电流不一致，同时亦可避免电源电压的压降差异造成驱动电流不一致，进而避免显示面板亮度不均匀。
综上所述，采用本发明所示的像素驱动器的优点在于可避免各个驱动晶体管的差异造成驱动电流不一致，同时亦可避免电源电压的压降差异造成驱动电流不一致，进而避免显示面板亮度不均匀。
再者，本发明所示的显示面板可采用简单的反向器以产生两个扫描信号中其中一者，而无需另一组移位缓存器、另一组缓冲器以及额外的电源、时钟脉冲信号拉线，进而减少整体电路布局所需面积，使得电路整合于其中的显示面板边框能设计的更窄。
其次，本发明所示的显示面板可采用简单的两个晶体管以产生电源控制信号，而无需另一组移位缓存器、另一组缓冲器以及额外的电源、时钟脉冲信号拉线，进而减少整体电路布局所需面积，使得电路整合于其中的显示面板边框能设计的更窄。
虽然本发明已以实施方式揭露如上，然其并非用以限定本发明，任何本领域技术人员，在不脱离本发明的精神和范围内，当可作各种的更动与润饰，因此本发明的保护范围当以权利要求书为准。

Claims (10)

1.一种像素驱动器，用以驱动一发光二极管，一移位缓存器提供扫描信号予相应的扫描线，其特征在于，该像素驱动器包含：
一输入单元，用以根据移位缓存器提供的一第一扫描信号以及一数据信号以输出一数据电压；
一电源开关单元，用以根据一第一电源电压以及一电源控制信号以输出该第一电源电压；
一分压单元，用以根据移位缓存器提供的一第二扫描信号以调整一控制电压；
一像素驱动单元，包含：
一第一端；
一第二端，连接该发光二极管；以及
一控制端，用以接收该控制电压，其中该像素驱动单元用以根据该控制端以及该第二端的电压差以提供一驱动电流予该发光二极管；以及
一短路单元，用以根据该第一扫描信号将该控制端与该第一端短路；
其中，一控制模块耦接于每一行的移位缓存器与相应的一组扫描线之间，控制模块包含反向器以及电源控制信号产生器，反向器用以根据第一扫描信号Sc[n]产生反向的第二扫描信号XSc[n]，电源控制信号产生器根据两个扫描信号Sc[n]与XSc[n]以及时钟脉冲信号CK_h产生电源控制信号EM[n]。
2.如权利要求1所述的像素驱动器，其特征在于，于一重置时段内，该短路单元根据该第一扫描信号将该控制端与该第一端短路以利用该第一电源电压重置该控制电压。
3.如权利要求2所述的像素驱动器，其特征在于，于该重置时段之后的一充电时段内，该电源开关单元停止输出该第一电源电压，且该短路单元根据该第一扫描信号将该控制端与该第一端短路，该输入单元根据该第一扫描信号输出该数据电压至该第二端。
4.如权利要求3所述的像素驱动器，其特征在于，于该充电时段之后的一发光时段内，该电源开关单元输出该第一电源电压，该分压单元根据该第二扫描信号以调整该控制电压，使得该像素驱动单元根据该控制端以及该第二端的电压差以提供该驱动电流予该发光二极管。
5.如权利要求1所述的像素驱动器，其特征在于，该发光二极管具有一第三端以及一第四端，该第三端用以接收该数据电压，该第四端用以接收一第三电源电压，其中该数据电压与该第三电源电压的差值小于该发光二极管的门槛电压值。
6.如权利要求1所述的像素驱动器，其特征在于，该输入单元包含一第一晶体管，该第一晶体管包含：
一栅极端，用以接收该第一扫描信号；
一第一端，用以接收该数据信号；以及
一第二端，与该像素驱动单元的第二端电性连接以传送该数据电压予该像素驱动单元。
7.如权利要求1所述的像素驱动器，其特征在于，该电源开关单元包含一第二晶体管，该第二晶体管包含：
一栅极端，用以接收该电源控制信号；
一第一端，用以接收该第一电源电压；以及
一第二端，与该像素驱动单元的第一端电性连接以传送该第一电源电压予该像素驱动单元。
8.如权利要求1所述的像素驱动器，其特征在于，该短路单元包含一第三晶体管，该第三晶体管包含：
一栅极端，用以接收该第一扫描信号；
一第一端，与该像素驱动单元的第一端电性连接；以及
一第二端，与该像素驱动单元的控制端电性连接。
9.如权利要求1所述的像素驱动器，其特征在于，该像素驱动单元包含一第四晶体管，该第四晶体管包含：
一栅极端，与该像素驱动单元的控制端电性连接；
一第一端，与该像素驱动单元的第一端电性连接；以及
一第二端，与该像素驱动单元的第二端电性连接。
10.如权利要求1所述的像素驱动器，其特征在于，该分压单元包含一第一电容器和一第二电容器，该第一电容器包含：
一第一端，与该像素驱动单元的控制端电性连接；以及
一第二端，用以接收该第二扫描信号，使得该第二扫描信号透过该第一电容器耦合，进而使得该分压单元根据该第二扫描信号以调整该控制电压；
该第二电容器包含：
一第一端，与该第一电容器的第一端电性连接；以及
一第二端，用以接收该第一电源电压；
其中该第二扫描信号根据该第一电容器以及该第二电容器的电容比例耦合至该控制电压。
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