CN103338014B - 运算放大器电路 - Google Patents

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Abstract

本发明提供一种运算放大器电路，包括第一级放大器电路、第二级放大器电路以及第一前馈电路。第一级放大器电路耦接至第一输入节点，用以接收第一输入信号并且放大第一输入信号，以产生第一放大信号。第二级放大器电路，耦接至第一级放大器电路，用以接收第一放大信号，并且放大第一放大信号，用以于第一输出节点产生第一输出信号。第一前馈电路耦接于第一输入节点与第二级放大器电路之间，用以将第一输入信号前馈至第二级放大器电路。

Description

运算放大器电路
技术领域
本发明关于一种高速运算放大器，特别关于一种具有高线性度与设计自由度的高速运算放大器电路。
背景技术
高速运算放大器具有使用为高频(例如，数个GHz)应用领域之趋势。当设计高速运算放大器时，可于运算放大器电路中使用一个或多个跨导(transconductance)，用以扩展运算放大器的操作带宽。然而，由于寄生的极点可能造成运算放大器变得不稳定，致使需要更大的电流来稳定运算放大器，因此对于比数个GHz还宽的宽带应用是相当耗电的。
有鉴于此，需要一种全新的高速运算放大器电路，比传统电路更稳定、功耗更低，并且具有高线性度以及高设计自由度等特性。
发明内容
有鉴于此，有必要提供一种运算放大器电路，以解决所述技术问题。
根据本发明之一实施例，一种运算放大器电路，包括第一级放大器电路、第二级放大器电路以及第一前馈电路。第一级放大器电路耦接至第一输入节点，用以接收第一输入信号并且放大第一输入信号，以产生第一放大信号。第二级放大器电路，耦接至第一级放大器电路，用以接收第一放大信号，并且放大第一放大信号，用以于第一输出节点产生第一输出信号。第一前馈电路耦接于第一输入节点与第二级放大器电路之间，用以将第一输入信号前馈至第二级放大器电路。
根据本发明之另一实施例，一种运算放大器电路，包括第一级放大器电路、第二级放大器电路、第一前馈电路以及第二前馈电路。第一级放大器电路耦接至第一输入节点与第二输入节点，用以接收第一输入信号与第二输入信号、放大第一输入信号以产生第一放大信号、并且放大第二输入信号以产生第二放大信号。第二级放大器电路耦接至第一级放大器电路，用以接收第一放大信号与第二放大信号，并且放大第一放大信号与第二放大信号，用以于第一输出节点产生第一输出信号以及于第二输出节点产生第二输出信号。第二级放大器电路包括耦接于一操作电压与所述第一输出节点之间之第一晶体管、耦接于第一输出节点与接地点之间之第二晶体管、耦接于所述操作电压与所述第二输出节点之间之第三晶体管、以及耦接于所述第二输出节点与所述接地点之间之第四晶体管。第一前馈电路耦接于第一输入节点与第二晶体管之一栅极之间，用以将第一输入信号前馈至第二晶体管之栅极。第二前馈电路耦接于第二输入节点与第四晶体管之一栅极之间，用以将第二输入信号前馈至第四晶体管之栅极。
与传统两级运算放大器相比，由于前馈电路提供了交流(AC)耦和路径，运算放大器电路之相位容限具有显着的改善，尤其是在高频区。因此，本发明所提出之运算放大器电路可成为高频应用中较佳的选择，以期能达到如上所述的高线性度以及设计自由度之功效。
附图说明
图1显示根据本发明之一实施例所述的运算放大器电路方块图。
图2显示根据本发明之一实施例所述的运算放大器范例电路图。
图3显示根据本发明之另一实施例所述的运算放大器范例电路图。
图4显示根据本发明之一实施例所述的具有本发明所提出之前馈路径以及无本发明所提出之前馈路径之运算放大器电路之相位容限模拟结果对照图。
具体实施方式
为使本发明之所述目的、特征和优点能更明显易懂，下文特举一较佳实施例，并配合所附图式，作详细说明如下。
第1图显示根据本发明之一实施例之运算放大器电路200的方块图。根据本发明之一实施例，运算放大器电路200可包括至少两级放大器电路以及频率补偿电路。第一级放大器电路210可耦接于运算放大器电路200的一对差动输入节点，用以接收一对差动输入信号Vin与Vip，并且放大所述差动输入信号Vin与Vip，用以分别于节点N1与N2产生放大过的信号V1与V2。第二级放大器电路可包含两个电路子单元220-1与220-2，其分别与第一级放大器电路210耦接于节点N1与N2，用以自第一级放大器电路210接收放大过的信号V1与V2，并且进一步放大所述放大过的信号V1与V2，以分别于运算放大器电路200的输出节点产生输出信号Vop与Von，其中输出信号Vop与Von可为一对差动输出信号。频率补偿电路230与240用以对运算放大器电路200的频率响应执行米勒补偿(millercompensation)。
根据本发明之一实施例，运算放大器电路200可更包括两前馈电路250与260，其分别耦接于运算放大器电路200的一输入节点与第二级放大器电路之间，用以于输入节点与第二级放大器电路之间提供一前馈路径。通过前馈电路250与260，差动输入信号Vin与Vip可直接被馈入至第二级放大器电路。于此实施例中，第二级放大器电路为耦接至运算放大器电路200的输出节点的最后一级放大器电路。根据本发明之一实施例，将输入信号馈入至输出端可在运算放大器电路200的整体转换函数(transferfunction)中产生一或多个额外的零点(zero)。额外的零点可用以消除运算放大器电路200的整体转换函数的极点(pole)。因此，产生额外的零点可用以减少运算放大器电路200的等效级数(equivalentstage)。等效级数减少有助于稳定运算放大器电路200，并且可进一步扩展运算放大器电路200的操作带宽。于此实施例中，运算放大器电路200于高频之级数(order)最终可降低至1，显示出此运算放大器电路200具有适用于高频应用的强大结构(因为其稳定度可轻易地被控制)。根据本发明之实施例，具有前馈电路的运算放大器电路200可被设计为A类放大器或AB类放大器。以下段落将针对本发明所提出之运算放大器电路200的多个范例电路图作详细的介绍与讨论。
第2图显示根据本发明之一实施例所述的运算放大器范例电路图。根据本发明之一实施例，运算放大器电路300可包括至少第一级放大器电路310以及第二级放大器电路320-1与320-2、频率补偿电路330与340以及前馈电路350与360。第一级放大器电路310耦接于运算放大器电路300的一对差动输入节点，用以接收一对差动输入信号Vin与Vip，并且放大所述差动输入信号Vin与Vip，用以分别于节点N1与N2产生放大过的信号。第一级放大器电路310可包括多个晶体管M0～M8。晶体管M0可耦接至偏压电压Vb1。晶体管对M1与M2可耦接至运算放大器电路300的输入节点，用以接收所述输入信号Vin与Vip。晶体管对M3与M4可耦接至偏压电压Vcasn。晶体管对M5与M6可耦接至偏压电压Vcasp。晶体管对M7与M8可耦接至偏压电压VCMFB，用以设定输出信号Von与Vop的输出共模电压(outputcommonmodevoltage)。
第二级放大器电路可包含两个电路子单元320-1与320-2，其分别与第一级放大器电路310耦接于节点N1与N2，用以自第一级放大器电路310接收放大过的信号V1与V2，并且进一步放大所述放大过的信号，用以分别于运算放大器电路300的输出节点产生输出信号Vop与Von。第二级放大器电路的电路子单元320-1可包括晶体管M9与M11，而第二级放大器电路的电路子单元320-2可包括晶体管M10与M12。晶体管M11可耦接于操作电压VDD与第一输出节点(即信号Vop的输出处)之间，用以输出输出信号Vop。晶体管M9可耦接于第一输出节点与接地点之间。晶体管M12可耦接于操作电压VDD与第二输出节点(即信号Von的输出处)之间，用以输出输出信号Von。晶体管M10可耦接于第二输出节点与接地点之间。根据本发明之一实施例，输出信号Vop与Von可为一对差动输出信号。
频率补偿电路330可包括电容CC1与电阻RC1，所述电容CC1与电阻RC1串联耦接于节点N1与运算放大器电路300的第一输出节点之间，用以执行米勒补偿。频率补偿电路340可包括电容CC2与电阻RC2，所述电容CC2与电阻RC2串联耦接于节点N2与运算放大器电路300的第二输出节点之间，用以执行米勒补偿。
前馈电路350可包括前馈电容Cf1，其具有耦接至第二输入节点并用以接收输入信号Vin的第一端以及耦接至晶体管M9的栅极的第二端。根据本发明之一实施例，输入信号Vin通过前馈电容Cf1被馈入晶体管M9的栅极。前馈电路360可包括前馈电容Cf2，其具有耦接至第一输入节点并用以接收输入信号Vip的第一端以及耦接至晶体管M10的栅极的第二端。根据本发明之一实施例，输入信号Vip通过前馈电容Cf2被馈入晶体管M10的栅极。根据本发明之一实施例，晶体管M9与M10的栅极可更耦接至一偏压电压Vbnh，而位于晶体管M9与M10栅极端的电容Cp1与Cp2为寄生电容。
如上述，将输入信号馈入至输出端可在运算放大器电路300的整体转换函数(transferfunction)中产生一个或多个额外的零点(zero)。额外的零点可用以消除运算放大器电路300的整体转换函数的极点(pole)。因此，产生额外的零点可用以减少运算放大器电路300的等效级数。等效级数的减少有助于稳定运算放大器电路300，并且可进一步扩展运算放大器电路300的操作带宽。此外，于此实施例中，由于第二级放大器电路中仅包含四个晶体管，其中接收前馈输入信号Vin与Vip的晶体管M9与M10直接耦接至接地点，因此电压摆幅将不会受限于耦接至晶体管M9与M10的源极的晶体管的电压限度(headroom)。换言之，于第2图中所示之运算放大器电路300中，并没有传统技术中为了提供适当的共模电压至输出节点Vop与Von而使用的额外晶体管耦接至晶体管M9与M10的源极。取而代之，共模电压由晶体管M7与M8通过偏压电压VCMFB的的调整机制而决定。如此一来，由于仅有一个装置耦接于输出节点与操作电压VDD或输出节点与接地点之间，第2图中所示之运算放大器电路300的线性度可被大幅提升。
此外，运算放大器电路300的操作带宽可通过以下三种方式进一步被扩大，所述三种方式包括：1)降低频率补偿电路中电容CC1以及/或CC2的电容值，2)增加流经第二级放大器电路的晶体管M9～M12的电流，以及3)增加流经第一级放大器电路310的晶体管M0、M1与M2的电流。由于电路设计者可有弹性地选择电容值以及/或电流之一或多者作调整以扩展操作带宽，与传统运算放大器相比，带宽控制的设计自由度也可大幅提升。
第3图显示根据本发明之另一实施例所述的运算放大器范例电路图。根据本发明之实施例，运算放大器电路400可包括至少第一级放大器电路410以及第二级放大器电路420-1与420-2、频率补偿电路430与440以及前馈电路450与460。第一级放大器电路410耦接于运算放大器电路400的一对差动输入节点，用以接收一对差动输入信号Vin与Vip，并且放大所述差动输入信号Vin与Vip，用以分别于节点N1与N2产生放大过的信号。第一级放大器电路410可包括多个晶体管Mc0～Mc8。晶体管Mc0可耦接至偏压电压Vb1。晶体管对Mc1与Mc2可耦接至运算放大器电路400的输入节点，用以分别接收输入信号Vin与Vip。晶体管对Mc3与Mc4可耦接至偏压电压Vcasn。晶体管对Mc5与Mc6可耦接至偏压电压Vcasp。晶体管对Mc7与Mc8可耦接至偏压电压VCMFB。
第二级放大器电路可包含两个电路子单元420-1与420-2，其分别与第一级放大器电路410耦接于节点N1与N2，用以自第一级放大器电路410接收放大过的信号，并且进一步放大所述放大过的信号，用以分别于运算放大器电路400的输出节点产生输出信号Vop与Von。第二级放大器电路的电路子单元420-1可包括晶体管Ma1与Ma2，而第二级放大器电路的电路子单元420-2可包括晶体管Mb1与Mb2。晶体管Ma2可耦接于操作电压VDD与用以输出输出信号Vop的第一输出节点之间。晶体管Ma1可耦接于第一输出节点与接地点之间。晶体管Mb2可耦接于操作电压VDD与用以输出输出信号Von的第二输出节点之间。晶体管Mb1可耦接于第二输出节点与接地点之间。根据本发明之一实施例，输出信号Vop与Von可为一对差动输出信号。
补偿电路430可耦接于第一级放大器电路410与第一输出节点之间，并且包括电容Cc1与Cc2以及电阻Rc1，用以执行米勒补偿。频率补偿电路440可耦接于第一级放大器电路410与第二输出节点之间，并且包括电容Cc3与Cc4以及电阻Rc2，用以执行米勒补偿。
前馈电路450可包括两前馈电容Cfa1与Cfa2。前馈电路460可包括两前馈电容Cfb1与Cfb2。根据本发明之一实施例，运算放大器电路400可更包括两AB类控制电路470与480，控制电路470包括静态偏压晶体管Ma3、Ma4、以及动态偏压晶体管Ma5、Ma6。控制电路480包括Mb3与Mb4以及动态偏压晶体管Mb5与Mb6。为了将输入信号前馈至第二级放大器电路，动态偏压晶体管Ma5、Ma6、Mb5与Mb6也可作为源级追随器输入，其适用于高频应用，并且不会造成显著的稳定度折损。于此实施例中，作为源极追随器之控制电路470可包括由晶体管Ma3与Ma5所组成的一P型源极追随器以及由晶体管Ma4与Ma6所组成的一N型源极追随器。此外，于此实施例中，作为源极追随器的控制电路480可包括由晶体管Mb3与Mb5所组成之一P型源极追随器以及由晶体管Mb4与Mb6所组成的一N型源极追随器。
根据本发明之一实施例，前馈电容Cfa1的第一端可耦接至运算放大器电路400的第二输入节点，用以接收输入信号Vin，而前馈电容Cfa1的第二端可耦接至由晶体管Ma3与Ma5所组成的P型源极追随器的输入晶体管Ma5的栅极。由晶体管Ma3与Ma5所组成的P型源极追随器的输出端可与第二级放大器电路的晶体管Ma2的栅极耦接于节点N1。此外，前馈电容Cfa2的第一端可耦接至运算放大器电路400的第二输入节点，用以接收输入信号Vin，而前馈电容Cfa2的第二端可耦接至由晶体管Ma4与Ma6所组成的N型源极追随器的输入晶体管Ma6的栅极。由晶体管Ma4与Ma6所组成的N型源极追随器的输出端可与第二级放大器电路的晶体管Ma1的栅极耦接于节点N3。
同样地，前馈电容Cfb1的第一端可耦接至运算放大器电路400的第一输入节点，用以接收输入信号Vip，而前馈电容Cfb1的第二端可耦接至由晶体管Mb3与Mb5所组成的P型源极追随器的输入晶体管Mb5的栅极。由晶体管Mb3与Mb5所组成的P型源极追随器的输出端可与第二级放大器电路的晶体管Mb2的栅极耦接于节点N2。此外，前馈电容Cfb2的第一端可耦接至运算放大器电路400的第一输入节点，用以接收输入信号Vip，而前馈电容Cfb2的第二端可耦接至由晶体管Mb4与Mb6所组成的N型源极追随器的输入晶体管Mb6的栅极。由晶体管Mb4与Mb6所组成的N型源极追随器的输出端可与第二级放大器电路的晶体管Mb1的栅极耦接于节点N4。
根据本发明之一实施例，由于由晶体管Ma3与Ma5所组成的P型源极追随器的输入端耦接至前馈电容Cfa1，用以接收输入信号Vin，并且P型源极追随器的输出端与晶体管Ma2的栅极耦接于节点N1，输入信号Vin可通过前馈电容Cfa1与P型源极追随器被馈入至晶体管Ma2的栅极。此外，由于由晶体管Ma4与Ma6所组成的N型源极追随器的输入端耦接至前馈电容Cfa2，用以接收输入信号Vin，并且N型源极追随器的输出端与晶体管Ma1的栅极耦接于节点N3，输入信号Vin也可通过前馈电容Cfa2与N型源极追随器被馈入至晶体管Ma1的栅极。
同样地，根据本发明之一实施例，由于由晶体管Mb3与Mb5所组成的P型源极追随器的输入端耦接至前馈电容Cfb1，用以接收输入信号Vip，并且P型源极追随器的输出端与晶体管Mb2的栅极耦接于节点N2，输入信号Vip可通过前馈电容Cfb1与P型源极追随器被馈入至晶体管Mb2的栅极。此外，由于由晶体管Mb4与Mb6所组成的N型源极追随器的输入端耦接至前馈电容Cfb2，用以接收输入信号Vip，并且N型源极追随器的输出端与晶体管Mb1的栅极耦接于节点N4，输入信号Vip也可通过前馈电容Cfb2与N型源极追随器被馈入至晶体管Mb1的栅极。
根据本发明一实施例，晶体管Ma5的栅极以及晶体管Mb5的栅极可更耦接至偏压电压Vbp，并且晶体管Ma6的栅极以及晶体管Mb6的栅极可更耦接至偏压电压Vbn。此外，晶体管Ma4的栅极以及晶体管Mb4的栅极可耦接至偏压电压Vb1，并且晶体管Ma3的栅极以及晶体管Mb3的栅极可耦接至偏压电压Vb2。值得注意的是，根据本发明之一些实施例，源极追随器电路(例如，AB类控制电路470与480)可被整合于第一级放大器电路410内，作为第一级放大器电路410的一部份，而本发明并不限于任一种实施方式。
如上述，将输入信号馈入输出端可为运算放大器电路400的整体转换函数(transferfunction)产生一或多个额外的零点(zero)。额外的零点可用以消除运算放大器电路400的整体转换函数的极点(pole)。因此，产生额外的零点可用以减少运算放大器电路400的等效级数。等效级数的减少有助于稳定运算放大器电路400，并且可进一步扩展运算放大器电路400的操作带宽。此外，于此实施例中，由于第二级放大器电路中仅包含四个晶体管，其中接收前馈输入信号Vin与Vip之晶体管Ma1与Mb1直接耦接至接地点，因此电压摆幅将不会受限于耦接至晶体管Ma1与Mb1的源极的晶体管的电压限度(headroom)。换言之，于第3图中所示的运算放大器电路中，并没有传统技术中为了提供适当的共模电压至输出节点Vop与Von而使用的额外晶体管耦接至晶体管Ma1与Mb1的源极。取而代之，共模电压由晶体管Mc7与Mc8通过偏压电压VCMFB的调整机制而决定。如此一来，由于仅有一个装置耦接于输出节点与操作电压VDD或输出节点与接地点之间，第3图中所示的运算放大器电路400的线性度可被大幅提升。
此外，运算放大器电路400的操作带宽可通过以下三种方式进一步被扩大，所述的三种方式包括：1)降低频率补偿电路中电容CC1、CC2、CC3以及/或CC4之电容值，2)增加流经第二级放大器电路之晶体管Ma1、Ma2、Mb1以及/或Mb2之电流，以及3)增加流经第一级放大器电路之晶体管Mc0、Mc1与Mc2之电流。由于电路设计者可有弹性地选择电容值以及/或电流之一或多者作调整以扩展操作带宽，与传统运算放大器相比，带宽控制之设计自由度也可大幅提升。
第4图显示根据本发明之一实施例所述的具有本发明所提出的前馈路径以及无本发明所提出的前馈路径的运算放大器电路的相位容限(phasemargin)模拟结果对照图。如第4图所示，与传统两级运算放大器相比，由于前馈电路提供了交流(AC)耦和路径，具有本发明所提出的前馈路径的运算放大器电路的相位容限具有显着的改善，尤其是在高频区。因此，本发明所提出的运算放大器电路可成为高频应用中较佳的选择，以期能达到如上所述的高线性度以及设计自由度的功效。
在前面详细的描述中，通过参考本发明描述的特定实施例，本领域技术人员可以理解的是，在没有背离本发明的精神的情况下可以做出各种修改。且前面详细的描述以及附图应所述理解为是为了清楚的阐述发明，而不是作为本发明的限制。

Claims (19)

1.一种运算放大器电路，包括：
一第一级放大器电路，耦接至一第一输入节点，用以接收一第一输入信号并且放大所述第一输入信号，以产生一第一放大信号；
一第二级放大器电路，耦接至所述第一级放大器电路，用以接收所述第一放大信号，并且放大所述第一放大信号，用以于一第一输出节点产生一第一输出信号；
一第一前馈电路，耦接于所述第一输入节点与所述第二级放大器电路之间，用以将所述第一输入信号前馈至所述第二级放大器电路；以及
第一控制电路，包括第一源极跟随器，所述第一源极跟随器包括第一端，所述第一源极跟随器的第一端耦接至所述第一前馈电路并用以自所述第一前馈电路接收所述第一输入信号，其中，所述第一输入信号通过所述第一源极跟随器被馈入至所述第二级放大器电路。
2.如权利要求1所述的运算放大器电路，其特征在于，所述第一级放大器电路更耦接至一第二输入节点，用以接收一第二输入信号并且放大所述第二输入信号，以产生一第二放大信号，所述第二级放大器电路更接收所述第二放大信号，并且放大所述第二放大信号，用以于一第二输出节点产生一第二输出信号，并且其中所述第一输入信号与所述第二输入信号为一对差动输入信号，以及所述第一输出信号与所述第二输出信号为一对差动输出信号。
3.如权利要求2所述的运算放大器电路，更包括一第二前馈电路，耦接于所述第二输入节点与所述第二级放大器电路之间，用以将所述第二输入信号前馈至所述第二级放大器电路。
4.如权利要求3所述的运算放大器电路，其特征在于，所述第二级放大器电路包括一第一电路子单元，用以接收所述第一放大信号并且放大所述第一放大信号，所述第一电路子单元包括：
一第一晶体管，耦接于一操作电压与所述第一输出节点之间；以及
一第二晶体管，耦接于所述第一输出节点与一接地点之间，其中所述第一输入信号被馈入至所述第一晶体管与所述第二晶体管的至少一者的一栅极。
5.如权利要求4所述的运算放大器电路，其特征在于，所述第二级放大器电路包括一第二电路子单元，用以接收所述第二放大信号并且放大所述第二放大信号，所述第二电路子单元包括：
一第三晶体管，耦接于一操作电压与所述第二输出节点之间；以及
一第四晶体管，耦接于所述第二输出节点与一接地点之间，所述第二输入信号被馈入至所述第三晶体管与所述第四晶体管至少其中之一者的一栅极。
6.如权利要求4所述的运算放大器电路，其特征在于，所述第一前馈电路包括一第一前馈电容，所述第一前馈电容包括第一端以及第二端，所述第一前馈电容的第一端耦接至所述第一输入节点，所述第一前馈电容的第二端耦接至所述第二晶体管的所述栅极。
7.如权利要求5所述的运算放大器电路，其特征在于，所述第二前馈电路更包括一第二前馈电容，所述第二前馈电容包括第一端与第二端，所述第二前馈电容的第一端耦接至所述第二输入节点，所述第二前馈电容的第二端耦接至所述第四晶体管的所述栅极。
8.如权利要求4所述的运算放大器电路，其特征在于，
所述第一源极跟随器还包括第二端，所述第一源极跟随器的第二端耦接至所述第一晶体管与所述第二晶体管的其中一者的所述栅极；以及
所述第一控制电路还包括一第二源极跟随器，所述第二源极跟随器包括第一端与第二端，所述第二源极跟随器的第一端耦接至所述第一前馈电路并用以自所述第一前馈电路接收所述第一输入信号，以及所述第二源极跟随器的第二端耦接至所述第一晶体管与所述第二晶体管的另一者的所述栅极，
其中所述第一输入信号通过所述第一源极跟随器与所述第二源极跟随器被馈入至所述第一晶体管的栅极与所述第二晶体管的栅极。
9.如权利要求8所述的运算放大器电路，其特征在于，所述第一前馈电路包括一第一前馈电容以及一第二前馈电容，所述第一前馈电容包括耦接至所述第一输入节点的一第一端，以及耦接至所述第一源极跟随器的一输入晶体管的一栅极的一第二端，所述第二前馈电容包括耦接至所述第一输入节点的一第一端，以及耦接至所述第二源极跟随器的一输入晶体管的一栅极的一第二端。
10.如权利要求8所述的运算放大器电路，其特征在于，所述第一控制电路包含于所述第一级放大器电路内。
11.如权利要求5所述的运算放大器电路，更包括一第二控制电路，其特征在于，所述第二控制电路包括：
一第三源极跟随器，包括第一端和第二端，所述第三源极跟随器的第一端耦接至所述第二前馈电路并用以自所述第二前馈电路接收所述第二输入信号，以及所述第三源极跟随器的第二端耦接至所述第三晶体管与所述第四晶体管的其中一者的所述栅极；以及
一第四源极跟随器，包括第一端和第二端，所述第四源极跟随器的第一端耦接至所述第二前馈电路并用以自所述第二前馈电路接收所述第二输入信号，以及所述第四源极跟随器的第二端耦接至所述第三晶体管与所述第四晶体管的另一者的所述栅极，
其中所述第二输入信号通过所述第三源极跟随器与所述第四源极跟随器被馈入至所述第三晶体管的栅极与所述第四晶体管的栅极。
12.如权利要求11所述的运算放大器电路，其特征在于，所述第二前馈电路包括一第三前馈电容以及一第四前馈电容，所述第三前馈电容包括耦接至所述第二输入节点的一第一端，以及耦接至所述第三源极跟随器的一输入晶体管的一栅极的一第二端，所述第四前馈电容包括耦接至所述第二输入节点的一第一端，以及耦接至所述第四源极跟随器的一输入晶体管的一栅极的一第二端。
13.如权利要求11所述的运算放大器电路，其特征在于，所述第二控制电路包含于所述第一级放大器电路内。
14.一种运算放大器电路，包括：一第一级放大器电路、一第二级放大器电路、一第一前馈电路、一第二前馈电路以及一第一控制电路；
所述第一级放大器电路，耦接至一第一输入节点与一第二输入节点，用以接收一第一输入信号与一第二输入信号、放大所述第一输入信号以产生一第一放大信号、并且放大所述第二输入信号以产生一第二放大信号；
所述第二级放大器电路，耦接至所述第一级放大器电路，用以接收所述第一放大信号与所述第二放大信号，并且放大所述第一放大信号与所述第二放大信号，用以于一第一输出节点产生一第一输出信号以及于一第二输出节点产生一第二输出信号，所述第二级放大器电路包括：
一第一晶体管，耦接于一操作电压与所述第一输出节点之间；
一第二晶体管，耦接于所述第一输出节点与一接地点之间；
一第三晶体管，耦接于所述操作电压与所述第二输出节点之间；以及
一第四晶体管，耦接于所述第二输出节点与所述接地点之间；
所述第一前馈电路，耦接于所述第一输入节点与所述第二晶体管的一栅极之间，用以将所述第一输入信号前馈至所述第二晶体管的栅极；
所述第二前馈电路，耦接于所述第二输入节点与所述第四晶体管的一栅极之间，用以将所述第二输入信号前馈至所述第四晶体管的栅极；以及
所述第一控制电路，包括一第一N型源极跟随器和一第一P型源极跟随器，所述第一输入信号分别通过所述第一N型源极跟随器以及所述第一P型源极跟随器被馈入所述第二级放大器电路。
15.如权利要求14所述的运算放大器电路，其特征在于，所述第一输入信号与所述第二输入信号为一对差动输入信号，并且所述第一输出信号与所述第二输出信号为一对差动输出信号。
16.如权利要求14所述的运算放大器电路，其特征在于，所述第一前馈电路包括一第一前馈电容，所述第一前馈电容具有耦接至所述第一输入节点的一第一端以及耦接至所述第二晶体管之所述栅极的一第二端，并且所述第二前馈电路包括一第二前馈电容，所述第二前馈电容具有耦接至所述第二输入节点的一第一端以及耦接至所述第四晶体管的所述栅极的一第二端。
17.如权利要求14所述的运算放大器电路，所述第一前馈电路包括：
一第一前馈电容，具有耦接至所述第一输入节点的一第一端，以及耦接至所述第一N型源极跟随器的一输入晶体管的一栅极的一第二端；以及
一第二前馈电容，具有耦接至所述第一输入节点的一第一端，以及耦接至所述第一P型源极跟随器的一输入晶体管的一栅极的一第二端；以及
所述第一输入信号分别通过所述第一N型源极跟随器以及所述第一P型源极跟随器被馈入所述第二晶体管的栅极以及所述第一晶体管的栅极。
18.如权利要求17所述的运算放大器电路，更包括：
一第二控制电路，包括一第二N型源极跟随器以及一第二P型源极跟随器；以及
所述第二前馈电路包括：
一第三前馈电容，具有耦接至所述第二输入节点的一第一端，以及耦接至所述第二N型源极跟随器的一输入晶体管的一栅极的一第二端；以及
一第四前馈电容，具有耦接至所述第二输入节点的一第一端，以及耦接至所述第二P型源极跟随器的一输入晶体管的一栅极的一第二端；并且
所述第二输入信号分别通过所述第二N型源极跟随器以及所述第二P型源极跟随器被馈入所述第四晶体管的栅极以及所述第三晶体管的栅极。
19.如权利要求14所述的运算放大器电路，更包括：
一第一频率补偿电路，耦接于所述第一级放大器电路与所述第一输出节点之间，用以执行米勒补偿；以及
一第二频率补偿电路，耦接于所述第一级放大器电路与所述第二输出节点之间，用以执行米勒补偿。
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