CN101483387B - 多级电源控制器及其方法 - Google Patents

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Abstract

本发明公开了多级电源控制器及其方法。在一个实施方式中，多级电源控制器配置成工作状态信号并响应性地禁止PWM控制器形成多个PWM驱动信号中的至少一个PWM驱动信号。

Description

多级电源控制器及其方法
技术领域
本发明大体涉及电子学，尤其是涉及形成半导体器件的方法和结构。
背景技术
过去，电子工业利用各种方法和结构来形成计算系统(例如计算机系统和微处理器系统)的电源控制器。很多现有的计算系统利用INTEL(英特尔)微处理器或其它类似的微处理器作为计算系统的计算元件。这些现有的计算系统通常要求给计算元件提供工作功率的电源控制器具有调节来自电源控制器的输出电压的值的能力。然而，输出电压的这些变化一般不降低计算系统所利用的功率的量。随着对减少功率消耗并提高效率需要的增加，期望提供具有比这些现有技术电源控制器所提供的效率更高的效率的电源控制器。
因此，期望有一种用于计算系统的具有提高的效率的电源控制器。
附图说明
图1简要示出包括根据本发明的有效电源控制器的示例性实施方式的计算系统的一部分的实施方式；
图2图形地示出根据本发明的图1的计算系统的各种状态和在计算系统内的信号；
图3简要示出根据本发明的图1的有效电源控制器的可选电路的示例性实施方式；
图4简要示出根据本发明的图1的有效电源控制器的一部分的示例性实施方式的结构图；以及
图5简要示出包括根据本发明的图1的有效电源控制器的半导体器件的放大平面图。
为了说明的简洁和清楚，附图中的元件没有必要按比例绘制，且不同图中相同的参考数字表示相同的元件。此外，为了描述的简单而省略了公知的步骤和元件的说明与详述。本领域中的技术人员应认识到，这里使用的词“在...的期间、在...同时、当...的时候”不是表示一有启动行为就会马上发生行为的准确术语，而是在被初始行为激起的反应之间可能有一些微小但合理的延迟，例如传播延迟。词“大约”或“基本”的使用意指元件的值具有被预期非常接近于规定值或位置的参数。然而，如在本领域中所公知的，总是存在阻止上述值或位置确切地如规定的微小变化。本领域中完全确认，直到至少约10％的变化被认为是偏离确切地如所述的理想目标的合理变化。
具体实施方式
图1简要示出计算系统10的一部分的实施方式，该计算系统10包括有效电源控制器32的示例性实施方式。系统10在输入端子12和返回端子13之间接收输入电压和电流，并在电压输出14和返回端子13之间提供基本被调节的输出电压。计算元件(例如微计算机或微处理器(处理器))11连接在输出14和返回端子13之间，以便接收输出电压作为用于操作处理器11的工作电压。为了附图的清楚，在图1中没有示出到返回13的连接。如本领域的技术人员所公知的，计算系统10可包括连接到处理器11的其它计算元件，例如总线控制器、外围控制器等，以便形成完整的计算系统。
在优选实施方式中，处理器11为INTEL微处理器(例如PENTIUM(奔腾)、INTEL CORE(英特尔核)、INTEL CORE Duo(英特尔双核)处理器)，或对计算元件的不同工作状态具有不同的功率要求的其它功率类型的微处理器。INTEL和INTEL CORE是加利福尼亚州的San Jose的英特尔公司的注册商标。系统10的功率控制元件包括电源控制器32以及各种其它元件，这些其它元件一般在控制器32的外部，且用于产生输出14上的输出电压并将其调节到期望值。由于变化的功率要求，控制元件包括用来调节输出电压的多个功率控制级(phase)或通道。每个级或通道一般包括形成PWM驱动信号的PWM控制部分、电感器和功率开关，该功率开关由PWM驱动信号驱动并开启或关闭电感器以调节输出电压。不同的级或通道一般从时钟信号操作，每个级的每个PWM控制部分使用的每个时钟信号相对于其它PWM控制部分的时钟偏移或移动。每个时钟信号通常产生自公共时钟信号并与该公共时钟信号同步。这样的多级PWM控制器对本领域的技术人员来说是公知的。
在图1中示出的功率控制元件的示例性实施方式包括一对开关晶体管17和18，这对开关晶体管连接在端子12和13之间的堆叠配置中，并由来自控制器32的PWM控制部分的PWM驱动信号操作。晶体管17和18开启或关闭向输出14提供电压和电流的电感器19。电流感测元件可用于感测流经电感器19的电流并形成由控制器32在输入50上接收的第一电流感测信号。例如，电阻-电容滤波器(未示出)可连接在电感器19两端以感测电流流动。类似地，第二通道或第二级包括一对开关晶体管21和22，这对开关晶体管连接在端子12和13之间的堆叠配置中，由来自控制器32的第二PWM控制部分的PWM驱动信号操作。晶体管21和22开启或关闭向输出14提供电压和电流的电感器23。另一电流感测元件可用于感测流经电感器23的电流并形成由控制器32在输入54上接收的第二电流感测信号。控制器32和控制器32外部的元件可具有如PWM控制部分N所示的任何数量(N)的级或通道。第N通道或级包括一对开关晶体管25和26，这对开关晶体管连接在端子12和13之间的堆叠配置中，由来自控制器32的第N PWM控制部分的PWM驱动信号操作。晶体管25和26开启或关闭向输出14提供电压和电流的第N电感器27。第N电流感测元件可用于感测流经第N电感器27的电流。第N电流感测信号由控制器32的第N PWM通道在输入58上接收。反馈网络例如电阻分压器形成表示输出14和端子13之间的输出电压的值的反馈(FB)信号。控制器32在输入60上接收FB信号并向每个PWM控制部分提供FB信号。如在本领域中所公知的，FB信号通常由包括某种类型的频率补偿的差分放大器或误差放大器接收，以提供稳定的控制回路。
控制器32包括通常连接到相应的端子12和13的电压输入59和电压返回66，以便接收用于操作控制器32的功率。内部调节器84在控制器32内通常连接在输入59和返回66之间，以便接收输入电压并在输出85上提供用于操作控制器32的元件的内部工作电压。控制器32通常包括时钟发生器或时钟33，其配置成形成用于操作控制器32的多个PWM控制部分的多个时钟信号。一般来说，每个时钟信号都具有相同的固定周期；然而，每个时钟信号的周期通常相对于其它时钟信号偏移或移动，以便每个PWM控制部分在不同的时刻使相应的PWM驱动信号有效。这样的PWM控制部分和时钟对本领域的技术人员来说是公知的。第一PWM控制部分包括第一PWM控制电路或第一PWM电路或控制器36以及PWM驱动器37和38。PWM控制器36接收来自时钟33的第一时钟信号、来自输入50的第一电流感测信号以及反馈(FB)信号，并形成第一PWM驱动信号。驱动器37和38接收PWM驱动信号并形成适合于通过控制器32的输出48和49操作晶体管17和18的信号。类似地，第二PWM控制部分包括第二PWM控制电路或第二PWM电路或控制器40，控制器40接收来自时钟33的第二时钟信号、来自输入54的第二电流感测信号以及FB信号，并形成第二PWM驱动信号。与门驱动器41和42用作接收第二PWM信号并提供用于通过输出52和53操作晶体管21和22的驱动信号的驱动器。第N PWM控制通道包括第N PWM控制电路或第N PWM电路或控制器44，控制器44接收来自时钟33的第N时钟信号、来自输入58的第N电流感测信号以及FB信号，并形成第N PWM驱动信号。与门驱动器45和46接收第N PWM驱动信号并用作提供用于通过输出56和57操作晶体管25和26的驱动信号的驱动器。如在下文中将进一步看到的，控制器32可包括可选的节电输入65，其可以用于接收节电输入控制(PS)信号并强制控制器32禁止形成至少一个PWM驱动信号。控制器32的可选的级选择输入或选择输入61可用于控制在某些条件下保持工作的PWM通道的数量，如在下文中将进一步看到的。
图2是用图形示出处理器11的内部执行指令、处理器11的内部时钟频率和系统10的其它信号之间的相互关系的图示。条形图90示出由处理器11在内部执行的指令的状态，而条形图91示出在条形图90所示指令的操作期间处理器11的内部时钟的相对频率。在图91中的标号PX表示处理器11可操作的X个数量的可变功率状态中的一个可变功率状态。曲线92示出由处理器11产生的多个电压识别(VID)信号的值，而曲线93示出控制器32的级失效(PD)控制信号的状态。
图3简要示出控制器32的可选的启动控制电路或EN电路110的示例性实施方式。电路110包括求和电路131、比较器118、晶体管111和123、电容器120、电阻器112-115、119、125-126和128。可选的晶体管122和电阻器124可包括在一些可选的实施方式中。此描述参考图1、图2和图3。本领域的技术人员应理解，处理器11具有不同的工作状态和功率要求，这取决于在处理器11的内部执行的指令的类型。因为MOS晶体管通常在较高的电压电平处具有较低的传播延迟，处理器11通常包括多个电压识别(VID)信号和输出(例如VID信号和在图1中被标识为VID1-VID7的输出)，这些VID信号和输出用于请求功率控制系统给处理器11提供输出电压的某些值，以便有助于快速执行指令。VID信号指示处理器11的电压要求，因此，它们可被视为电压要求信号。例如，当处理器11执行要求处理器11使用内部元件的指令(例如在寄存器内移动数据或计算虚拟或物理地址位置)时，处理器11可工作在高内部工作时钟频率下，并且还可请求系统10在输出14上为输出电压提供高值。VID信号通常为以数字格式或代码(例如二进制代码)来编码的数字信号，每个代码表示在输出14上的输出电压的电压值。因此，VID信号的值指示电压要求。包括控制器32的功率控制系统使用VID信号来设定输出14上的输出电压的值。
控制器32从VID信号接收数字代码，且转换器87通过诸如数模转换器(DAC)等元件将数字信号转换成模拟信号。转换器87接收数字VID信号并形成模拟参考信号或Ref，从1到N的PWM控制部分利用该模拟参考信号或Ref作为在PWM控制部分内的PWM控制器的参考电压值。当处理器11所需要的电压改变时，由VID信号形成的代码的值改变以请求输出14上的输出电压的更高或更低的值。控制器32接收VID信号并响应性地增加或减少参考信号(Ref)，从而增加或减小输出14上的输出电压的值。VID信号和转换器87形成Ref信号并改变输出电压的功能对本领域的技术人员来说是公知的。
控制器32通常还包括第一电路或VID解码电路67以及逻辑电路68，逻辑电路68接收VID信号并使用被编码在其中的数据以帮助操作控制器32。在优选实施方式中，VID解码电路67包括逻辑，该逻辑接收VID信号并确定由VID信号形成的代码的值是增加还是减小了，从而确定VID信号的值是增加还是减小了。电路67和68用来控制可操作地向输出14提供电流和电压的PWM通道的数量，以便提高系统10的效率。逻辑电路68的示例性实施方式包括触发器(flip-flop)73、或非门71和76、与门74、或门82和倒相器70。如将在下文中进一步看到的，可选的启动控制电路或EN电路110有助于给控制器32提供禁止形成多个PWM驱动信号中的一些PWM驱动信号并增加控制器32所提供的效率的能力。在一些实施方式中，电路110可在控制器32的外部，电路110的输出连接到输入62。
假定在时刻T0(图2)，处理器11正执行指令并以高频操作内部时钟，以便以快速的方式执行指令。在这个时刻期间，由VID信号形成的代码的值为高。转换器87接收VID信号并响应性地形成Ref信号的高值，以便输出电压值可以为高。
假定在时刻T1(图2)，处理器11完成了操作软件代码并处于闲置状态(例如执行停止指令)，等待中断或超时或一些其它事件来自重新启动软件例行程序的执行。处理器11在内部感测此工作状态并降低内部频率，如图91所示。因为处理器11的内部工作状态转到低工作状态，处理器11还降低VID信号的代码的值。电路67配置成检测VID信号的值的降低，并使指示VID信号的值已降低的减弱(down，DN)控制信号有效。电路67响应于检测到VID信号的值已降低而迫使DN信号高。高DN信号迫使触发器73的时钟输入高，这使逻辑高计时到触发器73中并迫使Q输出高。假定启动(EN)输入62为高且电路110被省略，则高Q输出迫使门74的输出高。来自门74的高信号迫使门76的输出低，从而使级减少(PD)信号有效。来自门76的低信号迫使驱动器45和46的输出低，从而禁止PWM通道N产生PWM驱动信号。因此，控制器32中的至少一个PWM通道被禁止形成PWM驱动信号。
控制器32可选地包括级选择输入或选择输入61，其用于控制在级减少(PD)控制信号有效时保持工作的PWM通道的数量。如果级选择输入61为高，则控制器32保持一个PWM通道工作和形成PWM驱动信号，而如果输入61为低，则控制器32保持两个PWM通道工作并形成PWM驱动信号。在输入61上的高信号迫使缓冲倒相器78的输出低。可选的测试多路复用器或Mux 79将一测试位与倒相器78的输出多路复用，该测试位在测试模式期间用来便于测试控制器32。在正常工作模式中，Mux 79的测试模式选择输入将倒相器78的输出选择至门80的输入。进入门80的选择输入用于选择单级工作模式或多级工作模式。如果选择输入为低，则控制器32总是使用单个通道。假定门80的选择输入为高，则来自倒相器78的低信号迫使门80的输出为低，从而允许PD信号迫使门82的输出为低。来自门82的低信号迫使驱动器41和42的输出低，从而禁止第二PWM通道形成PWM驱动信号。如果选择输入61为低，则倒相器78的输出为高，这迫使门80和82的输出高。来自门82的高信号使驱动器41和42能够由PWM驱动信号驱动，从而阻止PD信号禁止第二PWM通道产生PWM驱动信号。
假定在时刻T2，处理器11再次开始执行各种指令并增加VID信号的值。电路67检测VID信号的值的增加，这迫使UP控制信号高。来自UP控制信号的高信号迫使门71的输出低，这使触发器73复位，从而迫使Q输出低。低Q输出迫使门74的输出低。假定PS输入65上的节电(PS)控制输入信号为高，则倒相器70的输出为低，这允许来自门74的低信号迫使门76的输出高。来自门76的高信号迫使PD信号高，以使PD信号无效，如在时刻T2示出的。来自门76的高信号使驱动器45和46能够响应于由PWM控制器N产生的PWM信号而在输出56和57上产生PWM驱动信号。来自门76的高信号还迫使门82的输出高，从而允许驱动器41和42也响应于由PWM控制器40产生的PWM信号而形成PWM驱动信号。如果VID信号再次增加，如在时刻T3所示，则对电路67或68没有影响，因为UP控制信号已经为高。
如果VID信号降低，如在时刻T4所示的，则电路67检测到值的降低并迫使DN控制信号为高，以再次将逻辑高计时到触发器73中并使PD控制信号有效，从而禁止多个PWM通道中的至少一个产生PWM驱动信号。参考图3，可选的电路110从电流感测输入50、54和58接收电流感测信号，并通过求和电路131对它们求和以产生总电流感测信号(SCS)。总电流感测信号(SCS)由比较器118接收。如果处理器11所使用的电流没有减少，则SCS信号的值将不降低并将保持大于某个最小值。由此，比较器118比较SCS信号与在阈值(TH)输入96上接收的参考信号，并且如果SCS信号小于最小阈值就迫使EN信号低。低EN信号允许控制器32禁止多个PWM通道之一。电路110接收输入96上的阈值(Th)信号并通过电阻器113和114构成的电阻分压器来形成节点115上的参考信号。如果输入61上的选择信号为高，则节点115上的参考信号由电阻器113与电阻器114和112的并联组合串联来确定，这是由于晶体管111处于开启状态的缘故。当SCS信号大于在节点115处由Th信号以及电阻分压器113、114和112/111设置的参考信号时，比较器118的输出将为高。假定可选的晶体管122和电阻器124被省略，则晶体管123导通且电路110的输出上的EN信号为低。低EN信号将EN信号拉到返回66的值。低EN信号阻止控制器32响应于VID信号的减少而减少PWM通道的数量。可选的晶体管122和电阻器124配置成从处理器11接收停止时钟信号(STPCLK)。当处理器11的时钟在处理器11的内部被停止时，STPCLK信号为有效低。STPCLK信号变低关闭了晶体管122，这阻止晶体管123拉低EN信号，从而使EN信号能够以低延时响应来自处理器11的STPCLK信号。在电路110在控制器32的内部的实施方式中，控制器32需要用于接收STPCLK信号的额外输入(未示出)。相反，如果SCS低于节点115上的参考信号，则晶体管123被禁止，允许电阻器125将EN信号拉高到调节器84的输出85上的工作电压(图1)。高EN信号使控制器32能够响应于VID信号的减少而减少工作通道的数量。如果，如在时刻T5所示，VID信号的值再次降低，并假定处理器11所需要的电流也降低，则电路110迫使EN信号高，且电路67检测到值的降低并迫使DN控制信号高，以再次将逻辑高计时到触发器73中以使PD控制信号有效，从而禁止多个PWM通道中的至少一个产生PWM驱动信号。在上文中所指出的，可选输入61的状态决定了多少PWM通道继续形成PWM驱动信号。
可选的节电输入65可用来迫使控制器32禁止形成至少一个PWM驱动信号而不依赖于VID信号的状态。假定POR输入只在上电复位时间间隔期间为高，且在控制器32的正常工作期间为低。如果输入65低，则倒相器70的输出高，这迫使门76的输出低以使PD信号有效而不依赖于VID信号的状态。因此，控制器32响应于此控制信号而禁止至少一个PWM通道形成PWM驱动信号。当输入65变高时，倒相器70的输出低，这允许VID控制信号的状态通过UP和DN控制信号来确定形成PWM驱动信号的PWM通道的数量。输入65的低到高转变从单触发器(one-shot)69形成正脉冲，这迫使门71的输出低。来自门71的低信号使锁存器73复位并迫使Q输出低。来自锁存器73的低信号迫使门74的输出低和门76的输出高，以迫使第N PWM形成驱动信号。来自门76的高信号还迫使门82的输出高，以迫使PWM 2形成驱动信号。
本领域的技术人员应认识到，一些处理器产生指示处理器已达到或超过用于操作处理器的最大可接受的温度的信号。对于一些处理器，该信号被称为PROCHOT信号。该信号在图1中被示为PHOT信号。在一个实施方式中，PHOT信号可以可选地连接到输入62和电路110，如虚线所示。在这样的实施方式中，当PHOT信号变低时，门74的输出被强制为低，从而使触发器73的输入对门76无效，这阻止VID转变使PWM输出无效。在这么做的过程中，PWM输出都被强制返回有效(back on)，除非输入65有效(低)。这当处理器11在其最高温度之上运行时阻止控制器32以减少的通道运行，处理器11在其最高温度之上运行一般是大电流汲取的征兆并且也相应于集成电路的最坏情况泄露。当处理器11以明显较低的电流汲取量在低功率模式中运行并可用输出电压的减小的值操作的时期期间，使控制器32禁止形成一些PWM驱动信号减少了在那些通道中发生的功率损耗的量，从而提高了系统10的效率。在一个示例性实施方式中，使工作在5安培(5amp)的四级PWM控制器将PWM驱动信号的数量减少到一个，这提供了至少20％的效率提高。
为了提供控制器32的这项功能，调节器84连接在输入59和返回66之间。输出85连接成向控制器32的各个元件(例如门71、74、76、转换器87等)提供工作功率。电路67和转换器87每个都具有连接到控制器32的多个输入端子的多个输入，以便从处理器11接收控制信号。转换器87的模拟参考输出Ref连接到每个PWM控制器36、40和44的参考输入。来自电路67的UP控制信号连接到门71的第一输入，门71具有连接到触发器73的复位输入的输出。门71的第二输入连接到单触发器69的输出，单触发器69的输入连接到输入65和倒相器70的输入。倒相器70的输出连接到门76的第一输入。门71的第三输入连接到控制器32的上电复位(POR)输入64。电路67的DN控制输出连接到触发器73的时钟输入。触发器73的数据(D)输入连接到逻辑高信号。触发器73的Q输出连接到门74的第一输入，门74具有连接到门76的第二输入的输出。门74的第二输入连接到启动输入62。门76的输出公共地连接到驱动器45和46的输入以及门82的第一输入。门82的输出公共地连接到驱动器41和42的输入。倒相器78具有连接到输入61的输入和连接到Mux 79的输入的输出。Mux 79的第二输入连接成从测试电路接收测试位。Mux 79的模式控制输入连接到测试模式控制信号。Mux 79的输出连接到门80的第一输入，门80具有连接到门82的第二输入的输出。门80的第二输入连接到选择信号。
图4简要示出在图1和图2的描述中解释的电路67的一个示例性结构图实施方式的一部分。电路67包括用于锁存VID信号的状态的两个锁存寄存器137和138。锁存N寄存器137配置成存储VID信号的当前/最近的状态，而锁存N-1寄存器138代表VID信号的以前锁存的状态。当来自时钟136的时钟信号有效时，新的读取/锁存事件出现在锁存N寄存器137中，而被锁存到寄存器137中的以前的状态传送到锁存N-1寄存器138。因此，寄存器137包括VID信号的当前状态，而寄存器138包括VID信号的以前状态。寄存器138中的VID信号的状态从被锁存到寄存器137中的新VID状态中减去并与新VID状态比较。如果新VID信号的二进制值(在寄存器137中)增加了(相对于寄存器138中的以前的值)，则UP信号有效，而如果新VID信号的二进制值降低了，则DN信号有效。
图5简要示出在半导体管芯101上形成的半导体器件或集成电路100的实施方式的一部分的放大平面图。控制器32在管芯101上形成。管芯101还可包括在图4中为制图简单而没有示出的其它电路。控制器32和器件或集成电路100通过半导体制造技术在管芯101上形成，这些技术对本领域的技术人员来讲是公知的。
鉴于上述全部内容，显然公开的是一种新的器件和方法。连同其它特征包括的是配置多通道PWM控制器以接收状态信号并响应于状态信号的降低而禁止形成多个PWM驱动信号中的至少一个PWM驱动信号。
虽然本发明的主题是用特定的实施方式来描述的，但显然对本领域的技术人员来说许多替换和变化是明显的。例如，虽然驱动器37、38、41、42、45和46被示为在控制器32的内部，以及晶体管17、18、21、22、25和26被示为在控制器32的外部，但是这些驱动器和晶体管可在控制器32的内部或外部。本领域的技术人员应认识到，驱动器42和46可以不是分离的逻辑门，因为每个PWM控制器36、40或44内的逻辑可提供其它逻辑(加上驱动器41、42、45和46的逻辑功能)。例如，每个PWM控制器36、40和44内的逻辑可保持底部晶体管启动以更快地减小输出14上的电压的值。此外，为电路67和68示出的逻辑仅仅是例证性的，并且可由其它实现代替，这些实现检测在输入63上接收的状态信号的值的变化并响应性地禁止控制器32形成至少一个PWM驱动信号。控制器32可具有更多的控制输入(例如输入61)，以控制被禁止的PWM驱动信号的数量。

Claims (10)

1.一种电源控制器，包括：
多个PWM电路，其配置成形成多个PWM驱动信号，每个PWM电路都配置成形成所述多个PWM驱动信号中的PWM驱动信号，以操作功率开关来将输出电压调节到期望值，其中每个PWM驱动信号相对于所述多个PWM驱动信号中的其它PWM驱动信号在相位上偏移；
参考电路，其配置成形成模拟参考信号；
反馈输入，其配置成接收代表输出电压的反馈信号，其中所述多个PWM电路在控制回路中使用所述反馈信号并且使用所述参考信号以增加或减小所述输出电压的值；
第一电路，其配置成从计算机接收多个电压要求信号并响应性地形成指示所述计算机要求的电压的增加或降低中的一个的第一控制信号，并且配置成形成指示所述计算机要求的电压的增加或降低中的不同的一个的第二控制信号；以及
逻辑电路，其配置成接收所述第一控制信号并响应于所述第一控制信号指示所述计算机要求的电压的降低且不依赖于所述反馈信号的值而禁止形成所述多个PWM驱动信号中的至少一个PWM驱动信号，以及进一步包括：所述逻辑电路配置成响应于所述第二控制信号而随后重新使能所述多个PWM驱动信号中的所述至少一个PWM驱动信号的形成。
2.如权利要求1所述的电源控制器，进一步包括：第二电路，所述第二电路配置成接收所述多个电压要求信号并形成指示增加或降低所述输出电压的值的要求的模拟信号。
3.如权利要求2所述的电源控制器，其中所述第一电路包括数字逻辑以感测值增加的所述多个电压要求信号。
4.一种形成电源控制器的方法，包括：
配置多个PWM电路以形成多个PWM驱动信号，每个PWM电路都配置成形成PWM驱动信号，以操作功率开关来将输出电压调节到期望值，其中每个PWM驱动信号相对于所述多个PWM驱动信号中的其它PWM驱动信号在相位上偏移；
配置所述电源控制器以接收代表输出电压的值的反馈信号；
配置所述电源控制器以接收具有值的多个状态信号并响应于以下两个条件的组合而使第一控制信号有效：(a)所述多个状态信号的所述值的减少；以及(b)不依赖于所述反馈信号的值，并且所述方法还包括：配置所述电源控制器以响应于以下两个条件的组合而使第二控制信号有效：(a)所述多个状态信号的所述值的增加；以及(b)不依赖于所述反馈信号的值，其中所述多个状态信号从所述电源控制器的外部的计算机接收并代表所述计算机的电压要求；以及
配置所述电源控制器以响应于所述第一控制信号而禁止形成至少一个PWM驱动信号，并响应于所述第二控制信号而随后重新使能所述至少一个PWM驱动信号。
5.如权利要求4所述的方法，进一步包括：配置所述电源控制器以接收级控制输入信号，所述级控制输入信号具有表示不禁止的所述多个PWM驱动信号的数量的值。
6.如权利要求5所述的方法，其中配置所述电源控制器以禁止形成至少一个PWM驱动信号包括：配置所述电源控制器以禁止形成除了所述数量的所述多个PWM驱动信号以外的所有PWM驱动信号。
7.如权利要求6所述的方法，进一步包括：配置所述电源控制器以接收第三控制信号并响应于所述第三控制信号而禁止形成所述至少一个PWM驱动信号，而不依赖于所述第一控制信号的状态。
8.一种形成电源控制器的方法，包括：
配置多个PWM电路以形成多个PWM驱动信号，每个PWM电路都配置成形成PWM驱动信号，以操作功率开关来将输出电压调节到期望值，其中每个PWM驱动信号相对于所述多个PWM驱动信号中的其它PWM驱动信号在相位上偏移；
配置所述电源控制器以接收代表所述输出电压的反馈信号；
配置所述电源控制器以从负载接收多个状态信号，其中所述多个状态信号代表所述负载要求的电压；
配置所述电源控制器以将所述多个状态信号转换为第一控制信号，并响应于所述控制信号和所述反馈信号控制来增加或减小所述输出电压的值；以及
配置所述电源控制器以解码所述多个状态信号的值并响应于以下两个条件的组合而禁止形成所述多个PWM驱动信号中的至少一个PWM驱动信号：(a)所述多个状态信号的所述值的降低；以及(b)不依赖于所述反馈信号的值，并且所述方法还包括：配置所述电源控制器以响应于以下两个条件的组合而随后重新使能形成所述至少一个PWM驱动信号：(a)所述多个状态信号的所述值的增加；以及(b)不依赖于所述反馈信号的值。
9.如权利要求8所述的方法，其中配置所述电源控制器以接收所述多个状态信号并响应性地禁止形成至少一个PWM驱动信号包括：配置所述电源控制器以接收所述多个状态信号并响应于所述值的降低而响应性地禁止形成所述至少一个PWM驱动信号。
10.如权利要求8所述的方法，其中配置所述电源控制器以接收所述多个状态信号包括：配置所述电源控制器以禁止形成除了所述多个PWM驱动信号中一部分PWM驱动信号以外的全部PWM驱动信号。
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