CN101188429A - 一种比特交织器和进行比特交织的方法 - Google Patents
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Abstract
本发明公开了一种比特交织器和进行比特交织的方法；比特交织器包括两个随机存储器RAM，以乒乓RAM方式工作；两个配置信息存储介质，各固定对应于所述RAM中的一个；及一个控制单元，用于将所述的两个RAM交替作为用于读操作的RAM和写操作的RAM；还用于每接收到一个编码数据块的数据时，请求该编码数据块对应的配置信息；还用于当对一个RAM进行读/写数据的同时，相应对其对应的配置信息存储介质读/写配置信息；还用于每进行完一轮操作后，就交换用于读/写操作的RAM；所述编码数据块为比特交织器每次接收到的一批数据。本发明占用资源少，硬件实现简单，还可以解决配置信息与进行比特交织及星座映射的数据不匹配的问题。
Description
技术领域
本发明涉及无线通信领域，具体涉及一种比特交织器和进行比特交织的方法。
背景技术
比特交织器有两大主要功能，一是比特交织，二是根据上级模块传下来的配置信息进行星座映射。所述上级模块为用于向比特交织器提供数据和配置信息的编码器。
比特交织器内部有两块RAM(随机读写存储器)，以乒乓RAM的方式工作，记为RAM_0和RAM_1，数据以字节为单位按行写入任一个RAM的同时，从另一个RAM中把数据以比特为单位按列读出，从而实现比特交织。
比特交织器根据随数据所对应的配置信息进行星座映射；每个时隙的数据都有与其相对应的配置信息，所述配置信息中指定了所采用的星座映射模式。比如对于SCP模式，每秒有40个时隙，则共有40个配置信息；再比如对于LCP模式而言，每秒有36个时隙，则共有36个配置信息。现有的方法是将配置信息以时隙为单位存储在比特交织器的寄存器组中，以SCP模式为例，将40个配置信息存储在40个寄存器组中，各配置信息存储在一组寄存器中；当从RAM中读出某个时隙的数据时，还需要对输出时隙进行计数，根据该时隙号，从相应的寄存器组中读取配置信息，从而对当前数据进行星座映射；另外现有方案需要占用较多的寄存器资源，而且每次读/写配置信息时都需要根据时隙计数找到相应的寄存器组，因此硬件实现也较复杂。而在没有寄存器存储配置信息的情况下，当向RAM中写入某个时隙的数据时，也会同时将对应的配置信息写入对应于本时隙的寄存器组中；因此当读出数据及配置信息时，相应寄存器组中的配置信息实际上已经更新为与正在写入的数据对应的配置信息，会造成所读取的配置信息与进行比特交织及星座映射的数据不匹配的问题。
发明内容
本发明要解决的技术问题是提供一种比特交织器和进行比特交织的方法，能够解决配置信息与进行比特交织及星座映射的数据不匹配的问题，而且占用资源少，硬件实现简单。
为了解决上述技术问题，本发明提供一种比特交织器，包括两个随机存储器RAM和一个控制单元；
所述两个RAM以乒乓RAM方式工作；
所述控制单元将所述的两个RAM交替作为用于读操作的RAM和写操作的RAM；
还包括：
两个配置信息存储介质，各固定对应于所述RAM中的一个；
所述控制单元用于每接收到一个编码数据块的数据时，请求该编码数据块对应的配置信息；还用于当对一个RAM进行读/写数据的同时，相应对其对应的配置信息存储介质读/写配置信息；还用于每进行完一轮操作后，就交换用于读/写操作的RAM；
所述编码数据块为比特交织器每次接收到的一批数据。
进一步的，所述控制单元对一个RAM进行读/写数据的同时，相应对其对应的配置信息存储介质读/写配置信息是指：
所述控制单元在接收到一个编码数据块的数据后，向用于写操作的RAM中写入数据，如果不是上电后第一次接收数据则同时从用于读操作的RAM中读出数据；并在向用于写操作的RAM写入数据的同时，将所请求到的配置信息写入该RAM对应的配置信息存储介质，并从用于读操作的RAM中读出数据，从其对应的配置信息存储介质读出配置信息。
进一步的，所述控制单元用于每进行完一轮操作后，就交换用于读/写操作的RAM是指：
所述控制单元向RAM中写完一个编码数据块的数据后，就交换用于读/写操作的RAM；
或是指：所述控制单元向RAM中写完一个编码数据块的数据，并且从用于读操作的RAM中读出一个编码数据块的数据后，就交换用于读/写操作的RAM。
进一步的，所述的比特交织器还包括一星座映射单元；
所述控制模块还用于将读出的数据和配置信息一同发给所述星座映射单元；还用于当星座映射单元输出映射结果的同时，也将与其对应的配置信息输出；
所述星座映射单元用于根据所述读出的配置信息对读出数据进行星座映射并输出。
进一步的，所述存储介质为一独立寄存器组、或为独立的RAM、或为所对应的RAM中指定的一块存储区域。
进一步的，所述两个配置信息存储介质各自的大小至少等于一个配置信息的大小；所述两个RAM各自的大小至少等于一个编码数据块的大小。
进一步的，所述控制单元向RAM写入数据时是以字节为单位按行写入，从RAM中读取数据时是以比特为单位按列读出。
本发明还提供了一种在如权利要求1所述的比特交织器中进行比特交织的方法，包括：
将两个RAM交替作为用于读操作和写操作的RAM，每进行完一轮操作后，就交换用于读/写操作的RAM；
每接收到一个编码数据块的数据时，请求该编码数据块对应的配置信息；当对一个RAM进行读/写数据的同时，相应对其对应的配置信息存储介质读/写配置信息；
所述编码数据块为比特交织器每次接收到的一批数据。
进一步的，所述的方法具体包括：
A、接收一个编码数据块的数据；同时，请求并接收与该编码数据块对应的配置信息；
B、如果是比特交织器上电后第一次接收数据，则进行步骤B1，否则进行步骤B2；
B1、选择任一RAM作为用于写操作的RAM，将接收到的数据写入该RAM中，并将配置信息存放到该RAM对应的配置信息存储介质中；将另一RAM作为用于读操作的RAM；进行步骤C；
B2、将接收到的数据写入用于写操作的RAM中，并将配置信息存放到该RAM对应的配置信息存储介质中；同时从用于读操作的RAM中按列读出数据，并从其对应的配置信息存储介质中读出配置信息；进行步骤C；
C、每当进行完一轮操作后，交换用于读/写操作的RAM，并返回步骤A。
进一步的，步骤C中进行完一轮操作是指以下情况中的任一种：
向RAM中写完一个编码数据块的数据；
向RAM中写完一个编码数据块的数据，并且从用于读操作的RAM中读出一个编码数据块的数据。
进一步的，所述存储介质为一独立寄存器组、或为独立的RAM、或为所对应的RAM中指定的一块存储区域。
进一步的，向RAM写入数据时是以字节为单位按行写入，从RAM中读取数据时是以比特为单位按列读出。
本发明的技术方案最少只需要用到两部分存储介质——如寄存器组或部分RAM——来存放配置信息即可，使占用的资源大大减少，而且大大简化了硬件实现；另外，由于存放数据的RAM和存放对应配置信息的存储介质完全对应，因此也解决了输入数据配置信息与进行比特交织及星座映射的数据不匹配的问题。
附图说明
图1是本发明的比特交织器的具体实施结构示意图；
图2是本发明的比特交织方法的具体实施结构示意图；
图3是本发明的应用实例的比特交织器的结构示意图。
具体实施方式
下面将结合附图及实施例对本发明的技术方案进行更详细的说明。
本发明的核心思想是：将配置信息对应的单位从时隙转换为编码数据块，每进行完一轮操作后，就交换用于读/写操作的RAM；所述编码数据块为编码器每次向比特交织器输出的一批数据，各时隙的数据根据映射方式的不同可分为一个或多个编码数据块。在存储配置信息用的配置信息存储介质和RAM之间建立一一对应的关系，对RAM进行读/写数据的操作的同时，向其对应的配置信息存储介质中读/写所述数据对应的配置信息。
采用了本发明的技术方案后，当从RAM中读出数据时，无需知道当前数据属于哪个时隙，只需从与该RAM对应的配置信息存储介质中读出相应的配置信息即可；写入时也是一样。
本发明提供了一种比特交织器，如图1所示，包括两个以乒乓RAM方式工作的RAM、两个配置信息存储介质、一个星座映射单元和一个控制单元。
本发明实施例所述的两个RAM均用于存放数据，其各自的大小至少等于一个编码数据块的大小；所述编码数据块是指编码器每次向比特交织器输出的一批数据，亦即比特交织器每次接收到的一批数据。本发明实施例所述的两个RAM交替作为用于读操作和写操作的RAM。
本发明实施例所述的两个配置信息存储介质均用于存放配置信息，各固定对应于所述RAM中的一个，其各自的大小至少等于一个配置信息的大小；本发明实施例所述的存储介质可以为一独立寄存器组，也可以为独立的RAM，还可以是所对应的RAM中指定的一块存储区域。
本发明实施例所述的控制单元用于将所述的两个RAM交替作为用于读操作和写操作的RAM，并在接收数据后，向用于写操作的RAM中写入数据，如果不是上电后第一次接收数据则同时从用于读操作的RAM中读出数据；还用于每进行完一轮操作后，就交换用于读/写操作的RAM；还用于在接收到一编码数据块后向上级模块请求该编码数据块对应的配置信息，并在向用于写操作的RAM写入数据的同时，将所请求到的配置信息写入该RAM对应的配置信息存储介质，并从用于读操作的RAM中读出数据，从其对应的配置信息存储介质读出配置信息；还用于将读出的数据和配置信息一同发给所述星座映射单元。还用于当星座映射单元输出映射结果的同时，也将与其对应的配置信息传输给下级模块。
所述控制单元用于每进行完一轮操作后，就交换用于读/写操作的RAM可以是指：
所述控制单元向RAM中写完一个编码数据块的数据后，就交换用于读/写操作的RAM。
如果RAM的深度正好相当于一个编码数据块的大小时，即指：控制单元写满用于写操作的RAM后，就交换用于读/写操作的RAM。
如果在将数据写入用于写操作的RAM的同时，还在从用于读操作的RAM中读数据的话，则所述控制单元用于每进行完一轮操作后，就交换用于读/写操作的RAM也可以是指：
所述控制单元向RAM中写完一个编码数据块的数据，并且从用于读操作的RAM中读出一个编码数据块的数据后，就交换用于读/写操作的RAM。
如果两个RAM的深度都正好相当于一个编码数据块的大小时，即指：所述控制单元写满用于写操作的RAM，并且读完用于读操作的RAM后，就交换用于读/写操作的RAM。
由于写的速度通常比读慢，因此即使在将数据写入一个RAM的同时，还在从另一个RAM中读数据的情况下，所述控制单元用于每进行完一轮操作后，就交换用于读/写操作的RAM也可以仅指：所述控制单元向RAM中写完一个编码数据块的数据后，就交换用于读/写操作的RAM。
本发明实施例所述的控制单元向RAM写入数据时是以字节为单位按行写入，从RAM中读取数据时是以比特为单位按列读出。此处行与列的概念是相对的，也可以认为是按列写入，按行读出。
本发明实施例所述的星座映射单元用于根据所述读出的配置信息对读出数据进行星座映射并输出。
本发明还提供了一种在上述比特交织器中进行比特交织的方法，如图2所示，包括：
A、接收数据，并请求和接收该数据对应的配置信息。
本步骤可以具体包括：接收编码后的数据，每次接收一个编码数据块；同时，请求并接收与该编码数据块对应的配置信息。
B、将接收到的数据写入用于写操作的RAM中，并将配置信息存放到该RAM对应的配置信息存储介质中；同时从用于读操作的RAM中读出数据，并从其对应的配置信息存储介质中读出配置信息。
本步骤中，向RAM写入数据时是按行写入，从RAM中读取数据时是按列读出。
本步骤具体可以分为两种情况考虑：如果是比特交织器上电后第一次接收数据，则进行步骤B1，否则进行步骤B2。
B1、选择任一RAM作为用于写操作的RAM，将接收到的数据写入该RAM中，并将配置信息存放到该RAM对应的配置信息存储介质中；将另一RAM作为用于读操作的RAM；进行步骤C。
B2、将接收到的数据写入用于写操作的RAM中，并将配置信息存放到该RAM对应的配置信息存储介质中；同时从用于读操作的RAM中按列读出数据，并从其对应的配置信息存储介质中读出配置信息；进行步骤C。
本发明实施例所述的RAM的大小均至少等于一个编码数据块的大小。
本发明实施例所述的配置信息存储介质各自的大小至少等于一个配置信息的大小；本发明实施例所述的配置信息存储介质可以为一独立寄存器组，也可以为所述乒乓RAM中指定的一块存储区域。
C、每当进行完一轮操作后，交换用于读/写操作的RAM，并返回步骤A。
本步骤中，进行完一轮操作可以是指：向RAM中写完一个编码数据块的数据。
如果写的同时进行了读操作的话，则本步骤中，进行完一轮操作也可以是指：向RAM中写完一个编码数据块的数据，并且从用于读操作的RAM中读出一个编码数据块的数据。
由于写的速度通常比读慢，因此即使同时进行了读操作，本步骤中进行完一轮操作也可以仅指：向RAM中写完一个编码数据块的数据。
下面用本发明的一应用实例进一步加以说明。
本应用实例中，编码数据块大小为17280×8bits，乒乓RAM的存储深度也设置为17280×8bits，配置信息存储介质为寄存器组。
各时隙的数据根据映射方式的不同可分为一个或多个编码数据块，在本应用实例中：对于BPSK星座映射方式，一个时隙的数据量相当于1个编码数据块的大小；对于QPSK星座映射方式，一个时隙的数据量相当于2个编码数据块的大小；对于16QAM星座映射方式，一个时隙的数据量相当于4个编码数据块的大小。
比如，当一个时隙为QPSK映射时，一个时隙的数据分为2个编码数据块传输，因此分别匹配2个配置信息，但这两个配置信息的内容完全相同，因为是同一时隙的配置信息。采用其它映射方式时情况也相同，属于同一时隙的配置信息内容相同。
如图3所示，本应用实例中的比特交织器包括两个乒乓RAM，分别是RAM_0和RAM_1；还包括两个寄存器组，分别是cfg_reg_0和cfg_reg_1，其中cfg_reg_0与RAM_0相对应，cfg_reg_1与RAM_1相对应；另外还包括一个控制单元和一个星座映射单元。
假设控制单元先将RAM_0作为用于写操作的RAM，将RAM_1作为用于读操作的RAM；当控制单元接收到第一个编码数据块X后，请求该编码数据块X对应的配置信息IX，然后向RAM_0中以字节为单位按行写入所接收的编码数据块X的数据，在写入的同时，将所请求到的配置信息IX写入cfg_reg_0。
当进行完一轮操作后，即写满RAM_0后，控制单元改将RAM_1作为用于写操作的RAM，将RAM_0作为用于读操作的RAM。
当控制单元接收到第二个编码数据块Y后，请求该编码数据块Y对应的配置信息IY，然后向RAM_1中以字节为单位按行写入所接收的编码数据块Y的数据，在写入的同时，将所请求到的配置信息IY写入cfg_reg_1；与此同时，从RAM_0中以比特为单位按列读出数据——即编码数据块X的数据，并从cfg_reg_0中读出配置信息IX；根据从cfg_reg_0中读出的配置信息IX对从RAM_0中读出的数据进行比特交织及星座映射。比特交织器输出的同时，也将与其对应的配置信息传输给下级模块。
如果X和Y是属于同一时隙的，则IX和IY内容相同。
当进行完一轮操作后，即写满RAM_1，并且读空RAM_1后(当然也可以设定为写满RAM_1就是进行完一轮操作)，控制单元又改将RAM_0作为用于写操作的RAM，将RAM_1作为用于读操作的RAM。
以此类推，继续进行后面的操作。
当然，本发明还可有其他多种实施例，在不背离本发明精神及其实质的情况下，熟悉本领域的技术人员当可根据本发明作出各种相应的改变和变形，但这些相应的改变和变形都应属于本发明所附的权利要求的保护范围。
Claims (12)
1.一种比特交织器，包括两个随机存储器RAM和一个控制单元；
所述两个RAM以乒乓RAM方式工作；
所述控制单元将所述的两个RAM交替作为用于读操作的RAM和写操作的RAM；
其特征在于，还包括：
两个配置信息存储介质，各固定对应于所述RAM中的一个；
所述控制单元用于每接收到一个编码数据块的数据时，请求该编码数据块对应的配置信息；还用于当对一个RAM进行读/写数据的同时，相应对其对应的配置信息存储介质读/写配置信息；还用于每进行完一轮操作后，就交换用于读/写操作的RAM；
所述编码数据块为比特交织器每次接收到的一批数据。
2.如权利要求1所述的比特交织器，其特征在于，所述控制单元对一个RAM进行读/写数据的同时，相应对其对应的配置信息存储介质读/写配置信息是指：
所述控制单元在接收到一个编码数据块的数据后，向用于写操作的RAM中写入数据，如果不是上电后第一次接收数据则同时从用于读操作的RAM中读出数据；并在向用于写操作的RAM写入数据的同时，将所请求到的配置信息写入该RAM对应的配置信息存储介质，并从用于读操作的RAM中读出数据，从其对应的配置信息存储介质读出配置信息。
3.如权利要求1所述的比特交织器，其特征在于，所述控制单元用于每进行完一轮操作后，就交换用于读/写操作的RAM是指：
所述控制单元向RAM中写完一个编码数据块的数据后，就交换用于读/写操作的RAM；
或是指：所述控制单元向RAM中写完一个编码数据块的数据，并且从用于读操作的RAM中读出一个编码数据块的数据后，就交换用于读/写操作的RAM。
4.如权利要求1到3中任一项所述的比特交织器，其特征在于：
还包括一星座映射单元；
所述控制模块还用于将读出的数据和配置信息一同发给所述星座映射单元；还用于当星座映射单元输出映射结果的同时，也将与其对应的配置信息输出；
所述星座映射单元用于根据所述读出的配置信息对读出数据进行星座映射并输出。
5.如权利要求1到3中任一项所述的比特交织器，其特征在于：
所述存储介质为一独立寄存器组、或为独立的RAM、或为所对应的RAM中指定的一块存储区域。
6.如权利要求1到3中任一项所述的比特交织器，其特征在于：
所述两个配置信息存储介质各自的大小至少等于一个配置信息的大小；所述两个RAM各自的大小至少等于一个编码数据块的大小。
7.如权利要求1到3中任一项所述的比特交织器，其特征在于：
所述控制单元向RAM写入数据时是以字节为单位按行写入，从RAM中读取数据时是以比特为单位按列读出。
8.一种在如权利要求1所述的比特交织器中进行比特交织的方法，其特征在于，包括：
将两个RAM交替作为用于读操作和写操作的RAM，每进行完一轮操作后，就交换用于读/写操作的RAM；
每接收到一个编码数据块的数据时，请求该编码数据块对应的配置信息；当对一个RAM进行读/写数据的同时，相应对其对应的配置信息存储介质读/写配置信息；
所述编码数据块为比特交织器每次接收到的一批数据。
9.如权利要求8所述的方法，其特征在于，具体包括：
A、接收一个编码数据块的数据；同时，请求并接收与该编码数据块对应的配置信息；
B、如果是比特交织器上电后第一次接收数据，则进行步骤B1，否则进行步骤B2；
B1、选择任一RAM作为用于写操作的RAM，将接收到的数据写入该RAM中，并将配置信息存放到该RAM对应的配置信息存储介质中；将另一RAM作为用于读操作的RAM；进行步骤C；
B2、将接收到的数据写入用于写操作的RAM中，并将配置信息存放到该RAM对应的配置信息存储介质中；同时从用于读操作的RAM中按列读出数据，并从其对应的配置信息存储介质中读出配置信息；进行步骤C；
C、每当进行完一轮操作后，交换用于读/写操作的RAM，并返回步骤A。
10.如权利要求8或9所述的方法，其特征在于，步骤C中进行完一轮操作是指以下情况中的任一种：
向RAM中写完一个编码数据块的数据；
向RAM中写完一个编码数据块的数据，并且从用于读操作的RAM中读出一个编码数据块的数据。
11.如权利要求8或9所述的方法，其特征在于：
所述存储介质为一独立寄存器组、或为独立的RAM、或为所对应的RAM中指定的一块存储区域。
12.如权利要求8或9中任一项所述的方法，其特征在于：
向RAM写入数据时是以字节为单位按行写入，从RAM中读取数据时是以比特为单位按列读出。
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
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| PB01 | Publication | ||
| C10 | Entry into substantive examination | ||
| SE01 | Entry into force of request for substantive examination | ||
| C14 | Grant of patent or utility model | ||
| GR01 | Patent grant | ||
| PE01 | Entry into force of the registration of the contract for pledge of patent right |
Denomination of invention: A bit interleaver and method for bit interleaving Effective date of registration: 20130205 Granted publication date: 20111116 Pledgee: China Development Bank Co Pledgor: Beijing InnoFidei Technology Co. Ltd.|Beijing smartwell xunlian Polytron Technologies Inc|Anhui smartwell Communication Technology Co. Ltd. Registration number: 2013990000087 |
|
| PLDC | Enforcement, change and cancellation of contracts on pledge of patent right or utility model | ||
| PC01 | Cancellation of the registration of the contract for pledge of patent right |
Date of cancellation: 20140416 Granted publication date: 20111116 Pledgee: China Development Bank Co Pledgor: Beijing InnoFidei Technology Co. Ltd.|Beijing smartwell xunlian Polytron Technologies Inc|Anhui smartwell Communication Technology Co. Ltd. Registration number: 2013990000087 |
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| PLDC | Enforcement, change and cancellation of contracts on pledge of patent right or utility model | ||
| C41 | Transfer of patent application or patent right or utility model | ||
| TR01 | Transfer of patent right |
Effective date of registration: 20151016 Address after: 100080, Beijing, Zhongguancun Haidian District Street 11, 100 million world wealth center, block A, 12 Patentee after: BEIJING BOXIN SHITONG TECHNOLOGY CO., LTD. Address before: 100084, room 23, floor 2303, building A, science and technology building, Qinghua science park, Beijing, Haidian District Patentee before: Beijing Chuangyi Vision Technology Co., Ltd. |
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| CF01 | Termination of patent right due to non-payment of annual fee | ||
| CF01 | Termination of patent right due to non-payment of annual fee |
Granted publication date: 20111116 Termination date: 20181224 |