WO1998048355A3 - Procede pour transferer un systeme d'exploitation dans des installations informatiques - Google Patents

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    • G06F12/08Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
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Abstract

Ce procédé permet l'utilisation d'un système d'exploitation (OS1), destiné à un matériel source (M1) supportant un mode d'adressage réel, sur un matériel cible (M2) supportant uniquement un mode d'adressage virtuel, tout en maintenant l'adressage de la mémoire principale qui est indépendant de la configuration et du processus. A cet effet, un des espaces adresse virtuels pour l'adressage, indépendant du processus, de la mémoire principale (HS2) est réservé et, conformément au mode d'adressage réel, est utilisé sur le matériel source (ME2). Un programme de commande séparé (GSP) situé en aval permet au système d'exploitation transféré (OS2) de réagir à des conditions exceptionnelles (EV2) du matériel cible (M2), et les adresses réelles du système d'exploitation à transférer sont imagées, dans l'espace adresse réservé, sur des adresses libres de la mémoire physique qui ne sont pas occupées par le programme de commande séparé (GSP).
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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5038281A (en) * 1986-09-19 1991-08-06 International Business Machines Corporation Acceleration of system interrupts between operating systems in guest-host relationship
EP0645701A2 (fr) * 1993-09-28 1995-03-29 Bull HN Information Systems Inc. Emulation des fonctions mémoire d'un premier système sur un deuxième
US5479631A (en) * 1992-11-19 1995-12-26 International Business Machines Corporation System for designating real main storage addresses in instructions while dynamic address translation is on

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS58102380A (ja) * 1981-12-11 1983-06-17 Hitachi Ltd 仮想記憶管理方法
JP2510605B2 (ja) * 1987-07-24 1996-06-26 株式会社日立製作所 仮想計算機システム
JP2839201B2 (ja) * 1990-07-30 1998-12-16 株式会社日立製作所 仮想計算機システム

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5038281A (en) * 1986-09-19 1991-08-06 International Business Machines Corporation Acceleration of system interrupts between operating systems in guest-host relationship
US5479631A (en) * 1992-11-19 1995-12-26 International Business Machines Corporation System for designating real main storage addresses in instructions while dynamic address translation is on
EP0645701A2 (fr) * 1993-09-28 1995-03-29 Bull HN Information Systems Inc. Emulation des fonctions mémoire d'un premier système sur un deuxième

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
SHANG RONG TSAI ET AL: "ON THE ARCHITECTURAL SUPPORT FOR LOGICAL MACHINE SYSTEMS", MICROPROCESSING AND MICROPROGRAMMING, vol. 22, no. 2, 1 February 1988 (1988-02-01), pages 81 - 96, XP000284881 *

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