TWI757868B - 顯示面板之驅動電路、顯示面板之驅動方法與顯示模組 - Google Patents

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Abstract

一種顯示面板之驅動電路包括一共同電壓產生電路。共同電壓產生電路耦接一顯示面板的複數共同電極，提供複數共同電壓分別至該等共同電極。在一幀期間，共同電壓產生電路分別於不同時間改變該等共同電壓的一電壓位準。

Description

顯示面板之驅動電路、顯示面板之驅動方法與顯示模組
本發明係關於一種顯示面板之驅動電路與驅動方法及其顯示模組，尤指一種可有效降低畫面閃爍的顯示面板之驅動電路與驅動方法及其顯示模組。
薄膜電晶體液晶顯示器(Thin Film Transistor Liquid Crystal Display，簡稱為TFT-LCD)是多數液晶顯示器的一種，它使用薄膜電晶體技術改善影像品質，常被應用在電視、平面顯示器及投影機上。
為了不影響液晶分子的排列與穿透度，並且避免配向膜的直流阻絕效應與直流殘留造成的殘影，必須對施加在液晶分子上的電場做極性反轉，即，在不同的時間以相反方向的電場施加在液晶分子上。
常見的極性反轉包括線反轉(line inversion)、點反轉(dot inversion)與幀反轉(frame inversion)等。線反轉與點反轉因需要頻繁的執行極性反轉，因而存在耗電量高的問題。幀反轉則僅於每個幀(frame)執行一次極性反轉。然而，由於面板上存在寄生效應以及儲存電容的漏電效應，而會影響畫素的光亮度，畫素等待被致能的時間越長，其光變化量越大，於應用幀反轉時，會因為部分畫素等待被致能的時間較長，產生較大的光變化量，進而造成畫面閃爍。
為解決上述問題，需要一種可有效降低畫面閃爍的顯示面板之驅動電路與驅動方法及其顯示模組。
本發明之一目的在於解決顯示面板之畫面閃爍與亮度分布不均勻的問題。
根據本發明之一實施例，一種顯示面板之驅動電路包括一共同電壓產生電路。共同電壓產生電路耦接一顯示面板的複數共同電極，提供複數共同電壓分別至該等共同電極。在一幀期間，共同電壓產生電路分別於不同時間改變該等共同電壓的一電壓位準。
根據本發明之另一實施例，一種顯示面板之驅動方法，包括：提供複數共同電壓分別至一顯示面板的複數共同電極；以及於一幀期間內的不同時間改變該等共同電壓的一電壓位準。
根據本發明之又一實施例，一種顯示模組包括一顯示面板與一共同電壓產生電路。顯示面板具有複數共同電極。共同電壓產生電路耦接該等共同電極，提供複數共同電壓分別至該等共同電極。在一幀期間，共同電壓產生電路分別於不同時間改變該等共同電壓的一電壓位準。
100:顯示模組
110:共同電壓產生電路
120:時序控制電路
130:閘極驅動電路
140:源極驅動電路
200,200-1,200-2,200-3:顯示面板
210:畫素結構
CLC:液晶電容
CST:儲存電容
Frame_Period:幀期間
G(1)~G(M):閘極線
S(1)~S(N):源極線
SG(1)~SG(M):閘極訊號
T:電晶體
T1,T2,T3,T4:時間
VCOM,VCOM1,VCOM2,VCOM3,VCOM4:共同電極
V_VCOM1,V_VCOM2,V_VCOM3,V_VCOM4,V_VCOMk:共同電壓
第1圖係顯示根據本發明之一實施例所述之顯示模組的方塊圖。
第2圖係顯示根據本發明之第一實施例所述之共同電極的分布示意圖。
第3圖係顯示根據本發明之第一實施例所述之應用於第2圖之共同電極之電壓與訊號的時序圖。
第4圖係顯示根據本發明之第二實施例所述之應用於第2圖之共同電極之電壓與訊號的時序圖。
第5圖係顯示根據本發明之第三實施例所述之共同電極的分布示意圖。
第6圖係顯示根據本發明之第三實施例所述之應用於第5圖之共同電極之電壓與訊號的時序圖。
第7圖係顯示根據本發明之第四實施例所述之應用於第5圖之共同電極之電壓與訊號的時序圖。
第8圖係顯示根據本發明之第五實施例所述之共同電極的分布示意圖。
第9圖係顯示根據本發明之第五實施例所述之應用於第8圖之共同電極之電壓與訊號的時序圖。
第10圖係顯示根據本發明之第六實施例所述之應用於第8圖之共同電極之電壓與訊號的時序圖。
第11圖係顯示根據本發明之一實施例所述之顯示面板之驅動方法的流程圖。
在下文中，將藉由圖式說明本發明之各種實施例，以詳細描述本發明。然而本發明之概念可能以許多不同型式體現，且不應解釋為限於本文中所闡述之例式性實施例。
在說明書及請求項當中使用了某些詞彙指稱特定的元件，然，所屬本發明技術領域中具有通常知識者應可理解，製造商可能會用不同的名詞稱呼同一個元件，而且，本說明書及請求項並不以名稱的差異作為區分元件的方式，而是以元件在整體技術上的差異作為區分的準則。在通篇說明書及請求項當中所提及的「包含」為一開放式用語，故應解釋成「包含但不限定於」。再者，「耦接」一詞在此包含任何直接及間接的連接手段。因此，若文中描述一第一裝置 耦接一第二裝置，則代表第一裝置可直接連接第二裝置，或可透過其他裝置或其他連接手段間接地連接至第二裝置。
第1圖係顯示根據本發明之一實施例所述之顯示模組的方塊圖。顯示模組100包括顯示面板200與顯示面板之驅動電路，顯示面板之驅動電路耦接顯示面板200，用以驅動顯示面板200。顯示面板200具有複數共同電極與複數畫素結構，例如，畫素結構210。每一畫素結構210可具有一電晶體T、一液晶電容CLC與一儲存電容CST，並耦接複數共同電極之一者，因本發明之實施例中複數共同電極可有多種不同配置，於第1圖中統一以共同電極VCOM作為代表。此外，顯示面板200具有複數閘極線與複數源極線，每一畫素結構210可分別耦接一閘極線與一源極線，例如，閘極線G(1)~G(M)之其中一者與源極線S(1)~S(N)之其中一者，其中M、N為一正整數。
顯示面板之驅動電路可包括一共同電壓產生電路110、一時序控制電路120、一閘極驅動電路130以及一源極驅動電路140。於本發明之一實施例中，驅動電路可形成於一晶片(IC)。共同電壓產生電路110耦接顯示面板200的複數共同電極，並提供複數共同電壓，例如，共同電壓V_VCOM1~V_VCOMk分別至該些共同電極，其中k為大於1之正整數。閘極驅動電路130耦接顯示面板200的複數閘極線G(1)~G(M)，並輸出複數閘極訊號分別至該些閘極線。源極驅動電路140耦接顯示面板的複數源極線S(1)~S(N)，並輸出複數源極訊號分別至該些源極線。
時序控制電路120耦接共同電壓產生電路110、閘極驅動電路130以及源極驅動電路140，產生複數時序訊號至閘極驅動電路130、源極驅動電路140與共同電壓產生電路110，使其可依據時序訊號產生對應的訊號。例如，時序控制電路120可產生時脈訊號或起始脈衝，將時脈訊號或起始脈衝提供給閘極驅動電路130。閘極驅動電路130可根據時脈訊號或起始脈衝產生複數閘極訊號，控制 每一閘極訊號之準位為高準位(致能準位)與低準位(禁能準位)的時間，並依序將閘極訊號提供至對應的閘極線。時序控制電路120亦可將時脈訊號提供給源極驅動電路140。源極驅動電路140可根據時脈訊號與畫素資料產生複數源極訊號，並依序將源極訊號提供至對應的源極線。此外，時序控制電路120亦可將時脈訊號提供予共同電壓產生電路110，並控制共同電壓產生電路110改變共同電壓的電壓位準。例如，共同電壓產生電路110可根據時脈訊號控制共同電壓的電壓位準的切換時間(以下段落將作更詳細的介紹)。於本發明之一實施例中，可預設控制參數於共同電壓產生電路110，共同電壓產生電路110可依據控制參數改變共同電壓的電壓位準的切換時間，而可不需要受控於時序控制電路120。例如，共同電壓產生電路110具有計數器，而可進行計數操作，以依據控制參數決定改變共同電壓的電壓位準的切換時間。
第2圖係顯示根據本發明之一實施例所述之共同電極的分布示意圖。於此實施例中，顯示面板200-1具有兩個共同電極VCOM1與VCOM2，共同電極VCOM1與VCOM2互相獨立且不連接，而顯示面板200-1的複數畫素結構可對應地分群為兩個畫素群組，第一畫素群組的畫素結構可耦接共同電極VCOM1，第二畫素群組的畫素結構可耦接共同電極VCOM2。例如，共同電極VCOM1可分布於顯示面板200-1的上半部畫素區域，共同電極VCOM2可分布於顯示面板200-1的下半部畫素區域，因此，第1圖中與閘極線G(1)~G(M/2)相接的畫素結構所耦接的共同電極VCOM可以是第2圖的共同電極VCOM1，與閘極線G(M/2+1)~G(M)相接的畫素結構所耦接的共同電極VCOM可以是第2圖的共同電極VCOM2。
根據本發明之一實施例，共同電壓產生電路110提供複數共同電壓分別至顯示面板的複數共同電極，並且在一幀期間，共同電壓產生電路110分別於不同時間改變該些共同電壓的一電壓位準，以解決前述畫面閃爍的問題。
參考第2圖所示之實施例，於此應用中，由共同電壓產生電路110所產生的複數共同電壓可包括共同電壓V_VCOM1與V_VCOM2，共同電壓V_VCOM1被提供至共同電極VCOM1，共同電壓V_VCOM2被提供至共同電極VCOM2。此外，於此應用中，顯示面板的複數閘極線可分群為複數閘極線群組，包括第一閘極線群組與第二閘極線群組，閘極驅動電路130依據一第一順序輸出複數第一閘極訊號至第一閘極線群組的複數閘極線，並依據一第二順序輸出複數第二閘極訊號至第二閘極線群組的複數閘極線。於本發明之第一實施例中，第一順序與第二順序相同。
第3圖係顯示根據本發明之第一實施例所述之電壓與訊號的時序圖，其為共同電壓與閘極訊號應用於顯示面板具有兩個共同電極的時序範例，其中閘極訊號SG(1)~SG(M)為分別提供於閘極線G(1)~G(M)上的閘極訊號。如圖所示，於一個幀期間Frame_Period內，即顯示一個完整畫面的期間，共同電壓產生電路110可於第一時間T1改變共同電壓V_VCOM1的電壓位準，例如，由低準位切換為高準位，以及於第二時間T2改變共同電壓V_VCOM2的電壓位準，例如，由低準位切換為高準位，且第一時間T1不同於第二時間T2。
換言之，於本發明之實施例中，共同電壓產生電路110於不同時間點改變共同電壓V_VCOM1與V_VCOM2的電壓位準，使共同電壓V_VCOM1與V_VCOM2的電壓變化具有一既定的時間差，而此既定的時間差(即，第一時間T1第二時間T2之間的差異)相關於共同電壓/共同電極的數量。例如，當共同電壓的數量越多時，既定的時間差越小。又例如，既定的時間差可被設定為一個幀期間Frame_Period的長度除以共同電壓的數量所得的數值，或者是被設定為接近於前述所得的數值或根據前述所得的數值微調後的另一數值。
於本發明之實施例中，藉由配置複數共同電極與複數共同電壓，並且於不同時間點改變共同電壓的電壓位準，可有效解決或減緩顯示面板之部分 畫素因等待被致能的時間較長，產生較大的光變化量，進而造成明顯畫面閃爍的問題。其原理說明如下：假設一畫素結構應顯示的亮度為X，最終顯示的亮度為G，自從提供至該畫素結構所耦接之共同電極的共同電壓的電壓位準被切換後到該畫素結構被致能(該畫素結構所耦接之閘極線上的閘極訊號被致能)的單位時間差因寄生效應與漏電效應所造成的亮度變化量為Y，其中切換共同電壓的電壓位準係為了對施加在液晶分子上的電場做極性反轉，則因為畫素結構內的寄生效應以及儲存電容的漏電效應會導致該畫素結構最終顯示的亮度G偏離原本應顯示的亮度X，在幀反轉應用下亮度G可簡單表示為G=X-b*Y，其中b為單位時間的係數，b關係於自從共同電壓的電壓位準被切換後到該畫素結構被致能的時間差。因此，當共同電壓的電壓位準被切換的時間與閘極線被致能的時間的差異越大，則b越大，即，共同電壓的電壓位準被切換後，閘極線等待被致能的時間越長，光變化量也會越大。
於本發明的實施例中，藉由配置複數共同電極與提供複數共同電壓，且於不同時間點改變該等共同電壓的電壓位準，縮短共同電壓的電壓位準被切換的時間與閘極訊號/畫素結構被致能的時間的差異，如此可有效解決或減緩前述因畫素結構等待被致能的時間較長而產生畫面閃爍的問題。例如，於配置兩個共同電極與兩個共同電壓的幀反轉實施例中，相較於僅有一個共同電極與一個共同電壓實施例下，最晚被致能的畫素結構的亮度變化量可有效減半。
此外，參考回第3圖，於改變共同電壓的電壓位準後，共同電壓產生電路110更分別維持共同電壓V_VCOM1與V_VCOM2的電壓位準於一預定期間，此預定期間的長度等於一個幀期間Frame_Period的長度。如圖所示，共同電壓產生電路110於第一時間T1改變共同電壓V_VCOM1的電壓位準後，將共同電壓V_VCOM1的電壓位準於爾後的第一預定期間內維持在高準位，其中第一預定 期間的長度等於一個幀期間Frame_Period的長度，以及於第二時間T2改變共同電壓V_VCOM2的電壓位準後，將共同電壓V_VCOM2的電壓位準於爾後的第二預定期間內維持在高準位，第二預定期間的長度亦等於一個幀期間Frame_Period的長度，即共同電壓V_VCOM2的電壓位準維持高準位到下一幀期間Frame_Period的一半時間。於分別將共同電壓V_VCOM1與V_VCOM2的電壓位準維持一個幀期間Frame_Period的長度的期間後，共同電壓產生電路110會再度改變共同電壓V_VCOM1與V_VCOM2的電壓位準，例如，由高準位切換為低準位，以達到幀反轉的效果。
此外，如第3圖所示，於本發明之第一實施例中，第一閘極線群組包括閘極線G(1)~G(M/2)，第二閘極線群組包括閘極線G(M/2+1)~G(M)，閘極驅動電路130可自第一條閘極線G(1)開始，依據閘極線索引值遞增的順序輸出對應之第一閘極訊號，例如圖中所示之閘極訊號SG(1)~SG(M/2)，至閘極線G(1)~G(M/2)，並依閘極線索引值遞增的順序控制第一閘極訊號之準位為致能準位，使得第一閘極線群組的閘極線G(1)~G(M/2)可依據閘極線索引值遞增的順序依序響應於第一閘極訊號上的致能準位被致能，並且接著自第(M/2+1)條閘極線G(M/2+1)開始，依據閘極線索引值遞增的順序輸出對應之第二閘極訊號，例如圖中所示之閘極訊號SG(M/2+1)~SG(M)，至閘極線G(M/2+1)~G(M)，並依閘極線索引值遞增的順序控制第二閘極訊號之準位為致能準位，使得第二閘極線群組的閘極線G(M/2+1)~G(M)可依據閘極線索引值遞增的順序依序響應於第二閘極訊號上的致能準位被致能。
而於本發明之第二實施例中，閘極驅動電路130可依據不同的順序輸出閘極訊號至不同的閘極線群組，藉此進一步改善不同的閘極線群組交界處的畫素結構的亮度差值。
第4圖係顯示根據本發明之第二實施例所述之電壓與訊號的時序 圖，其為共同電壓與閘極訊號應用於顯示面板具有兩個共同電極的時序範例。於此實施例中，類似於前述第一實施例，於一個幀期間Frame_Period內，共同電壓產生電路110於第一時間T1改變共同電壓V_VCOM1的電壓位準，例如，由低準位切換為高準位，以及於第二時間T2改變共同電壓V_VCOM2的電壓位準，例如，由低準位切換為高準位，且第一時間T1不同於第二時間T2。此外，於改變共同電壓的電壓位準後，共同電壓產生電路110更分別維持共同電壓V_VCOM1與V_VCOM2的電壓位準於一預定期間，此預定期間的長度等於一個幀期間Frame_Period的長度，以達到幀反轉的效果。藉由此驅動電路的配置與對應之驅動方法，相較於傳統實施幀反轉的顯示面板，最晚被致能的畫素結構的亮度變化量可有效減半。
此外，於此實施例中，閘極驅動電路130依據第一順序輸出複數第一閘極訊號，例如，閘極訊號SG(1)~SG(M/2)，至第一閘極線群組的複數閘極線，例如，閘極線G(1)~G(M/2)，並依據第二順序輸出複數第二閘極訊號，例如，閘極訊號SG(M/2+1)~SG(M)，至第二閘極線群組的複數閘極線，例如，閘極線G(M/2+1)~G(M)，然而，與前述第一實施例的差異在於，於此實施例中，第一順序不同於第二順序。
如圖所示，於本發明之第二實施例中，閘極驅動電路130可自第一條閘極線G(1)開始，依據閘極線索引值遞增的順序輸出對應之第一閘極訊號，例如，閘極訊號SG(1)~SG(M/2)，至閘極線G(1)~G(M/2)，並依閘極線索引值遞增的順序控制第一閘極訊號之準位為致能準位，使得第一閘極線群組的閘極線G(1)~G(M/2)可依據閘極線索引值遞增的順序依序響應於第一閘極訊號上的致能準位被致能，並且接著閘極驅動電路130自最後一條閘極線G(M)開始，依據閘極線索引值遞減的順序輸出對應之第二閘極訊號，例如，閘極訊號SG(M)~SG(M/2+1)，至閘極線G(M)~G(M/2+1)，並依閘極線索 引值遞減的順序控制第二閘極訊號之準位為致能準位，使得第二閘極線群組的閘極線G(M/2+1)~G(M)可依據閘極線索引值遞減的順序自最後一條閘極線G(M)開始依序響應於第二閘極訊號上的致能準位被致能。
由於相鄰的第一閘極線群組的最後一條閘極線G(M/2)與第二閘極線群組的第一條閘極線G(M/2+1)分別為該群組中最晚被致能的閘極線，在兩群組閘極線數量相等或近乎相等的配置下，相鄰的閘極線G(M/2)與G(M/2+1)具有相近的等待被致能的時間(即前述自從對應的共同電壓的電壓位準被切換後到閘極線被致能的時間的差異)，如此可有效改善第一閘極線群組與第二閘極線群組交界處的畫素結構的亮度差值。
以上實施例係介紹於顯示模組配置兩個共同電極與兩個共同電壓的顯示面板之驅動電路與驅動方法，然而本發明並不限於配置兩個共同電極與兩個共同電壓。
第5圖係顯示根據本發明之另一實施例所述之共同電極的分布示意圖。於此實施例中，顯示面板200-2具有三個共同電極VCOM1、VCOM2與VCOM3，共同電極VCOM1、VCOM2與VCOM3互相獨立且不連接，而顯示面板200-2的複數畫素結構可分群為第一畫素群組、第二畫素群組與第三畫素群組，第一畫素群組的畫素結構可耦接共同電極VCOM1，第二畫素群組的畫素結構可耦接共同電極VCOM2，第三畫素群組的畫素結構可耦接共同電極VCOM3。舉例而言，於此應用中，第1圖中與閘極線G(1)~G(M/3)相接的畫素結構所耦接的共同電極VCOM可以是第5圖的共同電極VCOM1，與閘極線G(M/3+1)~G(2M/3)相接的畫素結構所耦接的共同電極VCOM可以是第5圖的共同電極VCOM2，與閘極線G(2M/3+1)~G(M)相接的畫素結構所耦接的共同電極VCOM可以是第5圖的共同電極VCOM3。
於此應用中，由共同電壓產生電路110所產生的複數共同電壓可包括 共同電壓V_VCOM1、V_VCOM2與V_VCOM3，共同電壓V_VCOM1被提供至共同電極VCOM1，共同電壓V_VCOM2被提供至共同電極VCOM2，共同電壓V_VCOM3被提供至共同電極VCOM3。此外，於此應用中，顯示面板的複數閘極線可分群為複數閘極線群組，包括第一閘極線群組、第二閘極線群組與第三閘極線群組。
第6圖係顯示根據本發明之第三實施例所述之電壓與訊號的時序圖，其為共同電壓與閘極訊號應用於顯示面板具有三個共同電極的時序範例。如圖所示，於一個幀期間Frame_Period內，共同電壓產生電路110可於第一時間T1改變共同電壓V_VCOM1的電壓位準，例如，由低準位切換為高準位，於第二時間T2改變共同電壓V_VCOM2的電壓位準，例如，由低準位切換為高準位，以及於第三時間T3改變共同電壓V_VCOM3的電壓位準，例如，由低準位切換為高準位，且第一時間T1、第二時間T2與第三時間T3均不相同。此外，於改變共同電壓的電壓位準後，共同電壓產生電路110更分別維持共同電壓V_VCOM1、V_VCOM2與V_VCOM3的電壓位準於一預定期間，此預定期間的長度等於一個幀期間Frame_Period的長度，例如共同電壓產生電路110維持共同電壓V_VCOM1的電壓位準為高準位到目前幀期間Frame_Period的結束時間，而維持共同電壓V_VCOM2的電壓位準為高準位到下一幀期間Frame_Period的三分之一時間，且維持共同電壓V_VCOM3的電壓位準為高準位到下一幀期間Frame_Period的三分之二時間。而於分別將共同電壓V_VCOM1、V_VCOM2與V_VCOM3的電壓位準維持一個幀期間Frame_Period的長度後，共同電壓產生電路110會再度改變共同電壓V_VCOM1、V_VCOM2與V_VCOM3的電壓位準，例如，由高準位切換為低準位，以達到幀反轉的效果。
此外，於此實施例中，閘極驅動電路130依據第一順序輸出複數第一閘極訊號，例如，閘極訊號SG(1)~SG(M/3)，至第一閘極線群組的複數閘 極線，例如，閘極線G(1)~G(M/3)，依據第二順序輸出複數第二閘極訊號，例如，閘極訊號SG(M/3+1)~SG(2M/3)，至第二閘極線群組的複數閘極線，例如，閘極線G(M/3+1)~G(2M/3)，並依據第三順序輸出複數第三閘極訊號，例如，閘極訊號SG(2M/3+1)~SG(M)，至第三閘極線群組的複數閘極線，例如，閘極線G(2M/3+1)~G(M)。於本發明之第三實施例中，第一順序、第二順序與第三順序相同。
如第6圖所示，於本發明之第三實施例中，閘極驅動電路130可自第一條閘極線G(1)開始，依據閘極線索引值遞增的順序輸出對應之第一閘極訊號，例如，閘極訊號SG(1)~SG(M/3)，至閘極線G(1)~G(M/3)，並依閘極線索引值遞增的順序控制第一閘極訊號之準位為致能準位，使得第一閘極線群組的閘極線G(1)~G(M/3)可依據閘極線索引值遞增的順序依序響應於第一閘極訊號上的致能準位被致能，接著自第(M/3+1)條閘極線G(M/3+1)開始，依據閘極線索引值遞增的順序輸出對應之第二閘極訊號，例如，閘極訊號SG(M/3+1)~SG(2M/3)，至閘極線G(M/3+1)~G(2M/3)，並依閘極線索引值遞增的順序控制第二閘極訊號之準位為致能準位，使得第二閘極線群組的閘極線G(M/3+1)~G(2M/3)可依據閘極線索引值遞增的順序依序響應於第二閘極訊號上的致能準位被致能，並且接著自第(2M/3+1)條閘極線G(2M/3+1)開始，依據閘極線索引值遞增的順序輸出對應之第三閘極訊號，例如，閘極訊號SG(2M/3+1)~SG(M)，至閘極線G(2M/3+1)~G(M)，並依閘極線索引值遞增的順序控制第三閘極訊號之準位為致能準位，使得第三閘極線群組的閘極線G(2M/3+1)~G(M)可依據閘極線索引值遞增的順序依序響應於第三閘極訊號上的致能準位被致能。
第7圖係顯示根據本發明之第四實施例所述之電壓與訊號的時序圖，其同樣為共同電壓與閘極訊號應用於顯示面板具有三個共同電極的時序範 例。於此範例中，共同電壓產生電路110的操作、共同電極、共同電壓與閘極線群組的配置、以及共同電壓的電壓位準切換的時序控制與第6圖相同，於此不再贅述。
於此實施例中，第一順序不同於第二順序，且第二順序不同於第三順序。
如圖所示，於本發明之第四實施例中，閘極驅動電路130可自第一條閘極線G(1)開始，依據閘極線索引值遞增的順序輸出對應之第一閘極訊號，例如，閘極訊號SG(1)~SG(M/3)，至閘極線G(1)~G(M/3)，並依閘極線索引值遞增的順序控制第一閘極訊號之準位為致能準位，使得第一閘極線群組的閘極線G(1)~G(M/3)可依據閘極線索引值遞增的順序自第一條閘極線G(1)開始依序響應於第一閘極訊號上的致能準位被致能，接著閘極驅動電路130自第(2M/3)條閘極線G(2M/3)開始，依據閘極線索引值遞減的順序輸出對應之第二閘極訊號，例如，閘極訊號SG(2M/3)~SG(M/3+1)，至閘極線G(2M/3)~G(M/3+1)，並依閘極線索引值遞減的順序控制第二閘極訊號之準位為致能準位，使得第二閘極線群組的閘極線G(M/3+1)~G(2M/3)可依據閘極線索引值遞減的順序自此群組的最後一條閘極線G(2M/3)開始依序響應於第二閘極訊號上的致能準位被致能，並且接著閘極驅動電路130自第(2M/3+1)條閘極線G(2M/3+1)開始，依據閘極線索引值遞增的順序輸出對應之第三閘極訊號，例如，閘極訊號SG(2M/3+1)~SG(M)，至閘極線G(2M/3+1)~G(M)，並依閘極線索引值遞增的順序控制第三閘極訊號之準位為致能準位，使得第三閘極線群組的閘極線G(2M/3+1)~G(M)可依據閘極線索引值遞增的順序自此群組的第一條閘極線G(2M/3+1)開始依序響應於第三閘極訊號上的致能準位被致能。
由於相鄰的第一閘極線群組的最後一條閘極線G(M/3)與第二閘極 線群組的第一條閘極線G(M/3+1)分別為該群組中最晚被致能的閘極線，在兩群組閘極線數量相等或近乎相等的配置下，相鄰的閘極線G(M/3)與G(M/3+1)具有相近的等待被致能的時間(即前述自從對應的共同電壓的電壓位準被切換後到閘極線被致能的時間的差異)，如此可有效改善第一閘極線群組與第二閘極線群組交界處的畫素結構的亮度差值。同樣地，由於相鄰的第二閘極線群組的最後一條閘極線G(2M/3)與第三閘極線群組的第一條閘極線G(2M/3+1)分別為該群組中最早被致能的閘極線，在兩群組閘極線數量相等或近乎相等的配置下，相鄰的閘極線G(2M/3)與G(2M/3+1)具有相近的等待被致能的時間，如此可有效改善第二閘極線群組與第三閘極線群組交界處的畫素結構的亮度差值。
第8圖係顯示根據本發明之又一實施例所述之共同電極的分布示意圖。於此實施例中，顯示面板200-3具有四個共同電極VCOM1、VCOM2、VCOM3與VCOM4，共同電極VCOM1、VCOM2、VCOM3與VCOM4互相獨立且不連接，而顯示面板200-3的複數畫素結構可分群為第一畫素群組、第二畫素群組、第三畫素群組與第四畫素群組，第一畫素群組的畫素結構可耦接共同電極VCOM1，第二畫素群組的畫素結構可耦接共同電極VCOM2，第三畫素群組的畫素結構可耦接共同電極VCOM3，第四畫素群組的畫素結構可耦接共同電極VCOM4。舉例而言，於此應用中，第1圖中與閘極線G(1)~G(M/4)相接的畫素結構所耦接的共同電極VCOM可以是第8圖的共同電極VCOM1，與閘極線G(M/4+1)~G(2M/4)相接的畫素結構所耦接的共同電極VCOM可以是第8圖的共同電極VCOM2，與閘極線G(2M/4+1)~G(3M/4)相接的畫素結構所耦接的共同電極VCOM可以是第8圖的共同電極VCOM3，與閘極線G(3M/4+1)~G(M)相接的畫素結構所耦接的共同電極VCOM可以是第8圖的共同電極VCOM4。
第9圖係顯示根據本發明之第五實施例所述之電壓與訊號的時序 圖，其為共同電壓與閘極訊號應用於顯示面板具有四個共同電極的時序範例。如圖所示，於一個幀期間Frame_Period內，共同電壓產生電路110可於第一時間T1改變共同電壓V_VCOM1的電壓位準，例如，由低準位切換為高準位，於第二時間T2改變共同電壓V_VCOM2的電壓位準，例如，由低準位切換為高準位，於第三時間T3改變共同電壓V_VCOM3的電壓位準，例如，由低準位切換為高準位，以及第四時間T4改變共同電壓V_VCOM4的電壓位準，例如，由低準位切換為高準位，且第一時間T1、第二時間T2、第三時間T3與第四時間T4均不相同。
此外，於改變共同電壓的電壓位準後，共同電壓產生電路110更分別維持共同電壓V_VCOM1、V_VCOM2、V_VCOM3與V_VCOM4的電壓位準於一預定期間，此預定期間的長度等於一個幀期間Frame_Period的長度，例如共同電壓產生電路110維持共同電壓V_VCOM1的電壓位準為高準位到目前幀期間Frame_Period的結束時間，而維持共同電壓V_VCOM2的電壓位準為高準位到下一幀期間Frame_Period的四分之一時間，並維持共同電壓V_VCOM3的電壓位準為高準位到下一幀期間Frame_Period的四分之二時間，且維持共同電壓V_VCOM4的電壓位準為高準位到下一幀期間Frame_Period的四分之三時間。而於分別將共同電壓V_VCOM1、V_VCOM2、V_VCOM3與V_VCOM4的電壓位準維持一個幀期間Frame_Period的長度後，共同電壓產生電路110會再度改變共同電壓V_VCOM1、V_VCOM2、V_VCOM3與V_VCOM4的電壓位準，例如，由高準位切換為低準位，以達到幀反轉的效果。
此外，於此實施例中，閘極驅動電路130依據第一順序輸出複數第一閘極訊號至第一閘極線群組的複數閘極線，例如，閘極線G(1)~G(M/4)，依據第二順序輸出複數第二閘極訊號至第二閘極線群組的複數閘極線，例如，閘極線G(M/4+1)~G(2M/4)，依據第三順序輸出複數第三閘極訊號至第三閘極線群組的複數閘極線，例如，閘極線G(2M/4+1)~G(3M/4)，並依據第四順 序輸出複數第四閘極訊號至第四閘極線群組的複數閘極線，例如，閘極線G(3M/4+1)~G(M)。於本發明之第五實施例中，第一順序、第二順序、第三順序與第四順序相同。
如第9圖所示，於本發明之第五實施例中，閘極驅動電路130可自第一條閘極線G(1)開始，依據閘極線索引值遞增的順序輸出對應之第一閘極訊號，例如，閘極訊號SG(1)~SG(M/4)，至閘極線G(1)~G(M/4)，並依閘極線索引值遞增的順序控制第一閘極訊號之準位為致能準位，使得第一閘極線群組的閘極線G(1)~G(M/4)可依據閘極線索引值遞增的順序依序響應於第一閘極訊號上的致能準位被致能，接著自第(M/4+1)條閘極線G(M/4+1)開始，依據閘極線索引值遞增的順序輸出對應之第二閘極訊號，例如，閘極訊號SG(M/4+1)~SG(2M/4)，至閘極線G(M/4+1)~G(2M/4)，並依閘極線索引值遞增的順序控制第二閘極訊號之準位為致能準位，使得第二閘極線群組的閘極線G(M/4+1)~G(2M/4)可依據閘極線索引值遞增的順序依序響應於第二閘極訊號上的致能準位被致能，接著自第(2M/4+1)條閘極線G(2M/4+1)開始，依據閘極線索引值遞增的順序輸出對應之第三閘極訊號，例如，閘極訊號SG(2M/4+1)~SG(3M/4)，至閘極線G(2M/4+1)~G(3M/4)，並依閘極線索引值遞增的順序控制第三閘極訊號之準位為致能準位，使得第三閘極線群組的閘極線G(2M/4+1)~G(3M/4)可依據閘極線索引值遞增的順序依序響應於第三閘極訊號上的致能準位被致能，並且接著自第(3M/4+1)條閘極線G(3M/4+1)開始，依據閘極線索引值遞增的順序輸出對應之第四閘極訊號，例如，閘極訊號SG(3M/4+1)~SG(M)，至閘極線G(3M/4+1)~G(M)，並依閘極線索引值遞增的順序控制第四閘極訊號之準位為致能準位，使得第四閘極線群組的閘極線G(3M/4+1)~G(M)可依據閘極線索引值遞增的順序依序響應於第四閘極訊號上的致能準位被致能。
第10圖係顯示根據本發明之第六實施例所述之電壓與訊號的時序圖，其同樣為共同電壓與閘極訊號應用於顯示面板具有四個共同電極的時序範例。於此範例中，共同電壓產生電路110的操作、共同電極、共同電壓與閘極線群組的配置、以及共同電壓的電壓位準切換的時序控制與第9圖相同，於此不再贅述。
於此實施例中，第一順序不同於第二順序，第二順序不同於第三順序，且第三順序不同於第四順序。
如圖所示，於本發明之第六實施例中，閘極驅動電路130可自第一條閘極線G(1)開始，依據閘極線索引值遞增的順序輸出對應之第一閘極訊號，例如，閘極訊號SG(1)~SG(M/4)，至閘極線G(1)~G(M/4)，並依閘極線索引值遞增的順序控制第一閘極訊號之準位為致能準位，使得第一閘極線群組的閘極線G(1)~G(M/4)可依據閘極線索引值遞增的順序自第一條閘極線G(1)開始依序響應於第一閘極訊號上的致能準位被致能，接著閘極驅動電路130自第(2M/4)條閘極線G(2M/4)開始，依據閘極線索引值遞減的順序輸出對應之第二閘極訊號，例如，閘極訊號SG(2M/4)~SG(M/4+1)，至閘極線G(2M/4)~G(M/4+1)，並依閘極線索引值遞減的順序控制第二閘極訊號之準位為致能準位，使得第二閘極線群組的閘極線G(M/4+1)~G(2M/4)可依據閘極線索引值遞減的順序自此群組的最後一條閘極線G(2M/4)開始依序響應於第二閘極訊號上的致能準位被致能，接著閘極驅動電路130自第(2M/4+1)條閘極線G(2M/4+1)開始，依據閘極線索引值遞增的順序輸出對應之第三閘極訊號，例如，閘極訊號SG(2M/4+1)~SG(3M/4)，至閘極線G(2M/4+1)~G(3M/4)，並依閘極線索引值遞增的順序控制第三閘極訊號之準位為致能準位，使得第三閘極線群組的閘極線G(2M/4+1)~G(3M/4)可依據閘極線索引值遞增的順序自此群組的第一條閘極線G(2M/4+1)開始依序響應於第三閘極訊號上的致能 準位被致能，並且接著閘極驅動電路130自第M條閘極線G(M)開始，依據閘極線索引值遞減的順序輸出對應之第四閘極訊號，例如，閘極訊號SG(M)~SG(3M/4+1)，至閘極線G(M)~G(3M/4+1)，並依閘極線索引值遞減的順序控制第四閘極訊號之準位為致能準位，使得第四閘極線群組的閘極線G(3M/4+1)~G(M)可依據閘極線索引值遞減的順序自此群組的最後一條閘極線G(M)開始依序響應於第四閘極訊號上的致能準位被致能。
由於相鄰的第一閘極線群組的最後一條閘極線G(M/4)與第二閘極線群組的第一條閘極線G(M/4+1)分別為該群組中最晚被致能的閘極線，在兩群組閘極線數量相等或近乎相等的配置下，相鄰的閘極線G(M/4)與G(M/4+1)具有相近的等待被致能的時間(即前述自從對應的共同電壓的電壓位準被切換後到閘極線被致能的時間的差異)，如此可有效改善第一閘極線群組與第二閘極線群組交界處的畫素亮度的亮度差值。同樣地，由於相鄰的第二閘極線群組的最後一條閘極線G(2M/4)與第三閘極線群組的第一條閘極線G(2M/4+1)分別為該群組中最早被致能的閘極線，在兩群組閘極線數量相等或近乎相等的配置下，相鄰的閘極線G(2M/4)與G(2M/4+1)具有相近的等待被致能的時間，如此可有效改善第二閘極線群組與第三閘極線群組交界處的畫素結構的亮度差值。同樣地，由於相鄰的第三閘極線群組的最後一條閘極線G(3M/4)與第四閘極線群組的第一條閘極線G(3M/4+1)分別為該群組中最晚被致能的閘極線，在兩群組閘極線數量相等或近乎相等的配置下，相鄰的閘極線G(3M/4)與G(3M/4+1)具有相近的等待被致能的時間，如此可有效改善第三閘極線群組與第四閘極線群組交界處的畫素結構的亮度差值。
需注意的是，於本發明之實施例中，閘極線總數M可以是2的整數倍、3的整數倍或者4的整數倍。然而，本發明亦不限於此。舉例而言，於本發明之一些實施例中，若前述之閘極線索引值M/2、M/3、M/4並非整數值時，則 可取最接近M/2、M/3、M/4之整數作為對應之閘極線索引值。
此外，需注意的是，於本發明之實施例中，雖可將畫素依共同電極/共同電壓的數量等分出複數畫素群組以配置複數共同電極的分布，但本發明並不限於此。於配置多個共同電極的分布時，每一畫素群組大小(畫素數量)亦可以不同。
此外，需注意的是，雖以上段落係以配置四個以下的共同電極與共同電壓作為實施例說明，但本發明並不限於此。孰悉此技藝者當可根據本說明書之揭露推導出配置四個以上的共同電極與共同電壓的驅動電路與驅動方法。 於本發明之實施例中，共同電極與共同電壓的數量可以是介於2~M之間的正整數。
第11圖係顯示根據本發明之一實施例所述之顯示面板之驅動方法的流程圖，包括以下步驟：
步驟S1102：由共同電壓產生電路提供複數共同電壓分別至顯示面板的複數共同電極。
步驟S1104：由共同電壓產生電路於一幀期間內的不同時間改變該等共同電壓的電壓位準。
步驟S1106：於改變共同電壓的電壓位準後，維持共同電壓的電壓位準於一預定期間。
其中步驟S1104與步驟S1106可於每一幀期間內反覆被執行，並且其中對於一些共同電壓，其電壓位準被維持的預定期間可跨越相鄰的兩幀。例如，可自一幀期間內的一既定時間點維持到次一幀期間內的另一既定時間點。
於本發明之實施例中，共同電壓之電壓位準的切換時間的控制方式可有多種不同的實施方式。例如，共同電壓產生電路110內包括一或多個暫存器，用以儲存控制參數，控制參數表示共同電壓產生電路110需分別於哪些時間 點切換各共同電壓的電壓位準，其中的時間點可計數時脈訊號的脈衝數量得知，共同電壓產生電路110根據暫存器所儲存的控制參數計數時脈訊號的脈衝數量，藉此於對應的時間點切換共同電壓的電壓位準，其中時脈訊號可由時序控制電路120提供，或者由共同電壓產生電路110自行產生，又或者可接收外部的時脈訊號。又例如，時序控制電路120可直接發出對應的控制信號，用以控制共同電壓產生電路110於不同的時間改變共同電壓的電壓位準。而本發明並不限於任一種實施方式。
綜上所述，本發明所提出之顯示模組及顯示面板之驅動電路與驅動方法藉由配置複數共同電極與複數共同電壓，並且於不同時間點改變共同電壓的電壓位準，可有效解決或可減緩先前技術中實施幀反轉的顯示面板所存在的畫面閃爍問題。此外，於本發明之一些實施例中，藉由控制閘極驅動電路依據不同的順序輸出閘極訊號至不同的閘極線群組，藉此進一步改善不同的閘極線群組交界處的畫素結構的亮度差值，使顯示面板的亮度分布可更加均勻。
以上所述僅為本發明之實施例，凡依本發明申請專利範圍所做之均等變化與修飾，皆應屬本發明之涵蓋範圍。
100:顯示模組
110:共同電壓產生電路
120:時序控制電路
130:閘極驅動電路
140:源極驅動電路
200:顯示面板
210:畫素結構
CLC:液晶電容
CST:儲存電容
G(1)~G(M):閘極線
S(1)~S(N):源極線
T:電晶體
VCOM:共同電極
V_VCOM1~V_VCOMk:共同電壓

Claims (20)

  1. 一種顯示面板之驅動電路，包括：一共同電壓產生電路，耦接一顯示面板的複數共同電極，提供複數共同電壓分別至該等共同電極；以及一閘極驅動電路，耦接該顯示面板的複數閘極線，並輸出複數閘極訊號，該等閘極訊號包括複數第一閘極訊號與複數第二閘極訊號；其中該等閘極線分群為複數閘極線群組，該等閘極線群組包括一第一閘極線群組與一第二閘極線群組，該閘極驅動電路依據一第一順序輸出該等第一閘極訊號至該第一閘極線群組的該等閘極線，以及依據一第二順序輸出該等第二閘極訊號至該第二閘極線群組的該等閘極線，該第一順序不同於該第二順序，並且其中，在一幀期間，該共同電壓產生電路分別於不同時間改變該等共同電壓的一電壓位準，並且於改變該等共同電壓的該電壓位準後，該共同電壓產生電路更維持該等共同電壓的該電壓位準於一預定期間，該預定期間的長度等於一個幀期間的長度。
  2. 如申請專利範圍第1項所述之顯示面板之驅動電路，更包括：一時序控制電路，耦接該共同電壓產生電路，並控制該共同電壓產生電路改變該等共同電壓的該電壓位準。
  3. 如申請專利範圍第1項所述之顯示面板之驅動電路，其中該顯示面板具有複數畫素結構，該等畫素結構分群為複數畫素群組，該等畫素群組分別耦接該等共同電極。
  4. 如申請專利範圍第1項所述之顯示面板之驅動電路，其中該等共同電壓包括一第一共同電壓與一第二共同電壓，該等共同電極包括一第一共同電極與一第二共同電極，該第一共同電壓被提供至該第一共同電極，該第二共同電壓被提供至該第二共同電極，該共同電壓產生電路於該幀期間內的一第一時間改變該第一共同電壓的該電壓位準，並於該幀期間內的一第二時間改變該第二共同電壓的該電壓位準，該第一時間不同於該第二時間。
  5. 如申請專利範圍第4項所述之顯示面板之驅動電路，其中該第一時間與該第二時間之間的差異相關於該等共同電壓的數量。
  6. 如申請專利範圍第4項所述之顯示面板之驅動電路，其中於改變該第一共同電壓的該電壓位準與該第二共同電壓的該電壓位準後，該共同電壓產生電路更維持該第一共同電壓的該電壓位準於一第一預定期間以及維持該第二共同電壓的該電壓位準於一第二預定期間，該第一預定期間的長度與該第二預定期間的長度等於一個幀期間的長度。
  7. 如申請專利範圍第4項所述之顯示面板之驅動電路，其中該顯示面板具有複數畫素結構，該等畫素結構分群為複數畫素群組，該等畫素群組包括一第一畫素群組與一第二畫素群組，該第一畫素群組之該等畫素結構耦接該第一共同電極，該第二畫素群組之該等畫素結構耦接該第二共同電極。
  8. 如申請專利範圍第1項所述之顯示面板之驅動電路，更包括：一源極驅動電路，耦接該顯示面板的複數源極線，並輸出複數源極訊號。
  9. 一種顯示面板之驅動方法，包括：提供複數共同電壓分別至一顯示面板的複數共同電極；於一幀期間內的不同時間改變該等共同電壓的一電壓位準；以及於改變該等共同電壓的該電壓位準後，維持該等共同電壓的該電壓位準於一預定期間，其中該預定期間的長度等於一個幀期間的長度，並且其中該顯示面板具有複數閘極線，該等閘極線分群為複數閘極線群組，該等閘極線群組包括一第一閘極線群組與一第二閘極線群組，該顯示面板之驅動方法更包括：依據一第一順序輸出複數第一閘極訊號至該第一閘極線群組的該等閘極線；以及依據一第二順序輸出複數第二閘極訊號至該第二閘極線群組的該等閘極線，該第一順序不同於該第二順序。
  10. 如申請專利範圍第9項所述之顯示面板之驅動方法，其中該顯示面板具有複數畫素結構，該等畫素結構分群為複數畫素群組，該等畫素群組分別耦接該等共同電極。
  11. 如申請專利範圍第9項所述之顯示面板之驅動方法，其中該等共同電壓包括一第一共同電壓與一第二共同電壓，該等共同電極包括一第一共同電極與一第二共同電極，該第一共同電壓被提供至該第一共同電極，該第二共同電壓被提供至該第二共同電極，並且於一幀期間內的不同時間改變該等共同電壓的該電壓位準的步驟更包括：於該幀期間內的一第一時間改變該第一共同電壓的該電壓位準；以及於該幀期間內的一第二時間改變該第二共同電壓的該電壓位準，該第二時 間不同於該第一時間。
  12. 如申請專利範圍第11項所述之顯示面板之驅動方法，其中該第一時間與該第二時間之間的差異相關於該等共同電壓的數量。
  13. 如申請專利範圍第11項所述之顯示面板之驅動方法，更包括：於改變該第一共同電壓的該電壓位準後，維持該第一共同電壓的該電壓位準於一第一預定期間；以及於改變該第二共同電壓的該電壓位準後，維持該第二共同電壓的該電壓位準於一第二預定期間，其中該第一預定期間的長度與該第二預定期間的長度等於一個幀期間的長度。
  14. 如申請專利範圍第11項所述之顯示面板之驅動方法，其中該顯示面板具有複數畫素結構，該等畫素結構分群為複數畫素群組，該等畫素群組包括一第一畫素群組與一第二畫素群組，該第一畫素群組之該等畫素結構耦接該第一共同電極，該第二畫素群組之該等畫素結構耦接該第二共同電極。
  15. 如申請專利範圍第9項所述之顯示面板之驅動方法，更包括：輸出複數源極訊號至該顯示面板的複數源極線。
  16. 一種顯示模組，包括：一顯示面板，具有複數共同電極；一共同電壓產生電路，耦接該等共同電極，提供複數共同電壓分別至該等共同電極； 一閘極驅動電路，耦接該顯示面板的複數閘極線，並輸出複數閘極訊號，該等閘極訊號包括複數第一閘極訊號與複數第二閘極訊號；以及一源極驅動電路，耦接該顯示面板的複數源極線，並輸出複數源極訊號；其中該等閘極線分群為複數閘極線群組，該等閘極線群組包括一第一閘極線群組與一第二閘極線群組，該閘極驅動電路依據一第一順序輸出該等第一閘極訊號至該第一閘極線群組的該等閘極線，以及依據一第二順序輸出該等第二閘極訊號至該第二閘極線群組的該等閘極線，該第一順序不同於該第二順序，並且其中，在一幀期間，該共同電壓產生電路分別於不同時間改變該等共同電壓的一電壓位準，並且於改變該等共同電壓的該電壓位準後，該共同電壓產生電路更維持該等共同電壓的該電壓位準於一預定期間，該預定期間的長度等於一個幀期間的長度。
  17. 如申請專利範圍第16項所述之顯示模組，更包括：一時序控制電路，耦接該共同電壓產生電路，控制該共同電壓產生電路改變該等共同電壓的該電壓位準。
  18. 如申請專利範圍第16項所述之顯示模組，其中該顯示面板具有複數畫素結構，該等畫素結構分群為複數畫素群組，該等畫素群組分別耦接該等共同電極。
  19. 如申請專利範圍第16項所述之顯示模組，其中該等共同電壓包括一第一共同電壓與一第二共同電壓，該等共同電極包括一第一共同電極與一第二共同電極，該第一共同電壓被提供至該第一共同電極，該第二共同電壓被提 供至該第二共同電極，該共同電壓產生電路於該幀期間內的一第一時間改變該第一共同電壓的該電壓位準，並於該幀期間內的一第二時間改變該第二共同電壓的該電壓位準，該第一時間不同於該第二時間。
  20. 如申請專利範圍第19項所述之顯示模組，其中於改變該第一共同電壓的該電壓位準與該第二共同電壓的該電壓位準後，該共同電壓產生電路更維持該第一共同電壓的該電壓位準於一第一預定期間以及維持該第二共同電壓的該電壓位準於一第二預定期間，其中該第一預定期間的長度與該第二預定期間的長度等於一個幀期間的長度。
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