TWI666496B - 顯示面板的製造方法 - Google Patents

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Abstract

一種顯示面板的製造方法，包括下列步驟。於第一基板上形成多條資料線、多條掃描線、多個畫素結構及第一電極。每一畫素結構包括主動元件以及與主動元件電性連接的畫素電極。第一電極與相鄰之兩畫素結構的兩畫素電極的相對兩邊緣及相鄰之兩畫素電極之間的間隙重疊。於第二基板上形成第二電極。製備顯示介質組成物，其包括多個液晶分子及多個可聚合單體。設置顯示介質組成物於第一基板與第二基板之間。進行第一次熟化程序，第一次熟化程序包括同時進行第一照光步驟、令資料線具有第一電位V1、令第二電極具有第二電位V2及令第一電極具有第三電位V3，其中V1＜V2＜V3。

Description

顯示面板的製造方法
本發明是有關於一種電子裝置的製造方法，且特別是有關於一種顯示面板的製造方法。
習知的多域垂直配向式（multi-domain vertically alignment；MVA）液晶顯示面板是利用配向結構（alignment structure）的配置使不同區域內的液晶分子以不同方位角傾倒，進而達到廣視角的功效。配向結構包括配向凸塊（alignment protrusion）以及設置於畫素電極之多個分支部所定義上的配向狹縫（alignment slit）。然而，位於配向凸塊與配向狹縫周邊的液晶分子的傾倒方向往往不連續，而造成漏光的情形，使得液晶顯示面板的對比度降低。若為了降低漏光程度，在對應於配向凸塊或配向狹縫處配置遮光層，又會使得液晶顯示面板的開口率下降。因此，一種聚合物穩定配向製程被提出，以改善多域垂直配向式液晶顯示面板之對比度不佳的問題。
在習知的聚合物穩定配向製程中，會施加電壓於液晶顯示面板，亦即，令資料線、畫素陣列的共用電極以及彩色濾光基板的共用電極具有低電位或高電位兩種電位。然而，為提升液晶顯示面板的開口率而使相鄰的兩個畫素電極靠近時，卻會使得液晶顯示面板於施加電壓後產生不規則的暗線（disclination line），即黑霧（sandy black fog）現象，而嚴重地影響顯示品質。
本發明提供一種顯示面板的製造方法，其所製造出的顯示面板具有良好的顯示品質。
本發明的顯示面板的製造方法，包括下列步驟：於第一基板上形成多條資料線、與資料線交錯的多條掃描線、與資料線及掃描線電性連接的多個畫素結構以及第一電極，其中每一畫素結構包括主動元件以及與主動元件電性連接的畫素電極，第一電極與相鄰之兩畫素電極的相對兩邊緣以及相鄰之兩畫素結構的兩畫素電極之間的間隙重疊；於第二基板上形成第二電極；製備顯示介質組成物，其包括多個液晶分子及多個可聚合單體，可聚合單體能夠在光照射下發生聚合反應；設置顯示介質組成物於第一基板與第二基板之間；以及進行第一次熟化程序，第一次熟化程序包括同時進行第一照光步驟、令資料線具有第一電位V1、令第二電極具有第二電位V2以及令第一電極具有第三電位V3，其中V1＜V2＜V3。
基於上述，本發明一實施例之顯示面板的製造方法藉由在第一次熟化程序包括同時進行第一照光步驟、令資料線具有第一電位V1、令第二電極具有第二電位V2以及令第一電極具有第三電位V3，其中V1＜V2＜V3，能改善顯示面板的黑霧（sandy black fog）現象，進而提升顯示面板品質。
為讓本發明的上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
圖1A～圖1D為本發明一實施例之顯示面板製造方法的剖面示意圖。圖2為圖1A～圖1D的顯示面板之畫素陣列的上視示意圖。
請參照圖1A，首先，提供第一基板110。舉例而言，在本實施例中，第一基板110的材質可為玻璃、石英、有機聚合物或其它適當材料，但本發明不以此為限。
請參照圖1A及圖2，接著，於第一基板110上形成畫素陣列A。畫素陣列A包括多條資料線DL、與多條資料線DL交錯的多條掃描線SL、與多條資料線DL及多條掃描線SL電性連接的多個主動元件T、與多個主動元件T電性連接的多個畫素電極170-1、170-2以及第一電極120。
畫素結構U1（或畫素結構U2）包括主動元件T以及與主動元件T電性連接的畫素電極170-1（或畫素電極170-2）。圖2繪示出相鄰兩個畫素結構U為示例。本發明所屬領域中具有通常知識者應理解，畫素陣列A實際上包括陣列排列的多個畫素結構U。然而，本發明並不限於此，在其他實施例中，畫素陣列A也可包括畫素結構U以及不同於畫素結構U的多個其他的畫素結構。此外，圖2繪示之相鄰兩個畫素結構U1、U2的結構相同。然而，本發明不限於此，在其它實施例中，相鄰兩個畫素結構U1、U2的結構也可相異。
掃描線SL大致上在第二方向x上延伸。多條掃描線SL在第一方向y上排列。資料線DL大致上在第一方向y上延伸。多條資料線DL在第二方向x上排列。第一方向x與第二方向y交錯。舉例而言，在本實施例中，第一方向x與第二方向y可垂直，但本發明不以此為限。
舉例而言，在本實施例中，主動元件T可選擇性地包括第一薄膜電晶體T1及第二薄膜電晶體T2，而畫素電極170-1、170-2可選擇性地包括分別位於掃描線SL之相對兩側的第一子畫素電極171及第二子畫素電極172。第一薄膜電晶體T1具有源極S1、閘極G1、汲極D1與通道C1。第一薄膜電晶體T1的源極S1與資料線DL電性連接。第一薄膜電晶體T1的閘極G1與掃描線SL電性連接。第一薄膜電晶體T1的汲極D1與第一子畫素電極171電性連接。第二薄膜電晶體T2具有源極S2、閘極G2、汲極D2與通道C2。第二薄膜電晶體T2的源極S2與資料線DL電性連接。第二薄膜電晶體T2的閘極G2與掃描線SL電性連接。第二薄膜電晶體T2的汲極D2與第二子畫素電極172電性連接。
在本實施例中，主動元件T可選擇性地包括第三薄膜電晶體T3。畫素陣列A可選擇性包括多條第二共用線160。多條第二共用線160在第二方向x上排列。第二共用線160與同一畫素結構U的第一子畫素電極171及第二子畫素電極172重疊。第三薄膜電晶體T3具有源極S3、閘極G3、汲極D3與通道C3。在本實施例中，第三薄膜電晶體T3的閘極G3與掃描線SL電性連接。第三薄膜電晶體T3的源極S3與第二薄膜電晶體T2的汲極D2電性連接。第三薄膜電晶體T3的汲極D3與第二共用線160電性連接。第二共用線160與第一子畫素電極171部分重疊，以形成第一耦合電容Cx1；第二共用線160與第二子畫素電極172部分重疊，以形成第二耦合電容Cx2。第一子畫素電極171與第二電極130（繪示於圖1A）重疊，以形成第一液晶電容（未繪示）；第二子畫素電極172與第二電極130重疊，以形成第二液晶電容（未繪示）。驅動已完成之顯示面板100（標示於圖1D）時，藉由控制第二共用線160上的電壓，能調整儲存於第一液晶電容之電荷量與儲存於第一耦合電容Cx1之電荷量的比例以及儲存於第二液晶電容之電荷量與儲存於第二耦合電容Cx2之電荷量的比例，進而改善色偏（color washout）問題。然而，本發明不限於此，根據其它實施例，畫素陣列A也可不包括第二共用線160；此外，主動元件T所包括的薄膜電晶體數量也不限於3個，畫素電極170-1或170-2也不一定要分為第一子畫素電極171與第二子畫素電極172。
在本實施例中，第一子畫素電極171包括兩主幹部171a、多個分支部171b及周圍部171c。兩主幹部171a相交錯，以定義出配向方向d1、d2、d3、d4相異的多個配向區（例如：四個配向區）。多個分支部171b包括多組分支部171b，多組分支部171b分別設置於所述多個配向區。位於不同配向區之多組分支部171b分別朝不同的配向方向d1、d2、d3、d4延伸。分支部171b之靠近第一子畫素電極171內部的一端連接至主幹部171a，分支部171b之遠離第一子畫素電極171內部的一端連接至周圍部171c。藉由所述多個配向區的互相搭配，能達成廣視角。
此外，在本實施例中，第一子畫素電極171的所述多個配向區可以選擇性地具有相同的面積，以提供在各視角提供大致相似或相同的顯示亮度。但本發明不以此為限，第一子畫素電極171的所述多個配向區的面積大小可以視產品需要而調整之，第一子畫素電極171的所述多個配向區的面積不限定為彼此相同。
類似地，第二子畫素電極172包括兩主幹部172a、多個分支部172b及周圍部172c。兩主幹部172a相交錯，以定義出配向方向d1、d2、d3、d4相異的多個配向區（例如：四個配向區）。多個分支部172b包括多組分支部172b，多組分支部172b分別設置於所述多個配向區。位於不同配向區之多組分支部172b朝不同的配向方向d1、d2、d3、d4延伸。分支部172b之靠近第二子畫素電極172內部的一端連接至主幹部172a，分支部172b之遠離第二子畫素電極172內部的一端連接至周圍部172c。
此外，在本實施例中，第二子畫素電極172的所述多個配向區可以選擇性地具有相同的面積，以提供在各視角提供大致相似或相同的顯示亮度。但本發明不以此為限，第二子畫素電極172的所述多個配向區的面積大小可以視產品需要而調整之，第二子畫素電極172的所述多個配向區的面積不限定為彼此相同。
第一電極120與相鄰之兩畫素電極170-1、170-2的相對兩邊緣170a、170b以及相鄰之兩畫素電極170-1、170-2之間的間隙g1、g2重疊。舉例而言，在本實施例中，畫素電極170-1之第一子畫素電極171的周圍部171c具有邊緣170a-1，畫素電極170-2之第一子畫素電極171的周圍部171c具有邊緣170b-1，邊緣170a-1與邊緣170b-1相鄰且具有間隙g1；畫素電極170-1之第二子畫素電極172的周圍部172c具有邊緣170a-2，畫素電極170-2之第二子畫素電極172的周圍部172c具有邊緣170b-2，邊緣170a-2與邊緣170b-2相鄰且具有間隙g2。第一電極120包括彼此分離的第一子電極120a與第二子電極120b，其中第一子電極120a與邊緣170a-1、邊緣170b-1及間隙g1重疊，而第二子電極120b與邊緣170a-2、邊緣170b-2及間隙g2重疊。
畫素陣列A還包括多條第一共用線150，其中至少一條第一共用線150與第一電極120電性連接。第一共用線150大致上在第二方向x上延伸。多條第一共用線150在第一方向y上排列。在本實施例中，第一共用線150包括分別與第一子電極120a及第二子電極120b電性連接的第一子共用線150a及第二子共用線150b。第一子共用線150a及第二子共用線150b可選擇性地分別與第一子畫素電極171及第二子畫素電極172部分重疊。舉例而言，第一子共用線150a可選擇性地與畫素電極170-1之第一子畫素電極171的周邊部171c及畫素電極170-2之第一子畫素電極171的周邊部171c部分重疊，第二子共用線150b可選擇性地與畫素電極170-1之第二子畫素電極172的周邊部172c及畫素電極170-2之第二子畫素電極172的周邊部172c部分重疊。
請參照圖1A，接著，在畫素陣列A上形成第一配向層PI1。舉例而言，在本實施例中，可利用滾筒（roller）印刷的方式將配向液轉印至畫素陣列A上，進而形成第一配向層PI1。然而，本發明不限於此，在其它實施例中，也可採用旋轉塗佈法（spinning coating）、噴墨法（PI inkjet）或其他適當方法形成之。在本實施例中，第一配向層PI1的材質例如為具有醯胺鍵及/或醯亞胺鍵的聚合物或其他適當材料，但本發明不以此為限。
接著，可選擇性地在第二基板140上形成第二電極130。然後，形成第二配向層PI2，以覆蓋第二電極130。第二基板140的材質、形成第二配向層PI2的方法以及第二配向層PI2的材質分別與第一基板110的材質、形成第一配向層PI1的方法以及第一配向層PI1的材質類似，於此便不再重述。
接著，製備顯示介質組成物MX。顯示介質組成物MX包括多個液晶分子LC以及多個可聚合單體（reactive monomer）RM。多個可聚合單體RM能夠在光照射下發生聚合反應，進而在第一基板110的內表面及/或第二基板140的內表面上形成多個配向聚合體（即多個第一配向顆粒p1及多個第二配向顆粒p2，請參見圖1C）。在本實施例中，顯示介質組成物MX更可進一步包括穩定劑（inhibitor）IHB，穩定劑IHB能夠避免可聚合單體RM在進行第一次熟化程序（curing）前即先行聚合，故能提升顯示介質組成物MX的穩定性。
接著，設置顯示介質組成物MX於第一基板110與第二基板140之間。舉例而言，在本實施例中，可先在第一基板110的第一配向層PI1上、或先在第二基板140的第二配向層PI2上塗佈框膠（sealant）。然後，將顯示介質組成物MX滴入框膠（未繪示）與第一配向層PI1圍出的空間中，或滴入框膠與第二配向層PI2圍出的空間中。之後，再於接近真空的環境下，令第一基板110與第二基板140透過框膠相連接，以將顯示介質組成物MX封在第一基板110與第二基板140之間。簡言之，在本實施例中，可採用液晶滴入法（one drop fill；ODF）填入顯示介質組成物MX。然而，本發明不限於此，在其他實施例中，亦可採用液晶注入法（LC injection）或其他適當方法填入顯示介質組成物MX。
請參照圖1B及圖1C，接著，進行第一次熟化程序（curing），第一次熟化程序包括同時進行第一照光步驟以及施加電壓於畫素陣列A及第二電極130。如圖1B所示，在本實施例中，可將畫素陣列A及第二電極130電性連接至訊號產生器（Function Generator）V，以使畫素陣列A及第二電極130具有指定的電位。詳言之，在本實施例中，可令掃描線SL具有足以使主動元件T開啟的第四電位V4，令資料線DL具有第一電位V1（即，令與資料線DL電性連接的畫素電極170-1、170-2實質上具有第一電位V1），令第二電極130具有第二電位V2以及令第一電極120具有第三電位V3，其中V1＜V2＜V3。舉例而言，在本實施例中，第三電位V3與第二電位V2的差值可大於或等於5伏特。在本實施例中，掃描線SL所具有之第四電位V4可等於第一電位V1、第二電位V2或第三電位V3。然而，本發明不限於此，在其它實施例中，掃描線SL也可具有足以使主動元件T開啟的其它適當電位。此外，在本實施例中，於施加上述電壓至掃描線SL、資料線DL、第二電極130及第一電極120時，還可令第二共用線160具有第一電位V1；亦即，可令第二共用線160具有與資料線DL相同的電位，但本發明不以此為限。
值得注意的是，在V1＜V2＜V3的條件下，位於顯示面板100各配向區的液晶分子LC能具有指定的方位角（azimuthal angle）及傾斜角（tile angle）。
如圖1C所示，接著，在維持V1＜V2＜V3的條件以使液晶分子LC具有指定的方位角及傾斜角下，進行第一照光步驟。在本實施例中，進行第一照光步驟時，可聚合單體RM會沿著液晶分子LC 之指定的方位角及傾斜角逐步聚合且相分離，而於第一配向層PI1及第二配向層PI2上形成多個第一配向顆粒p1及多個第二配向顆粒p2。透過第一配向顆粒p1及個第二配向顆粒p2的作用，在驅動後續完成之顯示面板100時，液晶分子LC會傾向於順著高分子聚合物的排列方向排列，而產生所欲的方位角及傾斜角，進而提供良好的顯示品質。
在本實施例中，第一照光步驟所使用的光束L1的波長可介於200奈米（nm）～450奈米。舉例而言，光束L1的主要波長可為313奈米，光束L1的照射時間可介於0分鐘至10分鐘，例如：200秒。光束L1的照光能量可介於為0（W/cm 2）～0.15（mW/cm 2），例如：0.07（W/cm 2）。然而，本發明不限於此，光束L1的波長、照射時間及照光能量均可視實際需求而做其它適當的設定。
請參照圖1D，接著，進行第二次熟化程序（curing）。第二次熟化程序包括在不施加電壓於畫素陣列A及第二電極130下進行第二照光步驟。第二次熟化程序能促使更多殘留在液晶分子LC中間的可聚合單體RM完全反應，以避免顯示面板100出現殘影（image sticking）問題或改善殘影程度。圖1D所示之顯示介質MX’為前述顯示介質組成物MX經過第一次熟化程序及第二次熟化程序後所存留的液體，顯示介質MX’至少包括液晶分子LC。
在本實施例中，第二照光步驟所使用之光束L2的功率及照光時間大於第一照光步驟所使用之光束L1的功率及照光時間。舉例而言，第二照光步驟所使用之光束L2的波長可介於200奈米至450奈米，光束L2的主要波長可為313奈米，光束L2的照光時間可介於0分鐘至180分鐘，例如：120分鐘，光束L2的照光能量可介於0W/cm 2至0.5W/cm 2，例如：0.3（W/cm 2）。然而，本發明不限於此，光束L2的波長、照射時間及照光能量均可視實際需求而做其它適當的設定。
值得一提的，透過V1＜V2＜V3的設定，於進行上述之第一次熟化程序時，不易出現先前技術所述之黑霧（sandy black fog）現象，進而能提升顯示面板100的顯示品質，例如：亮度、反應時間等。以下配合圖2及圖3說明之。
圖3示出第一比較例之顯示面板於具有不同的相鄰畫素電極170-1、170-2間之間隙d下所產生的等電位線、第二比較例之顯示面板於具有不同的相鄰畫素電極170-1、170-2間之間隙d所產生的等電位線以及本發明一實施例之顯示面板100於具有不同的相鄰畫素電極170-1、170-2間之間隙d（繪於圖2）所產生的等電位線。
第一比較例之顯示面板的結構、第二比較例之顯示面板的結構及本發明一實施例之顯示面板100的結構實質上相同，惟於進行上述之第一次熟化程序時各顯示面板之第一電極120、相鄰畫素電極170-1、170-2及第二電極130所具有的電位不盡相同。此外，圖3所示之各顯示面板之第一電極120、相鄰畫素電極170-1、170-2及第二電極130是對應圖2的剖線I-I’。
表一示出第一比較例之顯示面板、第二比較例之顯示面板及本實施例之顯示面板100的第一電極120、相鄰畫素電極170-1、170-2及第二電極130於進行第一熟化程序時所具有的電位。
畫素電極170-1、170-2 第一電極120 第二電極130
第一比較例 V1 V1 V2
第二比較例 V1 V2 V2
實施例 V1 V3 V2
[表一]
請參照上表一，第一比較例之顯示面板進行上述之第一次熟化程序時，令畫素電極170-1、170-2具有第一電位V1、令第一電極120具有第一電位V1及令第二電極130具有第二電位V2，其中V1＜V2。第二比較例之顯示面板進行上述之第一次熟化程序時，令畫素電極170-1、170-2具有第一電位V1、令第一電極120及第二電極130具有第二電位V2，其中V1＜V2。本實施例之顯示面板100進行上述之第一次熟化程序時，令畫素電極170-1、170-2具有第一電位V1、令第一電極120具有第三電位V3及令第二電極130具有第二電位V2，其中V1＜V2＜V3。
如圖3所示，施加電壓於各顯示面板之第一電極120、畫素電極170-1、畫素電極170-2及第二電極130時會產生等電位線。等電位線會決定顯示介質MX中的液晶分子LC的傾倒方向。舉例而言，在本實施中，液晶分子LC為負型液晶分子；當電場足夠大時，負型液晶分子的長軸大致上會與等電位線垂直。
請參照圖2及圖3，令第一比較例之顯示面板的畫素電極170-1、170-2具有電位V1、第一電極120具有第一電位V1以及第二電極130具有第二電位V2且相鄰兩畫素電極170-1與170-2間之間隙為8μm、6μm 或4μm時，分佈於相鄰兩畫素電極170-1、170-2之間的等電位線大致上呈下凹曲線。此時，位於相鄰兩畫素電極170-1、170-2之間的間隙g2的液晶分子LC的長軸大致上垂直於第一基板110（標示於圖1C），而位於畫素電極170-1邊緣170a-2及畫素電極170-2邊緣170b-2上之液晶分子LC的長軸大致上朝間隙g2的中央傾倒。換言之，分別位於畫素電極170-1邊緣170a-2及畫素電極170-2邊緣170b-2上之液晶分子LC的長軸不會分別順著畫素電極170-1之分支部172b所定義的配向方向d1及畫素電極170-2之分支部172b所定義的配向方向d2傾倒，以致於畫素電極170-1、170-2之分支部172b所在之配向區上的液晶分子傾倒方向與畫素電極170-1、170-2之邊緣170a-2、170b-2上之液晶分子傾倒方向不一致，進而造成不規則分佈的暗線（disclination line），即黑霧（sandy black fog）現象。
請參照圖2及圖3，令第二比較例之顯示面板的畫素電極170-1、170-2具有第一電位V1、第一電極120具有第二電位V2、第二電極130具有第二電位V2且相鄰兩畫素電極170-1與170-2間之間隙為8μm、6μm 或4μm時，分佈於相鄰兩畫素電極170-1、170-2之間隙之上半部的等電位線大致上呈略微下凹的曲線。此時，位於畫素電極170-1邊緣170a-2及畫素電極170-2邊緣170b-2上方的液晶分子LC的長軸大致上朝間隙g2的中央傾倒。換言之，分別位於畫素電極170-1邊緣170a-2及畫素電極170-2邊緣170b-2上方之液晶分子LC的長軸不會分別順著畫素電極170-1之分支部172b所定義的配向方向d1及畫素電極170-2之分支部172b所定義的配向方向d2傾倒，以致於畫素電極170-1、170-2之分支部172b所在的配向區上的液晶分子傾倒方向與畫素電極170-1、170-2之邊緣170a-2、170b-2上方之液晶分子傾倒方向不一致，而仍易產生黑霧現象。
請參照圖2及圖3，令本實施例之顯示面板100的畫素電極170-1、170-2具有第一電位V1、第一電極120具有第二電位V2、第二電極130具有第三電位V3且相鄰兩畫素電極170-1與170-2間之間隙為8μm、6μm 或4μm時，分佈於相鄰兩畫素電極170-1、170-2之間隙上的等電位線大致上呈明顯上凸的曲線。此時，位於畫素電極170-1邊緣170a-2及畫素電極170-2邊緣170b-2上方的液晶分子LC的長軸大致上會分別朝畫素電極170-1、170-2內部傾倒。換言之，分別位於畫素電極170-1邊緣170a-2及畫素電極170-2邊緣170b-2上之液晶分子LC的長軸易分別順著畫素電極170-1之分支部172b所定義的配向方向d1及畫素電極170-2之分支部172b所定義的配向方向d2傾倒，以致於畫素電極170-1、170-2之分支部172b所在的配向區上的液晶分子傾倒方向與畫素電極170-1、170-2之邊緣170a-2、170b-2上之液晶分子傾倒方向一致，而改善黑霧現象。
綜上所述，本發明一實施例之顯示面板的製造方法包括第一次熟化程序。第一次熟化程序包括同時進行第一照光步驟、令資料線具有第一電位V1、令第二電極具有第二電位V2以及令第一電極具有第三電位V3。特別是，V1＜V2＜V3。藉此，能改善黑霧現象，進而提升顯示面板品質。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明的精神和範圍內，當可作些許的更動與潤飾，故本發明的保護範圍當視後附的申請專利範圍所界定者為準。
100‧‧‧顯示面板
110‧‧‧第一基板
120‧‧‧第一電極
120a‧‧‧第一子電極
120b‧‧‧第二子電極
130‧‧‧第二電極
140‧‧‧第二基板
150‧‧‧第一共用線
150a‧‧‧第一子共用線
150b‧‧‧第二子共用線
160‧‧‧第二共用線
170a、170a-1、170a-2、170b、170b-1、170b-2‧‧‧邊緣
170-1、170-2‧‧‧畫素電極
171‧‧‧第一子畫素電極
171a、172a‧‧‧主幹部
171b、172b‧‧‧分支部
171c、172c‧‧‧周圍部
172‧‧‧第二子畫素電極
A‧‧‧畫素陣列
Cx1‧‧‧第一耦合電容
Cx2‧‧‧第二耦合電容
C1、C2、C3‧‧‧通道
DL‧‧‧資料線
D1、D2、D3‧‧‧汲極
d1‧‧‧第一配向方向
d2‧‧‧第二配向方向
d3‧‧‧第三配向方向
d4‧‧‧第四配向方向
G1、G2、G3‧‧‧閘極
g1、g2、d‧‧‧間隙
IHB‧‧‧穩定劑
LC‧‧‧液晶分子
L1、L2‧‧‧光束
MX‧‧‧顯示介質組成物
MX’‧‧‧顯示介質
PI1‧‧‧第一配向層
PI2‧‧‧第二配向層
p1‧‧‧第一配向顆粒
p2‧‧‧第二配向顆粒
RM‧‧‧可聚合單體
SL‧‧‧掃描線
S1、S2、S3‧‧‧源極
T‧‧‧主動元件
T1‧‧‧第一薄膜電晶體
T2‧‧‧第二薄膜電晶體
T3‧‧‧第三薄膜電晶體
U、U1、U2‧‧‧畫素結構
V‧‧‧訊號產生器
V1～V3‧‧‧電位
x‧‧‧第二方向
y‧‧‧第一方向
I-I’‧‧‧剖線
圖1A～圖1D為本發明一實施例之顯示面板製造方法的剖面示意圖。 圖2為圖1的顯示面板上形成的畫素陣列的上視示意圖。 圖3示出第一比較例之顯示面板於具有不同的相鄰畫素電極間之間隙下所產生的等電位線、第二比較例之顯示面板於具有不同的相鄰畫素電極間之間隙所產生的等電位線以及本發明一實施例之顯示面板於具有不同的相鄰畫素電極間之間隙所產生的等電位線。

Claims (9)

  1. 一種顯示面板的製造方法，包括：於一第一基板上形成多條資料線、與該些資料線交錯的多條掃描線、與該些資料線及該些掃描線電性連接的多個畫素結構以及一第一電極，其中每一畫素結構包括一主動元件以及與該主動元件電性連接的一畫素電極，該第一電極與相鄰之該兩畫素結構的兩畫素電極的相對兩邊緣以及相鄰之該兩畫素電極之間的一間隙重疊；於一第二基板上形成一第二電極；製備一顯示介質組成物，其包括多個液晶分子以及多個可聚合單體，該些可聚合單體能夠在光照射下發生聚合反應；設置該顯示介質組成物於該第一基板與該第二基板之間；以及進行一第一次熟化程序，該第一次熟化程序包括同時進行一第一照光步驟、令該些資料線具有一第一電位V1、令該第二電極具有一第二電位V2以及令該第一電極具有一第三電位V3，其中V1<V2<V3，其中該第三電位與該第二電位的差值大於或等於5伏特。
  2. 如申請專利範圍第1項所述的顯示面板的製造方法，其中進行該第一照光步驟時，相鄰之該兩畫素電極具有一接地電位。
  3. 如申請專利範圍第1項所述的顯示面板的製造方法，其中該第一次熟化程序更包括：同時進行該第一照光步驟以及令該些掃描線具有一第四電位，而該第四電位等於該第一電位、該第二電位或該第三電位。
  4. 如申請專利範圍第1項所述的顯示面板的製造方法，更包括：進行一第二次熟化程序，該第二次熟化程序包括進行一第二照光步驟。
  5. 如申請專利範圍第1項所述的顯示面板的製造方法，其中相鄰之該兩畫素電極的至少一畫素電極包括：多個分支部；以及一周圍部，其中該些分支部朝不同方向延伸以形成多個配向區，該些分支部之遠離該畫素電極內部的多端連接至該周圍部，而該第一電極與該周圍部至少部分重疊。
  6. 如申請專利範圍第1項所述的顯示面板的製造方法，更包括：於該第一基板上形成一第一共用線，其中該第一共用線與該第一電極電性連接。
  7. 如申請專利範圍第1項所述的顯示面板的製造方法，其中：每一畫素結構的該主動元件包括一第一薄膜電晶體及一第二薄膜電晶體，該第一薄膜電晶體及該第二薄膜電晶體與該些資料線的其中一條及該些掃描線的其中一條電性連接；每一畫素結構的該畫素電極包括一第一子畫素電極及一第二子畫素電極，分別與該第一薄膜電晶體及該第二薄膜電晶體電性連接；以及該第一電極包括一第一子電極及一第二子電極，該第一子電極與相鄰之該兩畫素結構的兩第一子畫素電極的相對兩邊緣以及相鄰之該兩第一子畫素電極之間的一間隙重疊，而該第二子電極與相鄰之該兩畫素結構的兩第二子畫素電極的相對兩邊緣以及相鄰之該兩第二子畫素電極之間的一間隙重疊。
  8. 如申請專利範圍第7項所述的顯示面板的製造方法，其中至少一畫素結構的該主動元件更包括一第三薄膜電晶體，該第三薄膜電晶體的一源極與該第二薄膜電晶體的一汲極電性連接，而該顯示面板的製造方法更包括：於該第一基板上形成至少一第二共用線，該至少一第二共用線與該至少一畫素結構的該第三薄膜電晶體的一汲極電性連接，該至少一第二共用線與該至少一畫素結構的該第一子畫素電極及該第二子畫素電極重疊設置，而該第一次熟化程序更包括令該至少一第二共用線具有該第一電位。
  9. 如申請專利範圍第8項所述的顯示面板的製造方法，更包括：形成一第一子共用線及一第二子共用線，其中該第一子共用線及該第二子共用線分別與該第一子電極及該第二子電極電性連接，該些掃描線、該第一子共用線及該第二子共用線在一第一方向上排列，而該些資料線與該至少一第二共用線在一第二方向上排列。
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