TWI463501B

TWI463501B - 快閃記憶體發展系統

Info

Publication number: TWI463501B
Application number: TW099144318A
Authority: TW
Inventors: Yi Chun Liu
Original assignee: Asolid Technology Co Ltd
Priority date: 2010-12-16
Filing date: 2010-12-16
Publication date: 2014-12-01
Also published as: CN102568602B; TW201227745A; CN102568602A

Description

快閃記憶體發展系統

本發明是有關於一種快閃記憶體發展系統。

快閃記憶體(flash memory)是一種可程式(programmable)的唯讀記憶體(read only memory,ROM)，其允許被多次的抹除並更新所儲存的資料。

在針對快閃記憶體以及其記憶體控制器進行偵錯時，常利用所謂的發展系統(development system)來完成。在習知的技術領域中，這種有關於快閃記憶體模組的發展系統可以以用邏輯分析儀(Logical Analyzer,LA)或通用異步收發傳輸器(Universal Asynchronous Receiver/Transmitter,UART)來建構。上述利用邏輯分析儀的習知作法，雖可以提供較為詳細的偵錯資料，但在價格上相當的昂貴。此外，邏輯分析儀也無法提供長時間的偵錯記錄，並不是一種好的選擇。而在使用通用異步收發傳輸器的技術中，其所產生的偵錯記錄並無法與錯誤的發生時間產生關聯。另外，通用異步收發傳輸器也無法提供大數量的偵錯記錄的記錄功能。

當然，除來上述所提的兩種方式外，習知技術也提出多種不同的替代方案，來進行快閃記憶體模組的偵錯及監控動作。然而，在兼顧成本以及功效上，並無令人滿意的解答。因此，有效的快閃記憶體模組的發展系統的建立，也為本領域的設計者所重視的一個課題。

本發明提供一種快閃記憶體發展系統，有效執行快閃記憶體及其所屬的記憶體控制器的除錯及監控功能。

本發明提出一種快閃記憶體發展系統，包括傳輸路徑切換器以及快閃記憶體模擬器。傳輸路徑切換器串接在記憶體控制器以及快閃記憶體的信號傳輸路徑間並接收偵錯啟動信號。快閃記憶體模擬器耦接傳輸路徑切換器，藉由信號傳輸路徑接收來自記憶體控制器的至少一控制命令。快閃記憶體模擬器並解譯控制命令且回應控制命令以產生至少一模擬回應資料。快閃記憶體模擬器更透過信號傳輸路徑傳送模擬回應資料至記憶體控制器。

在本發明之一實施例中，上述之傳輸路徑切換器藉由信號傳輸路徑將記憶體控制器傳送的控制命令傳送至快閃記憶體模擬器及快閃記憶體，並依據偵錯啟動信號將模擬回應資料及快閃記憶體產生的實際回應資料的其中之一藉由信號傳輸路徑傳送至記憶體控制器。

在本發明之一實施例中，上述之快閃記憶體模擬器更耦接至主機端，用以傳送記憶體控制器的至少狀態資訊至主機端。

在本發明之一實施例中，上述之狀態資訊包括記憶體控制器針對快閃記憶體進行存取的交通流量。

在本發明之一實施例中，上述之主機端更透過快閃記憶體模擬器以及信號傳輸路徑來依據非快閃記憶體控制命令來與記憶體控制器相互傳送至少一資料信號。

在本發明之一實施例中，上述之主機端更設定偵錯測試模式，並依據狀態資訊與偵錯測試模式來使快閃記憶體模擬器產生偵錯測試資料以作為模擬回應資料並傳送至記憶體控制器。

在本發明之一實施例中，上述之記憶體控制器依據固定週期來檢查快閃記憶體模擬器是否傳送快閃記憶體存取需求，記憶體控制器並依據快閃記憶體存取需求來存取快閃記憶體。

在本發明之一實施例中，上述之快閃記憶體存取需求由主機端發送至快閃記憶體模擬器。

在本發明之一實施例中，上述之主機端更用以儲存狀態資料以獲得備份狀態資料。

在本發明之一實施例中，上述之主機端更傳送備份狀態資料至記憶體控制器以作為記憶體控制器的工作狀態的回復依據。

基於上述，本發明藉由傳輸路徑切換器中所提供的信號傳輸路徑，來完成記憶體控制器、快閃記憶體以及快閃記憶體模擬器間的多種信號的傳輸動作。並藉以達成透過快閃記憶體模擬器來對快閃記憶體及其所屬的記憶體控制器進行監控及除錯的動作。不需要透過昂貴的儀器或複雜的方法，提升產品的成本競爭力。

為讓本發明之上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。

首先請參照圖1，圖1繪示本發明實施例的快閃記憶體模組的發展系統100的示意圖。其中，發展系統100包括傳輸路徑切換器110以及快閃記憶體模擬器120。傳輸路徑切換器110串接在快閃記憶體模組的記憶體控制器10以及快閃記憶體50的信號傳輸路徑間。快閃記憶體模擬器120耦接傳輸路徑切換器110，藉由信號傳輸路徑接收來自記憶體控制器的至少一個控制命令CTRLS，並解譯所接收的控制命令CTRLS以回應控制命令CTRLS以產生至少一個模擬回應資料。快閃記憶體模擬器120更透過信號傳輸路徑傳送模擬回應資料至記憶體控制器。

上述的信號傳輸路徑包括將記憶體控制器110傳送的控制命令CTRLS同時傳送至快閃記憶體模擬器120及快閃記憶體50。另外，信號傳輸路徑還包括將快閃記憶體模擬器120對應控制命令CTRLS所產生的模擬回應資料及快閃記憶體50產生的實際回應資料的其中之一傳送至記憶體控制器110。在此，傳輸路徑切換器110接收偵錯啟動信號DEBEN並依據偵錯啟動信號DEBEN來選擇傳送快閃記憶體模擬器120所產生的模擬回應資料或快閃記憶體50產生的實際回應資料來回傳至記憶體控制器110。具體一點來說明，當偵錯啟動信號DEBEN指示偵錯動作被啟動時，傳輸路徑切換器110選擇傳送快閃記憶體模擬器120所產生的模擬回應資料回傳至記憶體控制器110。相反的，若當偵錯啟動信號DEBEN指示偵錯動作被關閉時，傳輸路徑切換器110選擇傳送快閃記憶體50產生的實際回應資料來回傳至記憶體控制器110。

快閃記憶體模擬器120則是設計成包括快閃記憶體50的所有功能。簡單來說，就是當記憶體控制器10對快閃記憶體50寫入資料時，這些資料同時會被寫入至快閃記憶體模擬器120。相同的，當記憶體控制器10發送對快閃記憶體的讀取命令被傳送至快閃記憶體模擬器120時，快閃記憶體模擬器120回傳送出其所儲存的資料至記憶體控制器10。

請注意，偵錯啟動信號DEBEN可以由快閃記憶體模擬器120所產生。另外，快閃記憶體模擬器120還提供依個傳輸介面，來與外界的主機端30進行連接以及資料傳輸的動作。也就是說，快閃記憶體模擬器120可已透過其與主機端30的連接介面來將快閃記憶體模組內的一個或多個的狀態資訊傳送至主機端30。另外，快閃記憶體模擬器120也可以透過這個連接介面來接收主機端30所提供的命令，來進行對快閃記憶體模組進行偵錯的相關動作。在本實施例中，偵錯啟動信號DEBEN也可以是透過主機端30來下達偵錯啟動的命令，並使快閃記憶體模擬器120來產生指示偵錯動作被啟動的偵錯啟動信號DEBEN。

附帶一提的，主機端30可以是個人電腦或其他相同類型具有資料處理能力的電子裝置。

在本實施例中，快閃記憶體模擬器120，可以藉由其透過傳輸路徑切換器110所提供信號傳輸路徑來接收的一個或多個的控制命令CTRLS，來解析出快閃記憶體控制器10對快閃記憶體50進行存取的交通流量，並將這個交通流量週期性或非週期性的傳送至主機端30。主機端30則可以依據所接收的一個或多個的交通流量，來監控快閃記憶體控制器10與快閃記憶體50的存取狀態。

另外，主機端30更可以透過快閃記憶體模擬器120以及信號傳輸路徑110來依據非快閃記憶體控制命令來與記憶體控制器10相互傳送一個或多個的資料信號。其中，上述的非快閃記憶體控制命令並不會被記憶體控制器10所誤譯而對快閃記憶體50進行錯誤的存取。因此，利用非快閃記憶體控制命令可以有效使主機端30與記憶體控制器10進行雙向溝通，而不會產生對既有的快閃記憶體模組產生干擾。此外，非快閃記憶體控制命令可以由設計者自行定義，並使主機端30以及記憶體控制器10雙方皆可以識別即可。

在另一方面，主機端30還可以由使用者來設定一個偵錯測試模式。當快閃記憶體模擬器120所傳送的狀態資訊與所設定的偵錯測試模式相符合時，則使快閃記憶體模擬器120產生偵錯測試資料以作為模擬回應資料並傳送至記憶體控制器10。具體一點來說明，例如主機端30設定當記憶體控制器10發送針對位址0x0020讀出資料為偵錯測試模式。當快閃記憶體模擬器120接收到的記憶體控制器10所傳送的控制命令CTRLS恰為針對位址0x0020讀出資料時，快閃記憶體模擬器120變更原來應傳送出的儲存在位址0x0020的資料(例如是0xAA)為偵錯測試資料0x55來作為模擬回應資料並傳送至記憶體控制器10。並藉此來觀察記憶體控制器10接收到這個與預期不同的模擬回應資料所進行的反應，以觀測記憶體控制器10。

記憶體控制器10還可以依據一個固定週期來檢查快閃記憶體模擬器120是否有傳送快閃記憶體存取需求。當記憶體控制器10偵測到記憶體模擬器120有發送快閃記憶體存取需求時，記憶體控制器10則進行對快閃記憶體50進行存取。在本實施例中，快閃記憶體存取需求可以由主機端30產生，並透過快閃記憶體模擬器120來發送。而記憶體控制器10所針對快閃記憶體50所進行的存取結果，則可以藉由傳輸路徑切換器110及快閃記憶體模擬器120來傳回主機端30。也就是說，在本實施例中，主機端30可以存取快閃記憶體50。

主機端30還可以將由快閃記憶體模擬器120所獲得的狀態資料進行儲存以獲得備份狀態資料。主機端30更可以傳送所預先儲存的備份狀態資料至記憶體控制器10以作為記憶體控制器10的工作狀態的回復依據。

以下請參照圖2，圖2繪示本發明實施例的傳輸路徑切換器110的一實施方式示意圖。傳輸路徑切換器110包括路徑切換模組111。路徑切換模組111由開關SW1及SW2來建構。其中，開關SW1及SW2皆受控於偵錯啟動信號DEBEN，且開關SW1及SW2的導通或斷開的狀態是相反的。簡單來說，傳輸路徑切換器110會將所接收來自於記憶體控制器10的控制命令CTRS同時透過端點A1以及A2分別傳送至快閃記憶體模擬器120以及快閃記憶體50。在另一方面，由快閃記憶體模擬器120以及快閃記憶體50傳至傳輸路徑切換器110的資料(模擬回應資料以及實際回應資料)則會依據路徑切換模組111中的開關SW1及SW2的導通或斷開狀態，來傳送模擬回應資料以及實際回應資料的其中之一至記憶體控制器10。

綜上所述，本發明利用快閃記憶體模擬器來解譯記憶體控制器所產生的控制命令，並依據控制命令以產生模擬回應資料以進行監控及偵錯的功能。另外，本發明更藉由傳輸路徑切換器來選擇偵錯動作啟動或關閉時的信號傳輸路徑，並藉以使快閃記憶體模擬器在偵錯動作啟動時，可以有效與快閃記憶體以及記憶體控制器進行互動，而在偵錯動作關閉時，可以回復快閃記憶體以及記憶體控制器的正常動作。如此一來，在不需要高成本的電子裝置的輔助下，可以達到快閃記憶體的偵錯及監控功能。

雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明之精神和範圍內，當可作些許之更動與潤飾，故本發明之保護範圍當視後附之申請專利範圍所界定者為準。

100‧‧‧發展系統

110‧‧‧傳輸路徑切換器

120‧‧‧快閃記憶體模擬器

10‧‧‧記憶體控制器

30‧‧‧主機端

50‧‧‧快閃記憶體

111‧‧‧路徑切換模組

CTRLS‧‧‧控制命令

DEBEN‧‧‧偵錯啟動信號

SW1、SW2‧‧‧開關

A1、A2‧‧‧端點

圖1繪示本發明實施例的快閃記憶體模組的發展系統100的示意圖。

圖2繪示本發明實施例的傳輸路徑切換器110的一實施方式示意圖。

100．．．發展系統

110．．．傳輸路徑切換器

120．．．快閃記憶體模擬器

10．．．記憶體控制器

30．．．主機端

50．．．快閃記憶體

CTRLS．．．控制命令

DEBEN．．．偵錯啟動信號

Claims

一種快閃記憶體發展系統，包括：一傳輸路徑切換器，串接在一記憶體控制器以及一快閃記憶體的一信號傳輸路徑間，接收一偵錯啟動信號；以及一快閃記憶體模擬器，耦接該傳輸路徑切換器並設置在該快閃記憶體外，藉由該信號傳輸路徑接收來自該記憶體控制器的至少一控制命令，解譯該控制命令並回應該控制命令以產生至少一模擬回應資料，該快閃記憶體模擬器更透過該信號傳輸路徑傳送該模擬回應資料至該記憶體控制器。
如申請專利範圍第1項所述之快閃記憶體發展系統，其中該傳輸路徑切換器藉由該信號傳輸路徑將該記憶體控制器傳送的該控制命令傳送至該快閃記憶體模擬器及該快閃記憶體，並依據該偵錯啟動信號將該模擬回應資料及該快閃記憶體產生的一實際回應資料的其中之一藉由該信號傳輸路徑傳送至該記憶體控制器。
如申請專利範圍第1項所述之快閃記憶體發展系統，其中該快閃記憶體模擬器更耦接至一主機端，用以傳送該記憶體控制器的至少一狀態資訊至該主機端。
如申請專利範圍第3項所述之快閃記憶體發展系統，其中該狀態資訊包括該記憶體控制器針對該快閃記憶體進行存取的一交通流量。
如申請專利範圍第3項所述之快閃記憶體發展系統，其中該主機端更透過該快閃記憶體模擬器以及該信號傳輸路徑來依據一非快閃記憶體控制命令來與該記憶體控制器相互傳送至少一資料信號。
如申請專利範圍第3項所述之快閃記憶體發展系統，其中該主機端更設定一偵錯測試模式，並依據該狀態資訊與該偵錯測試模式來使該快閃記憶體模擬器產生一偵錯測試資料以作為該模擬回應資料並傳送至該記憶體控制器。
如申請專利範圍第3項所述之快閃記憶體發展系統，其中該記憶體控制器依據一固定週期來檢查該快閃記憶體模擬器是否傳送一快閃記憶體存取需求，該記憶體控制器並依據該快閃記憶體存取需求來存取該快閃記憶體。
如申請專利範圍第7項所述之快閃記憶體發展系統，其中該快閃記憶體存取需求由該主機端發送至該快閃記憶體模擬器。
如申請專利範圍第3項所述之快閃記憶體發展系統，其中該主機端更用以儲存該狀態資料以獲得一備份狀態資料。
如申請專利範圍第9項所述之快閃記憶體發展系統，其中該主機端更傳送該備份狀態資料至該記憶體控制器以作為該記憶體控制器的工作狀態的回復依據。