TWI462540B - 在積體電路裝置之調變器模組 - Google Patents

在積體電路裝置之調變器模組 Download PDF

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TWI462540B
TWI462540B TW099102112A TW99102112A TWI462540B TW I462540 B TWI462540 B TW I462540B TW 099102112 A TW099102112 A TW 099102112A TW 99102112 A TW99102112 A TW 99102112A TW I462540 B TWI462540 B TW I462540B
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Zeke R Lundstrum
Keith Curtis
Sean Steedman
Vivien Delport
Jerrold S Zdenek
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Description

在積體電路裝置之調變器模組
本發明係關於積體電路裝置，且更特定言之，本發明係關於在其中整合有一調變模組之積體電路裝置。
本申請案主張2009年1月26日申請，由Keith Curtis、Sean Steedman、Jerrold S. Zdenek及Zeke R. Lundstrum共同擁有的美國臨時專利申請案第61/147,137號，名為「Modulator Module in an Integrated Circuit Device」之優先權；且為了所有目的，該案以引用之方式併入本文中。
電子系統(諸如無線系統)可藉由某一形式之電磁信號(例如，射頻、紅外線等等)進行通信。亦存在可用於該等電磁信號之許多類型的調變，例如，調幅(AM)、調頻(FM)、相移鍵控(PSK)、頻移鍵控(FSK)等等。當前技術僅提供須增添至無線電子系統之其他電子邏輯的一特定應用通信調變器周邊裝置。此需要用於一通信調變器周邊裝置的額外印刷電路板面積及一分離積體電路裝置封裝。
此外，存在其他電子裝置，該等電子裝置可為有線或無線，並且需要若干經調變信號以用於通信及/或控制一應用(例如，馬達速度及螢光燈調光控制)，該等經調變信號使用複數個不同的頻率且可在該複數個不同的頻率之間進行調變及/或開關鍵控該複數個不同的頻率之任一者或多者。
所需要的是一種積體電路裝置，其包括一通信調變器周邊裝置並且提供一介面以運用亦包括於該積體電路裝置中之數位邏輯來操縱及自動化該通信調變器周邊裝置的電路。該通信調變器周邊裝置能夠使用二進位資料產生大體上任何形式之調變，並且可自該積體電路裝置之數位邏輯所供應之資料產生一資料經調變信號，而無需外部連接或外部周邊裝置。
舉例而言，資料傳輸可使用音訊數據機、超音波、紅外線(IR)及射頻信號裝置，該等裝置使用一適當的經調變載波來發送資料。該經調變載波之操作頻率可為(例如但不限於)低至40Hz及高至32MHz。迄今為止，調變一載波信號通常需要除積體電路裝置以外的外部電路，例如微控制器。
根據本發明之教示，可支援不同類型之調變格式。所支援之此等調變格式的一些可為(例如但不限於)開關鍵控(OOK)、頻移鍵控(FSK)、相移鍵控(PSK)、脈衝寬度調變(PWM)、脈衝位置調變(PPM)、脈衝密度調變(PDM)等等。
調變邏輯係與該積體電路裝置整合，且對於(諸)載波及來自該積體電路裝置內部硬體邏輯之調變資料、經軟體產生之調變資料或來自一個(若干個)外部資料源之調變資料可使用若干內部頻率源。經選擇載波之資料調變轉變的一與零之間之調變可自動同步化，以便大體上減少經調變信號輸出中的「短時脈衝干擾」及/或其他不需要的頻率成分，例如寄生雜訊。舉例而言，當啟用同步時，當調變器信號自邏輯低位準切換至邏輯高位準或自邏輯高位準切換至邏輯低位準(例如，邏輯轉變)時，載波源將切換。同步確保當前載波信號在分別切換至一不同載波信號之邏輯低位準或高位準之前轉至一邏輯低位準或高位準。此特徵防止在輸出信號中之位元邊界處出現縮短之載波脈衝。
載波源可為(例如但不限於)：1)具有一獨立分頻器之積體電路裝置的一系統時鐘；2)能夠以多重頻率操作並且具有擁有啟用多重相位之一共同週期之若干偏移計時器的複數個脈衝寬度調變(PWM)及/或脈衝位置調變(PPM)通道；3)一個(若干個)時鐘源；及4)具有一固定作用時間循環並且能夠以每時間週期不同數量之脈衝操作的複數個脈衝密度調變(PDM)通道。
調變源可為(例如但不限於)：1)主控同步串列埠/同步串列埠(MSSP/SSP)，例如串列周邊介面匯流排(SPI)及內部積體電路(I2 C)通信周邊裝置；2)通用非同步接收器傳輸器(UART)，其包括可用於不歸零(NRZ)資料串流之通用同步非同步接收器傳輸器(USART)及增強型非同步接收器傳輸器(EUART)；3)用於軟體程式控制之調變周邊裝置的軟體位元；4)用於脈衝寬度及脈衝位置調變之PWM模組；5)用於處理控制應用之電壓比較器；及6)外部信號。
可預期且在本發明之範疇內，(諸)調變源可選擇之兩個或更多個載波源可在相同頻率但不同相位關係下，例如相移120電角度，以驅動及控制三相無刷式直流馬達。
根據本發明之一特定實例實施例，一種積體電路裝置具有包括下列之一調變模組：一調變混頻器；一調變器多工器，其具有接收複數個調變器信號之若干輸入及連接至該調變混頻器之一調變器輸入的一輸出，其中該調變器多工器選擇該複數個調變器信號之一者以耦合至該調變器輸入；一高載波多工器，其具有經調適用以耦合至複數個載波信號的若干輸入及耦合至該調變混頻器之一高載波輸入的一輸出，其中該調變器多工器選擇該複數個載波信號之哪一者將耦合至該高載波輸入；一低載波多工器，其具有經調適用以耦合至該複數個載波信號的若干輸入及耦合至該調變混頻器之一低載波輸入的一輸出，其中該調變器多工器選擇該複數個載波信號之哪一者將耦合至該低載波輸入者；且其中該調變混頻器在該調變器輸入處於一第一邏輯位準時輸出自該高載波輸入導出的一經調變信號，且在該調變器輸入處於一第二邏輯位準時輸出自該低載波輸入導出的一經調變信號。
參考結合附圖所作的下列描述，可獲得本發明之更完整的理解。
雖然本發明可有多種修改及替代形式，但其特定實例實施例已顯示於圖式中並且在本文中予以詳細描述。然而應瞭解，本文特定實例實施例之描述並不希望將本發明限制於本文所揭示之特定形式，恰相反，本發明將涵蓋如申請專利範圍所界定之所有修改及等效物。
現在參考圖式，示意性繪示特定實例實施例之細節。圖式中之相同元件將由相同數字表示，且類似元件將由具有不同小寫字母後綴之相同數字表示。
參考圖1，所描繪的是根據本發明之一特定實例實施例的包括一調變器模組之一積體電路裝置的一示意方塊圖。一積體電路裝置(整體由數字100表示)包括一調變器模組，該調變器模組具有調變控制邏輯106、一信號調變混頻器108、一XOR(互斥或)閘110、一調變器多工器112、一高載波多工器114、一低載波多工器116，及輸入接收器及輸出驅動器(I/O)118。該積體電路裝置100可進一步包括一數位處理器102及一記憶體104。該積體電路裝置100可為(例如但不限於)一微控制器、一微處理器、一數位信號處理器(DSP)、一特定應用積體電路(ASIC)、一可程式化邏輯陣列(PLA)、一場可程式化閘陣列(FPGA)等等。一般而言，數位處理器102係用儲存於記憶體104中之一軟體/韌體程式予以控制。該記憶體104可為揮發性及/或非揮發性隨機存取記憶體(RAM)及類似物。
根據本發明之教示，可由受一軟體程式(圖中未顯示)控制的數位處理器102及/或經特定設計以操作多工器112、114及116的專屬硬體/韌體邏輯執行調變控制邏輯106之功能。調變控制邏輯106可為(例如但不限於)一狀態機。XOR閘110可用於使來自信號調變混頻器108之經調變信號128的極性反相。調變控制邏輯106可具有一關閉控制輸入，用於當該調變器模組未被使用時或當積體電路裝置處於一待機或休眠模式時關閉該調變器模組。當關閉調變控制邏輯106時，其輸出亦可被置於一高阻抗狀態中，例如三態輸出。
經由調變器多工器112可隨時選擇複數個調變信號之任一者。分別經由高載波多工器114及低載波多工器116可隨時選擇複數個載波信號之任意兩者。此特徵實現在一脈衝流中具有複數個不同的頻率脈衝，例如用於螢光燈驅動及調光應用、發光二極體(LED)亮度控制應用、無刷式直流馬達驅動及控制應用等等。
調變器模組提供在無需外部調變器及驅動器電路之情況下產生一經調變信號128並且經由積體電路裝置100之I/O 118發送此信號128之能力。
參考圖2，所描繪的是根據本發明之一特定實例實施例的圖1所示之積體電路裝置的調變器模組中之一混頻器的一示意圖。高及/或低載波可來自內部時鐘、時鐘及分頻器、計時器、外部等等。信號調變混頻器108從調變器多工器112之輸出122獲得進入的調變器信號，該調變器信號與來自高載波多工器114之高載波124或來自低載波多工器116之低載波126的一載波信號進行「及(運算)」，以產生經調變信號128。
調變器源可來自內部資料信號源及/或外部資料信號源(圖中未顯示)。經由調變器多工器112可選擇複數個調變器源之任一者。經選擇之調變器源係將調變一個或兩個載波，即高載波124或低載波126(按時間順序)之一資料串流。此外，高載波多工器114及/或低載波多工器116可分別用於選擇一個以上高載波輸出124及/或低載波輸出126，使得複數個高及/或低載波可循序處於資料串流中。此特徵係最有利於具有熱燈絲之螢光燈的亮度控制及無刷式直流馬達的速度控制。
信號調變混頻器108之一獨特的特徵係載波同步，該載波同步確保經調變信號128中大體上無短時脈衝干擾發生。短時脈衝干擾或縮短載波脈衝係由調變器自一載波頻率切換至另一載波頻率所致。當啟用載波切換同步且調變器資料切換邏輯位準(例如，自一邏輯高位準切換至一邏輯低位準或反之亦然)時，調變混頻器108首先等待當前載波轉至一邏輯低位準。該載波輸出接著係鎖定為低位準，以啟用資料低載波之輸出。一旦在該資料低載波上偵測到一下降沿，則為該載波源啟用輸出。
當施加一邏輯高位準於多工器236之高載波同步控制埠及/或多工器238之低載波同步控制埠時可完成載波切換同步。D正反器240及242分別保持高載波124及低載波126之邏輯位準。從而每當調變器信號122中存在一邏輯位準變化且該等載波同步控制埠之一者或兩者處於一邏輯高位準時，高載波與低載波之間的切換(反之亦然)將如下文更充分之描述發生。高及低載波邏輯位準可分別經由XOR閘250及252而反向。可預期且在本發明之範疇內，其他邏輯電路設計可利用於圖1所示之電路的功能，且該等其他邏輯電路設計對熟習數位邏輯設計並且瞭解本發明之教示的一般技術者將是顯而易見的。
參考圖3，所描繪的是根據本發明之教示的一開關鍵控(OOK)經調變信號之一示意時序圖。調變器信號122致使信號調變混頻器108在高載波信號124與低載波信號126之間切換。在圖3所示之實例中，低載波信號126係連續處於一邏輯低位準，即關閉。每當調變器信號122處於一邏輯高位準時，信號調變混頻器108將使用高載波信號124，且每當調變器信號122處於一邏輯低位準時，信號調變混頻器108將使用低載波信號126。在底部四個波形圖(a)至(d)中繪示啟用及/或停用高載波及低載波之同步如何影響經調變信號128。
現在參考波形圖(a)，啟用高載波同步且停用低載波同步。每當調變器信號122轉至邏輯低位準且高載波信號124轉至邏輯低位準時，經調變信號128將轉至邏輯低位準。因此，自高載波信號124至低載波信號126之轉變將與高載波信號124之邏輯位準變化(自高位準至低位準)同步。
現在參考波形圖(b)，高載波同步及低載波同步皆啟用。每當調變器信號122轉至邏輯低位準且高載波信號124轉至邏輯低位準時，經調變信號128將轉至邏輯低位準。因此，高載波信號124與低載波信號126之間之轉變將與自高至低之一邏輯位準變化同步。在此實例中，低載波信號126始終處於一邏輯低位準，故經調變信號128係與波形圖(a)中的相同。
現在參考波形圖(c)，高載波同步及低載波同步皆停用。每當調變器信號122轉至邏輯低位準時，經調變信號128將轉至邏輯低位準。自高載波信號124至低載波信號126之轉變可被截短為如在時間點(1)、(2)及(3)處所繪示。
現在參考波形圖(d)，停用高載波同步且啟用低載波同步。每當調變器信號122轉至邏輯低位準時，經調變信號128將轉至邏輯低位準。自高載波信號124至低載波信號126之轉變可被截短為如在時間點(1)、(2)及(3)處所繪示。在此實例中，低載波信號126始終處於一邏輯低位準，故經調變信號128係與波形圖(c)中的相同。
參考圖4，所描繪的是根據本發明教示之在高載波與低載波之間切換時無載波同步的一經調變信號之一示意時序圖。當調變器信號122係處於一邏輯高位準時，經調變信號128遵循高載波信號124之邏輯狀態，且當調變器信號122係處於一邏輯低位準時，經調變信號128遵循低載波信號126之邏輯狀態。經調變信號128表示一FSK或PSK經調變載波。在圖4所示之實例中，經調變信號128之邏輯狀態變化係根據調變器信號122之邏輯狀態變化(而無關於高載波信號124及低載波信號126之邏輯狀態)遵循高載波信號124與低載波信號126之間之載波信號選擇。如可在時間點(1)、(2)及(3)處所見，經調變信號128之波形被截短，並且趨於產生「短時脈衝干擾」及頻率突波。
參考圖5，所描繪的是根據本發明教示之在高載波與低載波之間切換時僅具有高載波同步的一經調變信號之一示意時序圖。只要調變器信號122處於一邏輯高位準，則經調變信號128遵循高載波信號124之邏輯狀態。然而，當調變器信號122轉至一邏輯低位準時，切換至待用作為經調變信號128之低載波信號126係延遲直至高載波信號124處於一邏輯低位準。此防止遭遇如圖4所示之某些短時脈衝干擾問題。然而，當調變器信號122轉回至一邏輯高位準時，不管低載波信號126之邏輯狀態為何，經調變信號128將切換回至高載波信號124。此仍可能引入一些不期望之波形，例如脈衝寬度縮短。
參考圖6，所描繪的是根據本發明教示之在高載波與低載波之間切換時僅具有低載波同步的一經調變信號之一示意時序圖。只要調變器信號122處於一邏輯低位準，則經調變信號128遵循低載波信號126之邏輯狀態。然而，當調變器信號122轉至一邏輯高位準時，切換至待用作為經調變信號128之高載波信號124係延遲直至低載波信號126處於一邏輯低位準。此防止遭遇如圖4所示之某些短時脈衝干擾問題。然而，當調變器信號122轉回至一邏輯低位準時，不管高載波信號124之邏輯狀態為何，經調變信號128將切換回至低載波信號126。此仍可能引入一些不期望之波形，例如脈衝寬度縮短。
參考圖7，所描繪的是根據本發明教示之在高載波與低載波之間切換時具有高載波同步及低載波同步的一經調變信號之一示意時序圖。當調變器信號122處於一邏輯高位準且低載波信號126(當作為調變器122時)處於一邏輯低位準(除非調變器信號122係在邏輯狀態之間轉變，即邏輯高位準至邏輯低位準或反之亦然)時，則經調變信號128遵循高載波信號124之邏輯狀態。經調變信號128係僅當調變器信號122處於一邏輯低位準且高載波信號124處於一邏輯低位準時，才自高載波信號124切換至低載波信號126。同樣，經調變信號128係僅當調變器信號122處於一邏輯高位準且低載波信號126處於一邏輯低位準時，才自低載波信號126切換至高載波信號124。使調變器信號122與高載波信號124與低載波信號126兩者同步可維持經調變信號128之各自適當之波形且大體上減少其中之短時脈衝干擾。
參考圖8，所描繪的是利用圖1之積體電路裝置的一螢光燈驅動器電路之一示意方塊圖。圖8之螢光燈電路可用於固定亮度應用與調光應用兩者。該螢光燈電路(整體由數字800表示)包括一積體電路裝置100a、高壓側及低壓側金屬氧化物半導體場效應電晶體(MOSFET)驅動器804、一高壓側功率MOSFET 806、一低壓側功率MOSFET 808、一電感器810、一螢光燈812、一燈絲電容器816及一DC阻隔電容器814。MOSFET驅動器804係用於將積體電路裝置100a之低輸出電壓轉變為操作高壓側功率MOSFET 806及低壓側功率MOSFET 808所需之高電壓位準。積體電路裝置100a可用於經由MOSFET驅動器804分別切換高壓側驅動器為ON或OFF及切換低壓側驅動器為OFF或ON。當高壓側驅動器處於ON時，高壓側功率MOSFET 806容許電流往一方向流過諧振RLC螢光燈電路(電感器810及DC阻隔電容器814)，且當低壓側驅動器處於ON時，低壓側功率MOSFET 808容許電流往另一方向流過諧振RLC螢光燈電路(電感器810、螢光燈812及DC阻隔電容器814)。高壓側功率MOSFET 806及低壓側功率MOSFET 808無法同時處於ON。再者可期望一無作用帶(dead band)，例如高壓側功率MOSFET 806及低壓側功率MOSFET 808皆處於OFF。此利用運行於積體電路裝置100a之一數位處理器中之軟體指令可輕易地完成。積體電路裝置100a可藉由交替地開啟MOSFET驅動器804之高壓側及低壓側輸出而合成一交流電(AC)信號。對於螢光燈調光應用，精心控制MOSFET驅動器804之高壓側及低壓側輸出的持續時間將產生可如上文圖1及圖2所示實施例之更充分描述而合成的具有若干特定頻率之一AC驅動信號。
根據本發明之教示之調變器可用於多種螢光燈驅動器系統中。舉例而言(但不限於)，多重頻率脈衝密度調變可有效用於螢光燈亮度控制(調光)應用。在2006年9月5日申請，由John K. Gulsen及Stephen Bowling共同擁有之名為「Using Pulse Density Modulation for Controlling Dimmable Electronic Lighting Ballasts」的美國專利申請案第11/470,052號(現在為美國專利第　　 號，授予 　　 )，及2009年12月4日申請，由John K. Gulsen及Stephen Bowling共同擁有之名為「Using Pulse Density Modulation for Controlling Dimmable Electronic Lighting Ballasts」的美國專利申請案第12/631,118號中提出用於螢光燈之電子調光的在時間上使用不同頻率之亮度控制的一更詳細描述，其中為了所有目的，該兩案以引用之方式併入本文中。
雖然已參考本發明之實例實施例描繪、描述及界定本發明之實施例，但此等參考並不暗示對本發明之限制，且不可推斷此限制。如熟習相關技術並且受益於本發明之一般技術者所想，所揭示之標的可在形式及功能上有大量修改、變更及等效物。本發明所描繪及描述之實施例僅為實例，且並非為本發明之範疇的詳盡描述。
100．．．積體電路裝置
100a．．．積體電路裝置
102．．．數位處理器
104．．．記憶體
106．．．調變控制邏輯
108．．．信號調變混頻器
110．．．XOR閘
112．．．調變器多工器
114．．．高載波多工器
116．．．低載波多工器
118．．．輸入接收器及輸出驅動器(I/O)
122．．．調變器信號
124．．．高載波信號
126．．．低載波信號
128．．．經調變信號
236、238．．．多工器
240、242．．．D正反器
250、252．．．XOR閘
800．．．螢光燈電路
804．．．高壓側及低壓側金屬氧化物半導體場效應電晶體(MOSFET)驅動器
806．．．高壓側功率MOSFET
808．．．低壓側功率MOSFET
810．．．電感器
812．．．螢光燈
814．．．DC阻隔電容器
816．．．燈絲電容器
圖1繪示根據本發明之一特定實例實施例的包括一調變器模組之一積體電路裝置的一示意方塊圖；
圖2繪示根據本發明之一特定實例實施例的圖1所示之積體電路裝置的調變器模組中之一混頻器的一示意圖；
圖3繪示根據本發明教示的一開關鍵控(OOK)經調變信號之一示意時序圖；
圖4繪示根據本發明教示之在高載波與低載波之間切換時無載波同步的一經調變信號之一示意時序圖；
圖5繪示根據本發明教示之在高載波與低載波之間切換時僅具有高載波同步的一經調變信號之一示意時序圖；
圖6繪示根據本發明教示之在高載波與低載波之間切換時僅具有低載波同步的一經調變信號之一示意時序圖；
圖7繪示根據本發明教示之在高載波與低載波之間切換時具有高載波同步及低載波同步的一經調變信號之一示意時序圖；及
圖8繪示根據本發明教示之利用圖1之積體電路裝置的一螢光燈驅動器電路之一示意方塊圖。
100．．．積體電路裝置
102．．．數位處理器
104．．．記憶體
106．．．調變控制邏輯
108．．．信號調變混頻器
110．．．XOR閘
112．．．調變器多工器
114．．．高載波多工器
116．．．低載波多工器
118．．．輸入接收器及輸出驅動器(I/O)
122．．．調變器信號
124．．．高載波信號
126．．．低載波信號
128．．．經調變信號

Claims (28)

  1. 一種具有一調變模組之積體電路裝置，該調變模組包括：一調變混頻器；一調變器多工器，其具有接收複數個調變器信號之若干輸入及連接至該調變混頻器之一調變器輸入的一輸出，其中該調變器多工器選擇該複數個調變器信號之一者以耦合至該調變器輸入；一高載波多工器，其具有經調適用以耦合至複數個載波信號的若干輸入及耦合至該調變混頻器之一高載波輸入的一輸出，其中該高載波多工器選擇該複數個載波信號之一者以耦合至該高載波輸入；一低載波多工器，其具有經調適用以耦合至該複數個載波信號的若干輸入及耦合至該調變混頻器之一低載波輸入的一輸出，其中該低載波多工器選擇該複數個載波信號之一者以耦合至該低載波輸入；及其中該調變混頻器在該調變器輸入處於一第一邏輯位準時輸出自該高載波輸入導出的一經調變信號，且在該調變器輸入處於一第二邏輯位準時輸出自該低載波輸入導出的一經調變信號。
  2. 如請求項1之積體電路裝置，其中該第一邏輯位準係一邏輯低位準，且該第二邏輯位準係一邏輯高位準。
  3. 如請求項1之積體電路裝置，其中該第一邏輯位準係一邏輯高位準，且該第二邏輯位準係一邏輯低位準。
  4. 如請求項1之積體電路裝置，其中該複數個載波信號之一者係連續處於一邏輯低位準之一無載波信號。
  5. 如請求項1之積體電路裝置，其中該複數個載波信號之一者係連續處於一邏輯高位準之一無載波信號。
  6. 如請求項1之積體電路裝置，其進一步包括用於當該經調變信號係藉由僅當該調變器輸入及該高載波輸入皆處於該等第一邏輯位準時自該高載波輸入切換至該低載波輸入時之同步的一電路。
  7. 如請求項1之積體電路裝置，其進一步包括用於當該經調變信號係藉由僅當該調變器輸入及該高載波輸入皆處於該等第二邏輯位準時自該高載波輸入切換至該低載波輸入時之同步的一電路。
  8. 如請求項1之積體電路裝置，其進一步包括用於當該經調變信號係藉由僅當該調變器輸入及該高載波輸入皆處於相同邏輯位準時自該高載波輸入切換至該低載波輸入時之同步的一電路。
  9. 如請求項1之積體電路裝置，其進一步包括用於當該經調變信號係藉由僅當該調變器輸入及該低載波輸入皆處於該等第一邏輯位準時自該低載波輸入切換至該高載波輸入時之同步的一電路。
  10. 如請求項1之積體電路裝置，其進一步包括用於當該經調變信號係藉由僅當該調變器輸入及該低載波輸入皆處於該等第二邏輯位準時自該低載波輸入切換至該高載波輸入時之同步的一電路。
  11. 如請求項1之積體電路裝置，其進一步包括用於當該經調變信號係藉由僅當該調變器輸入及該低載波輸入皆處於相同邏輯位準時自該低載波輸入切換至該高載波輸入時之同步的一電路。
  12. 如請求項1之積體電路裝置，其進一步包括用於當該經調變信號係藉由僅當該調變器輸入及該低載波輸入皆處於該等第一邏輯位準時切換至該高載波輸入及僅當該調變器輸入及該高載波輸入皆處於該等第一邏輯位準時切換至該低載波輸入而在該低載波輸入與該高載波輸入之間切換時之同步的一電路。
  13. 如請求項1之積體電路裝置，其進一步包括用於當該經調變信號係藉由僅當該調變器輸入及該低載波輸入皆處於該等第二邏輯位準時切換至該高載波輸入及僅當該調變器輸入及該高載波輸入皆處於該等第二邏輯位準時切換至該低載波輸入而在該低載波輸入與該高載波輸入之間切換時之同步的一電路。
  14. 如請求項1之積體電路裝置，其進一步包括用於當該經調變信號係藉由僅當該調變器輸入及該低載波輸入皆處於相同邏輯位準時切換至該高載波輸入及僅當該調變器輸入及該高載波輸入皆處於相同邏輯位準時切換至該低載波輸入而在該低載波輸入與該高載波輸入之間切換時之同步的一電路。
  15. 如請求項1之積體電路裝置，其中該積體電路裝置係一微控制器且進一步包括： 一數位處理器；及一記憶體，其係耦合至該數位處理器，其中該數位處理器係用一軟體程式控制。
  16. 如請求項15之積體電路裝置，其中該調變器多工器、該高載波多工器及該低載波多工器係由該數位處理器控制。
  17. 如請求項15之積體電路裝置，其進一步包括用於控制該調變器多工器、該高載波多工器及該低載波多工器之調變控制邏輯，其中該調變控制邏輯係耦合至該數位處理器。
  18. 如請求項17之積體電路裝置，其中該調變控制邏輯係一邏輯狀態機。
  19. 如請求項1之積體電路裝置，其中該積體電路裝置係一微控制器。
  20. 如請求項1之積體電路裝置，其中該積體電路裝置係選自由一微處理器、一數位信號處理器(DSP)、一特定應用積體電路(ASIC)、一可程式化邏輯陣列(PLA)及一場可程式化閘陣列(FPGA)組成之群組。
  21. 如請求項1之積體電路裝置，其中該調變混頻器包括同步邏輯，其中該同步邏輯防止自該低載波輸入變化至該高載波輸入直至該低載波輸入處於一邏輯低位準，且防止自該高載波輸入變化至該低載波輸入直至該高載波輸入處於一邏輯低位準。
  22. 如請求項20之積體電路裝置，其中 當對該高載波輸入啟用該同步邏輯時，該經調變信號僅當該高載波輸入處於該邏輯低位準時自該低載波輸入變化至該高載波輸入，及當對該高載波輸入停用該同步邏輯時，該經調變信號當該調變器輸入處於該邏輯高位準時自該低載波輸入變化至該高載波輸入。
  23. 如請求項20之積體電路裝置，其中當對該低載波輸入啟用該同步邏輯時，該經調變信號僅當該低載波輸入處於該邏輯低位準時自該高載波輸入變化至該低載波輸入，及當對該低載波輸入停用該同步邏輯時，該經調變信號當該調變器輸入處於該邏輯低位準時自該高載波輸入變化至該低載波輸入。
  24. 如請求項1之積體電路裝置，其中該經調變信號係開關鍵控，其中該高載波輸入為該複數個載波信號之一經選擇者，且該低載波信號輸入係處於該邏輯低位準。
  25. 如請求項1之積體電路裝置，其中該經調變信號係頻移鍵控(FSK)，其中該高載波輸入為該複數個載波信號之一經選擇者，且該低載波信號輸入為該複數個載波信號之另一經選擇者。
  26. 如請求項1之積體電路裝置，其中該經調變信號係相移鍵控(PSK)，其中該高載波輸入為該複數個載波信號之一經選擇者，且該低載波信號輸入為該複數個載波信號之經相移之該經選擇者。
  27. 如請求項1之積體電路裝置，其中該積體裝置係用於對一螢光燈調光。
  28. 如請求項1之積體電路裝置，其中該調變模組當未使用時係置於一低功率模式中。
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