TWI383571B - 同步整流方法與裝置 - Google Patents

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Description

同步整流方法與裝置
本發明主要關於一種電源轉換器，特別係有關於一種同步整流柔性切換電源轉換器之方法與裝置。
第1圖係顯示一傳統柔性切換電源轉換器之電路架構圖。傳統柔性切換電源轉換器包括一變壓器10，用以電性隔離交流輸入端以及電源轉換器之輸出端。柔性切換電源轉換器能夠達到高效率以及低電磁干擾(electric-magnetic interference，EMI)之性能。電晶體20與30形成一半橋電路，用以切換一諧振槽(resonant tank)以及變壓器10。諧振槽係由電感15以及電容40所形成。電感15作為變壓器10之一次側漏電感(primary-side leakage inductance)以及/或一電感性裝置。電感15之電感值L以及電容40之電容值C決定了共振頻率f 0 。
變壓器10將能量由其一次側傳送至二次側。整流器41與42將變壓器10之切換電壓整流，並輸入至電容65，因此，於電源轉換器之輸出端產生一直流電壓VO 。
於變壓器二次側設置一同步整流器能夠得到更高之電源轉換效率，例如Yang所提出之美國專利編號7,173,835，標題為「具有運作為同步整流順向型電源轉換器之飽和電 感之控制電路」。然而，此傳統技術之缺點為飽和電感將導致額外之電源消耗。本發明之一目的是為了提供一種同步整流裝置與方法來柔性切換一電源轉換器，以達到高效率。
有鑑於此，本發明提供一種同步整流裝置與方法來柔性切換一電源轉換器。根據本發明一實施例所述之方法與裝置包括一切換控制電路，用以根據一切換信號之上升緣以及下降緣產生驅動信號。驅動信號耦接並切換一變壓器以調整電源轉換器。驅動信號之間具有傳遞延遲以柔性切換電源轉換器。切換控制電路更根據一電流信號產生一脈波信號。電流感測電路耦接至變壓器以根據變壓器之切換電流產生電流信號。脈波信號根據切換電流之零交越而產生。隔離裝置，例如脈衝變壓器或複數電容，耦接至切換控制電路以由變壓器之一次側傳送脈波信號至二次側。積體同步整流器包括一控制器以及一電源電晶體。電源電晶體耦接於變壓器以及電源轉換器之輸出端，用以整流。脈波信號設定或重置一栓鎖電路，用以切換上述電源電晶體。脈波信號為差動信號，而脈波信號之極性決定積體同步整流器之啟動或關閉。
為使本發明之上述目的、特徵和優點能更明顯易懂， 下文特舉一較佳實施例，並配合所附圖式，作詳細說明如下：
實施例：
第2圖係顯示具有同步整流電路之柔性切換電源轉換器。電源轉換器具有一變壓器10，包括一次測以及二次側。變壓器10之一次側包括電源電晶體20以及30以切換變壓器10之一次側線圈NP 。變壓器10之二次側包括二次側線圈NS1 以及另一二次側線圈NS2 。第一積體同步整流器51包括一陰極端DET，耦接至二次側線圈NS1 。第一積體同步整流器51之陽極端GND係耦接至電源轉換器之輸出接地點。第二積體同步整流器52包括一陰極端DET以及經由二次側線圈NS2 耦接至電源轉換器之輸出接地點之陽極端GND。第一積體同步整流器51與第二積體同步整流器52之第一輸入信號端SP 以及第二輸入信號端SN 係耦接至隔離裝置70之二次側以接收脈波信號Spulse 以開啟或關閉第一積體同步整流器51與第二積體同步整流器52。隔離裝置70作為一隔離障壁，可以包括電容71和72，或可為一脈波變壓器。電容71和72之電容值可為如20 pF之小電容，但必須為高額定電壓才適合用來作電性隔離。
切換控制電路80根據電源轉換器之輸出負載耦接並接收回授信號VFB 。驅動信號SA 與SB 耦接並分別經由驅動電路25與35控制電源電晶體20以及30，以切換變壓器10。驅動信號SA 與SB 之間具有一延遲時間TD 以柔性 方式切換電源轉換器。在此僅大略說明說明切換信號以及延遲時間TD ，詳細之內容將在下文說明。
脈波信號Spulse 根據電流信號VS 而產生。電流信號VS 耦接至切換控制電路80，並與變壓器10之切換電流IP 相關。電流感測元件17耦接至變壓器10並產生電流信號VS 。脈波信號Spulse 根據切換電流IP 之零交越(zero-crossings)而產生於第一輸出信號端XP 以及第二輸出信號端XN ，脈波信號Spulse 為差動信號。而脈波信號Spulse 之極性係決定第一積體同步整流器51與第二積體同步整流器52之開啟或關閉。
切換控制電路80之第一輸出信號端XP 以及第二輸出信號端XN 係耦接至隔離裝置70以由變壓器10之一次側將脈波信號Spulse 傳送至二次側。脈波信號Spulse 之脈波寬度係小於切換信號SIN 之脈波寬度。脈波信號Spulse 為具有高頻成分之信號，因此，隔離裝置70只需使用小電容或小脈波變壓器即可，有效節省印刷電路板的空間以及電源轉換器的成本。
第3圖係顯示根據本發明一實施例所述之積體同步整流器50之架構圖，代表第一積體同步整流器51或第二積體同步整流器52。積體同步整流器50包括電源電晶體400、二極體450以及控制器200。二極體450與電源電晶體400並聯。電源電晶體400耦接於陰極端DET以及陽極端GND之間。陰極端DET耦接於第2圖所示之變壓器10之二次側。陽極端GND耦接於電源轉換器之輸出。控制器 200經由第一輸入信號端SP 以及第二輸入信號端SN 耦接並接收脈波信號Spulse ，用以控制該電源電晶體400的開啟或關閉狀態，即開啟或關閉電源電晶體400。VCC 端子用以供應電源至控制器200。
第4圖係顯示根據本發明一實施例所述之控制器200之架構圖。電阻211與221提供第一輸入信號端SP 端點偏壓(bias termination)。電阻213與223提供第二輸入信號端SN 端點偏壓(bias termination)。第一輸入信號端SP 耦接至比較器210之正輸入端以及比較器220之負輸入端。第二輸入信號端SN 耦接至比較器220之正輸入端以及比較器210之負輸入端。比較器210與220分別具有偏移電壓(offset voltage)215與225，用以提供磁滯(hysteresis)。比較器230耦接至陰極端DET。比較器210與230之輸出係經由AND邏輯閘235耦接至SR正反器250之設定輸入端S。SR正反器250的重置輸入端R由比較器220之輸出所控制。SR正反器250以及比較器230之輸出耦接至AND邏輯閘262。閘驅動信號VG 係產生於AND邏輯閘262之輸出以控制電源電晶體400之開啟或者關閉狀態。閘驅動信號VG 之最大導通時間係受到最大導通時間電路(maximum-on-time circuit，MOT)270所限制。閘驅動信號VG 耦接至最大導通時間電路270。在一既定時間之後，最大導通時間信號SM 根據閘驅動信號VG 之致能而產生，經由反相器261耦接至AND邏輯閘260。AND邏輯閘260之另一輸入端耦接至電源啟動重置信號RST。AND邏輯閘 260之輸出端耦接至SR正反器250之清除端CLR以重置SR正反器250。因此，閘驅動信號VG 之最大導通時間受限於最大導通時間電路270的既定時間。VG 關閉電源電晶體400。
VSN -VSP >V225 ---(2)
當符合方程式(2)及(3)時，閘驅動信號VG 將導通電源電晶體400。
VSP -VSN >V215 ---(3)
VDET <VTH ---(4)
其中VSP 為第一輸入信號端SP 之電壓，VSN 為第二輸入信號端SN 之電壓，VDET 為陰極端DET之電壓，VTH 為臨界電壓之電壓值，V215 為偏移電壓215之電壓值，而V225 為偏移電壓225之電壓值。
當二極體450導通時，陰極端DET之電壓值將低於臨界電壓VTH 。因此，顯示電源電晶體400僅在二極體450導通時導通。
第5圖係顯示根據本發明一實施例所述之最大導通時間電路270。電流源273用來對電容275充電。電晶體272用來對電容275放電。閘驅動信號VG 經由反相器271控制電晶體272。閘驅動信號VG 更耦接至AND邏輯閘279。AND邏輯閘279之另一輸入端耦接至電容275。當閘驅動 信號VG 致能時，AND邏輯閘279之輸出將產生最大導通時間信號SM 以於該既定時間禁能(disable)閘驅動信號VG 。該既定時間係由電流源273之電流以及電容275之電容值所決定。
第6圖係顯示根據本發明一實施例所述之切換控制電路80。切換控制電路80接收第2圖所示之回授信號VFB ，並產生切換信號SIN 。信號產生器100根據切換信號SIN 之上升緣(前緣)以及下降緣(後緣)產生信號SA 與SB 。切換信號SIN 由T型正反器95(除二電路(divided-by-two circuit))所產生，用以確保切換信號SIN 具有50%之工作週期(duty cycle)。T型正反器95之輸入為壓控振盪電路(VCO)480所產生之振盪信號SO 。回授信號VFB 係用以控制壓控振盪電路480。振盪信號SO 之頻率係由回授信號VFB 所決定。電源管理電路500用以根據回授信號VFB 產生間歇節能(burst)信號BST。間歇節能信號BST耦接至信號產生器100以產生用以關閉積體同步整流器51與52(使得同步整流器之電源電晶體400不導通)之脈波信號。再者，間歇節能信號BST用以重置T型正反器95以禁能切換信號SIN 。
電流源81在電流信號VS 提供直流偏壓(DC bias)。電流信號VS 耦接至比較器85之負輸入端以及比較器86之正輸入端。比較器85之正輸入端耦接至臨界信號V2 。比較器86之負輸入端耦接至臨界信號V1 。臨界信號V2 大於臨界信號V1 。比較器85以及比較器86之輸出耦接至AND邏輯閘90。AND邏輯閘90產生零交越信號IZ 並耦接至信 號產生器100以於第一輸出信號端XP 以及第二輸出信號端XN 產生脈波信號。零交越信號IZ 係根據切換電流IP 之交越而產生。
第7圖係顯示根據本發明一實施例所述之電源管理電路500。運算放大器510、電阻511以及電晶體512形成一電壓轉電流轉換器，用以根據回授信號VFB 於電晶體512產生電流I512 。電晶體521、522與523形成一電流鏡。根據電流I512 與電流源515之電流的比較結果而分別於電晶體522與523產生電流I522 與I523 。根據電流I522 與電流源525之電流的比較結果產生耦接至磁滯緩衝器581之信號SHYS 。電流I523 以及電流源540經由開關530對電容550充電。電流源545經由開關535對電容550放電。磁滯緩衝器581產生清除信號SCLR 以控制開關536以重置電容550。電容550耦接至比較器561與562。NAND邏輯閘575以及576形成一SR栓鎖器，耦接至比較器561與562以產生放電信號SDIS 。放電信號SDIS 用以控制開關535。充電信號SCHR 經由反相器580，依據放電信號SDIS 而產生。充電信號SCHR 耦接至開關530用以控制開關530。因此，斜坡(ramp)信號RMP產生於電容550。充電信號SCHR 更耦接至NAND邏輯閘585。NAND邏輯閘585之另一輸入端經由反相器582耦接至清除信號SCLR 。NAND邏輯閘585之輸出耦接至正反器590之D輸入端。振盪信號SO 耦接至正反器590之時脈輸入端，用以同步正反器590。電源啟動重置信號RST耦接至正反器590之重置端，用以重 置正反器590。因此，正反器590根據回授信號VFB 產生間歇節能信號BST。
第8圖係顯示間歇節能信號BST之波形。斜坡信號RMP之充電時間以及間歇節能信號BST之間歇節能時期隨著回授信號VFB 之降低而增加。而回授信號VFB 係隨著電源轉換器之負載降低而降低。
第9圖係顯示信號產生器100之電路。驅動信號SA 與SB 根據切換信號SIN 而產生。切換信號SIN 耦接至延遲電路110之輸入端。延遲電路110之輸出端經由反相器105耦接至AND邏輯閘150之輸入端。AND邏輯閘150之另一輸入端耦接至切換信號SIN 。AND邏輯閘150、160與反相器130、140形成一抗跨傳輸電路(anti-cross-conduction circuit)以產生驅動信號SA 與SB 。AND邏輯閘150之輸出端耦接至抗跨傳輸電路之輸入端。切換信號SIN 更經由反相器124耦接至延遲電路120之輸入端。延遲電路120之輸出端經由反相器125耦接至AND邏輯閘160之輸入端。AND邏輯閘160之另一輸入端耦接至反相器124之輸出端。AND邏輯閘160之輸出端耦接至抗跨傳輸電路之輸入端。因此，在致能切換信號SIN 以及驅動信號SA 與SB 之間具有一時間延遲。延遲電路110、120決定該時間延遲。再者，間歇節能信號BST、零交越信號IZ 以及驅動信號SA 與SB 耦接至脈波信號產生器300以於第一輸出信號端XP 以及第二輸出信號端XN 產生脈波信號。
第10圖係顯示根據本發明一實施例所述之延遲電 路。電流源113用以對電容115充電。電晶體112用以對電容115放電。輸入信號IN經由反相器111耦接並控制電晶體112。輸入信號IN更耦接至NAND邏輯閘119。NAND邏輯閘119之另一輸入端耦接至電容115。NAND邏輯閘119之輸出端為延遲電路之輸出。當輸入信號IN為低邏輯位準時，電容115放電且NAND邏輯閘119之輸出端為高邏輯位準。當輸入信號IN充電至高邏輯位準時，電流源113開始充電電容115。當電容115之電壓高於NAND邏輯閘119之輸入臨限時，NAND邏輯閘119之輸出轉為低邏輯位準。電流源113之電流以及電容115之電容值決定延遲電路之延遲時間。延遲時間由輸入信號IN之高邏輯位準開始至延遲電路之輸出信號為低邏輯位準為止。
第11圖係顯示根據本發明一實施例所述之脈波信號產生器300。正反器320之時脈輸入端接收零交越信號IZ 以產生第一信號。第一信號傳輸至OR邏輯閘315之第一輸入端。間歇節能信號BST經由反相器343耦接至正反器330之時脈輸入端。正反器330輸出耦接至OR邏輯閘315之第二輸入端之第二信號。OR邏輯閘315用以於第二輸出信號端XN 產生負脈波信號。負脈波信號傳輸經由延遲電路335輸出以重置正反器320與330。延遲電路335之延遲時間決定負脈波信號之脈衝寬度TP 。反相器343之輸出經由正反器341耦接至正反器340之D輸入端以及AND邏輯閘345之第一輸入端。正反器340之時脈輸入端耦接至AND邏輯閘305之輸出。AND邏輯閘305之其中兩輸入 端接收驅動信號SA 與SB 。AND邏輯閘305之另一輸入端經由反相器342耦接至第二輸出信號端XN 以接收負脈波信號。正反器340之輸出耦接至AND邏輯閘345之第二輸入端。電源啟動重置信號RST耦接至AND邏輯閘345之第三輸入端。AND邏輯閘345於第一輸出信號端XP 產生正脈波信號。正脈波信號傳輸經由延遲電路337輸出至正反器340用以重置正反器340。延遲電路337之延遲時間決定正脈波信號之脈衝寬度TP 。因此，根據位於第一輸出信號端XP 以及第二輸出信號端XN 之正脈波信號與負脈波信號可產生脈波信號。
第12圖係顯示同步整流電路之波形。驅動信號SA 與SB 分別根據切換信號SIN 之上升緣(前緣)以及下降緣(後緣)產生。在致能切換信號SIN 以及驅動信號SA 與SB 之間具有一時間延遲。時間延遲係設計為位於切換信號SIN 之上升緣以及驅動信號SA 之上升緣之間。另外，另一時間延遲係設計為位於切換信號SIN 之下降緣以及驅動信號SB 之上升緣之間。驅動信號SB 為驅動信號SA 之反相信號。
根據零交越信號IZ 產生脈波信號SP -SN (負脈波信號)以禁能第一積體同步整流器51與第二積體同步整流器52。在脈波信號SP -SN (負脈波信號)結束之後，將產生脈波信號SP -SN (正脈波信號)以於第一積體同步整流器51或第二積體同步整流器52之二極體450導通時致能第一積體同步整流器51或第二積體同步整流器52。再者，脈波信號SP -SN (負脈波信號)係根據間歇節能信號BST而產 生，代表電源轉換器操作於間歇節能模式之間歇節能時期時，會禁能第一積體同步整流器51與第二積體同步整流器52。
第13圖係顯示根據本發明另一實施例所述之同步整流柔性切換電源轉換器。在此實施例中，加入脈波變壓器75做為隔離裝置70。再者，變壓器11包括耦接至電阻19之輔助線圈NA ，用以產生電流信號VS 。
本發明雖以較佳實施例揭露如上，然其並非用以限定本發明的範圍，任何熟習此項技藝者，在不脫離本發明之精神和範圍內，當可做些許的更動與潤飾，因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。
10、11‧‧‧變壓器
115、275、40、550、65、71、72‧‧‧電容
15‧‧‧電感
17‧‧‧電流感測元件
19、211、221、213、223、511‧‧‧電阻
100‧‧‧信號產生器
110、120、335、337‧‧‧延遲電路
113、273、515、540、545、81‧‧‧電流源
150、160、235、260、262、279、305、345、90‧‧‧AND邏輯閘
271、130、140、105、111、124、125、341、342、343、580、582‧‧‧反相器
119、575、576、585‧‧‧NAND邏輯閘
20、30、400‧‧‧電源電晶體
25、35‧‧‧驅動電路
200‧‧‧控制器
210、220、230、561、562、85、86‧‧‧比較器
215、225‧‧‧偏移電壓
250‧‧‧SR正反器
261、320、330、340、590‧‧‧正反器
270‧‧‧最大導通時間電路
272、512、521、522、523‧‧‧電晶體
300‧‧‧脈衝信號產生器
315‧‧‧OR邏輯閘
41、42‧‧‧整流器
450‧‧‧二極體
480‧‧‧壓控振盪電路
50、51、52‧‧‧積體同步整流器
500‧‧‧電源管理電路
510‧‧‧運算放大器
530、535、536‧‧‧開關
581‧‧‧磁滯緩衝器
70‧‧‧隔離裝置
75‧‧‧脈波變壓器
80‧‧‧切換控制電路
95‧‧‧T型正反器(除二電路)
BST‧‧‧間歇節能信號
CLR‧‧‧清除端
DET‧‧‧陰極端
GND‧‧‧陽極端
I512 、I522 、I523 ‧‧‧電流
IP ‧‧‧切換電流
IZ ‧‧‧零交越信號
NP ‧‧‧一次側線圈
NA ‧‧‧輔助線圈
NS1 、NS2 ‧‧‧二次側線圈
R‧‧‧重置輸入端
RMP‧‧‧斜坡信號
RST‧‧‧電源啟動重置信號
SDIS ‧‧‧放電信號
SCHR ‧‧‧充電信號
SCLR ‧‧‧清除信號
SHYS ‧‧‧信號
TP ‧‧‧脈衝寬度
S‧‧‧設定輸入端
SA 、SB ‧‧‧驅動信號
SIN ‧‧‧切換信號
SP ‧‧‧第一輸入信號端
SN ‧‧‧第二輸入信號端
SM ‧‧‧最大導通時間信號
SO ‧‧‧振盪信號
Spulse ‧‧‧脈波信號
TD ‧‧‧延遲時間
V1 、V2 ‧‧‧臨界信號
VG ‧‧‧閘驅動信號
VFB ‧‧‧回授信號
VO ‧‧‧直流電壓
VS ‧‧‧電流信號
第1圖係顯示一傳統柔性切換電源轉換器之電路架構圖。
第2圖係顯示根據本發明一實施例所述之具有同步整流電路之柔性切換電源轉換器。
第3圖係顯示根據本發明一實施例所述之積體同步整流器之電路圖。
第4圖係顯示根據本發明一實施例所述之控制器之電路圖。
第5圖係顯示根據本發明一實施例所述之最大導通時間電路。
第6圖係顯示根據本發明一實施例所述之切換控制電路。
第7圖係顯示根據本發明一實施例所述之電源管理電路。
第8圖係顯示根據本發明一實施例所述之電源管理電路之波形。
第9圖係顯示根據本發明一實施例所述之信號產生器之電路。
第10圖係顯示根據本發明一實施例所述之延遲電路。
第11圖係顯示根據本發明一實施例所述之脈波信號產生器。
第12圖係顯示根據本發明一實施例所述之同步整流電路之波形。
第13圖係顯示根據本發明另一實施例所述之同步整流柔性切換電源轉換器。
10‧‧‧變壓器
15‧‧‧電感
17‧‧‧電流感測元件
20、30‧‧‧電源電晶體
25、35‧‧‧驅動電路
70‧‧‧隔離裝置
51、52‧‧‧積體同步整流器
40、65、71、72‧‧‧電容
80‧‧‧切換控制電路
GND‧‧‧陽極端
IP ‧‧‧切換電流
NP ‧‧‧一次側線圈
NS1 、NS2 ‧‧‧二次側線圈
SA 、SB ‧‧‧驅動信號
SP 、SN ‧‧‧輸入信號端
Spulse ‧‧‧脈波信號
VFB ‧‧‧回授信號
VS ‧‧‧電流信號
XP 、XN ‧‧‧輸出信號端

Claims (15)

  1. 一種同步整流裝置，適用於柔性切換一電源轉換器，包括：一積體同步整流器，包括：一電源電晶體，耦接於一變壓器以及上述電源轉換器之輸出之間；一控制器接收一脈波信號，用以切換上述電源電晶體之開啟或關閉狀態；以及一二極體，與上述電源電晶體並聯，其中上述二極體之陽極耦接至上述電源電晶體之源極，而上述二極體之陰極耦接至上述電源電晶體之汲極；一切換控制電路，根據一電流信號產生上述脈波信號，並根據一切換信號產生複數驅動信號以切換上述變壓器；以及一隔離裝置，耦接於上述切換控制電路以及上述積體同步整流器之間，用以傳送上述脈波信號，其中上述切換信號係用以調整上述電源轉換器，而上述電流信號與上述變壓器之切換電流有關，其中，上述隔離裝置包括複數電容。
  2. 如申請專利範圍第1項所述之同步整流裝置，更包括一電流感測元件，耦接於上述變壓器，用以根據上述切換電流產生上述電流信號，其中上述脈波信號根據上述電流信號以及上述切換電流之零交越而產生。
  3. 如申請專利範圍第1項所述之同步整流裝置，其中 上述積體同步整流器之上述控制器包括一栓鎖電路，用以切換上述電源電晶體，而上述栓鎖電路係根據上述脈波信號而設定或重置。
  4. 如申請專利範圍第1項所述之同步整流裝置，其中上述脈波信號為一差動信號，而上述積體同步整流器之開啟或關閉狀態係根據上述脈波信號之極性而決定。
  5. 如申請專利範圍第1項所述之同步整流裝置，其中上述積體同步整流器更包括一最大導通時間電路，用以限制上述電源電晶體之最大導通時間。
  6. 如申請專利範圍第1項所述之同步整流裝置，其中上述切換控制電路更包括一電源管理電路，用以根據上述電源轉換器之一回授信號產生一間歇節能信號，上述間歇節能信號用以產生上述脈波信號以切換上述電源電晶體，而上述回授信號根據上述電源轉換器之輸出負載而產生。
  7. 如申請專利範圍第1項所述之同步整流裝置，其中上述驅動信號之間具有一傳輸延遲，用以柔性切換上述電源轉換器。
  8. 如申請專利範圍第1項所述之同步整流裝置，其中上述切換控制電路更包括一除二電路，用以使得上述切換信號具有50%之工作週期。
  9. 如申請專利範圍第5項所述之同步整流裝置，其中上述最大導通時間電路包括：一反相器，用以反相上述控制器產生之一閘驅動信號；一電晶體，其中上述電晶體之閘極接收反相之上述閘 驅動信號；一電容器，耦接至上述電晶體之汲極；一電流源，耦接至上述電容器；以及一AND邏輯閘，具有接收上述閘驅動信號之一第一輸入端，並具有耦接至上述電容器之一第二輸入端，其中，上述AND邏輯閘產生一最大導通時間信號以限制上述電源電晶體之上述最大導通時間；以及其中，上述電流源用以對上述電容器充電，而上述電晶體用以對上述電容器放電。
  10. 一種同步整流方法，適用於柔性切換一電源轉換器，包括：根據一電流信號產生一脈波信號；經由一隔離障壁傳送上述脈波信號；根據上述脈波信號重置或設定一栓鎖電路；以及根據上述栓鎖電路之狀態開啟或關閉一電源電晶體，其中上述電源電晶體耦接於一變壓器之二次側，用以整流，而上述電流信號根據上述變壓器之一切換電流而產生；其中，複數電容作為耦接於上述隔離障壁之一隔離裝置；以及其中，一二極體與上述電源電晶體並聯，上述二極體之陽極耦接至上述電源電晶體之源極，而上述二極體之陰極耦接至上述電源電晶體之汲極。
  11. 如申請專利範圍第10項所述之同步整流方法，其中上述脈波信號根據上述變壓器之上述切換電流之零交越 而產生。
  12. 如申請專利範圍第10項所述之同步整流方法，其中上述電流信號根據上述變壓器之一次側切換電流而產生。
  13. 如申請專利範圍第10項所述之同步整流方法，更包括根據一間歇節能信號開啟或關閉上述電源電晶體，其中上述間歇節能信號根據上述電源轉換器之一回授信號而產生，而上述回授信號根據上述電源轉換器之輸出負載而產生。
  14. 如申請專利範圍第10項所述之同步整流方法，其中上述電源電晶體之一最大導通時間受到一最大導通時間電路所限制。
  15. 如申請專利範圍第14項所述之同步整流方法，其中上述最大導通時間電路包括：一反相器，用以反相一閘驅動信號；一電晶體，其中上述電晶體之閘極接收反相之上述閘驅動信號；一電容器，耦接至上述電晶體之汲極；一電流源，耦接至上述電容器；以及一AND邏輯閘，具有接收上述閘驅動信號之一第一輸入端，並具有耦接至上述電容器之一第二輸入端，其中，上述AND邏輯閘產生一最大導通時間信號以限制上述電源電晶體之上述最大導通時間；以及其中，上述電流源用以對上述電容器充電，而上述電 晶體用以對上述電容器放電。
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