TW201701167A - 介面偵測電路 - Google Patents

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TW201701167A
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彭章龍
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鴻富錦精密工業（武漢）有限公司
鴻海精密工業股份有限公司
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    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
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    • G—PHYSICS
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Abstract

一種介面偵測電路，包括一控制電路及一連接所述控制電路之管理晶片，所述控制電路用於連接一連接器，所述連接器用於插接一外接卡，所述控制電路用於在所述連接器沒有電性插接所述外接卡時輸出一第一控制訊號及用於在所述連接器電性插接所述外接卡時輸出一第二控制訊號，所述管理晶片用於根據所述第一控制訊號輸出一第一輸出訊號及用於根據所述第二控制訊號輸出一第二輸出訊號。

Description

介面偵測電路
本發明涉及一種介面偵測電路。
於電腦之主機板設計中，通常需要使用外接卡來滿足用戶之需求。有些外接卡是藉由線纜之插頭連接到主機板之連接器上。使用時，有些線纜之插頭不能很好之插入到主機板之連接器上，從而使外接卡不能電性插接至連接器上而無法正常使用。因此，有必要設計一種能夠偵測到外接卡是否電性插接至主機板之連接器上之電路。
鑒於以上內容，有必要提供一種能夠判斷外接卡是否電性插接至主機板之連接器上之供電電路。
一種介面偵測電路，包括一控制電路及一連接所述控制電路之管理晶片，所述控制電路用於連接一連接器，所述連接器用於插接一外接卡，所述控制電路用於在所述連接器沒有電性插接所述外接卡時輸出一第一控制訊號及用於在所述連接器電性插接所述外接卡時輸出一第二控制訊號，所述管理晶片用於根據所述第一控制訊號輸出一第一輸出訊號及用於根據所述第二控制訊號輸出一第二輸出訊號。
與習知技術相比，上述介面偵測電路中，當所述連接器沒有電性插接所述外接卡時，所述控制電路輸出所述第一控制訊號，從而所述管理晶片輸出所述第一輸出訊號；當所述連接器電性插接所述外接卡時，所述控制電路輸出所述第二控制訊號，從而所述管理晶片輸出所述第二輸出訊號。使用時，可根據所述管理晶片輸出之第一輸出訊號或第二輸出訊號來判斷所述連接器是否電性插接所述外接卡。
圖1係本發明介面偵測電路之一較佳實施方式之一功能模組圖。
圖2係本發明介面偵測電路之一較佳實施方式之一電路連接圖。
請參閱圖1，本發明介面偵測電路之一較佳實施方式包括一主機板電源10、一連接所述主機板電源10之控制電路20及一連接所述控制電路20之管理晶片30。所述控制電路20用於連接一連接器40。所述主機板電源10用於給所述控制電路20供電。
所述管理晶片30用於連接一偵測系統50。所述連接器40用於插接一外接卡60。所述連接器40還用於輸出一第一偵測訊號及一第二偵測訊號。所述控制電路20用於根據所述第一偵測訊號及所述第二偵測訊號之電平值而輸出一第一控制訊號或一第二控制訊號。所述管理晶片30用於根據所述控制電路20輸出之第一控制訊號而輸出一第一輸出訊號，並用於根據所述控制電路20輸出之第二控制訊號而輸出一第二輸出訊號。所述偵測系統50用於根據所述管理晶片30輸出之第一輸出訊號或第二輸出訊號來判斷所述連接器40是否電性插接所述外接卡60。
請參閱圖2，所述主機板電源10包括一第一電源11及兩第二電源13。所述第一電源11及每一第二電源13均用於提供一3V之電壓。
所述控制電路20包括一邏輯電路21、一第一電阻R1、一第二電阻R2及一電容C1。所述邏輯電路21為一或閘，並包括一第一輸入端1、一第二輸入端2、一電源端5、一輸出端4及一接地端3。
所述管理晶片30包括一偵測端31。於一實施例中，所述管理晶片30為一南橋晶片，所述偵測端31為一通用輸入/輸出（General Purpose Input Output，GPIO）端。
所述連接器40包括一第一偵測引腳41及一第二偵測引腳43。所述第一偵測引腳41及所述第二偵測引腳43分別位於所述連接器40相對之兩端。所述第一偵測引腳41用於輸出所述第一偵測訊號，所述第二偵測引腳43用於輸出所述第二偵測訊號。所述第一偵測訊號於所述第一偵測引腳41是否電性插接所述外接卡60時具有不同之電平值，所述第二偵測訊號於所述第二偵測引腳43是否電性插接所述外接卡60時具有不同之電平值。於一實施例中，當所述第一偵測引腳41未電性插接所述外接卡60時，所述第一偵測訊號為高電平訊號，否則為低電平訊號；當所述第二偵測引腳43未電性插接所述外接卡60時，所述第二偵測訊號為高電平訊號，否則為低電平訊號。
其中一第二電源13連接所述第一電阻R1之一端。所述第一電阻R1之另一端連接所述連接器40之第一偵測引腳41及連接所述邏輯電路21之第一輸入端1。另一第二電源13連接所述第二電阻R2之一端。所述第二電阻R2之另一端連接所述連接器40之第二偵測引腳43及連接所述邏輯電路21之第二輸入端2。所述邏輯電路21之電源端5連接所述第一電源11及藉由所述電容C1接地。所述邏輯電路21之輸出端4連接所述管理晶片30之偵測端31。所述邏輯電路21之接地端3接地。
偵測時，當所述第一偵測訊號為高電平訊號及所述第二偵測訊號為高電平訊號時，所述邏輯電路21輸出一高電平之第一控制訊號，所述管理晶片30接收到所述高電平之第一控制訊號後輸出一低電平之第一輸出訊號，所述偵測系統50接收到所述低電平之第一輸出訊號後判斷所述連接器40未電性插接所述外接卡60。當所述第一偵測訊號為高電平訊號及所述第二偵測訊號為低電平訊號時，所述邏輯電路21輸出所述高電平之第一控制訊號，所述管理晶片30接收到所述高電平之第一控制訊號後輸出所述低電平之第一輸出訊號，所述偵測系統50接收到所述低電平之第一輸出訊號後判斷所述連接器40未電性插接所述外接卡60。當所述第一偵測訊號為低電平訊號及所述第二偵測訊號為高電平訊號時，所述邏輯電路21輸出所述高電平之第一控制訊號，所述管理晶片30接收到所述高電平之第一控制訊號後輸出所述低電平之第一輸出訊號，所述偵測系統50接收到所述低電平之第一輸出訊號後判斷所述連接器40未電性插接所述外接卡60。當所述第一偵測訊號為低電平訊號及所述第二偵測訊號為低電平訊號時，所述邏輯電路21輸出一低電平之第二控制訊號，所述管理晶片30接收到所述低電平之第二控制訊號後後輸出一高電平之第二輸出訊號，所述偵測系統50接收到所述高電平之第二輸出訊號後判斷所述連接器40電性插接所述外接卡60。
上述介面偵測電路中，當所述連接器40電性插接所述外接卡60時，所述連接器40輸出所述低電平之第一偵測訊號及所述低電平之第二偵測訊號，從而所述控制電路20輸出所述低電平之第二控制訊號，使所述管理晶片30輸出所述高電平之第二輸出訊號，進而所述偵測系統50判斷所述連接器40電性插接所述外接卡60；當所述外接卡60沒有電性插接至所述連接器40插接時，所述控制電路20輸出高電平之第一控制訊號，從而所述管理晶片30輸出所述低電平之第一輸出訊號，進而所述偵測系統50判斷所述連接器40未電性插接所述外接卡60，以方便判斷所述連接器40是否電性插接所述外接卡60。
綜上所述，本發明確已符合發明專利之要件，遂依法提出專利申請。惟，以上所述者僅為本發明之較佳實施方式，自不能以此限制本案之申請專利範圍。舉凡熟悉本案技藝之人士爰依本發明之精神所作之等效修飾或變化，皆應涵蓋於以下申請專利範圍內。
10‧‧‧主機板電源
11‧‧‧第一電源
13‧‧‧第二電源
20‧‧‧控制電路
21‧‧‧邏輯電路
30‧‧‧管理晶片
31‧‧‧偵測端
40‧‧‧連接器
41‧‧‧第一偵測引腳
43‧‧‧第二偵測引腳
50‧‧‧偵測系統
60‧‧‧外接卡
無
10‧‧‧主機板電源
20‧‧‧控制電路
30‧‧‧管理晶片
40‧‧‧連接器
50‧‧‧偵測系統
60‧‧‧外接卡

Claims (10)

  1. 一種介面偵測電路，包括一控制電路及一連接所述控制電路之管理晶片，所述控制電路用於連接一連接器，所述連接器用於插接一外接卡，所述控制電路用於在所述連接器沒有電性插接所述外接卡時輸出一第一控制訊號及用於在所述連接器電性插接所述外接卡時輸出一第二控制訊號，所述管理晶片用於根據所述第一控制訊號輸出一第一輸出訊號及用於根據所述第二控制訊號輸出一第二輸出訊號。
  2. 如請求項第1項所述之介面偵測電路，其中所述連接器包括一第一偵測引腳及一第二偵測引腳，所述第一偵測引腳用於輸出一第一偵測訊號，所述第二偵測引腳用於輸出一第二偵測訊號，所述第一偵測訊號於所述第一偵測引腳是否電性插接所述外接卡時具有不同之電平值，所述第二偵測訊號於所述第二偵測引腳是否電性插接所述外接卡時具有不同之電平值。
  3. 如請求項第2項所述之介面偵測電路，其中所述第一偵測引腳及所述第二偵測引腳分別位於所述連接器相對之兩端。
  4. 如請求項第2項所述之介面偵測電路，其中當所述第一偵測引腳沒有電性連接所述外接卡時，所述第一偵測訊號為高電平訊號，當所述第一偵測引腳電性連接所述外接卡時，所述第一偵測訊號為低電平訊號。
  5. 如請求項第4項所述之介面偵測電路，其中當所述第二偵測引腳沒有電性連接所述外接卡時，所述第二偵測訊號為高電平訊號，當所述第二偵測引腳電性連接所述外接卡時，所述第二偵測訊號為低高電平訊號。
  6. 如請求項第5項所述之介面偵測電路，其中所述管理晶片用於在所述第一偵測訊號及所述第二偵測訊號均為低電平時輸出所述第二輸出訊號。
  7. 如請求項第6項所述之介面偵測電路，其中所述第二輸出訊號為高電平訊號。
  8. 如請求項第2項所述之介面偵測電路，其中所述控制電路包括一邏輯電路，所述邏輯電路為一或閘，所述連接器之第一偵測引腳連接所述或閘之一第一輸入端，第二偵測引腳連接所述或閘之一第二輸入端，所述或閘之一輸出端連接所述管理晶片。
  9. 如請求項第1項所述之介面偵測電路，其中所述第一輸出訊號為低電平訊號。
  10. 如請求項第1項所述之介面偵測電路，其中所述第一控制訊號為高電平訊號。
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