TW201516660A - 主機板調試電路 - Google Patents

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Wu Zhou
Meng-Liang Yang
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Hon Hai Prec Ind Co Ltd
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Abstract

一種主機板調試電路包括一調試介面、與調試介面相連的一切換單元、與切換單元相連的一控制訊號輸出單元、及與切換單元相連的一平臺控制中樞和微處理器。該調試介面連接在該切換單元與一調試設備之間。該切換單元接收控制訊號輸出單元的發出的控制訊號，並選擇地將平臺控制中樞或微處理器的資料訊號透過調試介面傳遞至該調試設備。

Description

主機板調試電路
本發明係關於一種主機板調試電路。
在習知伺服器設計中我們需要透過基本輸入輸出系統（Basic Input Output System, BIOS）來對主機板的平臺控制中樞（Platform Controller Hub，PCH）及微處理器（Central Processing Unit，CPU）進行故障調試。在調試中，通常對PCH與CPU分別配置一個連接到主機板上的介面連接器，這樣，不僅佔用主機板上的空間，而且在切換PCH與CPU的調試時，需更換相應的介面連接器，從而導致調試效率降低。
鑒於上述內容，有必要提供一種能使平臺控制中樞和微處理器共用一個調試介面的主機板調試電路。
一種主機板調試電路，包括：
一平臺控制中樞，包括第一組資料引腳及第二組資料引腳；
一微處理器，包括第一組資料引腳及第二組資料引腳；
一控制訊號輸出單元，用於輸出一控制訊號；
一切換單元，包括邏輯控制引腳、第一組輸入端、第二組輸入端及輸出端，該平臺控制中樞的第一及第二組資料引腳與切換單元的第一組輸入端相連，該微處理器的第一及第二組資料引腳與切換單元的第二組輸入端相連，該切換單元的邏輯控制引腳接收該控制訊號輸出單元發出的控制訊號，並根據控制訊號的邏輯狀態選擇性地將第一組輸入端接收到的平臺控制中樞的資料訊號或第二組輸入端接收到微處理器的資料訊號透過該輸出端輸出；
一調試介面，連接於該切換單元，該調試介面的輸入端與該切換單元的輸出端相連，用於將切換單元輸出端的資料訊號傳遞至與調試介面相連的一調試設備。
本發明的主機板調試電路能使平臺控制中樞及微處理器透過一個切換單元共用一個調試介面，並由切換單元根據控制訊號輸出單元發出的控制訊號，選擇地將平臺控制中樞的資料訊號或微處理器的資料訊號透過該調試介面傳遞至外部調試設備。從而，不僅節省主機板上的空間，還可以方便調試，提高調試效率。
10‧‧‧主機板調試電路
20‧‧‧調試設備
11‧‧‧調試介面
12‧‧‧切換單元
14‧‧‧控制訊號輸出單元
16‧‧‧平臺控制中樞
18‧‧‧微處理器
U1‧‧‧第一切換晶片
U2‧‧‧第二切換晶片
JP1‧‧‧連接器
R1-R5‧‧‧電阻
J1‧‧‧跳帽
圖1係本發明主機板調試電路與一調試設備連接的較佳實施例的方框圖。
圖2係本發明主機板調試電路的較佳實施例的電路圖。
如圖1所示，為本發明主機板調試電路10與一調試設備20相連的較佳實施例的方框圖。該主機板調試電路10包括一調試介面11、與調試介面11相連的一切換單元12、與切換單元12相連的一控制訊號輸出單元14、與切換單元12相連的一平臺控制中樞（Platform Controller Hub，PCH）16及微處理器（Central Processing Unit，CPU）18。該切換單元12接收控制訊號輸出單元14發出的控制訊號，並選擇地將平臺控制中樞16或微處理器18的資料訊號透過調試介面11傳遞至該調試設備20。
如圖2所示，該平臺控制中樞16包括第一組資料引腳D1-D4及第二組數據引腳D5-D8。該微處理器18包括第一組資料引腳D1-D4及第二組數據引腳D5-D8。
該切換單元12包括第一切換晶片U1及第二切換晶片U2，該第一切換晶片U1及第二切換晶片U2分別包括四個第一組輸入引腳10A-10D及四個第二組輸入引腳11A-11D。其中，該平臺控制中樞16的第一組資料引腳D1-D4與第一切換晶片U1的第一組輸入引腳10A-10D對應相連，平臺控制中樞16的第二組資料引腳D5-D8與第二切換晶片U2的第一組輸入引腳10A-10D對應相連；該微處理器18的第一組資料引腳D1-D4與第一切換晶片U1的第二組輸入引腳11A-11D對應相連，微處理器18的第二組資料引腳D5-D8與第二切換晶片U2的第二組輸入引腳11A-11D對應相連。該第一切換晶片U1及第二切換晶片U2的接地引腳GND均接地。該第一切換晶片U1及第二切換晶片U2的使能引腳E分別透過電阻R1及電阻R2接地。該第一切換晶片U1及第二切換晶片U2的邏輯控制引腳S均與該控制訊號輸出單元14相連。該第一切換晶片U1及第二切換晶片U2的電源引腳VCC均連接一電壓源P3V3。
該第一切換晶片U1及第二切換晶片U2均包括四個輸出引腳YA-YD，該調試介面11包括八個資料傳輸介面D0-D7，該第一切換晶片U1的四個輸出引腳YA-YD與調試介面11的資料傳輸介面D0-D3對應相連，該第二切換晶片U2的四個輸出引腳YA-YD與調試介面11的資料傳輸介面D4-D7對應相連。
該控制訊號輸出單元14包括一連接器JP1及一跳帽J1，該連接器JP1的第一引腳P1透過一電阻R3與該電壓源P3V3相連。該連接器JP1的第二引腳P2與該第一切換晶片U1及第二切換晶片U2的邏輯控制引腳S相連，該連接器JP1的第二引腳P2還透過一電阻R4連接該電壓源P3V3。該連接器JP1的第三引腳P3透過一電阻R5接地。
本實施例的工作原理如下：
當對PCH訊號進行調試時，透過一跳帽J1將該連接器JP1的第一引腳P1與第二引腳P2相連，該連接器JP1的第二引腳P2向第一切換晶片U1及第二切換晶片U2的邏輯控制引腳S發出一高電平控制訊號，該平臺控制中樞16的8路數據訊號透過第一切換晶片U1及第二切換晶片U2的第一組輸入引腳10A-10D傳遞至該第一切換晶片U1及第二切換晶片U2的輸出引腳YA-YD，該第一切換晶片U1及第二切換晶片U2的輸出引腳YA-YD將平臺控制中樞16的8路數據訊號輸出至該調試介面11，並經該調試介面11傳遞至調試設備20。
當對CPU訊號進行調試時，透過該跳帽J1將該連接器JP1的第一引腳P2與第二引腳P3相連，該連接器JP1的第二引腳P2向第一切換晶片U1及第二切換晶片U2的邏輯控制引腳S發出一低電平控制訊號，該微處理器18的8路數據訊號透過第一切換晶片U1及第二切換晶片U2的第二組輸入引腳11A-11D傳遞至該第一切換晶片U1及第二切換晶片U2的輸出引腳YA-YD，該第一切換晶片U1及第二切換晶片U2的輸出引腳YA-YD將微處理器18的8路數據訊號輸出至該調試介面11，並經該調試介面11傳遞至調試設備20。
由於平臺控制中樞16與微處理器18透過切換單元12共用一個調試介面11，並由切換單元12根據接收到的控制訊號輸出單元14發出的控制訊號，而選擇地將平臺控制中樞16的資料訊號或微處理器18的資料訊號透過該調試介面11傳遞至調試設備20。由此，便可實現節省主機板上的空間，且方便調試，提高調試效率效果。
綜上所述，本發明確已符合發明專利的要件，爰依法提出專利申請。惟，以上所述者僅為本發明的較佳實施方式，本發明的範圍並不以上述實施方式為限，舉凡熟悉本案技藝的人士爰依本發明的精神所作的等效修飾或變化，皆應涵蓋於以下申請專利範圍內。
無
10‧‧‧主機板調試電路
20‧‧‧調試設備
11‧‧‧調試介面
12‧‧‧切換單元
14‧‧‧控制訊號輸出單元
16‧‧‧平臺控制中樞
18‧‧‧微處理器

Claims (4)

  1. 一種主機板調試電路，包括：
    一平臺控制中樞，包括第一組資料引腳及第二組資料引腳；
    一微處理器，包括第一組資料引腳及第二組資料引腳；
    一控制訊號輸出單元，用於輸出一控制訊號；
    一切換單元，包括邏輯控制引腳、第一組輸入端、第二組輸入端及輸出端，該平臺控制中樞的第一及第二組資料引腳與切換單元的第一組輸入端相連，該微處理器的第一及第二組資料引腳與切換單元的第二組輸入端相連，該切換單元的邏輯控制引腳接收該控制訊號輸出單元發出的控制訊號，並根據控制訊號的邏輯狀態選擇性地將第一組輸入端接收到的平臺控制中樞的資料訊號透過該輸出端輸出或將第二組輸入端接收到微處理器的資料訊號透過該輸出端輸出；
    一調試介面，連接於該切換單元，該調試介面的輸入端與該切換單元的輸出端相連，用於將切換單元輸出端的資料訊號傳遞至與調試介面相連的一調試設備。
  2. 如申請專利範圍第1項所述的主機板調試電路，其中該切換單元包括第一切換晶片和第二切換晶片，該第一及第二切換晶片的使能引腳均接地，第一及第二切換晶片的接地引腳均接地，該第一及第二切換晶片的電壓引腳均連接一電壓源，該第一及第二切換晶片均包括第一組輸入端及第二組輸入端，該切換單元的第一組輸入端包括第一及第二切換晶片的第一組輸入端，該切換單元的第二組輸入端包括第一及第二切換晶片的第二組輸入端，第一及第二切換晶片的第一組輸入端和第二組輸入端均包括四個輸入引腳，第一及第二切換晶片的輸出端包括四個與調試介面相連並用以將的輸出引腳，切換單元的第一組輸入端或第二組輸入端接收到的訊號傳遞至調試介面，該第一及第二切換晶片的邏輯控制引腳接收控制訊號輸出單元發出的控制訊號，當控制訊號輸出單元發出的控制訊號為高電平時，第一及第二切換晶片輸出第一組輸入端接收到的平臺控制中樞的資料訊號，並將該平臺控制中樞的資料訊號透過該調試介面傳遞至該調試設備；當控制訊號輸出單元發出的控制訊號為低電平時，第一及第二切換晶片輸出第二組輸出端接收到的微處理器的資料訊號，並將該微處理器的資料訊號透過該調試介面傳遞至該調試設備。
  3. 如申請專利範圍第2項所述的主機板調試電路，其中該控制訊號輸出單元包括一連接器及一跳帽，該連接器的第一引腳透過一第一電阻連接該電壓源，該連接器的第二引腳與該第一及第二切換晶片的邏輯控制引腳相連，且透過一第二電阻連接該電壓源，該連接器的第三引腳透過一第三電阻接地，當該跳帽將該連接器的第一及第二引腳相連時，該連接器的第二引腳輸出一高電平控制訊號給該第一及第二切換晶片的邏輯控制引腳；當該跳帽將該連接器的第二及第三引腳相連時，該連接器的第二引腳輸出一低電平控制訊號給該第一及第二切換晶片的邏輯控制引腳。
  4. 如申請專利範圍第2項所述的主機板調試電路，其中該第一切換晶片的使能引腳通過一第四電阻接地，該第二切換晶片的使能引腳通過一第五電阻接地。
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