TW201416845A - 主機板 - Google Patents

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Chun-Sheng Chen
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Hon Hai Prec Ind Co Ltd
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Abstract

本發明涉及一種主機板,該主機板包括第一電源、濾波電容及PCI-E插槽,PCI-E插槽包括電源腳,接收自第一電源輸出電壓以驅動PCI-E插槽工作,同時經由濾波電容接地,該主機板還包括軟關機偵測單元、電源控制電路及放電電路,該軟關機偵測電路偵測該主機板是否接收到軟關機指令,並在該主機板接收到該軟關機指令時輸出第一控制訊號,電源控制電路在第一控制訊號控制下關斷第一電源向電源腳供電,放電電路與濾波電容並聯,當電源控制電路關斷第一電源向PCI-E插槽供電時,濾波電容及該PCI-E插槽殘餘電能經由放電電路放電。

Description

主機板
本發明涉及一種主機板。
主機板上之快捷外設互聯標準介面(Peripheral Component Interconnect Express,PCI-E)係個人電腦中常用之匯流排界面之一。在現有PCI-E插槽供電電路中,一外部電源連接至PCI-E插槽之電源接腳,以給該PCI-E插槽提供3.3V之供電電源,該PCI-E插槽之電源接腳同時與一濾波電容相連。通常,主機板在軟關機(Soft shutdown)狀態下,該3.3V電源仍然持續供電,且該濾波電容還沒有放電完畢。因此,PCI-E插槽在軟關機狀態時仍然是有電之,當PCI-E插槽上安插PCI-E設備時則會消耗電能。有時會超過歐盟認證之節能要求(歐盟認證要求系統在軟關機狀態下耗電不能超過1W),而達不到節能需求。
有鑑於此,有必要提供一種節約能量之主機板。
一種主機板,該主機板包括第一電源、濾波電容及PCI-E插槽,該PCI-E插槽包括電源腳,該PCI-E插槽之電源腳接收自該第一電源輸出之電壓驅動該PCI-E插槽工作,同時經由該濾波電容接地,該主機板還包括一軟關機偵測單元、一電源控制電路及一放電電路,該軟關機偵測電路偵測該主機板是否接收到一軟關機指令,並在偵測到該主機板接收到該軟關機指令時輸出一第一控制訊號,該電源控制電路用於在該第一控制訊號之控制下關斷該第一電源向該PCI-E插槽之電源腳之供電,該放電電路與該濾波電容並聯,當該電源控制電路關斷該第一電源向該PCI-E插槽之供電時,該濾波電容及該PCI-E插槽之殘餘電能經由該放電電路放電。
與先前技術相較,本發明之主機板通過軟關機偵測單元偵測該主機板是否接受到軟關機指令,並在該主機板接受到軟關機指令時,輸出第一控制訊號。該電源控制電路在該第一控制訊號之控制下關斷該第一電源向該PCI-E插槽之電源腳供電。該濾波電容C及該PCI-E插槽之殘餘電能經由該放電電路放電。經過一段時間後,該PCI-E插槽上電壓為零。此時,安插在該PCI-E插槽上之PCI-E設備在軟關機狀態下不會再額外耗電,從而達到了節約主機板能量之技術效果。
下面將結合附圖對本發明作具體介紹。請參閱圖1,其是本發明主機板一較佳實施方式之電路圖。一種主機板1,該主機板1包括第一電源40、濾波電容C及PCI-E插槽50。該PCI-E插槽50包括電源腳51,該PCI-E插槽50之電源腳51接收自該第一電源40輸出之電壓驅動該PCI-E插槽50工作,同時經由該濾波電容C接地。該主機板1還包括一軟關機偵測單元10、一電源控制電路20及一放電電路30。該軟關機偵測單元10偵測該主機板1是否接收到一軟關機指令,並在偵測到該主機板1接收到該軟關機指令時輸出一第一控制訊號,該電源控制電路20用於在該第一控制訊號之控制下關斷該第一電源40向該PCI-E插槽50之電源腳51之供電。該放電電路30與該濾波電容C並聯,當該電源控制電路20關斷該第一電源40向該PCI-E插槽50之供電時,該濾波電容C及該PCI-E插槽50之殘餘電能經由該放電電路30放電。
當該軟關機偵測單元10未接收到軟關機指令時輸出一第二控制訊號,該電源控制電路20在該第二控制訊號之控制下保持該第一電源40向該PCI-E插槽50之電源腳51之供電。在一實施方式中,該第一控制訊號及該第二控制訊號為PMW (Pulse Width Modulation) 控制訊號或其他之ACPI(Advanced Configuration and Power Management Interface)控制訊號。
該電源控制電路20包括第一開關單元21、第二開關單元23、第一電阻R1及第二電源25。
該第二電源25經由該第一開關單元21接地,從而定義一連接在該第二電源25與該第一開關單元21之間之節點N。該第二開關單元23連接在該第一電源40與該PCI-E插槽50之電源腳51之間,且該第二開關單元23之控制端連接至該節點N,該第一開關單元21在該軟關機偵測單元10發出之該第一控制訊號之作用下拉低該節點N之電位,迫使該第二開關單元23關斷,從而關斷該第一電源40向該PCI-E插槽50之供電。該第一電阻R1連接該第二電源該節點N之間。該第一開關單元21包括第一導通控制端211、第二導通控制端212及第三導通控制端213。該第一導通控制端211與該軟關機偵測單元10相連,用於接收該第一控制訊號及該第二控制訊號,並在該第一控制訊號或該第二控制訊號之控制下控制該第二導通控制端212與該第三導通控制端213導通或者截止。該第二導通控制端212接地,該第三導通控制端213通過該第一電阻R1與該第二電源25相連。該第二電源25之電壓值大於該第一電源40之電壓值,在本實施方式中,該第二電源25之電壓值為5V。該第一開關單元21為NMOS(Negative channel-Metal-Oxide-Semiconductor)場效應電晶體。該第一導通控制端211為該NMOS場效應電晶體之閘極,該第二導通控制端212為該NMOS場效應電晶體之源極,該第三導通控制端213為該NMOS場效應電晶體之汲極。
該第二開關單元23包括第四導通控制端231、第五導通控制端232及第六導通控制端233。該第四導通控制端231連接該第三導通控制端213,該第五導通控制端232連接該第一電源40,該第六導通控制端233通過該放電電路30接地。在本實施方式中,該第一電源40之電壓值為3.3V。該第二開關單元23為PMOS(Positive channel-Metal-Oxide-Semiconductor)場效應電晶體。該第四導通控制端231為該PMOS場效應電晶體之閘極,該第五導通控制端232為該PMOS場效應電晶體之源極,該第六導通控制端233為該PMOS場效應電晶體之汲極。該放電電路30一端連接該第六導通控制端233,另一端接地。該濾波電容C與該放電電路30並聯,該PCI-E插槽50連接該第六導通控制端233。在本實施方式中,該第一導通控制端211為該第一開關單元21之控制端,該第四導通控制端231為該第二開關單元23之控制端。
在本實施方式中,該放電電路30為電阻。在一種變更之實施方式中,該放電電路30也可為二極體,該二極體之正極連接該電源腳51,該二極體之負極接地。
當主機板1處於軟關機狀態時,該軟關機偵測單元10輸出低電平之第一控制訊號,從而使該第一開關單元21截止。即,該第一導通控制端211控制該第二導通控制端212及第三導通控制端213截止。進一步,該第二開關單元23截止。該濾波電容C與該放電電路30組成放電回路,該濾波電容C及該PCI-E插槽50之殘餘電能經由該放電電路30釋放出去。則,該PCI-E插槽50上是沒有電之,與該PCI-E插槽50相連之PCI-E設備也不再工作。
當主機板1處於工作狀態時,該軟關機偵測單元10輸出高電平之第二控制訊號,從而使該第一開關單元21導通。即,該第一導通控制端211控制該第二導通控制端212及第三導通控制端213導通。進一步,該第二開關單元23導通。該PCI-E插槽50上有電,與該PCI-E插槽50相連之PCI-E設備可以工作。
可以理解地,在其他變更實施方式中,該第一開關單元21及該第二開關單元23亦可採用其他類型之場效應管或者三極體來代替,甚至其他具有電子開關功能之電子元件均可。比如,當利用三極體來替代該第一開關單元21時,該三極體之基極對應該第一開關單元21之該第一導通控制端211,該三極體之射極對應於該第一開關單元21之第二導通控制端212,該三極體之集極對應該第一開關單元21之第三導通控制端213。
與先前技術相較,本發明之主機板1通過軟關機偵測單元10偵測該主機板1是否接受到軟關機指令,並在該主機板1接受到軟關機指令時,輸出第一控制訊號。本發明之電源控制電路20在該第一控制訊號之控制下關斷該第一電源40向該PCI-E插槽50之電源腳51供電。該濾波電容C及該PCI-E插槽50之殘餘電能經由該放電電路30放電。經過一段時間後,該PCI-E插槽50上電壓為零。此時,安插在該PCI-E插槽50上之PCI-E設備在軟關機狀態下不會再額外耗電,從而達到了節約主機板1能量之技術效果。
以上實施例僅用以說明本發明之技術方案而非限制,儘管參照較佳實施例對本發明進行了詳細說明,本領域之普通技術人員應當理解,可以對本發明之技術方案進行修改或等同替換,而不脫離本發明技術方案之精神和範圍。
1...主機板
10...軟關機偵測單元
20...電源控制電路
30...放電電路
21...第一開關單元
23...第二開關單元
25...第二電源
40...第一電源
50...PCI-E插槽
51...電源腳
C...濾波電容
R1...第一電阻
N...節點
211...第一導通控制端
212...第二導通控制端
213...第三導通控制端
231...第四導通控制端
232...第五導通控制端
233...第六導通控制端
圖1是本發明主機板一較佳實施方式之電路圖。
1...主機板
10...軟關機偵測單元
20...電源控制電路
30...放電電路
21...第一開關單元
23...第二開關單元
25...第二電源
40...第一電源
50...PCI-E插槽
51...電源腳
C...濾波電容
R1...第一電阻
N...節點
211...第一導通控制端
212...第二導通控制端
213...第三導通控制端
231...第四導通控制端
232...第五導通控制端
233...第六導通控制端

Claims (10)

  1. 一種主機板,該主機板包括第一電源、濾波電容及PCI-E插槽,該PCI-E插槽包括電源腳,該PCI-E插槽之電源腳接收自該第一電源輸出之電壓驅動該PCI-E插槽工作,同時經由該濾波電容接地,其中,該主機板還包括一軟關機偵測單元、一電源控制電路及一放電電路,該軟關機偵測電路偵測該主機板是否接收到一軟關機指令,並在偵測到該主機板接收到該軟關機指令時輸出一第一控制訊號,該電源控制電路用於在該第一控制訊號之控制下關斷該第一電源向該PCI-E插槽之電源腳之供電,該放電電路與該濾波電容並聯,當該電源控制電路關斷該第一電源向該PCI-E插槽之供電時,該濾波電容及該PCI-E插槽之殘餘電能經由該放電電路放電。
  2. 如申請專利範圍第1項所述之主機板,其中:該軟關機偵測單元未接收到軟關機指令時輸出一第二控制訊號,該電源控制電路在該第二控制訊號之控制下保持該第一電源向該PCI-E插槽之電源腳之供電。
  3. 如申請專利範圍第1項所述之主機板,其中:該電源控制電路包括一第一開關單元、一第二開關單元及第二電源,該第二電源經由該第一開關單元接地,從而定義一連接在該第二電源與該第一開關單元之間之節點,該第二開關單元連接在該第一電源與該PCI-E插槽之電源腳之間,且該第二開關單元之控制端連接至該節點,該第一開關單元在該軟關機偵測單元發出之該第一控制訊號之作用下拉低該節點之電位,迫使該第二開關單元關斷,從而關斷該第一電源向該PCI-E插槽之供電。
  4. 如申請專利範圍第3項所述之主機板,其中,該電源控制電路還包括第一電阻,該第一電阻連接該第二電源及該第二電源與該第一開關單元之間之該節點。
  5. 如申請專利範圍第3項所述之主機板,其中,該第一開關單元包括第一導通控制端、第二導通控制端及第三導通控制端,該第二開關單元包括第四導通控制端、第五導通控制端及第六導通控制端,該第一導通控制端連接該軟關機偵測單元接收該控制訊號,並在該控制訊號之控制下控制該第二導通控制端與該第三導通控制端導通或者截止,該第四導通控制端連接該第三導通控制端,以作為該第二開關單元之控制端。
  6. 如申請專利範圍第5項所述之主機板,其中,該第一開關單元為NMOS場效應電晶體,該第一導通控制端為該NMOS場效應電晶體之閘極,該第二導通控制端為該NMOS場效應電晶體之源極,該第三導通控制端為該NMOS場效應電晶體之汲極,該第二開關單元為PMOS場效應電晶體,該第四導通控制端為該PMOS場效應電晶體之閘極,該第五導通控制端為該PMOS場效應電晶體之源極,該第六導通控制端為該PMOS場效應電晶體之汲極。
  7. 如申請專利範圍第5項所述之主機板,其中,該第一開關單元為三極體,該第一導通控制端為該三極體之基極,該第二導通控制端為該三極體之射極,該第三導通控制端為該三極體之集極。
  8. 如申請專利範圍第2項所述之主機板,其中,該第一控制訊號及該第二控制訊號為PMW控制訊號。
  9. 如申請專利範圍第3項所述之主機板,其中,該第二電源之電壓值大於該第一電源之電壓值。
  10. 如申請專利範圍第1至9任一項所述之主機板,其中,該放電電路為一電阻或一二極體。
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