SU656054A1 - Homogeneous computing medium element - Google Patents
Homogeneous computing medium elementInfo
- Publication number
- SU656054A1 SU656054A1 SU721799416A SU1799416A SU656054A1 SU 656054 A1 SU656054 A1 SU 656054A1 SU 721799416 A SU721799416 A SU 721799416A SU 1799416 A SU1799416 A SU 1799416A SU 656054 A1 SU656054 A1 SU 656054A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- medium element
- homogeneous computing
- computing medium
- homogeneous
- decoder
- Prior art date
Links
Description
1one
Изобретение относитс к вычисли тельной технике, может быть использовано при разработке вычислительныз средств на основе однородных вычислительных сред.The invention relates to computing technology, can be used in the development of computing tools based on homogeneous computing environments.
Известен элемент однородной вычислительной среды, содержащий элементы И, дешифраторы и статический регистр l .A well-known element of a homogeneous computing environment, containing the elements And, decoders and static register l.
Недостаток этого элемента - невозможность получени управл емой за-держки выходного сигнала.The disadvantage of this element is the impossibility of obtaining a controlled output delay.
Известен элемент однородной вычислительной среды, содержащий статический регистр, логический узел, два элемента И, элемент ИЛИ и элемент НЕ 2 .A known element of a homogeneous computing environment containing a static register, a logical node, two AND elements, an OR element, and an NOT element 2.
Недостаток этого элемента - невозможность получени регулируемой- задержки выходного сигнала.The disadvantage of this element is the impossibility of obtaining an adjustable-delayed output signal.
Цель изобретени - получение регу .лируемой задержки выходного сигнала.The purpose of the invention is to obtain a controlled output delay.
Цель достигаетс тем, Что в элемент однородной вычислительной среды, содержащей статический регистр, логический узел, два элемента И, элемент ИЛИ и элемент НЕ,- введены два дешифратора входных переменных, дешифратор управл ющей переменной, Г5ешифратор кода операций, йинамичес-кйй регистр и дешифратор-селектор, перва и втора группа входов, которого соединены соответственно с выходами динамического регистра и с первой группой выходов статического регистра, втора , треть , четверта и п та группы выходов которого соединены с первыми группами входов соответственно первого и BTOpojo дешифраторов входных переменных, дешифратора кода операций и дешифратора управл ющей переменной) входы логического узла соединены с выходами дешифраторов входных переменных и дешифратора кодов операций, выход логического узла соединен с первымивходами первого и второго элементов И,The goal is achieved by the fact that an element of a homogeneous computing environment containing a static register, a logical node, two AND elements, an OR element and an NOT element, introduced two decoders of input variables, a decoder of a control variable, an F5 encoder of an operation code, a dynamic register and a decoder -selector, first and second group of inputs, which are connected respectively to the outputs of the dynamic register and with the first group of outputs of the static register; second, third, fourth and fifth groups of the outputs of which are connected to the first groups of inputs of the first and BTOpojo decoders of the input variables, the opcode decoder and the decoder of the control variable, respectively) the inputs of the logical node are connected to the outputs of the decoders of the input variables and the decoder of operation codes, the output of the logical node is connected to the first inputs of the first and second elements And,
Claims (2)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU721799416A SU656054A1 (en) | 1972-06-20 | 1972-06-20 | Homogeneous computing medium element |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU721799416A SU656054A1 (en) | 1972-06-20 | 1972-06-20 | Homogeneous computing medium element |
Publications (1)
Publication Number | Publication Date |
---|---|
SU656054A1 true SU656054A1 (en) | 1979-04-05 |
Family
ID=20518616
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU721799416A SU656054A1 (en) | 1972-06-20 | 1972-06-20 | Homogeneous computing medium element |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU656054A1 (en) |
-
1972
- 1972-06-20 SU SU721799416A patent/SU656054A1/en active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU656054A1 (en) | Homogeneous computing medium element | |
GB955295A (en) | Converter devices | |
BR7406498D0 (en) | COMPOSITION PROMOTING THE RICE DEVELOPMENT AND ITS APPLICATIONS | |
SU483778A1 (en) | Device with one steady state | |
SU497594A1 (en) | Logic circuit | |
SU564635A1 (en) | Microprogramming control device | |
JPS5235535A (en) | Semiconductor memory | |
SU441672A1 (en) | Multi-decade scaling device with controllable conversion factor | |
SU456276A1 (en) | Dividing device | |
SU462268A1 (en) | Differential amplifier | |
SU543958A1 (en) | Simulator for digital differential analyzer | |
ES318469A1 (en) | Binary to multilevel conversion by combining redundant information signal with transition encoded information signal | |
SU739509A1 (en) | Digital functional converter | |
SU839059A1 (en) | Logical redundancy device | |
SU496652A1 (en) | Phase Shift Amplifier | |
SU875382A1 (en) | Device for forming addresses | |
SU830467A1 (en) | Shaft angular position-to-code converter | |
SU1764050A1 (en) | Mogul three adder | |
SU514282A1 (en) | Voltage stabilizer | |
GB1498353A (en) | Data processing circuitry | |
SU480188A1 (en) | Voltage converter to code | |
RU2022466C1 (en) | Code converter | |
SU429504A1 (en) | ||
SU429431A1 (en) | INTEGRATOR | |
SU1564730A1 (en) | Bipolar code converter |