SU585503A1 - Устройство дл возведени в степень - Google Patents
Устройство дл возведени в степеньInfo
- Publication number
- SU585503A1 SU585503A1 SU762336370A SU2336370A SU585503A1 SU 585503 A1 SU585503 A1 SU 585503A1 SU 762336370 A SU762336370 A SU 762336370A SU 2336370 A SU2336370 A SU 2336370A SU 585503 A1 SU585503 A1 SU 585503A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- code
- voltage
- keys
- input
- converter
- Prior art date
Links
Landscapes
- Control By Computers (AREA)
Description
1
Изобретение относитс к области вычислительной техники и может быть использовано дл возведени в.степень величин, заданных в виде числовых кодов.
Известны устройства дл возведени в
степень, содержащие генераторы экспоненциапь51ых напр жений с перестраиваемыми посто нными времени, но они образуют аналоговые входные сигналы Flj.
Известно устройство дл возведени в
степень, содержащее операционный усилитель, две группы входных масштабных резисторов операционного усилител через соответствующие группы ключей, св занных управл ющими входами с соответствующими регистрами, подключены к выходам соответствующих логарифмических преобразователей код-напр жение , первые входы которых св заны с истоником опорного напр жени .,а второй вход первого лот-арифмического преобразовател код-напр жение соединен с источником входного сигнала, нуль-орган и блок выработки цифрового кода 2.
Известное устройство не поавол ог сразу осуществить операцию возведени в дробную степень и обусловлено это тем, что в устройстве возведение - в степень или извлечение корн происходит путем последовательного соединени определенного числа цифро-анапо говых преобразователей первой ступени, равного целому показателю степени. Кроме того, наличие в известном устройстве большого числа цифро-аналоговых преобразователей первой ступени усложн ет конструкцию устройства.
Целью изобретени вл етс расширение класса решаемых задач и упрощение устройст ва.
Достигаетс это благодар тому, что выход операционного усилител через последовательно соединенные нуль-орган и блок выработки цифрового кода подключен к второму входу второго логарифмического преобразовател код-напр жение и выходу устройства . Это позвол ет осуществить операцию вазводени цифрового кода в любую степень;включа и дробную.
Claims (2)
- Па чертеже приведена функциональна схома устройства дл возведени в степень. Устройство содрржнт первый логарифмический преобразователь код-напр жение 1, операционный усилитель 2 с входными мас табными резисторами 3 -3 + , и резисто ром обратной св зи 4, а также последовательно включенные нуль-орган 5, блок выработки цифрового кода 6 и второй логариф мический преобразователь код-напр жение 7. Ключи 8 -8д управл ютс регистром 9, а ключи 10 - 10 управ л даете дополнительным регистром 11. Устройство работает следующим образом На регистр 9 записываетс код числител дробного показател степени -S- , в на дополнительный регистр 11 записьЬаетс код знаменател CJ- . Регистр 9 управл ет ключами 8 -8д так, что открыты Р клю чей; дополнительный регистр 11 управл ет ключами lOj - lOtr так, что открыты а, ключей. На преобразователь 1 поступае входной цифровой код X , и выходное напр жение и преобразовател 1 равно Ui Uo tog; X , где I/O - опорное напр жение. Ца преобразователь 7 поступает цифровой код Y с блока выработки цифрового кода 6. Выходное напр жение U«j, преобразовател 7 противоположно по знаку напр жению и и равно tog . Если сопротивлени всех входных резист равны, то при Р откры тых ключах 8j - 8п и Ц, открытых lO,j - 10 выходное напр жение аю операционного усилител 2 равно U6btxU,CP oex c eog-Y), Ц) где Ид - сопротивление резистора 4 ; Я - сопротивление входных резисторов 3 - З- уль-орган 5 управл ет цепью обратной св зи, составленной блоком выработки цифрового кода 6 и преобразователем 7 так, что все врем поддерживаетс равенство нулю выходного напр жени операционного усилител 2 Ug,,,. При -jiwM из формулы (I) следует, что ци(()ровой код, вл кцнийс выходной величиной , равен ; у Таким образом, устройство осуществл ет возведение как в целые степени, так и в степени, заданные рациональной дробью. Предлагаемое устройство может быть выполнено на стандартных цифровых микросхемах , быстродействующих интегральных ключах и на интегральном cepийнo l усилителе посто нного тока. Применение только двух цифро-аналоговых преобразователей позвол ет снизить вес, уменьшить объем устройства а также повысить надежность за счет упрощени конструкции устройства. Предлагаемое устройство может найти применение прифункциональной обработке цифровой информации в специализированных вычислительных устройствах. Формула изобретени Устройство дл возведени в степень, содержащее операдионный усилитель, две группы входных масштабньГх резисторсе one- рационного усилител через соответствующие группы ключей, св занных управл ющими входами с соответствующими регистрами, подключены к выходам соответствующих логарифмических преобразователей код-напр жение, первые входы которых св заны с источником опорного напр жени , а второй вход первого логарифмического преобразовател код-напр жение соединен с источником входного сигнала , нуль-орган и блок выработки цифрового кода, отличающеес тем, что, с целью расширени класса рещаемых задач и упрощени устройства, выход операционного усилител через последовательно соединенные нуль-орган и блок выработки цифрового кода подключен к второму входу второго логарифмического преобразовател коднапр жение и выходу устройства. Источники информации, прин тые во внимание при экспертизе: 1.Патент США № 3679884 МКЙ 235-193.5, 1974.
- 2.Авторское свидетельство СССР N° 285362, М. Кл. G- 06 G- 7/20, 1965.ВыхвУ
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU762336370A SU585503A1 (ru) | 1976-03-17 | 1976-03-17 | Устройство дл возведени в степень |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU762336370A SU585503A1 (ru) | 1976-03-17 | 1976-03-17 | Устройство дл возведени в степень |
Publications (1)
Publication Number | Publication Date |
---|---|
SU585503A1 true SU585503A1 (ru) | 1977-12-25 |
Family
ID=20652932
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU762336370A SU585503A1 (ru) | 1976-03-17 | 1976-03-17 | Устройство дл возведени в степень |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU585503A1 (ru) |
-
1976
- 1976-03-17 SU SU762336370A patent/SU585503A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US3264457A (en) | Hybrid digital-analog nonlinear function generator | |
SU585503A1 (ru) | Устройство дл возведени в степень | |
US3488588A (en) | Digital voltmeter | |
SU661525A1 (ru) | Экспоненциальный калибратор напр жени | |
SU752394A1 (ru) | Гибридный синусно-косинусный функциональный преобразователь | |
SU696489A1 (ru) | Функциональный декодирующий преобразователь | |
SU718918A1 (ru) | След ща цифрова декада | |
SU970392A1 (ru) | Врем -импульсный арксинусный преобразователь | |
SU1005298A1 (ru) | Цифроаналоговый преобразователь | |
SU834718A2 (ru) | Устройство дл вычислени логариф-MA ОТНОшЕНи дВуХ НАпР жЕНий | |
SU1599872A1 (ru) | Блок кодоуправл емого сопротивлени | |
SU860088A1 (ru) | Квадратор | |
SU591873A1 (ru) | Ступенчато-линейный экстрапол тор | |
SU532174A2 (ru) | Измерительный преобразователь напр жени в частоту следовани импульсов | |
SU813773A1 (ru) | Преобразователь электрических сиг-НАлОВ МОСТОВыХ дАТчиКОВ B чАСТОТу | |
SU744655A1 (ru) | Устройство дл возведени в степень | |
SU1056448A1 (ru) | Разр дный элемент дл преобразовател кода в напр жение каскадной структуры | |
SU926680A1 (ru) | Диодный фукциональный преобразователь | |
SU780015A1 (ru) | Четырехквадратное делительное устройство | |
SU470820A1 (ru) | Функциональный преобразователь | |
SU888140A1 (ru) | Множительно-делительное устройство | |
SU807326A1 (ru) | Аналоговый интегратор | |
SU411472A1 (ru) | ||
SU879765A1 (ru) | Способ аналого-цифрового преобразовани | |
SU746324A1 (ru) | Преобразователь сдвига фаз в цифровой код |