SU1385246A1 - Цифровой частотный компаратор - Google Patents
Цифровой частотный компаратор Download PDFInfo
- Publication number
- SU1385246A1 SU1385246A1 SU864092573A SU4092573A SU1385246A1 SU 1385246 A1 SU1385246 A1 SU 1385246A1 SU 864092573 A SU864092573 A SU 864092573A SU 4092573 A SU4092573 A SU 4092573A SU 1385246 A1 SU1385246 A1 SU 1385246A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- output
- pulses
- counter
- reset
- Prior art date
Links
Landscapes
- Measuring Frequencies, Analyzing Spectra (AREA)
Abstract
Изобретение относитс к радиотехнике . Цель изобретени - повьшё- . ние точности при работе с ЧМ-сигнала- .ми. Устр-во содержит счетчики импульсов (си) 1 и 2, зл-ты И 4 и 6, RS-триггер 7. Введены СИ 3, реверсивный счетчик (РС) 5. Сигналы с частотами f, и fJ, периодически измен ющимис относительно опорной частоты f , поступают соответственно на тактовые входы СИ 1 и 2, а сигналы f(,n - на СИ 3. В случае, когда f, ,n, первым заполн етс СИ 1, и на его выход поступают импульсы с частотой f,/2 , где N - разр дность счетчика. В случае, когда ,fjj , первым заполн етс СИ 2, и на его выход поступают импульсы с частотой . Эти импульсы поступают на вход обратного счета PC 5 и на 2-й вход зл-та 4, по выходному сигналу к-рого СИ 1-3 устанавливаютс в исходное состо ние. Сигналы, поступающие на вход : пр мого шш обратного счета PC 5, увеличивают или уменьшают код PC 5 до по влени сигнала переноса или заема на его выходах, к-рые устанавливают RS-триггер 7 в состо ние, соответствующее определенному соотношению входных частот. Одновременно один из сигналов переноса или заема через эл-т 6 поступает на вход установки PC 5, к-рый устанавливаетс в исходное состо ние, при к-ром число, записываемое в него, равно половине объема PC 5. Дл случа , когда fan вл етс макс., первым заполнитс СИ 3 По его выходному сигналу через эл-т 4 все СИ 1-3 установ тс в исходное состо ние, а на выходе устр-ва сохранитс предыдущий результат сравнени . I ил. (Л С
Description
10
Изобретение относитс к радиотехнике и может быть использовано в системах св зи с частотно-модулированными сигналами (например, дл выборки максимального речевого сигнала), в системах автоматического управлени , а также в электроизмерительных устройствах .
. Цель изобретени - повьшение точности при работе с частотно-модулированными сигналами.
На чертеже приведена структурна электрическа схема цифрового частотного компаратора.
Цифровой частотньй компаратор содержит первый 1, второй 2 и третий 3 счетчики импульсов, первый элемент И 4, реверсивный счетчик 5, второй элемент И 6 и RS-триггер 7.
Цифровой частотный компаратор работает следующим образом.
Сигналы с частотами f, и f, периодически измен ющимис относительно опорной частоты f, поступают соот- 25 ветственно на тактовые входы счетчиков 1 и 2 импульсов, а сигналы опорной частоты fj,n - на тактовый вход
ленному соотношению входных частот. Одновременно один из сигналов переноса или заема через второй элемент г И 6 поступает на вход установки реверсивного счетчика 5, который устанавливаетс в исходное состо ние, при котором число, записьшаемое в него, равно половине объема реверсивного счетчика 5.
Дл случай, когда f вл етс
максимальной из «трех входньпс частот, первым заполн етс третий счетчик 3 импульсов, и по его выходному сигна- 15 лу через первый элемент И 4 счетчики 1-3 импульсов устанавливаютс в исходное состо ние, а на выходе цифрового частотного компаратора сохран етс предьщущий результат сравнени .
20
Claims (1)
- Формула изобретениЦифровой частотный компаратор, содержащий первый и второй счетчики импульсов, тактовые входы которых вл ютс первым и вторым входами цифрового частотного компаратора соответственно , входы сброса счетчиков импульсов объединены и подключены ксчетчика 3 импульсов. В случае, когда f, , первым заполн етс пер-30 выходу первого элемента И, первый вый счетчик 1 импульсов, и на его и второй входы которого соединены с выход поступают импульсы с частотой выходами первого и второго счетчиков f,, где N - разр дность счетчика. импульсов соответственно, RS-триггер, Эти импульсы поступают на вход пр мо- пр мой и инверсный выходы которого Го счета импульсов реверсивного счет- ,r вл ютс выходами цифрового частот- чика 5 и на первый вход первого эле- ного компаратора, и второй элемент мента И 4, по выходному сигналу ко- И, отличающийс тем, что,с целью повышени точности при работе с- частотно-модулированными сигна- 4Q лами, в него введены реверсивный счетчик и третий счетчик импульсов, тактовый вход которого, вл етс тре- тгьим входом цифрового частотноготорого счетчики 1-3 импульсов устанавливаютс в исходное состо ние, и цикл сравнени повтор етс . В случае , когда ,fon, первым заполн етс второй счетчик 2 импульсов, и на его выход поступают импульсы с частотой . Эти .импульсы поступают на вход обратного счета импульсов реверсивного счетчика 5 и на второй вход первого элемента И 4, по выходному сигналу которого счетчики 1-3 импульсов устанавливаютс в исходное состо ние. Сигналы, поступающие на вход пр мого или обратного счета импульсов реверсивного счетчика 5, увеличивают или уменьшают код реверсивного счетчика до по влени сигнакомпаратора ,а его выход подключен,с К третьему входу первого элемента И, выход которого подключен к входу сброса третьего счетчика импульсов, вход пр мого счета и вход обратного счета реверсивного счетчика подключены к выходам первого и второго счетчиков импульсов соответственно, выход переноса и выход заема реверсивного счетчика соединены с первыми и вторыми входами RS-триггера и вто50ленному соотношению входных частот. Одновременно один из сигналов переноса или заема через второй элемент И 6 поступает на вход установки реверсивного счетчика 5, который устанавливаетс в исходное состо ние, при котором число, записьшаемое в него, равно половине объема реверсивного счетчика 5.Дл случай, когда f вл етсмаксимальной из «трех входньпс частот, первым заполн етс третий счетчик 3 импульсов, и по его выходному сигна- лу через первый элемент И 4 счетчики 1-3 импульсов устанавливаютс в исходное состо ние, а на выходе цифрового частотного компаратора сохран етс предьщущий результат сравнени .Формула изобретениЦифровой частотный компаратор, содержащий первый и второй счетчики импульсов, тактовые входы которых вл ютс первым и вторым входами цифрового частотного компаратора соответственно , входы сброса счетчиков импульсов объединены и подключены квыходу первого элемента И, первый и второй входы которого соединены с выходами первого и второго счетчиков импульсов соответственно, RS-триггер, пр мой и инверсный выходы которого вл ютс выходами цифрового частот- ного компаратора, и второй элемент И, отличающийс тем, что,компаратора,а его выход подключенК третьему входу первого элемента И, выход которого подключен к входу сброса третьего счетчика импульсов, вход пр мого счета и вход обратного счета реверсивного счетчика подключены к выходам первого и второго счетчиков импульсов соответственно, выход переноса и выход заема реверсивного счетчика соединены с первыми и вторыми входами RS-триггера и вто
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864092573A SU1385246A1 (ru) | 1986-05-29 | 1986-05-29 | Цифровой частотный компаратор |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864092573A SU1385246A1 (ru) | 1986-05-29 | 1986-05-29 | Цифровой частотный компаратор |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1385246A1 true SU1385246A1 (ru) | 1988-03-30 |
Family
ID=21247131
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU864092573A SU1385246A1 (ru) | 1986-05-29 | 1986-05-29 | Цифровой частотный компаратор |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1385246A1 (ru) |
-
1986
- 1986-05-29 SU SU864092573A patent/SU1385246A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JPS577634A (en) | Frequency dividing circuit | |
SU1385246A1 (ru) | Цифровой частотный компаратор | |
SU1348809A1 (ru) | Многоканальное устройство дл ввода информации | |
SU1388860A1 (ru) | Устройство дл умножени частоты на коэффициент | |
SU1314435A1 (ru) | Цифровой умножитель частоты | |
SU1415225A1 (ru) | Анализатор спектра по функци м Уолша | |
JPS5530213A (en) | Signal converter | |
SU1522396A1 (ru) | Управл емый делитель частоты | |
SU1014142A1 (ru) | Преобразователь частоты в код | |
SU1193658A1 (ru) | Устройство дл сравнени двоичных чисел | |
SU1273954A1 (ru) | Врем -импульсный функциональный преобразователь | |
SU1441402A1 (ru) | Устройство дл мажоритарного выбора сигналов | |
RU1802408C (ru) | Делитель частоты | |
SU1156111A1 (ru) | Устройство телеуправлени | |
SU1223329A1 (ru) | Умножитель частоты | |
SU1051727A1 (ru) | Устройство дл контрол работоспособности счетчика | |
SU1285467A1 (ru) | Цифровой умножитель частоты | |
SU1368961A1 (ru) | Преобразователь числа импульсов во временной интервал | |
SU449438A1 (ru) | Преобразователь кода числа в код обратной величины | |
SU1430946A1 (ru) | Цифровой генератор периодических функций | |
SU1264135A1 (ru) | Двухканальный врем импульсный преобразователь | |
SU930751A1 (ru) | Устройство дл выделени серий импульсов | |
SU411628A1 (ru) | ||
SU1538239A1 (ru) | Умножитель частоты следовани импульсов | |
SU549803A2 (ru) | Преобразователь двоично-дес тичного кода "12222" в унитарный код |