SU1112550A2 - Аналого-цифровой преобразователь - Google Patents
Аналого-цифровой преобразователь Download PDFInfo
- Publication number
- SU1112550A2 SU1112550A2 SU833606540A SU3606540A SU1112550A2 SU 1112550 A2 SU1112550 A2 SU 1112550A2 SU 833606540 A SU833606540 A SU 833606540A SU 3606540 A SU3606540 A SU 3606540A SU 1112550 A2 SU1112550 A2 SU 1112550A2
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- additional
- output
- counter
- inputs
- Prior art date
Links
Landscapes
- Analogue/Digital Conversion (AREA)
Abstract
АНАЛОГО-ЦИФРОВОЙ ПРЕОБРАЗОВАТЕЛЬ по авт. св. № 921079, отличающийс тем, что, с целью расширени его функциональных возможностей путем обеспечени степенных , характеристик преобразовани с показателен 2 или 1/2, в него введены два дополнительнительных счетчика штульсов, счетчик-делитель частоты на два, накапливающий сумматор , дополнительный регистр пам ти , дополнительный третий триггер, блок сравнени кодов, два дополнительных элемента И, первый вход первого из которых соединен с дополнительной миной опорной частоты, второй вход - с первым выходом блока сравнени кодов, первые входы которого соединены с входами регистра пам ти , второй выход - с первым входом второго дополнительного элемен та И, второй вход которого соединен с выходом третьего дополнительного триггера, а выход - с первыми входами дополнительного регистра пам ти и третьего дополнительного триггера, второй вход которого соединен с миной Запись, первый вход первого дополнительного счетчика импульсов соединен с выходом счетчика-делител частоты на два и первым входом накапливающего сумматора, а второй вход - с плиной Сброс, вторым входом накапливающего сумматора, первыми входами второго дополнительного счетчика импульсов и счетчика-делител частоты на два, второй вход которого (g соединен с выходом первого дополни (Л тельного элемента И и вторым входом второго дополнительного счетчика имс пульсов, выходы которого соединены с третьими входами накапливающего сумматора, причем выходы перЬого до- 2 полнитель.ного счетчика импульсов и капливающего суг1матора соответственно соединены с вторыг1И входами блока сравнени кодов и дополнительного регистра при степенной характеристике преобразовани с по- . казателем 2 или с вторыми входами :л У1 дополнительного регистра пам ти и блока сравнени кодов соответственно о при степенной характеристике преобразовани с показателем 1/2.
Description
Изобретение относитс к импульсной технике и используетс в устрой ствах св зи первичных преобразовате лей физических параметров с цифроBtJMH устройствами обработки автоматизированных систем управлени . По ocHOBHOf-iy авт. св. 921079 известен аналого-цифровой преобразо ватель, содержащий два блока сравнени напр жений, первые входы кото рых объединены,, выход nejjBoro блока сравнени напр жений через первый формирователь импульсов подключен к входу Запись регистра пам ти, выход второго блока сравнени напр жени через второй формирователь импульсов подключен к первому входу триггера, суммирующий счетчик импул сов, разр дные выходы которого подключены к соответствующим входам ре гистра пам ти, четыре счетчика импульсов , блок вычитани частот, два дополнительный триггера, два ключа, конденсатор, резистор, три элемента И, элемент ИЛИ-НЕ, ждущий мультивиб ратор, два дополнительных формировател импульсов, потенциометр, при чем первый выходпервого ключа чере резистор подключен к первому выводу потенциометра, подвижный контакт которого подключен, к второму входу второго блока сравнени напр жений, первые входы первого и второго блоков сравнени напр жений - к второму выходу первого ключа, первому выходу второго ключа и первой обкладке конденсатора, втора обкладка которого , а также второй выход второго ключа и второй вывод потенциометра соединены с общей шиной, второй вход триггера подключен к первым входам первого и второго дополнительных триггеров, к выходу первого дополнительного формировател импульсов и выходу и сброс суммирук цего счетчика импульсов, выход которого подключен к второму входу второго дополнительного триггера, первые выходы три гера и второго дополнительного триг .гера - соответственно к первому и второму входам первого элемента И, выход которого подключен к первому входу элемента ИЛИ-НЕ, вторые выходы триггера и второго дополнительного триггера - соответственно к первому и второму входам второго элемента И и первым входам третьего и четвертого элементов И, выход второго элемен та И подключен к второму входу элеме та ИЛИ-НЕ, выход которого подключен к второму входу элемента ИЛИ-НЕ, . выход которого - к входу второго дополнительного формировател импульdoB и к вторым входам третьего и чет вертого элементов И, третьи входы которых объединены, а выходы подключены соответственно к cyMMBpytomefw и вычитающему входам первого счетчика импульсов, выход второго дополнительного формировател импульсов подключен к второму входу первого дополнительного триггера и входу ждущего мультивибратора, выход которого подключен к входу первого дополничельного формировател импульсов, первый и второй выходи первого дополнительного триггера подключены соответственно к входам перв-ого и второго ключей, разр дные выходы первого счетчика импульсов подключены к соответствующим входам второго счетчика импульсов, а выход - к первому входу блока вычитани частот и счетному входу третьего счетчика, иготульсов , выход которого подключен к счетному входу четвертого счетчика импульсов, группа входов которого подключена к разр дным выходам суммирующего счетчика импульсов, а выход - к второпу входу блока вычитани частот, выход которого подключен к счетному входу сумглирующего. счетчика импульсов 1. Недостатком известного устройства вл ютс его ограниченные функциональные вoз южнocти. Характеристика преобразовани аналого-цифрового преобразовател линейна, что требуетс только при св зи линейных первичных преобразователей физических параметров с цифровыми устройствами обработки информации . На практике р д первичных преобразователей (датчиков) обладает нелинейной характеристикой, с большой точностью аппроксимируемой степенной функцией с показателем степени 1/2 (например, виброчастотные датчики силы) или 2 (термометры сопротивлений и т.д.). Это требует в дальнейшем при обработке цифровой информации специальных устройств дл возведени в квадрат или извлечени квадратного корн из двоичного кода, что приводит к увеличению габаритов устройства, его стоимости. Цель изобретени - расширение функциональных возможностей путем обеспечени степенных характеристик преобразовани с показателем два или одна втора . Поставленна цель достигаетс тем, что в аналого-цифровой преобразователь введены два дополнительных счетчика импульсов, счетчик-делитель частоты на два, накапливающий сумматор , дополнительный регистр пам ти, дополнительный третий триггер, блок сравнени кодов, два дополнительных элемента И, первый вход первого из которых соединен с дополнительной шиной опЬрной частоты, второй вход с первым выходом блока сравнени кодов , первые входы которого соединены с входами регистра пам ти, второй выход - с первыщ входом второго дополнительного элемента И, второй вход которого соединен с выходом тре тьего дополнительного триггера, а вы ход - с первыми входами дополнительного регистра пам ти и третьего дополнительного триггера, второй вход которого соединен с шиной Запись, первый вход первого дополнительного счетчика импульсов соединен с выходом счетчика-делител частоты на два и первым входом накапливающего сумматора , а второй вход - с шиной Сброс, вторым входом накапливающего сумматора. Первыми входами второ го дополнительного счетчика импульсов и счетчика-делител частоты на два, второй вход которого соединен с выходом первого дополнительного эл мента И и вторым входом второго дополнительного счетчика импульсов, выходы которого соединены с третьими входами накапливающего сумматора, причем выходы первого дополнительног счетчика импульсов и накапливающеЪо сумматора соответственно соединены с вторыми входами блока сравнени ко дов и дополнительного регистра пам ти при степенной характеристике преобразовани с показателем 2 или с вт рьми входами дополнительного регистра пам ти и блока сравнени кодов соответственно при степенной характе ристике преобразовани с показателем 1/2. На фиг. 1 показана структурна схема аналого-цифрового преобразовател дл извлечени квадратного корн на фиг. 2 - то же, дл возведени в квадрат. Аналого-цифровой преобразователь содержит счетчики 1-5 импульсов (из которых счетчик 2- суммирук ций счетчик импульсов), регистр б пам ти, блок 7 вычитани частот, триггеры 810 с раздельным запуском (из которых триггеры 8 и 10 - дополнительные триггеры), ключи 11 и 12, блоки 13 и 14 сравнени напр жений, конденсатор 15, элементы И 16-19, элемент ИЛИ-НЕ 20, ждущий tyльтивибpaтор 21, формирователи 22-25 импульсов , потенциометр 26, резистор 27, счетчики 28 и 29 импульсов, счетчикделитель 30 частоты на два, дополнительный накаплив.ающий сумматор 31, дополнительный регистр 32 пам ти, блок 33 сравнени кодов, третий дополнительный триггер 34 и два дополнительных элемента И 35 и 36. Выход счетчика 1 импульсов соединен с первым входом блока 7 вычитани частот, выход которого соединен с входом счетчика 2 импульсов, выход которого соединен с входом счетчика 5 импульсов, второй вход которого соединен с входом счетчика 4 импульсов , а второй вход счетчика 1 импуль сов - с выходом счетчика 3 имПульсов , вход счетчика импульсов 5 соединен с входом регистра 6 пам ти, входы триггера 8 - соответственно с выходом формировател 25 импульсов и входом триггеров 9 и 10-, а выходы с входами ключей 11 и 12, выходы которых соединены с входами блоков 13 и 14 сравнени и. конденсатооа 15, вход элецента Н 16 соединен с входом элемента И 18, входы элемента И 17 с выходами триггеров 9 и 10, а выход - с входом элемента ИЛМ-НЕ, выход которого соединен с входом-элемента И 19 и входом формировател 24 импульсов, выход которого соединен с входом ждущего мультивибратора 21, потенциометр 26 через резистор 27 соединен с входом ключа 11, первый вход дополнительного счетчика 28 с входом накапливающего сумматора 31,, а второй вход - с выходом первого элемента И 35 и входом счетчика-делител 30 частоты на два, выход которого соединен с входом второго дополнительного счетчика 29 импульсов, выход которого соединен с дополнительным регистром 32 пам ти при показателе , равном 1/2 и с входом блока 33 сравнени кода при показателе, равном 2, второй вход регистра 32 пам ти соединен с выходом элемента И 36, вход которого .соединен с выходом триггера 34, выход накапливающего сумматора 31 - с входом блока 33 сравнени кодов при показателе, равном 1/2, и регистром 32 пам типри показателе 2. В основу сформировани степенной характеристики преоОразовани как с показателем 2, так и 1/2, расшир ющих функциональные возможности преобразовател , положена следующа закономерность нечетных чисеЛ арифметического р да: 2 1+3 3 1+3 + 5 1+34-5 + 5 1 + 3 + 5 + 7 + 9 25 и т.д. В Общем виде дл числа п - i (2i -1). Выражение (I) вл етс алгоритмом вычислени квадрата числа п. Отсюда можно записить следуютий сшгоритм вычислени квадратного кор й : {nJ- п iZ - i (2i -1) 0. t Преобразователь работает следующим образом. Аналоговый сигнал U поступает на первый вход блока 13 сравнени напр жений. На счетный вход счетчика 1 поступает последовательность импульсов эталонной частоты Гц , на первые входы элементов И 18 и 19 - последовательность импульсов с частотой f . В исходном состо нии при нулевых значени х аналоговой и цифровой экспонент с шины Сброс основного кана ла преобразовани поступает импульс, который устанавливает накапливающий сумматор 31,счетчики 28 и 29 импульсов и триггер 34 в нулевое состо ние , а счетчик-делитель 30 частоты на 2 - в состо ние логической 1. Соотношение между опорными частотами fo основного канала преобразовани и fj , поступающей на вход элемента И 35, (а также разр дность сче чика 2 основного канала преобразовани и счетчика 29 импульсов) выбираетс исход из требуемой погрешности вычислений и равно при требуемой точности вычислений квадратного корн до к-го знака после зап той
f; 2.10 f Начало цикла преобразовани опре дел ет сигнал с выхода формировател 25, который, поступа на первые входы ±риггеров 8-10, устанавливает их в исходное состо ние и осуществл ет сброс счетчика 2. Единичные сигналы с первых выходов триггеров 9 и 10 че рез элементы И 16, ИЛИ-НЕ 20 поступают на вторые входы элементов И 18 и 19, запреща прохождение частоты fj через них на входы счетчика 3. Единичный сигнал с первого выхода триггера 8 замыкает ключ 11, подключающий конденсатор 15 .к источнику напр жени и,, . Одновременно начинают с зар д конденсатора 15 через резистор 27 и набор информации в счетчике 2, начина с нулевого значени Во врем зар да конденсатора напр жение на нем измен етс по закону и Un (1 - о Ч ) где t - текущее врем TQ- посто нна времени аналогового генератора (зар да конденсатора 15); е - основание натурального лога рифма. Выходной код счетчика 2 измен етс по закону ( 5) NO N.. (1 - .) , где NO - код, к которому стремитс цифрова экспонента. Та - посто нна времени цифрового генератора.
или в частном случае, при к 2, Из выражени (.4 получаем t -Talnd - -К-) (6) и, подставив в выражение (51 , имеем N2 (l - -SJ-). (7) Ч отсюда при Т, TU получаем линейную зависимость кода в счетчике 2 от изменени напр жени на конденсаторе 15 N. -S-.U -NO -Ht., (8) При u и срабатывает блок 13 и сигнал с его выхода через формирователь 22 производит запись кода из счетчика 2 в регистр б. Одновременно при начале формировани аналоговой и цифровой экспонент сигнал Сброс снимаетс . Блок 33 сравнени кодов вьадает сигнал логической 1. при соотношении lOOOONi К рде н. код, набранный в счетчике 2, код на выходе накапливающегосумматора 31. После поступлени первого импульса на вход счетчика 2 на выходе блока 33 сравнени кодов по вл етс сигнал логической 1 и импульсы с частотой fi начинают проходить на входы счетчика 28 импульсов и счетчика-делител 30 частоты на два. После первого импульса, насчитанного счетчиком 28, на выходе счетчика-делител 30 по вл етс отрицательный перепад напр жени , по которому осуществл етс суммирование содержимого счетчика 28:tl1 с содержимым накапливак цего сумматора 31 iO} . Одновременно срабатывает счетчик 29 импульсов. Так при к 2 10000И2 10000 Нз, 1, на выходе блока 33 сравнени кодов остаетс сигнал логической 1 и с третьим импульсом частоты f осуществл етс сумглирование с содержимым накапливсцощего cyr iMaTopa 31 числа 3, с п тыг импульсом - числа 5 и т.д. После двухсотого импульса частоты fo в накапливающем сумматоре 31 по вл етс число 10000, что соответствует числу 100(1,00) , сосчитанному счетчиком 29 импульсов на выходе блока 33 сравнени кодов, соответственно на выходе первого элемента И 35 по вл етс сигнал логического и импульсы на вход счетчика 28
импульсов и счетчика-делител 30 нь проход т.
После поступлени второго импульса на вход счетчика 2 основного канала преобразовани процесс повтор етс , на момент окончани преобразовани в счетчике 29 набрано ,число 142 (1,42) .
Преобразование происходит аналоги но до того момента пока не сравн ютс входные напр жение преобразовател и напр жение аналоговой экспоненты . При этом срабатыёает блок 13 сравнени напр жений, на шине Запись по вл етс импульс, который перебрасывает триггер 34 и на втором входе элемента И 36 по вл етс сигнал логической 1. По окончании преобразовани на инверсном выходе блока 33 сравнени кодов также по вл етс сигнал логической 1, которы поступает на первый вход элемента И 36, при этом с выхода элемента И 36 на вход регистра 32 пам ти поступает сигнал записи, содержимое счетчика 29 переписываетс в регистр 32 и поступает на выход пр.еобразовател .
Сигнал логической 1 с выхода элмента И 36 устанавливает триггер 34 в исходное состо ние, на первом входе элемента И 36 по вл етс сигнал логического О, запреща прохождение импульсов записи на вход регистра 32.
По окончании аналоговой и цифровой экспонент вновь формируетс сигнал Сброс и процесс преобразовани в дальнейшем повтор етс .
Таким образом, на выходе регистЬа 6 Пам ти преобразовател форми- руетс код, пропорциональный входному напр жению и,у , а на выходе регистра 32 пам ти - пропорциональный корню квадратному из входного напр жени (Щу.
Аналогично осуществл етс процесс возведени кода в квадрат (фиг; 2). Так как при этом к блоку 33 сравнени кодов подключены информационные выходы счетчика 29 импульсов, а выходы накапливающего сумматора 31 регистру 32 пам ти, в последний записываетс код, пропорциональный квадрату входного напр жени jj|n .
Значение опорной частоты при этом выбираетс из соотношени
fo 2f, .
Таким образом, технико-экономическим преимуществом предлагаемого преобразовател вл етс то, что он позвол ет преобразовывать в цифровой код аналоговые сигналы как датчиков с линейной характеристикой, так и степенной с показател ми 2 .или 1/2и одновременно его линеаризовывать.
Claims (1)
- АНАЛОГО-ЦИФРОВОЙ ПРЕОБРАЗОВАТЕЛЬ по авт. св. № 921079, отличающийся тем, что, с целью расширения его функциональных возможностей путем обеспечения степенных- характеристик преобразования с показателем 2 или 1/2, в него введены два дополнительнительных счетчика импульсов, счетчик-делитель частоты на два, накапливающий сумматор, дополнительный регистр памяти, дополнительный третий триггер, блок сравнения кодов, два дополнительных элемента И, первый вход первого из которых соединен с дополнительной шиной опорной частоты, второй вход - с первым выходом блока сравнения кодов, первые входы которого соединены с входами регистра памяти, второй выход - с первым вхо- дом второго дополнительного элемен та И, второй вход которого соединен с выходом третьего дополнительного триггера, а выход - с первыми входами дополнительного регистра памяти и третьего дополнительного триггера, второй вход которого соединен с шиной Запись, первый вход первого дополнительного счетчика импульсов соединен с выходом счетчика-делителя частоты на два и первым входом накапливающего сумматора, а второй вход - с шиной Сброс, вторым входом накапливающего сумматора, первыми входами второго дополнительного счетчика импульсов и счетчика-делителя частоты на два, второй вход которого © соединен с выходом первого дополнительного элемента И и вторым входом второго дополнительного счетчика импульсов, выходы которого соединены с третьими входами накапливающего сумматора, причем выходы первого дополнительного счетчика импульсов и капливающего сумматора соответственно соединены с вторыми входами блока сравнения кодов и дополнительного регистра памяти при степенной характеристике преобразования с по- ·. казателем 2 или с вторыми входами дополнительного регистра памяти и блока сравнения кодов соответственно при степенной характеристике преобразования с показателем 1/2.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU833606540A SU1112550A2 (ru) | 1983-03-24 | 1983-03-24 | Аналого-цифровой преобразователь |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU833606540A SU1112550A2 (ru) | 1983-03-24 | 1983-03-24 | Аналого-цифровой преобразователь |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU921079 Addition |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1112550A2 true SU1112550A2 (ru) | 1984-09-07 |
Family
ID=21068864
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU833606540A SU1112550A2 (ru) | 1983-03-24 | 1983-03-24 | Аналого-цифровой преобразователь |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1112550A2 (ru) |
-
1983
- 1983-03-24 SU SU833606540A patent/SU1112550A2/ru active
Non-Patent Citations (1)
Title |
---|
1. Авторское свидетельство СССР № 921079, кл. Н 03 К 13/20, 1980 Дпрототип). * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US3201781A (en) | Analog to digital transducers | |
US3745475A (en) | Measurement system | |
SU1112550A2 (ru) | Аналого-цифровой преобразователь | |
US3947673A (en) | Apparatus for comparing two binary signals | |
US3237171A (en) | Timing device | |
SU699450A1 (ru) | Цифровой фазометр | |
SU1035787A1 (ru) | Преобразователь код-напр жение | |
SU951322A1 (ru) | Статистический анализатор дл определени количества информации | |
SU1109661A1 (ru) | Цифровой вольтметр переменного напр жени | |
SU807285A1 (ru) | Функциональный преобразовательчиСлА иМпульСОВ B цифРОВОй КОд | |
SU1742783A1 (ru) | Цифровой измеритель отношени временных интервалов | |
SU691862A1 (ru) | Устройство дл вычислени логарифмических функций | |
RU1833896C (ru) | Устройство дл формировани пор дковых статистик | |
SU1626351A1 (ru) | Устройство дл определени моментов по влени экстремума | |
SU982014A1 (ru) | Адаптивный вычислитель оценки математического ожидани | |
SU907474A1 (ru) | Устройство дл автоматического контрол прецизионных делителей напр жени | |
SU714404A1 (ru) | Дифференцирующе-сглаживающее устройство | |
SU960843A1 (ru) | Устройство дл определени энтропии | |
SU1247773A1 (ru) | Устройство дл измерени частоты | |
SU542338A1 (ru) | Умножитель частоты следовани периодических импульсов | |
SU1205050A1 (ru) | Устройство дл измерени абсолютного отклонени частоты | |
SU748271A1 (ru) | Цифровой частотомер | |
SU1156259A1 (ru) | Преобразователь частоты импульсов в код | |
SU583430A1 (ru) | Цифровое вычислительное устройство | |
SU894875A2 (ru) | Устройство дл изменени частоты следовани импульсов |