RU2475954C2 - Цифровое устройство для формирования последовательностей управляющих сигналов с параллельным переносом - Google Patents

Цифровое устройство для формирования последовательностей управляющих сигналов с параллельным переносом Download PDF

Info

Publication number
RU2475954C2
RU2475954C2 RU2011110562/08A RU2011110562A RU2475954C2 RU 2475954 C2 RU2475954 C2 RU 2475954C2 RU 2011110562/08 A RU2011110562/08 A RU 2011110562/08A RU 2011110562 A RU2011110562 A RU 2011110562A RU 2475954 C2 RU2475954 C2 RU 2475954C2
Authority
RU
Russia
Prior art keywords
outputs
inputs
block
unit
state
Prior art date
Application number
RU2011110562/08A
Other languages
English (en)
Other versions
RU2011110562A (ru
Inventor
Николай Иванович Гудко
Евгений Иванович Смышляев
Original Assignee
Николай Иванович Гудко
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Николай Иванович Гудко filed Critical Николай Иванович Гудко
Priority to RU2011110562/08A priority Critical patent/RU2475954C2/ru
Publication of RU2011110562A publication Critical patent/RU2011110562A/ru
Application granted granted Critical
Publication of RU2475954C2 publication Critical patent/RU2475954C2/ru

Links

Images

Landscapes

  • Information Transfer Systems (AREA)
  • Compression, Expansion, Code Conversion, And Decoders (AREA)

Abstract

Изобретение относится к области цифровой технике и может быть использовано при построении различного рода автоматов циклического действия. Техническим результатом является повышение быстродействия и экономия количества оборудования. Устройство содержит последовательно соединенные блоки, принимающие при воздействии тактовых сигналов одну и ту же последовательность внутренних состояний; при этом переход к очередным состояниям осуществляется под действием активного уровня на соответствующих им входах и очередным состояниям соответствуют определенные выходы, после сигнала на очередных входах, являющихся выходами предыдущего блока, соответствующими определенным его состояниям, переключающих блок в очередное внутреннее состояние «j» в данном цикле предыдущего блока, следующим сигналом, переключающем последующий блок в следующее внутреннее состояние (j+1) в следующем цикле предыдущего блока, является сигнал предыдущего блока, соответствующий другому его внутреннему состоянию, предшествующий по циклу предыдущего блока сигналу, переключающему последующий блок в состояние «j», при этом выходами данного блока, соответствующими его очередному состоянию, и соответствующими им входами последующего блока являются входы тактовых сигналов и выходы триггеров данного и предыдущих блоков. 5 ил., 3 табл.

Description

Устройство относится к области цифровой техники и может быть использовано в вычислительной технике, системах передачи и обработки информации, при построении различного рода управляющих автоматов циклического действия, то есть устройств, принимающих при воздействии входных сигналов одну и ту же последовательность внутренних состояний (состояний элементов памяти), предназначенных для формирования последовательностей управляющих сигналов.
Наиболее типичными, простыми и наиболее исследованными устройствами такого вида являются счетчик и распределители импульсов, а также более сложные управляющие автоматы циклического действия с произвольным алгоритмом функционирования (например, устройства управления процессоров, формирующие на своих выходах последовательности сигналов, управляющие операционными устройствами, генераторы кодов, а также кодирующие и декодирующие устройства систем передачи информации).
Устройства циклического действия традиционно выполняется в виде счетчика импульсов совместно с дешифратором. Наиболее распространенным примером такого подхода являются распределители импульсов. При этом важной является возможность использования логических элементов, входящих в счетчик, для реализации дешифратора, что позволяет уменьшать количество оборудования.
Название предлагаемого изобретения выбрано исходя из того, что предлагаемое устройство при частной реализации может выполнять функции всех вышеперечисленных устройств циклического действия, то есть обладать универсальностью, позволяет строить различные его варианты и выбирать наиболее подходящий с учетом используемой элементной базы (например, с учетом ограничений на реализацию логических элементов и элементов памяти при разработке микросхем), а также других требуемых параметров, отличается оригинальностью структуры. То есть название принято обобщающего характера и не отражает частную функцию (счетчик, распределитель, устройство и т.п.), а отражает общее понятие (выражающее функцию), охватывающее разные частные формы его реализации (см. «Правила составления, подачи и рассмотрения заявки…». П.3.3.1 (6)).
Показателями технического уровня цифрового устройства циклического действия, как и других видов цифровых устройств, являются используемое для его реализации количество оборудования и быстродействие.
Известны устройства, которые обеспечивают высокие показатели по быстродействию и экономии количества оборудования.
Это, например, устройство в соответствии с патентом на изобретение №2397610 («Цифровое устройство для формирования последовательностей управляющих сигналов», зарегистрированное 20.08.2010 г.). Пример его реализации приведен на Фиг.1.
Выберем его в качестве прототипа.
Другое широко используемое устройство с высоким быстродействием (счетчик с параллельным переносом информации), приведенное на схеме Фиг.3, (см. также, например, Ю.Ф.Опадчий, О.Г.Глудкин, А.И.Гуров. Аналоговая и цифровая электроника. Полный курс. М.: Горячая линия - Телеком. 2000 г., Рис.17.35, Рис.17.8, Рис.17.4а; в схеме Фиг.3 приведена подробная схема T-триггера с изображением RS-триггеров и вентилей (Рис.17.8, Рис.17.4а)), используем в качестве аналога.
В изобретении №2397610, H03K 5/15 (прототипе) описано цифровое устройство для формирования последовательностей управляющих сигналов, содержащее два или более последовательно соединенных блоков, являющихся последовательностными устройствами, имеющими по несколько входов и выходов, каждый из которых соответствует одному внутреннему состоянию, меняющими в одной очередности свои внутренние состояния только при воздействии активного уровня на один из очередных входов и не меняющие внутреннее состояние при переходе активного уровня в пассивный, что в сочетании с оригинальной организацией связей между выходами и входами блоков таких, что после сигнала на очередном входе последующего блока, переключающем этот блок в очередное внутреннее состояние «j» в данном цикле предыдущего блока, следующим сигналом, переключающим последующий блок в следующее внутреннее состояние (j+1) в следующем цикле предыдущего блока, является сигнал, предшествующий по циклу предыдущего блока сигналу, переключающему последующий блок во внутреннее состояние «j» позволяет экономить количество оборудования, повышать быстродействие, обеспечивать регулярность (однородность) структуры.
Однако в этом устройстве можно дополнительно повысить быстродействие за счет замены каждого из единичных выходов блоков комбинациями выходов тактовых сигналов и триггеров данного и предыдущего блоков, участвующих в формировании данного выхода.
При этом на входы всех последующих блоков вместо единичных выходов предыдущего блока подаются комбинации выходов всех предыдущих блоков, каждая из которых соответствует одному из его состояний, в соответствии с принятой организацией связей в случае единичных входов и выходов в прототипе.
То есть каждая единичная шина заменяется комбинацией шин, являющихся выходами триггеров всех предыдущих блоков и тактовых сигналов, участвующих в формировании сигнала на соответствующей единичной шине.
Такая замена единичных шин на комбинацию шин, активный уровень на которых формирует сигнал на единичной шине в схеме прототипа, позволяет повысить быстродействие, так как из цепи передачи информации исключаются вентили, формирующие сигнал на единичной выходной шине (но они остаются в схеме для переключения триггеров в своем блоке), а вся информация подается на каждый блок со всех предыдущих блоков непосредственно, вызывая изменение его состояния. То есть устройство работает с параллельным переносом информации, в отличии от прототипа, где осуществляется сквозной перенос информации.
При этом несколько увеличивается количество оборудования по сравнению с прототипом из-за увеличения числа входов вентилей, принимающих информацию в каждом блоке, но уменьшение его за счет принятого алгоритма переключения состояний блоков и принципа организации связей блоков, принятых в прототипе, сохраняется, что приводит в результате к значительной экономии количества оборудования в целом.
В результате достигается его значительная экономия по сравнению с известными схемами с параллельным переносом, например по сравнению с аналогом Фиг.3.
Все вышеописанное поясним на конкретных примерах.
На Фиг.1 приведена схема счетчика, ярко иллюстрирующая прототип, так как по сравнению со схемой с таким же составом блоков как и широко известная схема на T-триггерах за счет выбора алгоритма функционирования блоков и оригинальной организации соединений между их входами и выходами позволяет экономить количество оборудования и повысить быстродействие. Схема состоит из трех блоков и имеет коэффициент счета КСЧ=18. При этом все блоки, кроме первого, имеют КСЧ=3, вместо 2-х в схеме на T-триггерах (см. описание изобретения №2397610). Быстродействие повышается за счет того, что при использовании указанного принципа триггеры переключаются не последовательно друг за другом, когда в цепочке переноса информации участвуют последовательно соединенные триггеры всех блоков и вентили на входах триггеров (последовательный перенос), а последовательно с появлением сигнала на выходах последовательно соединенных вентилей. Например, если в схеме Фиг.1 единица появляется на выходе вентиля «И» (на входе S1), то она может проходить цепочку: вентиль на входе S1 и далее через выход I 21 и вентиль на входе R3, выход I 42 и вентиль на входе S5, вызывая переключение соответствующих триггеров. Суммарная задержка определяется суммой времен переключения вентилей. На это нужно значительно меньше времени, чем при последовательном переносе, где последовательно переключаются и вентили и триггеры, так как в этом случае суммарная задержка определяется суммой времен переключения вентилей и триггеров. То есть в схеме Фиг.1 информация распространяется по последовательной цепочке вентилей (сквозной перенос информации). И тот и другой принцип широко известны, но в данном случае сквозной перенос организован совершенно по-другому, в сравнении с известными случаями, так как реализуется в рамках принципа, заложенного в прототипе.
Быстродействие прототипа можно существенно увеличить путем изменения характера связей между блоками, приводящего к параллельному переносу информации.
На Фиг.2 приведена схема счетчика, аналогичная по функциям схеме Фиг.1 с КСЧ=18, но реализующая параллельный перенос информации. Каждый из выходов блоков Б1 (I11, I21, I31, I41), Б2 (I12, I22, I32, I42) заменяется на выходы соответствующих триггеров и тактовых сигналов, формирующих данный выход.
В обозначениях выходов первая цифра - это номер выхода, а вторая - номер блока.
Логические функции, описывающие цепи, воздействующие на входы триггеров и на выходы блоков Б1 и Б2 в схеме Фиг.1
Figure 00000001
Figure 00000002
Figure 00000003
Figure 00000004
Figure 00000005
Figure 00000006
Figure 00000007
Figure 00000008
Figure 00000009
Figure 00000010
Figure 00000011
Figure 00000012
Здесь все логические функции «I» реализованы 2- входовыми схемами «И». Следовательно, выходы блоков Б1 и Б2 заменяются: I11 на выходы
Figure 00000013
и
Figure 00000014
; I21 на T и
Figure 00000015
; I31 на
Figure 00000016
и Q1; I41 на T и Q2; I12 на
Figure 00000016
,
Figure 00000017
,
Figure 00000018
; I22 на T, Q2,
Figure 00000019
; I32 на
Figure 00000013
, Q1, Q3; I42 на T,
Figure 00000020
,Q4, что отображено на схеме Фиг.2.
Логические функции, описывающие цепи, воздействующие на входы триггеров в схеме Фиг.2
Figure 00000021
Figure 00000022
Figure 00000023
Figure 00000024
Figure 00000025
Figure 00000026
Figure 00000027
Figure 00000028
Figure 00000029
Figure 00000030
Figure 00000031
Figure 00000032
Цепи блока Б1 остаются без изменения, так как они определяются входными сигналами.
Детально работу схемы Фиг.2 удобно рассматривать по тем же таблицам переходов, что и схемы Фиг.1 в описании прототипа (Здесь эти таблицы 1, 2, 3 приведены). В описании прототипа схема Фиг.1 обозначена как Фиг.2.
Из схемы видно, что при переходе устройства из одного состояния в другое переключается один вентиль и один RS-триггер, что является фактически предельно возможным случаем, так как в любой логической схеме существует переход, когда триггер переключается под воздействием вентиля. Это определяет максимально возможное быстродействие.
В схеме по Фиг.1 переключаются последовательно несколько вентилей и триггер.
В предлагаемой схеме используются RS-триггеры, в то время как в широко применяемых схемах с параллельным переносом используются сложные триггеры, внутри которых имеются RS-триггеры и вентили. Следовательно, в этом случае при смене состояния переключается вентиль, обеспечивающий параллельный перенос, вентиль внутри сложного триггера (например, T-триггера, JK-триггера, D-триггера и других) и RS-триггер внутри сложного триггера, что значительно снижает быстродействие.
Это видно из схемы Фиг.3, являющейся широко используемой (См., например, Ю.Ф.Опадчий, О.Г.Глудкин, А.И.Гуров. Аналоговая и цифровая электроника. Полный курс. М.: Горячая линия - Телеком. 2000 г., Рис.17.35, Рис.17.8, Рис.17.4а).
В схеме Фиг.3 приведена подробная схема Т-триггера с изображением RS-триггеров и вентилей (Рис.17.8, Рис.17.4а).
Из этой схемы видно, что при переходе из одного состояния в другое переключаются схема «И», обеспечивающая перенос, схема «И» внутри T-триггера на входе RS-триггера и RS-триггер, то есть на один вентиль больше, чем в предлагаемой схеме.
Эта схема при коэффициенте счета КСЧ=16 использует в 4-х блоках, являющихся T-триггерами, и в цепях переноса всего 39 вентилей (схема RS-триггера состоит из 2-х вентилей).
Предлагаемая схема при большем коэффициенте счета (КСЧ=18) использует 25 вентилей. Экономия (39-25)/39≈36% при значительно большем быстродействии.
По сравнению со схемой прототипа Фиг.1 проигрыш в количестве оборудования заключается в данном случае в увеличении числа входов схем «И» (кроме блока Б1), но зато получается существенный выигрыш в быстродействии.
Необходимо отметить, что при увеличении числа блоков проигрыш в количестве оборудования по сравнению со схемой Фиг.1 будет увеличиваться из-за увеличения числа входов схем «И».
Схема прототипа обеспечивает и достаточно высокое быстродействие и значительную экономию оборудования и однородность структуры.
Существуют устройства циклического действия (счетчики распределители и др.), в которых при переходе из состояния в состояние переключается один вентиль и один RS-триггер. Это счетчики в коде Грея и счетчики в коде Джонсона, но они значительно проигрывают в количестве оборудования и устройству по основному изобретению и устройству по предполагаемому дополнительному изобретению. Это обосновывается в описании прототипа.
Представим предлагаемое изобретение в виде обобщенной схемы Фиг.4, отражающей общее понятие, так же как в прототипе, охватывающем разные частные формы его реализации (См. «Правила составления, подачи и рассмотрения заявки…» П.3.3.1(6)). То есть эта схема отражает сущность изобретения в обобщенном виде.
Устройство содержит блоки 1, 2, …P. Входы и выходы блоков, кроме входов входного блока и выходов выходного блока, представляют собой не единичные шины, а комбинации определенных выходов тактовых сигналов и триггеров. Порядок соединения комбинации входов и выходов такой же как и единичных, соответствующих им.
Входной блок 1 имеет номера входов 01, 11, …n1, где нижний индекс является номером блока. Эти входы полностью идентичны входам прототипа. Выходной блок «P» имеет номера выходов 0p, 1p, …np, где нижний индекс - номер блока. Эти выходы также идентичны выходам прототипа.
Блок 1 имеет комбинации выходов 01c, 11c, 21c…i1c-1, i1c, i1c+1…n1c-1, n1c (в нижнем индексе 1 - номер блока, c - означает комбинацию).
Каждая комбинация выходов является выходами триггеров и тактовых входов, определяющих переход в очередное состояние блока.
Комбинации входов блоков (кроме первого) 0ic, 1ic, …nic, где i - номер блока. Каждая комбинация определяется той комбинацией выходов предыдущего блока, с которой она соединяется.
Комбинация выходов других блоков, кроме первого, состоит из комбинации, которая подана на соответствующий вход с тем же номером и комбинации выходов триггеров данного блока, определяющих переход к состоянию, в котором находится блок.
То есть комбинация выходов 0, 02c блока 2 состоит из комбинации входов 02c и комбинации выходов триггеров 02c, данного блока 2, определяющих переход в состояние «0» блока 2.
Комбинация выходов 12c, 12c блока 2 состоит из комбинации входов 1 и комбинации выходов триггеров данного блока 2, определяющих переход в состояние 1 блока 2 и т.д.
Комбинации выходов и входов соединяются в том же порядке, что соответствующие им единичные входы и выходы в прототипе.
В данном случае на вход 0 подается комбинация выхода блока 1 01c, а на вход 1 комбинация выхода блока 1 n1с в соответствии со схемой Фиг.4 и т.д.
Рассмотрим работу схемы Фиг.4 совместно со схемами по Фиг.1 и 2. Схема Фиг.4 является обобщенной (то есть в общем виде отображающей суть изобретения) и при задании конкретных ее параметров приводит к частному решению.
Схема Фиг.2 является таким частным решением при числе комбинаций входов и выходов блоков равном 4 (от «0» до nic или nic), которое равно числу внутренних состояний блоков при n1c=n2cn=n2c=…nic=nic=…n(p-1),c=n(p-1), c=npc=3.
Входы блока 1 в частном случае Фиг.2 являются тактовыми входами T и
Figure 00000033
.
Выходы блока «Р» и формирующие их цепи на Фиг.2 не показаны, так как эти выходы формируются из выходов логических схем (вентилей) блоков в виде комбинационной схемы, что является тривиальной задачей. Это показано на Фиг.4 выходами блоков 1, 2, … и т.д. и входами Р выходного блока P, по которому поступают комбинации сигналов от других блоков, и выходами блока Р.
Каждый блок Фиг.2 состоит из 2-х триггеров с выходами Q1Q2, Q3Q4, Q5Q6 для формирования четырех выходных комбинаций (22=4).
Схема Фиг.2 отличается от схемы Фиг.1 существенными признаками предлагаемого изобретения. В Фиг.2 единичные выходы Фиг.1 заменены на комбинации выходов, состоящих из входов вентилей, формирующих единичные выходы в Фиг.1.
Эти входы вентилей являются комбинациями тактовых сигналов и выходов триггеров, вызывающих переход в данное состояние блока.
Работа схемы Фиг.1 и 2 описывается таблицами переходов (таблица 1 - блок 1; таблица 2 - блок 2; таблица 3 - блок 3).
При этом в вершинах столбцов таблиц применительно к схеме Фиг.1 обозначены единичные выходы вентилей (двухвходовых схем «И»), а применительно к схеме Фиг.2 это комбинации переменных, подаваемых на входы этих вентилей (кроме таблицы 1, где в вершинах столбцов состояние входа Т). Это приводит к вышеприведенным логическим выражениям для цепей, воздействующих на входы триггеров в обеих схемах.
Более подробно принцип построения таблиц переходов приведен в описании прототипа.
Если число входов и выходов блоков обобщенной схемы принять равным 4-м (кроме входов первого блока и выходов последнего), как указано выше, при числе блоков равным 3-м, то в обозначениях обобщенной схемы выходы блоков Фиг.1 и 2 выглядят так: I11 для схемы Фиг.1 и выходы
Figure 00000033
и
Figure 00000034
для схемы Фиг.2 - это выход 01с. И далее соответственно
Figure 00000035
;
Figure 00000036
;
Figure 00000037
;
Figure 00000038
;
Figure 00000039
,
Figure 00000040
;
Figure 00000041
.
Из вышеизложенного следует, что устройства, реализованные в соответствии с принципами предлагаемого изобретения, имеют большее быстродействие по сравнению с устройствами, основанными на принципах прототипа, в результате описанного усовершенствования порядка фиксации циклов предыдущего блока последующим путем замены единичных выходов и входов блоков на комбинации выходов и входов триггеров и тактовых сигналов, при сохранении порядка их соединения между собой.
При этом в прототипе требуется для его реализации несколько меньшее количество оборудования и обеспечивается большая однородность структуры, что в определенных условиях, когда не требуется по быстродействию показателей устройств, соответствующих предлагаемому изобретению, дает ему преимущества.
В случае, когда основным критерием является быстродействие, преимущества устройств, соответствующих предлагаемому изобретению, очевидны.
Оба вида устройств имеют преимущества по быстродействию и количеству оборудования по сравнению с другими устройствами такого же назначения.
Функционирование схемы, приведенной на Фиг.2, было проверено путем моделирования на ПЭВМ с использованием программы Electronics Workbench 6.0. На Фиг.5 приводится распечатка схемы, полностью соответствующей схеме Фиг.2, подвергавшейся моделированию, с использованием изображений логических элементов в соответствии с американским стандартом ANSI, принятых в этой программе.
В схеме раскрыта структура RS-триггеров на основе 2-х элементов «ИЛИ-НЕ», используется переключатель S4 для формирования входных сигналов, переключатель S3 для начальной установки RS-триггеров, а также индикаторы состояний триггеров (обозначены буквой X).
Схема состоит из 3-х блоков, полностью идентичны по структуре блокам Б1-Б3 на Фиг.2.
При этом каждый RS-триггер выполнен на 2-х элементах «ИЛИ-НЕ»: T1(U2A, U2B), T2(U2C, U1A) - блок Б1; T3(U6A, U6B), Т4 (U6C, U7A) - блок Б2; T5(U10A, U10B), Т6 (U10C, U11A) - блок Б3. Инвертор - U5A.
Схема функционирует в полном соответствии с таблицами переходов (таблица 1 - блок Б1, таблица 2 - блок Б2, таблица 3 - блок Б3), обеспечивая заданный коэффициент счета КСЧ=18. В таблицах переходов цифрами обозначены номера импульсов и пауз (символов), поступивших на вход для достижения данного состояния (Всего 36 символов за цикл - 18 импульсов и 18 пауз).

Claims (1)

  1. Цифровое устройство для формирования последовательностей управляющих сигналов с параллельным переносом, содержащее два или более последовательно соединенных блоков, являющихся последовательностными устройствами, принимающими при воздействии тактовых сигналов одну и ту же последовательность внутренних состояний; при этом переход к очередным состояниям осуществляется под действием активного уровня на соответствующих им входах и очередным состоянием соответствуют определенные выходы, а связи между выходами и входами соседних блоков такие, что после сигнала на очередных входах, являющихся выходами предыдущего блока, соответствующими определенным его состояниям, переключающих блок в очередное внутреннее состояние j в данном цикле предыдущего блока, следующим сигналом, переключающим последующий блок в следующее внутреннее состояние j+1 в следующем цикле предыдущего блока, является сигнал предыдущего блока, соответствующий другому его внутреннему состоянию, предшествующий по циклу предыдущего блока сигналу, переключающему последующий блок в состояние j, отличающееся тем, что выходами данного блока, соответствующими его очередному состоянию, и соответствующими им входами последующего блока являются входы тактовых сигналов и выходы триггеров данного и предыдущих блоков, определяющие переход к этому состоянию.
RU2011110562/08A 2011-03-22 2011-03-22 Цифровое устройство для формирования последовательностей управляющих сигналов с параллельным переносом RU2475954C2 (ru)

Priority Applications (1)

Application Number Priority Date Filing Date Title
RU2011110562/08A RU2475954C2 (ru) 2011-03-22 2011-03-22 Цифровое устройство для формирования последовательностей управляющих сигналов с параллельным переносом

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
RU2011110562/08A RU2475954C2 (ru) 2011-03-22 2011-03-22 Цифровое устройство для формирования последовательностей управляющих сигналов с параллельным переносом

Publications (2)

Publication Number Publication Date
RU2011110562A RU2011110562A (ru) 2012-09-27
RU2475954C2 true RU2475954C2 (ru) 2013-02-20

Family

ID=47078032

Family Applications (1)

Application Number Title Priority Date Filing Date
RU2011110562/08A RU2475954C2 (ru) 2011-03-22 2011-03-22 Цифровое устройство для формирования последовательностей управляющих сигналов с параллельным переносом

Country Status (1)

Country Link
RU (1) RU2475954C2 (ru)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
RU2642395C2 (ru) * 2016-06-15 2018-01-24 Николай Иванович Гудко Цифровое устройство для формирования последовательностей управляющих сигналов с последовательным переносом информации
RU2698431C2 (ru) * 2017-09-01 2019-08-26 Российская Федерация, от имени которой выступает Министерство обороны Российской Федерации Счетчик

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
SU423249A1 (ru) * 1972-09-12 1974-04-05 Н. И. Гудко Распределитель импульсов
JPH0394514A (ja) * 1989-09-07 1991-04-19 Nippon Telegr & Teleph Corp <Ntt> 多相同期信号発生装置
US20030222689A1 (en) * 2002-05-30 2003-12-04 Lsi Logic Corporation Multi-phase edge rate control for scsi lvd
RU2397610C2 (ru) * 2008-06-19 2010-08-20 Николай Иванович Гудко Цифровое устройство для формирования последовательностей управляющих сигналов

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
SU423249A1 (ru) * 1972-09-12 1974-04-05 Н. И. Гудко Распределитель импульсов
JPH0394514A (ja) * 1989-09-07 1991-04-19 Nippon Telegr & Teleph Corp <Ntt> 多相同期信号発生装置
US20030222689A1 (en) * 2002-05-30 2003-12-04 Lsi Logic Corporation Multi-phase edge rate control for scsi lvd
RU2397610C2 (ru) * 2008-06-19 2010-08-20 Николай Иванович Гудко Цифровое устройство для формирования последовательностей управляющих сигналов

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
RU2642395C2 (ru) * 2016-06-15 2018-01-24 Николай Иванович Гудко Цифровое устройство для формирования последовательностей управляющих сигналов с последовательным переносом информации
RU2698431C2 (ru) * 2017-09-01 2019-08-26 Российская Федерация, от имени которой выступает Министерство обороны Российской Федерации Счетчик

Also Published As

Publication number Publication date
RU2011110562A (ru) 2012-09-27

Similar Documents

Publication Publication Date Title
US7579883B2 (en) Frequency divider
JPH07106949A (ja) 汎用組み合わせ論理モジュール
US5327019A (en) Double edge single data flip-flop circuitry
GB2079998A (en) Frequency-dividing circuit
RU2475954C2 (ru) Цифровое устройство для формирования последовательностей управляющих сигналов с параллельным переносом
KR20020049387A (ko) 고속 동작이 가능하고 순차적으로 2진 카운터 순서를 갖는카운터 회로 및 그 카운팅 방법
CN101739232B (zh) 基于可逆逻辑的除法器
RU2397610C2 (ru) Цифровое устройство для формирования последовательностей управляющих сигналов
US6504407B2 (en) Programmable high speed frequency divider
US6725245B2 (en) High speed programmable counter architecture
RU2642395C2 (ru) Цифровое устройство для формирования последовательностей управляющих сигналов с последовательным переносом информации
US6091794A (en) Fast synchronous counter
JP3489178B2 (ja) 同期式カウンタ
RU2262736C1 (ru) Сумматор комбинационно-накапливающего типа
CA2172095C (en) Precision time of day counter
Niranjan Low power and high performance shift registers using pulsed latch technique
RU2752485C1 (ru) Делитель частоты с переменным коэффициентом деления
York et al. Design and VLSI implementation of mod-127 multiplier using cellular automaton-based data compression techniques
JPH09289445A (ja) 同期式カウンタ
JPH0683066B2 (ja) カウンタ回路
SU1016778A1 (ru) Схема сравнени кодов
KR200144729Y1 (ko) Prom 데이터를 이용한 트리거 신호 발생회로
US3862401A (en) Multi-phase pulse counter
Benafa et al. Loadable Kessels counter
KR100418574B1 (ko) 로드가능 업/다운 카운터 회로