RU2019031C1 - Аналого-цифровой преобразователь параллельного сравнения - Google Patents
Аналого-цифровой преобразователь параллельного сравнения Download PDFInfo
- Publication number
- RU2019031C1 RU2019031C1 SU5003071A RU2019031C1 RU 2019031 C1 RU2019031 C1 RU 2019031C1 SU 5003071 A SU5003071 A SU 5003071A RU 2019031 C1 RU2019031 C1 RU 2019031C1
- Authority
- RU
- Russia
- Prior art keywords
- resistive
- input
- coding
- resistive divider
- bus
- Prior art date
Links
Images
Landscapes
- Analogue/Digital Conversion (AREA)
Abstract
Изобретение относится к технике построения АЦП, преназначенных для кодирования мгновенных значений быстропротекающих процессов. Цель изобретения - уменьшение погрешности преобразования достигается за счет того, что в АЦП, содержащий n-p-разрядных блоков кодирования, состоящих каждый из p-ступенчатого резистивного делителя и группы компараторов, введены во все блоки кодирования, кроме первого блока, резистивный элемент смещения, включенный между первым входом резистивного делителя и шиной нулевого потенциала, во все блоки кодирования элементы развязки, а в первые n-1 блоки кодирования дополнительный резистивный элемент смещения, который включен между вторым входом резистивного делителя и выходом элемента развязки соответствующего блока. 1 ил.
Description
Изобретение относится к технике построения АЦП, предназначенных для кодирования мгновенных значений быстропротекающих процессов.
Известен АЦП параллельного сравнения, содержащий группу компараторов, один из входов каждого из которых (опорный вход) смещен относительно соседнего на величину напряжения - шаг квантования последовательным равноступенчатым делителем [1].
Недостатком известного АЦП является ограниченная точность и разрядность (6+8 бит). С увеличением разрядности (числа уровней квантования) возрастает число ступеней последовательного резистивного делителя, на котором формируется шкала опорных уровней квантования, и усиливается влияние входных токов компараторов на рост погрешности преобразования. При этом образуются различные паразитные смещения нулевого уровня каждого из компараторов, вызывающие как следствие, рост нелинейности характеристики преобразования. Для их уменьшения используют низкоомные делители, что вызывает увеличение тока, а значит, и увеличение температуры элементов. Это, в свою очередь, вызывает возникновение дополнительной погрешности. Одновременно с увеличением числа ступеней последовательного резистивного делителя возрастают паразитные реактивности, поэтому снижается быстродействие АЦП.
Наиболее близким по технической сущности к предлагаемому является АЦП параллельного сравнения, содержащий источник опорного напряжения, n p-разрядных блоков кодирования с одинаковым шагом квантования, каждый из которых выполнен на p-ступенчатом резистивном делителе и группе компараторов, первые входы которых в каждом блоке кодирования подключены к соответствующим выходам p-ступенчатого резистивного делителя, причем вторые входы компараторов всех блоков кодирования объединены и являются входной шиной, третьи входы объединены и являются шиной стробирования, а их выходы являются выходной шиной единичного кода, первый вход p-ступенчатого резистивного делителя первого блока кодирования является шиной нулевого потенциала [2]. Разрядность такого устройства при этом возрастает.
Но так как опорное напряжение на делителе не должно по условиям пробоя и нагрева превышать предельно допустимого значения для одного из блоков кодирования, то каждый из них может работать только в диапазоне напряжений, в n раз меньшем (n - число используемых блоков кодирования) по сравнению с предельно допустимым опорным напряжением. Однако снижение опорного напряжения вызывает снижение тока через делитель, что приводит к относительному увеличению входных паразитных токов компараторов и росту соответствующей погрешности. Одновременно уменьшение тока через делитель вызывает и снижение быстродействия АЦП, так как уменьшение тока приводит к увеличению времени заряда паразитной емкости, значение которой осталось неизменным по сравнению с непрерывным по структуре делителем.
Целью изобретения является уменьшение погрешности преобразования.
Цель достигается тем, что в АЦП параллельного сравнения, содержащем источник опорного напряжения, n p-разрядных блоков кодирования с одинаковым шагом квантования, каждый из которых выполнен на p-ступенчатом резистивном делителе и группе компараторов, первые входы которых в каждом блоке кодирования подключены к соответствующим выходам p-ступенча- того резистивного делителя, причем вторые входы компараторов всех блоков кодирования объединены и являются входной шиной, третьи входы объединены и являются шиной стробирования, а их выходы являются выходной шиной единичного кода, первый вход p-ступенчатого резистивного делителя первого блока кодирования является шиной нулевого потенциала, в каждом из последующих блоков кодирования между первым входом резистивного делителя и шиной нулевого потенциала включен соответствующий резистивный элемент смещения, во все блоки кодирования введены элементы развязки, входы которых объединены и соединены с выходом источника опорного напряжения, при этом выход элемента развязки n-го блока кодирования подключен к второму входу p-ступенчатого резистивного делителя данного блока кодирования, а в первых n-1 блоках кодирования между выходом соответствующего элемента развязки и вторым входом p-ступенчатого резистивного делителя каждого из данных блоков кодирования включен соответствующий дополнительный резистивный элемент смещения.
Схема АЦП приведена на чертеже, где 1 - входная шина, 2 - источник опорного напряжения, 3 - элементы развязки, 4 - дополнительный резистивный элемент сравнения, 5 - p-ступенчатый резистивный делитель, 6 - резистивный элемент смещения, 7 - компараторы, 8 - шина стробирования, 9 - шина единичного кода.
АЦП работает следующим образом.
Он содержит группу из n малоразрядных блоков кодирования параллельного сравнения. Число p единичных уровней квантования в каждом блоке кодирования и шаг квантования выбирают исходя из условия достижения максимального быстродействия и минимальной погрешности блока. Если общее число ступеней квантования (число единичных разрядов кода) АЦП должно составлять Z, то n = [Z/p].
Уровни квантования каждого блока кодирования смещены относительно друг друга, образуя совокупную шкалу из n p последовательно возрастающих уровней квантования. Требуемое смещение уровней в блоке достигается последовательным включением с делителем 5 каждого из блоков резисторов 4 и 5, образующих в совокупности неравноступенчатый делитель. Причем в первом из блоков включен резистор 4 так, что образуются последние p младших уровней, а в последнем n=m блоке последовательно с делителем 5 включается только резистор 6, чем образуются первые p старших уровней квантования. В совокупности все n блоков образуют параллельную шкалу n˙p уровней квантования, последовательно изменяющихся на шаг квантования. Если суммарное сопротивление резисторов 4 и 6 составляет RΣ= (Z-p)R, где R - сопротивление ступени делителя 5, то сопротивление резистора 6 составляет R6 = =ipR, где i = i= - номер блока, а сопротивление резистора 4 при этом равно R4 = = RΣ- R6.
По сигналу, поступившему на вход 8, производится параллельное стробирование всех компараторов и считывается текущее мгновенное значение измеряемой величины, как и в известной схеме АЦП параллельного сравнения (одного отсчета). Так как число компараторов в каждом блоке минимизировано, а сами блоки развязаны между собой элементами 3, то это приводит к уменьшению погрешности преобразования, в частности, вследствие уменьшения нелинейности характеристики преобразования каждого из блоков и увеличению быстродействия, так как уменьшаются паразитные реактивности каждого из блоков, питаемых параллельными токами.
Элементами развязки могут служить, например, повторители напряжения, при помощи которых можно осуществлять также градуировку каждого из блоков. Для упрощения на чертеже не указаны источники напряжений для коррекции (при необходимости) нулевых точек характеристик каждого из блоков. При необходимости могут быть включены элементы развязки между блоками и во входной шине.
Наличие общего опорного источника обеспечивает минимизацию относительных погрешностей каждого из блоков.
Предельное разрешение АЦП ограничивается только шумом компаратора (сегодня оно много хуже), а его предельное быстродействие определяется задержкой компараторов и дешифратора.
Claims (1)
- АНАЛОГО-ЦИФРОВОЙ ПРЕОБРАЗОВАТЕЛЬ ПАРАЛЛЕЛЬНОГО СРАВНЕНИЯ, содержащий источник опорного напряжения, np-разрядных блоков кодирования с одинаковым шагом квантования, каждый из которых выполнен на p-ступенчатом резистивном делителе и группе компараторов, первые входы которых в каждом блоке кодирования подключены к соответствующим выходам p-ступенчатого резистивного делителя, вторые входы компараторов всех блоков кодирования объединены и являются входной шиной, третьи входы объединены и являются шиной стробирования, а их выходы являются выходной шиной единичного кода, первый вход p-ступенчатого резистивного делителя первого блока кодирования является шиной нулевого потенциала, отличающийся тем, что, с целью уменьшения погрешности преобразования, в каждом из последующих блоков кодирования между первым входом резистивного делителя и шиной нулевого потенциала включен соответствующий резистивный элемент смещения, во все блоки кодирования введены элементы развязки, входы которых объединены и соединены с выходом источника опорного напряжения, выход элемента развязки n-го блока кодирования подключен к второму входу p-ступенчатого резистивного делителя данного блока кодирования, а в первых n-1 блоках кодирования между выходом соответствующего элемента развязки и вторым входом p-ступенчатого резистивного делителя каждого из данных блоков кодирования включен соответствующий дополнительный резистивный элемент смещения.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU5003071 RU2019031C1 (ru) | 1991-07-03 | 1991-07-03 | Аналого-цифровой преобразователь параллельного сравнения |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU5003071 RU2019031C1 (ru) | 1991-07-03 | 1991-07-03 | Аналого-цифровой преобразователь параллельного сравнения |
Publications (1)
Publication Number | Publication Date |
---|---|
RU2019031C1 true RU2019031C1 (ru) | 1994-08-30 |
Family
ID=21585642
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU5003071 RU2019031C1 (ru) | 1991-07-03 | 1991-07-03 | Аналого-цифровой преобразователь параллельного сравнения |
Country Status (1)
Country | Link |
---|---|
RU (1) | RU2019031C1 (ru) |
-
1991
- 1991-07-03 RU SU5003071 patent/RU2019031C1/ru active
Non-Patent Citations (2)
Title |
---|
1. Марцинкявичус А.-Й. К. и др. Быстродействующие интегральные микросхемы ЦАП и АЦП и измерение их параметров. М.: Радио и связь,1988, с.9, рис.1.6. * |
2. Там же, с.87-90. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US6424276B1 (en) | Successive approximation algorithm-based architectures and systems | |
US5361067A (en) | Digital linearization calibration for analog to digital converter | |
US6486806B1 (en) | Systems and methods for adaptive auto-calibration of Radix<2 A/D SAR converters with internally generated stimuli | |
US5072221A (en) | Error limiting analog to digital converter | |
US10298250B2 (en) | Capacitor order determination in an analog-to-digital converter | |
JP3224808B2 (ja) | 冗長性a‐dおよびd‐a変換器の較正方法 | |
US6417794B1 (en) | System and apparatus for digitally calibrating capacitors in an analog-to-digital converter using successive approximation | |
US4336526A (en) | Successive approximation analog-to-digital converter using non-binary series | |
US5225837A (en) | A/D converter | |
SE516157C2 (sv) | Rättning av statiska fel i en AD-omvandlare | |
EP0075441A2 (en) | Voltage dividing circuit | |
EP3026818B1 (en) | Method of self-calibrating a sar a/d converter and sar-a/d converter implementing said method | |
CN110995265B (zh) | 模数转换器失调误差自动校准方法及系统 | |
JPH0345581B2 (ru) | ||
US6404375B1 (en) | System and method of selecting and using bit testing sequences during successive approximation for calibrating an analog-to-digital converter | |
US9124288B2 (en) | Semiconductor device | |
EP0289081B1 (en) | Digital-to-analog converter | |
US6348885B1 (en) | System and method for digitally calibrating an analog-to-digital converter | |
US5173698A (en) | Flash analog-to-digital converter with integrating input stage | |
RU2019031C1 (ru) | Аналого-цифровой преобразователь параллельного сравнения | |
KR100300240B1 (ko) | 직병렬형a/d변환기 | |
US5614902A (en) | Ratiometric analog to digital converter with automatic offset | |
RU2020747C1 (ru) | Аналого-цифровой преобразователь параллельного сравнения | |
KR20010108035A (ko) | 용량성 플래시 아날로그-디지털 컨버터 | |
RU2020748C1 (ru) | Способ аналого-цифрового преобразования электрических сигналов |