PT79548B - Tri-level sandcastle pulse decoder - Google Patents

Description

DESCRIÇÃO DO INVENTO

Este invento diz respeito, de um modo geral, ao equipamento necessário para fazer a discriminação entre componentes de impulsos de um trem de impulsos, do tipo chamado "castelo de areia” e, em particular, a descodificar impulsos do tipo castelo de areia com três níveis.

Quando várias funçSes de corte, com necessidades diferen^ tes de temporização, tem de actuar dentro de um circuito integrado comum, pode realizar-se uma economia no número total de terminais. Consegue-se isto pela formação externa de uma onda composta com cortes a vários níveis, para ligar a um só terminal de entrada do circuito integrado e incluir, dentro do circuito integrado, circuitos descodificadores sensíveis aos valores dos níveis. Os circuitos descodificadores extraem as respejc tivas ondas de corte com diferentes temporizaçães a partir da forma de onda composta que foi ligada (o que á viável tendo um perfil semelhante ao do castelo de areia).

Um exemplo de circuitos codificadores convenientes para utilização na formação de trens de impulsos do tipo castelo de areia com componentes de impulsos com dois níveis diferentes (acima de um nível de base) está indicado na Patente U.S. NS.

4 313 130 - Yost. Um exemplo de circuitos descodificadores cari venientes para utilização na separação de componentes de impulsos do tipo castelo de areia de dois níveis, como os do tipo ge rado pelo codificador Yost, estâ apresentado num artigo intitulado "Processador de luminância/crominência NTSC integrado”, por L. Harwood e outros, que aparece nas páginas 693 a 706 do "IEEE Transactions’¹¹ nos Consumidores Electrónicos, Volume CE-26 (Novembro de 1980).

No exemplo do descodif içador de Hara/ood e outros, atrás mencionado, o sinal de apagamento do retorno e o sinal de corte de ruptura, para utilização em circuitos de processamento dos sinais de luminância e de crominância de um receptor de televisão a cores, são separadamente obtidos a partir dos impulsos sm castelo de areia com dois níveis. Os impulsos em castelo de areia com dois níveis apresentam um primeiro nível durante as ρ,ο

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-3sições iniciais e finais dos períodos de repetição quando á necessário o apagamento de retorno. Estes impulsos apresentam um segundo nível mais alto durante as porções intermédias dos períodos repetitivos, cujas porções intermédias coincidem no tempo com os intervalos de repetição durante os quais a função de disparo de ruptura deve ser realizada. Neste exemplo de utilização do impulso do tipo castelo de areia há uma sobreposição de funções de corte a ser realizada com prolongamento do apagamento de retorno em cada período de corte de ruptura. No caso do receptor de televisão a cores, do tipo que incorpora equipamento para controle automático da polarização do cinescópio a cores, ê aconselhável associar com os circuitos de processamento dos sinais de luminância e de crominância um conjunto de funções de corte, inclusivé de não sobreposição, bem como de funções de sobreposição, como estâ explicado na aplicação Patente U.S. Na. de Série 571 176 de R. Sanley, registada em 14 de Dezembro de 1983 e intitulada "Circuitos de processamento para sistemas de controle de sinais de luminância e de crominância".

Como montagem exemplificativa para um controle automâti co da polarização de um cinescópio a cores num receptor de tele. visão a cores temos a que está descrita na Patente U.S, Na,

4 263 622 - Hinn. Na montagem Hinn, um período de controle, ocu pando um periodo de vários intervalos de linhas sucessivas dentro de cada intervalo de apagamento vertical, é colocado àparte para verificação da corrente de nível negro produzido pelo canhão de electrões sob determinadas condições do sinal de referência. Durante este período de controle são examinados os afas. tamentos em relação a um determinado nível de corrente, sendo a polarização do canhão reajustada para se opor às variações não desejadas. Durante a porção do período de controle, a grelha do cinescópio a cores recebe um impulso de condução reforçada.

0 controle da polarização é baseado em informações obtidas como indicativas da variação do nivel da corrente catódica introduzi, das pelas variações na grelha. Um sistema com vantagem sobre o sistema Hinn, atrás descrito, para manter uma relação ds polari zação apropriada entre o trio de canhões do cinescópio (em face do envelhecimento e outras variações de parâmetros), está des-

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-4orito na AplicaçSo da Patente NS. de série 434 314 de R.P. Parker, registada em 14 de Outubro de 1982.

Para utilizaçSo eficiente do controle automático de polarização do cinescópio (AKB), do modo exemplificado pelas estruturas da atrás mencionada Patente de Hinn e AplicaçSo da Patente de Parker, reconhece-se na atrás mencionada AplicaçSo de Patente de Shanley que os circuitos de processamento dos sinais de luminância/crominância requerem algumas formas de manipulaçSo durante os intervalos de controle da polarizaçSo do cinescó pio para evitar perturbações indesejáveis ou contaminações na verificaçSo da corrente e funções de ajustamento da polarizaçSo. Estes circuitos de processamento de sinal processam a informaçSo de sinal para a entregar ao cinescópio a cores durante os perío dos de tempo em que intervém, repetida e periódicamente, os intervalos de controle da polarizaçSo.

Para concentrar num só terminal de entrada da pastilha de circuito integrado a informaçSo temporizada que identifica os intervalos repetitivos do controle de polarizaçSo do cinescó, pio, além da informaçSo temporizada transportada pelos impulsos em castelo de areia com dois níveis, atrás descritos, acha-se conveniente a utilizaçSo de impulsos em castelo de areia, com um formato de três níveis, isto é, oom três níveis diferentes (acima de um nível de base) para os respectivos componentes de impulsos. Um equipamento exemplificativo para formar os impulsos em castelo de areia convenientes, com très níveis, está indicado na AplicaçSo de Patente U,S» Série NS. 561 333 de 3. He_t tiger, intitulada "Codificador de impulsos do tipo castelo de areia com três níveis", registado em 14 de Dezembro de 1983. No trem de impulsos produzido por um codificador do tipo descrito por Hettigerí (a) - Durante as zonas de apagamento doe interva los de linha situados fora dos intervalos repetitivos ds contro le de polarizaçSo do cinescópio, aparecem impulsos da forma de dois níveis (semelhantes àqueles, atrás indicados, na Patente de Yost) com componentes de impulsos de corte de ruptura com ní vel alto, precedidos e seguidos por componentes de impulsos de apagamento de retorno com nível baixo; (b) - ao longo dos perío dos de sete linhas ocupados por cada intervalo de controle de

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-5polarização do cinescópio, aparece, no entanto, um componente de impulso de controle de polarização (AKB) num nível intermédio que cai entre o nível alto do componente do impulso de corte de ruptura e o nível baixo do componente do sinal de apagamento de retorno.

Algumas das funções temporizadas a realizar nos circuitos de processamento do sinal luminância/crominância, em respos, ta aos respectivos componentes de impulsos do tipo castelo de areia com trôs níveis são, por natureza, não sobreponíveis. Des. te modo é imposto um maior peso de discriminação de nível sobre os circuitos descodificadores de impulsos em castelo de areia com très níveis do que ê imposto sobre o atrás descrito descodj. fiçador de impulsos de dois níveis de Harmood e outros, por exem pio. Para ilustrar este ponto de vista são considerados seguidamente diversos exemplos:

1) Certas operações de corte dizem respeito ao controle automático de polarização do cinescópio (AKB) nos circuitos de processamento dos sinais luminância/crominância e são necessários para actuar apenas durante os intervalos repetitivos ds controle de polarização do cinescópio. Uma delas pode apenas indicar, depois de reconhecimento, que o trem de impulsos em castelo de areia ultrapassou um potencial limite, colocado entre o nível mais baixo do apagamento de retorno e o nível intermédio para produzir os impulsos de corte relacionados com o controle automático de polarização (AKB). No entanto, neste caso, a fo£ ma de onda resultante de impulsos de corte, terá impulsos de coj? te não apenas durante os intervalos repetitivos de controle de polarização do cinescópio (o que se pretende) mas também o aparecimento (indesejável) durante cada componente do impulsos de corte de ruptura de nível alto.

2) 0 apagamento de retorno ê desejável durante a maioria dos períodos de retorno, mas é especialmente indesejável djj rante os intervalos repetitivos do controle de polarização de modo a evitar perturbações na verificação do valor da corrente. Se apenas uma função indica, após reconhecimento, que o trem de impulsos do tipo castelo de areia ultrapassou o potencial limite existente entre o nível de base do trem de impulsos e o nível

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-6baixo do apagamento para controlar a produção da uma forma da onda de apagamento da retorno, a forma da onda resultante terá, indesejavelmente incluído um impulso da apagamento durante o aparecimento de cada componente de impulso de nível intermédio do controle de polarização do cinescópio (AKB).

Numa modalidade preferida, este invento á dirigido para um descodificador de impulsos do tipo castelo de areia com três níveis, o qual evita os problemas atrás indicados. 0 descodifi cador utiliza vários comparadores interligados de modo que permite a discriminação entre casos quando um potencial de referên cia relativo a um dos três níveis de impulsos em castelo de areia é excedido pelo aparecimento de um componente de impulso em castelo de areia a esse nível e no caso em que esse potencial de referência foi excedido pelo aparecimento de um componente de impulso próximo do mais alto nível dos três níveis dos sj. nais em castelo de areia.

D® acordo com os princípios deste invento, a modalidade preferida inclui um descodificador de impulsos em castelo de areia com três níveis, tendo uma primeira tensão de comparação, com meios para comparar o trem de impulsos com três níveis com uma tensão de referência de um nível de tensão localizado entre um dos níveis de tensão dos três níveis do trem de impulsos em castelo de areia e o próximo valor mais alto dos níveis de tensão do trem de impulsos em castelo de areia com três níveis. Meios adicionais, incluindo segundos meios de comparação de teri sSee para comparar o trem de impulsos com castelo de areia, com três níveis, com uma segura tensão de referência, mais baixas do que as referidas primeira e próxima mais alta dos níveis de tensão do referido trem em castelo de areia com três níveis, meios essss estabelecidos para produzir normalmente uma saída de impulsos de corte quando o referido trem de impulsos apresenta um nível de tensão que excede significativamente a segunda tensão de referência. Meios de controle estão ligados aos referidos impulsos de corte produzindo meios que respondem à saída dos primeiros meios de comparação com a primeira tensão, para impedir a produção dos referidos impulsos de corte, quando trem de impulsos em castelo de areia o referido nível mais ele63 210

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-7vado. De acordo com o primeiro exemplo da técnica de controle, oe meios de controle param a produção dos impulsos de corte intejr ibmpendo o circuito de alimentação dos impulsos em castelo de areia para a entrada do sinal dos segundos meios de comparação de tensões em resposta a uma saída dos primeiros meios de comp.a ração de tensões. De acordo com um segundo exemplo ilustrativo de técnica de controle, os meios ds controle incorporam meios com circuitos lógicos que permitem a produção de impulsos de acordo com a relatividade dos estados de funcionamento entre os dois meios de comparação.

Nos desenhos que acompanham:

FIGURAS 1 e 2 mostram, em parte esquematicamente e em parte em representação em blocos, configurações alternativas de circuitos do descodificador de impulsos em castelo de areia de acordo com este invento, para utilização num receptor de te levisão a cores, e

FIGURA 3 mostra, graficamente, formas de onda que ajudam a explicar o funcionamento dos circuitos das FIGURAS 1 e 2.

Na montagem da FIGURA 1 uma fonte de impulsos do tipo castelo de areia com três níveis 11 entrega um trem de impulsos em castelo de areia com três níveis, ao terminal de entrada I do descodificador. Como exemplo, a fonte de impulsos 11 compre ende circuitos da forma indicada na citada Aplicação de Patente de Hettiger, com a forma de onda dos impulsos entregues, como indicado graficamente pela curva ^MSC” da FIGURA 3. 0 terminal

I engloba, como exemplo, um terminal de entrada de um circuito integrado que contém circuitos de processamento do sinal luminância/cromxnância de um receptor de televisão a cores.

Como mostra a FIGURA 3, a forma de onda ”SC^H inclui com ponentes de impulso de apagamento de retorno de arranque positi vo com um primeiro nível de tensão (ν^θ) acima do nível de base (Vg), componentes de impulsos de arranque positivo de corte de ruptura com um segundo nível de tensão mais elevado (Vgg), componentes ds impulsos de arranque positivo para temporização do intervalo de controle de polarização do cinescópio com um terceiro nível de tensão intermediário (V^) colocado entre (V_Rg)

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-8 V_nni Cada um dos impulsos ds nível intermediário coincide com o período de sete intervalos de linha (TH) durante a posição de post-sincronismo do intervalo de apagamento vertical de um sinal recsbido ds televisão a cores. Cada um dos componentes de impulso de corte de ruptura está temporizado de modo a coincidir com um segmento da zona anterior ao sincronismo das porções de apagamento horizontal dos intervalos de linha (fora dos intervalos repetitivos de controle de polarização do cinescópio) do sinal rscebido. Os componentes do impulso de apagamento de retorno englobara aquelas porções do horizontal periódico e perí odosyãe retorno vertical de feixe (fora dos intervalos repetitivos do controle de polarização do cinescópio) que não são ocup,a dos pelos componentes de impulso de corte de ruptura.

0 equipamento da FIGURA 1 inclui um trio de comparadores de tensões, 20, 30 e 40, para comparação dos impulsos em castelo de areia produzidos para o terminal I com as respectivas tensões de referência (V^, ^j_) derivados de um divisor de tensão co

mum. 0 divisor ds tensão á formado pelas resistências 51, 53,

55 e 57, ligadas em sárie entre o terminal positivo (+V ) e o

terminal negativo (terra) de uma alimentação de tensão com uma tensão alta de referência que aparece na junção das resistèn cias 51 e 53, uma baixa tensão de referência U^, que aparece na junção das resistências 55 e 57, e uma tensão de referência intermédia Vjq que aparece na junção das resistências 53 e 55.

0 comparador 20 inclui um par de transistores NPN 21 e 22 montados em amplificador diferencial com ambos os electrodos emissores ligados. A fonte de corrente para os transístores comparadores 21, 22 é formada por um transistor NPN 23, montado com o seu electrodo de colector directamente ligado aos electrodos emissores interligados dos transístores 21 e 22, com o seu electrodo de base ligado ao terminal positivo (+V_b) da alimentação de tensão de polarização s com o seu electrodo de emissor ligado à terra através de uma resistência de emissor 24. Os electrodos dos colectores dos transístores 21 e 22 são ligados ao terminal de alimentação +V através das respectivas resistências de carga 25 s 26. Uma ligação directa da junção das resistências 51 e 53 alimenta a alta tensão da referência ao

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-9slsctrodo de base do transístor 21, enquanto que uma ligação djL recta ao terminal I entrega os impulsos em castelo de areia que entram ao electrodo base do transístor 22.

0 comparador 30 inclui um par de transístores NPN, 31 e 32, montados em amplificador diferencial com os seus eléctrodos emissores interligados. A fonte de corrente para os transístores 31 s 32 ô formada por um transístor NPN, 33, montado com o seu electrodo colector directamente ligado aos eléctrodos emissores interligados dos transistores 31 e 32, com o electrodo ba se ligado ao terminal de alimentação +V& e com o seu electrodo de emissor ligado à terra através de uma resistência de emissor 34. Os eléctrodos de colector dos transistores 31 e 32 estão ligados ao terminal de alimentação +^_cc através das respectivas resistência ds carga 35 e 36. A ligação directa para a junção das resistências 53 e 55 fornece a tensão de referência intsrmé dia ao electrodo de base do transístor 31 enquanto que a ligação directa ao terminal I entrega os impulsos em castelo de areia entrados, ao electrodo de base do transistor 32.

0 comparador 40 inclui um par de transistores NPN, 41 e 42, montados em amplificador diferencial com os seus slectrodos ds emissores interligados. A fonte de corrente para os transis, tores comparadores 41, 42 é formada por um transistor NPN 43, montado com o seu electrodo colector directamente ligado aos slectrodos emissores interligados dos transistores 41 β 42, com o seu electrodo de base ligado ao terminal de alimentação +V& e o seu electrodo de emissor ligado à terra através da resistência de emissor 44. Os eléctrodos de colector dos transistores 41 e 42 são ligados ao terminal de alimentação +V_CC através das respectivas resistências de carga 45 e 46. A ligação directa para a junção das resistências 55 e 57 fornece a tensão de refe rência baixa, V^, ao electrodo de base do transistor 41. Um cir cuito ds ligação para os impulsos em castelo de areia entrados, entregues ao electrodo de base do transistor 42 ô fornecido por um seguidor de emissor formado por um transistor PNP, 75, monta do com o seu electrodo colector ligado à terra, com o seu electrodo de base directamente ligado ao terminal Iso seu terminal emissor directamente ligado ao electrodo de base do transis

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-10tor 42 β ligado ao terminal de alimentação +V através de uma CC

resistência de emissor 74.

Um par de amplificadores diferenciais 60, 70 e um transístor NPN, 73, de controle são interligados de modo a formar um sistema de controle para interromper de forma selectiva o circuito de ligação dos impulsos em castelo de areia fornecidos através do seguidor de emissor 75* 0 amplificador diferencial

60 responde às saídas do comparador 20 e inclui um par de transístores PNP, 61 e 62, montados com os eléctrodos de emissores interligados, os quais estão ligados ao terminal de alimentação +V__ através de uma resistência de emissor comum, 63. 0 términal H de saida do comparador (no electrodo de colector do transístor comparador 21) estâ directamente ligado ao electrodo de base do transistor amplificador 61. 0 terminal H' de saida do

comparador (no electrodo de colector do transistor comparador 22) está directamente ligado ao electrodo de base do transistor amplificador 62. 0 electrodo colector do transistor 62 está li

gado à terra. 0 transistor amplificador 61 serve como fonte de corrente selectivamente disponível para o amplificador diferencial 70, o qual incorpora um par de transistores PNP, 71 e 72, montados com os eléctrodos emissores interligados directamente ligados ao electrodo de colector do transistor 61. 0 amplificai

dor diferencial 70 responde às saldas do comparador 30, com o electrodo de base do transistor amplificador 71 directamente li gado ao terminal M de saída do comparador (no electrodo colector do transistor comparador 3l) e com o electrodo de base do transistor amplificador 72 directamente ligado ao terminal M‘ de saída do comparador (no electrodo colector do transistor comparador 32). 0 electrodo de colector do transistor 71 esté

ligado à terra.

A corrente de colector do transistor 72 é fornecida como corrente de entrada a um circuito imagem de corrente formado pelo transistor NPN de controle, 73 e pelo diodo 76. 0 transis,

tor de controle 73 estâ montado com o seu electrodo de base directamente ligado ao electrodo de colector do transistor 72 β ao anodo do diodo 76, com o seu electrodo emissor directamente ligado à terra e ao cátodo do diodo 76, e com o seu electrodo

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-lide colector directamente ligado ao electrodo de base do transis, tor comparador 42 no comparador 40.

A montagem da FIGURA 1 inclui ainda um circuito lógico 80 com um par de entradas que respondem respectivamente a uma salda do comparador 20 que aparece no terminal H’ e uma salda do comparador 30 que aparece no terminal M’. 0 circuito lógico 80, realizando a função lógica de OU-EXCLUSIVO, produz uma salda a qual toma a forma de onda indicada em ^Hpⁿ da FIGURA 8, como será explicado com maior detalhe na descrição que se segue sobre o funcionamento da montagem da FIGURA 1.

Quando o trem de impulsos sm castelo de areia apresenta o nível ds base (νθ), as tensões nas respectivas entradas de s.i nais dos comparadores 20, 30 e 40 (isto ô, as tensães nos electrodos de base dos transístores 22, 32 e 42) são, cada uma, sufi cientements mais baixas do que os respectivos potenciais de referência nas entradas de referência dos comparadores (isto é, os potenciais nos eláctrodos de base dos transístores 21, 31 e 41) de modo que cada um dos transístores comparadores do sinal de comando (22, 32, 42) está em estado de corte. Neste estado, cada um dos transístores comparadores da referência de comando (21, 31, 4l) conduz toda a corrente dirigida pelo respectivo transístor fonte de corrente, os potenciais na salda dos terminais de salda dos comparadores, Η, M e L (nos respectivos electrodos dos transístores 21, 31, 41) são baixos β os potenciais nos terminais de salda do comparador Η', M* a L’ são elevados (nos respectivos electrodos de colector dos transístores 22, 32 e 42).

Nestas circunstâncias, o transistor 61 do amplificador diferencial 60 ê condutor enquanto que o transístor 62 está cojr tado. A corrente fornecida pelo transístor 61 para tnêrgizar o amplificador diferencial 70 ô passada para a terra pelo transístor 71 enquanto que o transístor 72 está cortado incapacitari do o diodo 76 e o transístor de controle 73. Com ambas as entradas altas, o circuito lógico 80 fornece uma saída para um baixo nível de base.

Durante a porção de apagamento do intervalo de linha

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fora do controla de polarização do cinescópio quando o trem de impulsos em castelo de areia aumenta para o nível de apagamento de retorno V^g, o comparador 40 comuta para um estado diferente de funcionamento, pois a tensão no electrodo de base do transis, tor 42 aumenta suficientemente acima de para cortar o transístor 41 e permitir que toda a corrente fornecida pelo transis, tor 43 passe através do transístor 42. 0 potencial no terminal

de saída L* oscila pouco enquanto que o potencial à saída do terminal L varia fortemente. Como o nível de apagamento de retorno Vpg ê significativamente mais baixo do que os níveis de re ferência e V^, os estados de funcionamento dos comparadores 30 e 20 não são afectados pelo aparecimento do sinal ^URB» com os transístores 32 a 22 permanecendo nas condições de corte. As condições de condução dos transístores 61 e 72 continuam como foi descrito atrás e a saída do circuito lógico 80 permanece para um baixo nível de base.

Durante o aparecimento da zona antes do sincronismo (backporch) de um aumento de sinal atá ao nível de corte de ruptura U_QG no terminal 1, porém, os estados de funcionamento de ambos os comparadores 20 e 30 são mudados, com os transístores 21 e 31 actuando para o corte. Os potenciais nos terminais de saida Η e M variam fortemente, ao passo que os potenciais nos terminais de salda H’ e M* variam pouco. Nestas circunstâjn cias, o transístor 62 do amplificador diferencial 60 torna-se condutor enquanto que o transístor 61 é cortado para desactivar o amplificador diferencial 70. 0 diodo 76 e o transistor de

controle 73 continuam na condição de corte. Com ambas as suas saídas baixas, o circuito lógico 80 continua a fornecer uma sa.í da a baixo nível de base. As saídas do comparador 40 não são perturbadas pelo aumento do sinal para o nível νθ^ com um poten ciai no terminal de salda L permanecendo elevado e o potencial no terminal L* de saída permanecendo baixo.

Um sinal de retorno para o nível de apagamento de reto£ no V_Rg na conclusão do aparecimento dos impulsos de corte de ruptura restauram os comparadores 20 e 30 ao seu estado de funcionamento enquanto que o comparador 40 continua a apresentar um potencial elevado no terminal L e um potencial baixo no ter63 210

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-13minai L*. A saída do circuito lógico continua em nível baixo de base. 0 comparador 40 junta os comparadores 20 e 30 no esta do de operação original sobre um retorno de nível do sinal ao nível de base νθ no final do intervalo de apagamento.

Ao passo que as operações atrás indicadas representam as condições obtidas fora dos intervalos repetitivos de controle de polarização do cinescópio, uma situação diferente apreseri ta-ee durante cada intervalo de controle de polarização do cinescópio, como agora será descrito. No começo de um intervalo de controle de polarização de um cinescópio, o nível de sinal no terminal I aumenta desde o nível V_Rg atá ao nível que diz respeito ao controle de polarização do cinescápio (AKB) (que es, tá posicionado entre o potencial de referência intermediário e o potencial de referência elevado V^). 0 estado de funcionamento do comparador 30 é comutado do seu estado original (nível base), enquanto que o estado de operação do comparador 20 não á modificado do seu estado original. 0 potencial no terminal de saída M varia fortemente e o potencial à salda do terminal M* oscila pouco, ao passo que o potencial à saida do terminal H permanece baixo e o potencial à saída do terminal H* permanece alto.

Nestas condições, o transistor 61 conduz para energizar c amplificador diferencial 70; o transistor 71 do amplificador diferencial 70, no entanto está em corte e o transistor 72 conduz, possibilitando a condução do diodo 76 e do transistor de controla 73. A condução pelo transistor de controle 73 mantêm o eléctrodo de base do transistor 42 num potencial baixo, impqs sibilitando □ transistor em seguidor de emissor 73 e provocando a comutação do comparador 40 da volta, para o seu estado original de funcionamento. Deste modo, o potencial no terminal de salda L ê baixo e o potencial no terminal de saída L* á elevado durante todo o intervalo de controle ds polarização do cinescópio.

A forma de onda ^Mrb^M da FIGURA 3 6 examplificativa do trem de impulsos de saída obtido no terminal L do comparador 40. 0 trem de impulsos "rb" inclui impulsos de arranque convenientes

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para a utilizaçSo no apagamento de retorno, o qual no entanto desaparece (como pretendido) durante o período de sete linhas dentro do intervalo de controle de polarizaçSo do cinescópio. Durante o funcionamento do sistema de controle 60, 70, 76, 73, o comparador 40 6 selectivamente excluído de responder aos componentes de impulsos de nível ^VAK·

Durante o intervalo de controle de polarizaçSo do cines cópio, as entradas dos circuitos lógicos 80 sSo reciprocamente diferentes, com um potencial baixo fornecido pelo terminal M’ ao passo que o potencial alto é fornecido a partir do terminai H'« Por conseguinte, a salda do circuito lógico 80 é alta durante o intervalo de controle de polarizaçSo do cinescópio. A salda do circuito lógico 80, como estâ indicado pela forma de onda ^Mp^H da FIGURA 3, é um trem de impulsos de arranques positi vos unicamente indicativo do intervalo de tsmporizaçSo do contro le de polarizaçSo do cinescópio e livre (quando desejado) de apa recimento de impulsos durante os intervalos de nível ^UBG·

A forma ds onda ”kn" é ilustrativa de um trem de impulsos ds saída que aparece no terminal de saida H’ do comparador 20. 0 trem ds impulsos ”kn" inclui impulsos ds arranque negati

vos, convenientes para o corte ds ruptura s outras utilizações ds corte de intervalo antes do sincronismo (backporch) o qual, no entanto, desaparece (sa se desejar) durante o período de sets linhas ocupado pelo intervalo de controle de polarização do cinescópio.

Uma configuração alternativa do presente invento está representada na FIGURA 2. 0 descodificador de impulsos em castelo de areia da FIGURA 2 também inclui um trio de comparadores de tensão (100, 120, 140) associado com um divisor de tensão 90, comum, ligado entre os terminais da tensão +V e da terra da

w C

unidade de alimentação de tensão ds funcionamento. 0 divisor ds tensão produz uma variedade de tensões continuas de referência (de níveis sucessivamente mais elevados) nos terminais + VR^, +VRj, +VR^ s +VRg·

0 nível de apagamento de retorno V_RR do trem de impulsos em castelo de areia, entregue ao terminal I da FIGURA 2,

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-15cai entra os potenciais de referência nos terminais +VR^ β +VRj. 0 nível relacionado com o controle automático de polarização (AKB), AK, situa-se entre os potenciais de referência nos termi nais +VRj e +VR^ enquanto que o nível de corte de ruptura Vgj, s^i tua-ss acima do potencial de referência no terminal +VR^.

0 comparador de tensões 100 inclui um par de transístores NPN, 101 e 102, montados com os electrodos emissores interligados. Um transistor NPN 103, funcionando como fonte de corrente, tem o seu electrodo colector directamente ligado aos ele£ trodos emissores interligados dos transístores comparadores 101 e 102. 0 electrodo base do transistor fonte de corrente 103 es.

tâ ligado a um terminal de alimentação de polarização +ν^, enquanto qus o electrodo emissor daquele 6 ligado em retorno à terra atravás de uma resistência ds emissor 104.

0 mais baixo potencial de referência produzido no divisor de tensões 90 ê fornecido pelo terminal +VR1 para o electro do de base do transistor comparador 102. Os impulsos em castelo de areia que aparecem no terminal I da entrada dos impulsos em castelo de areia são ligados atravás da resistência 91 ao terminal de alimentação SC de impulsos em castelo de areia para o qus o electrodo de base do transistor 101 está directamente ligado. 0 transistor PNP, 92, de fixação estã montado com o seu electrodo emissor ligado ao terminal SC, com o seu electrodo de colector ligado à terra e com o seu electrodo de base ligado ao terminal +VR^ (no qual aparece o mais elevado dos poteji ciais de referência produzido pelo divisor 90). 0 transistor

92 está normalmente em corte, mas a sua presença assegura que a oscilação mais positiva do trem de impulsos em castelo de areia no terminal SÇâerá limitada ao potencial que 6 mais alto do que o potencial de referência +VRg·

A carga dinâmica para o transistor comparador 101 á for necida pelo transistor PNP, 105, com vários colectores. 0 elejç trodt/smissor do transistor de carga 105 estâ ligado ao terminal de alimentação +V . 0 electrodo colector (107) do transis

CC —

tor da carga 105 está directamente ligado ao electrodo de base daquele e ao electrodo colector do transistor comparador 101.

Um electrodo (108) do colector adicional do transistor de carga

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105 fornece uma versão imagem da corrente de colector do transis tor comparador 101 para o electrodo de base de um transistor síj guidor da emissor 112, PNP. 0 electrodo colector do transistor 112 estâ directamente ligado a um terminal V ds uma alimenta9

ção positiva enquanto que o Blactrodo emissor do transistor 112 estâ directamente ligado ao terminal de salda do primeiro desco dificador BRP e, através da resistência de emissor 114, à terra, A resistência 113 fica em paralelo com o circuito-bass-emis sor do transistor seguidor de emissor 112.

A carga dinâmica para o transistor comparador 102 é for necida por um transistor PNP com colector múltiplo, 106, 0 eleç:

trodo emissor do transistor de carga 106 estâ ligado ao terminal da alimentação +^_cc· 0 electrodo colector (109) do transis

tor ds carga 106 está directamente ligado à base daquele e ao electrodo colector do transistor comparador 102. Um colector adicional (110) do transistor ds carga 106 fornece uma versão simétrica (raflectida) da corrente de colector do transistor comparador 102 para o electrodo de base do transistor seguidor de emissor 115 do tipo NPN. 0 electrodo colector do transistor 115 estâ directamente ligado ao terminal da alimentação +V_g enquanto que o electrodo de emissor do transistor 115 estâ directamenta ligado com um segundo terminal de saída do descodificador BRN a, via resistência de emissor 117, à terra. A resistên cia 116 liga em paralelo o circuito base-emissor do transistor seguidor de emissor 115.

0 transistor ds carga 106 tam um terceiro electrodo colector (lil) que fornece uma versão simétrica da corrente de co lector do transistor comparador 102 para os circuitos da contr£ le que serão descritos seguidamente.

0 comparador de tensões 120 inclui um par da transistores NPN, 121 e 122, montados com os eléctrodos emissores interligados. Um transistor NPN, 123, funcionando como fonte de cor rente, tem o seu electrodo colector directamente ligado aos eléctrodos emissores, interligados, dos transistores comparadores 121 e 122. 0 electrodo de base do transistor fonte da corrente, 123, estâ ligado ao terminal de alimentação de polariza!ΐφ;Ε' 63 210

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-17lã;

ί'ί'

I

ção enquanto que ο electrodo emissor daquela está ligado â

terra via uma resistência de emissor 124.

Um dos potenciais de referência intermediários produzidos pelo divisor 90, que aparece no terminal +VRj, é fornecido ao electrodo da base do transistor comparador 122. 0 transistor PNP, 163, estâ montado como seguidor de emissor para ligação dos impulsos em castelo de areia vindos do terminal SC da alimeji tação de impulsos em castelo de areia para o electrodo de base do transistor comparador 121. 0 transistor 163 estã montado

com o seu electrodo de base directamente ligado ao terminal SC, com o seu electrodo de colector ligado à terra e com o seu eleç, trodo emissor directamente ligado ao electrodo de base do transistor comparador 121, e, via uma resistência de emissor 161, ao terminal de alimentação positiva +Vg·, 0 condensador 162 es,

tá ligado entre o electrodo emissor do transistor seguidor de emissor 163 e a terra.

A carga dinâmica para o transistor comparador 121 é fojr necida pelo transistor 125, PNP de colector múltiplo. 0 electrodo de emissor do transistor 125 estâ ligado ao terminal de

alimentação +V . 0 electrodo de colector (122) do transistor

c c

125 estâ directamente ligado ao electrodo de base daquele e ao electrodo colector do transistor comparador 121. Os colectores adicionais (128, 129) do transistor 125 são reunidos para forne, cer uma versão simétrica da corrente de colector do transistor comparador 121 para o electrodo de base de um transistor seguidor de emissor 132, do tipo NPN. 0 electrodo de colector do transistor 132 esté directamente ligado ao terminal da alimenta ção +V , enquanto que o electrodo emissor do transistor 132 estâ directamente ligado a um terceiro terminal P de saída do des. codificador e, via uma resistência de emissor 134, à terra. A resistência 133 estâ ligada entre o electrodo de base do transistor seguidor de emissor 132 β a terra»

A carga dinâmica para o transistor comparador 122 é foç necida por um transistor PNP com colector múltiplo, 126. 0 eleç

trodo de emissor do transistor de carga 126 estâ ligado ao termi nal de alimentação +V . 0 electrodo de colector (130) do tran

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?3.l

-18sistor de carga 126 está directamente ligado à base daquela e ao electrodo de colector do transístor comparador 122. Um colejc tor adicional (131) do transístor de carga 126 alimenta uma vejç são simétrica da corrente de colector do transístor comparador 122 para o electrodo de base de um transístor seguidor ds emissor, 137 do tipo PNP. 0 electrodo colector do transístor 137 está directamente ligado à alimentação +V , enquanto que o ele£ trodo emissor do transístor 137 estâ directamente ligado ao ter minai de saída RB de um quarto descodificador e, via uma resistência 139 de emissor, à terra. A resistência 138 liga em para leio o circuito base-emissor do transístor seguidor de emissor 137.

0 electrodo de base do transístor seguidor de emissor

137 está directamente ligado ao electrodo de colector de um transístor de controle NPN, 135. 0 electrodo de emissor de con

trole para o transístor 135 está ligado à terra, enquanto que o electrodo de base deste está directamente ligado ao electrodo de colector 111 do transistor de carga 106 do comparador 100. A resistência 136 liga em paralelo com o circuito base-emissor do transistor de controle 135.

0 comparador de tensães 140 inclui um par de transístores NPN, 141 e 142, e está montado com os seus emissores interligados através de umei combinação em série de díodos 1410 e 142 0. 0e díodos 1410 s 1420 estão dispostos com os seus cátodos juntos, com o anodo do díodo 1410 ligado ao electrodo do emissor do comparador 141, e com o anodo do diodo 1420 ligado ao electrodo emissor do transistor comparador 142. Um transistor NPN, 143, funcionando como fonts de corrente, tem o seu electro do colector directamente ligado à junção dos díodos 1410 e 1420. 0 electrodo de base do transistor fonts de corrente, 143, está ligado ao terminal de alimentação de polarização +V&, e o electrodo de emissor deste está ligado em retorno para a terra, via uma resistência de emissor 144.

0 segundo potencial de referência mais alto produzido

no divisor de tensão 90 é fornecido a partir do terminal +UR^ para o electrodo de base do transistor comparador 142. 0 elec63 210

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-19-

trodo de base do transístor comparador 141 astá directamente li gado ao terminal SC para receber os impulsos em castelo de areia entrados.

A carga dinâmica para o transístor comparador 141 é for.

necida por um transístor com colector múltiplo PNP, 145. 0

electrodo de emissor do transístor ds carga 145 sstá ligado ao

terminal +V de alimentação. 0 electrodo de colector (147) do CC

transístor da carga 145 está directamente ligado ao electrodo de base daqusls e ao electrodo colector do transistor comparador

141. Um electrodo do colector adicional (148) do transistor da carga 145 forneça uma versão imagem da corrente de colector do transistor comparador 141 para o electrodo de base de um transis, tor 152 do tipo NPN, montado em seguidor ds emissor. 0 electro do colector do transistor 152 sstá directamente ligado ao tarmi nal da alimentação +V , enquanto qua o electrodo de emissor do transistor 152 está directamente ligado a um terminal KP de aajt da de um quinto descodificador e, via uma resistância de emissor, 154, à terra. A resistância 153 está em paralelo com o circuito base-smissor do transistor 152 em, seguidor de emissor.

0 terceiro electrodo colector (149) do transistor 145 fornece uma versão imagem da corrente de colector do transistor comparador 141, para o electrodo de base do transistor de controle 160, do tipo NPN. 0 electrodo emissor do transistor de controle 160 está ligado à terra, enquanto o electrodo colector daquele sstá directamente ligado ao electrodo de base do transistor comparador 121 (no comparador 120).

A carga dinâmica para o transistor comparador 142 é foj? necida pelo transistor PNP, 146, com colector múltiplo. 0 eleç trodo emissor do transistor de carga 146 estã ligado ao terminal de alimentação +V . 0 electrodo colector (150) do transis

fcór da carga 146 sstá directamente ligado ao electrodo de base daquela a para o electrodo colector do transistor comparador

142. Um colector adicional (l5l) do transistor de carga 146 fornece uma versão imagem da corranta de colector do transistor comparador 142 para o electrodo base de um transistor 155, do tipo NPN, montado em seguidor de emissor. 0 electrodo colector do transistor 155 sstá directamente ligado ao terminal de ali63 210

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mentação +V , enquanto que o electrodo do emissor do transistor 135 estâ directamente ligado ao terminal de saída KN do sexto descodifiçador e, via uma resistência de emissor 157, à terra.

A resistência 156 estâ ligada em paralelo ao circuito basa-emis, sor do transistor 155 montado em seguidor de emissor*

As formas de onda "brn”, ”p”, "rb” β "kn" da FIGURA 3 mostram os trens de impulsos ds saída que aparecem respectivamente no terminal de saída BRN do segundo descodificador, no terminal de saída P do terceiro descodificador, no terminal de saída RB do quarto descodificador e no terminal de saída KN do sexto descodificador. Pods-se verificar que a forma de onda do trem de impulsos qus aparece no terminal BRP da saída do segundo descodificador corresponde a uma versão invertida da forma de onda "brn", enquanto que a forma de onda do trem de impul sos que aparece no terminal KP do quinto descodificador corresponde à versão invertida da forma de onda "kn".

No funcionamento do descodificador da FIGURA 2, quando o trem de impulsos em castelo de areia apresenta no terminal I o nível base (νθ), os estados de funcionamento dos comparadores 100, 120 e 140 são todos os mesmas, com cada um dos transístores comparadores de comando do sinal (101, 121, 14l) no estado de corte. Como consequência, cada um dos transístores seguidores ds emissor 112, 132 e 152 estão também no estado de corte do que resulta a apresentação de um baixo nível de base nos tejç minais de saída dos descodificadores BRP, P e KP. Apresenta-se um nivel alto de base nos terminais de salda dos descodificadores BRN e KN quando os transístores seguidores de emissor 115 e 155 conduzem em resposta àscorrentes fornecidas pelos transisto res de carga 106 e 146, respectivamente. No entanto, um nível de base baixo aparece no terminal de saída RB do descodificador. Embora o transistor de carga 126 seja condutor, o elactrodo de base do transistor seguidor de emissor 137 matém-se baixo pela condução do transistor de controle 135 de modo a manter o transistor 137 em condição de corte.

Durante a porção de apagamento de um intervalo de linha fora do intervalo de controle da polarização do cinescópio, quando o trem de impulsos em castelo de areia aumenta para o

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-21nível de apagamento ds retorno, V_RR, o comparador 100 comuta para um estado de funcionamento diferente, pois a tensão no electrodo de base do transistor 101 aumenta suficientemente acima do potencial de referência no terminal +VR^ para cortar o transistor 102 e permitir toda a corrente fornecida pelo transistor 103 passe através da resistência 101. 0 terminal de saida BRP

varia fortements quando o transistor seguidor de emissor 112 conduz, enquanto que o terminal BRN varia pouco pois o transistor seguidor de emissor 115 pára a sua condução.

Como o nível de apagamento de retorno U_RR é significati vamente mais baixo do que os potenciais nos terminais +UR^ e +VR₅, os estados ds funcionamento dos comparadores 120 e 140 não são afectados pelo aparecimento do nivel U_RR, com os transístores 121 s 141 permanecendo na condição ds corte. Os termi. nais de salda P, KP s KN permanecem também nos respectivos níveis de base. 0 terminal de saida RB, no entanto, varia fortemente, pois o transistor de controle 135 deixa de conduzir libertando o eiectrodo de base do transistor seguidor de emissor 137 o qual começa a conduzir.

Durante o intervalo antes do sincronismo (backporch) o aparecimento de um aumento de sinal para o nível de corte de ruptura no terminal I, é modificado o estado de funcionamejn to do comparador 140, com o transistor 142 comandado para corte. 0 terminal de saída KP varia fortemente pois o transistor 152, seguidor de emissor, conduz, enquanto que o terminal KN varia pouco pois o transistor 155 deixa de conduzir.

Apesar do facto do nível de corte de ruptura V_Rg ser

significativamente mais alto do que o potencial de referência

no terminal +VR^, o comparador 120 não modifica o seu estado de

operação em resposta ao aumento de sinal para o nívsl V„„ deviDu

do à operação do transistor ds controle 160 (tornado condutor em resposta è condução pelo transistor ds carga 145 quando o comparador 140 muda o estado ds operação). A condução pelo tran sistor de controle 160 retém o eiectrodo de base do transistor comparador 121 bem abaixo do potencial de referência no terminal +UR^ e corta o transistor ssguidor ds emissor 163 para isolar o eiectrodo de base do transistor comparador 121 do terminal SC.

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Para evitar a possibilidade de troca de transitórios no estado de operação do comparador 120 durante o aumento do sinal para o nível Vθ_G, a resistência 161 e o condensador 162 cooperam para retardar suficientemente o aumento em potencial no electrodo de base do transístor 121 para assegurar que o transístor de contro le 160 começa a condução antes da mudança no estado ds operação do comparador 120 começar.

Com as saídas dos comparadores 100 s 120 não perturbados pela subida do nível Vgç, os terminais BRP e RB mantêm-se altos enquanto que os terminais de saída BRN e P permanecem bai. xos durante o aparecimento do nível ^VBG*

0 retorno do sinal para o nível de apagamento de retorno na conclusão do aparecimento do impulso de corte de ruptura, restaura o comparador 140 para a sua posição original de estado de funcionamento com o terminal de saída KP variando pou co e com o terminal de saída KN variando forte. Os terminais de saída BRP e RB permanecem altos, e os terminais BRN θ P permanecem baixos.

0 comparador 100 leva os comparadores 120 e 140 ao seu estado original de funcionamento depois do retorno do sinal de nível de base V_Q no fim do intervalo de apagamento horizontal, restaurando os terminais BRP e RB para nível de base baixo e o terminal BRN para um nível de base alto.

Durante o intervalo de controle da polarização do cines. cópio, quando o sinal no terminal I ó o nível Vque diz respeito ao controle automático de polarização do cinescópio (AKB) ambos os comparadores 100 e 120 são comutados dos seus estados originais (nível de base). Os terminais de saída BRP e P são altos devido à condução feita pelos transístores seguidores ds emissor, 112 e 113, enquanto que o terminal de saída BRN ê baixo devido à ausência de condução no transístor seguidor de emis sor 115. 0 terminal de saída RB S baixo apesar do corte do

transístor de controle 135, devido ao corte do transístor de carga 126.

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Como o nível Vfica significativamente abaixo do potencial de referência no terminal +UR₅, o aparecimento do nível V_ftK não causa mudanças no estado de funcionamento do comparador 140. Por consequência, o terminal de saída KP permanece a nível de base baixo, enquanto que o terminal KN permanece a um nível de base alto durante o nível de controle de polarização do cinescõpio.

Os trens de impulsos de saída produzidos nos terminais KP e KN, convenientes para corte de ruptura e outros fins de corte na zona anterior ao sincronismo "backporch" (descritos com mais detalhe na atrãs citada Aplicação de Shanley) são des^ javelmente destituídos de aparecimentos de impulsos durante o intervalo de controle de polarização do cinescõpio. 0 trsm de impulsos de saída que aparecem no terminal P 6 apenas indicativo dos intervalos repetitivos de controle de polarização do cinescópio e desejavelmente livre de impulsos durante todos os ou tros intervalos. 0 trem de impulsos de saída no terminal RB, conveniente para utilização no apagamento de retorno, ê desejavelmente livre do aparecimento de impulsos durante os intervalos repetitivos do controle de polarização do cinescõpio. Os trens de impulsos de saída nos terminais 8RP e BRN, com apareci mento de impulsos que correspondem à combinação do aparecimento de impulsos nas saídas, nos terminais P e RB, são úteis para objectivos de controle de brilho, como está descrito com maior detalhe na referida Aplicação de Shanley.

Note-se que os transístores 135 e 137 cooperam para rea lizar a função lógica em relação às entradas produzidas pelos respectivos comparadores 100 e 120, Quando ambos os transístores de carga 106 e 126 são simultaneamente condutores, isto é, durante os aparecimentos do nível de base (υθ) e quando ambos os transístores ds carga 106 e 126 estão simultaneamente cortados, isto é, durante 03 aparecimentos do nível (V^) relativo ao controle de polarização do cinescõpio, o terminal de saída RB permanece baixo. Durante os aparecimentos do apagamento de retorno, com o nível ^VRB* ou com o nível de corte de ruptura

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-24Vgç, no entanto, quando o corta do transístor de carga 106 acom panha a condução do transístor de carga 126, o terminal de salda RB varia fortemente·

Em relação com as atrás descritas três condições de entrada, o circuito formado pelos transístores 135 e 137 comportam-se como uma porta OU-EXCLUSIVA. Enquanto o circuito formado pelos transístores 135 e 137 não apresentarém uma resposta em porta OU-EXCLUSIVA para uma quarta condição de entrada (condução pelo transístor de carga 106 acompanhando o corte do tran sistor de carga 126), não resultando de tal condição de entrada uma operação do descodificador da FIGURA 2.

Claims (11)

1. REIVINDICAÇÕES

   1 - Descodificador de impulsos, do tipo castelo de areia, para utilizar com uma fonte de impulsos do tipo castelo de areia, entregando um trem de impulsos earacterizado por o re ferido trem de impulsos incluir impulsos de três níveis que inc luem primeiros componentes de impulsos, que apresentam um primeiro nível de tensão (νθ^), segundos componentes de impulsos, que apresentam um segundo nível de tensão (ν^θ), mais baixo do que o referido primeiro nível ds tensão e terceiros componentes de impulsos que apresentam um terceiro nível de tensão intermédio entre os referidos primeiro e segundo níveis de tensão, em relação a um terminal de entrada de impulsos (I); este descodificador inclui:

   - primeiros meios de comparação de tensões (30; 140), para comparar o referido trem de impulsos com três níveis com uma primeira tensão ds referência (V^; V_R^) de um nível de tensão existente entre um (^VRB^{J V}Al? dos referidos níveis de tensão dos referidos impulsos com três níveis e o próximo mais sl_e vado (V^j dos referidos níveis de tensão do referido trem

   de impulsos de três níveis;

   - meios, que incluem segundos meios de comparação de tensões (40; 120), para comparar os referidos trens de impulsos de três níveis com uma segunda tensão de referência de um nível de tensão (Vj_; VR^) mais baixo do que ambos os referidos (Vrb;

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   -25V^) β o referido próximo mais elevado (V^ ^{} U}8G^ dos níveis de tensão do referido trem de impulsos de três níveis, para produzir normalmente um impulso ds interrupção (L; P) quando o referido trem de impulsos com três nívais apresenta um nível de ten são que excede significativamente a referida tensão de referência; e

   - meios de controle (73; 160) ligados aos referidos meios de produção de impulsos de interrupção e que respondem a uma saí da dos referidos meios de comparação de tensões (30; 140) para excluir a referida produção do impulso de interrupção quando o referido trem de impulsos com três níveis apresenta o referido seguinte mais elevado nível de tensão (VVg_G).
2. 2 - Equipamento de acordo com a Reivindicação 1, incluin do meios (75j 163) para ligar normalmente sinais do referido ter minai de entrada de impulsos (I; SC) para os referidos segundos meios ds comparação (40; 120) sm que o referido controle inclui meios (73; 160) para bloquear a referida ligação de sinal em resposta à referida saída dos referidos primeiros meios de comparação de tensões (30; 140)·
3. 3 - Equipamento ds acordo com a Reivindicação 1 caracte rizado por:

   - as referidas tensões de referência serem fornecidas

   por uma fonte(+V ) de potencial contínuo; c c

   - um divisor de ten9ão (51, 53, 55, 57; 90) ligado aos terminais da referida fonte de potencial contínuo, com uma vari edade ds terminais de saída do divisor nos quais aparecem diferentes tensões ds referência, respectivamente, (U^, V^, V^;

   V_R1, vr₃, V_R5),

   - os referidos primeiros meios de comparação de tensões (30; 140) terem uma entrada de referência e uma entrada de sinal, ssndo a referida entrada ds referência ligada a um dos referidos terminais de saída do divisor para receber uma das refe ridas tensões de referência; apresentando os referidos primeiros msios ds comparação um primeiro estado de operação quando a tensão na sua entrada ds sinal estâ abaixo de um potencial limi te (V^; Vrjj) relacionado com referida tensão de referência e

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   -26apresentando um segundo estado de operação quando a tensão no seu terminal de entrada excede significativamente o referido pçj tencial limite (V^j U_R^) sendo o referido terminal de entrada do impulso ligado desde o referido terminal de entrada de impul sos (i) para a referida entrada de sinal dos referidos primeiros meios de comparação de tensões;

   - os referidos segundos meios de comparação de tensões (40; 120) tem uma entrada de referência e uma entrada de sinal, sendo a referida entrada da referência ligada a outro dos referidos terminais de saída do divisor para receber uma segunda das referidas tensões de referência; os referidos segundos meios de comparação de tensões apresentam um primeiro estado de operação quando a tensão na sua entrada de sinal está abaixo ds um segundo potencial limite (V^; VR^) relacionado com a segunda tensão ds referência, e apresentando um segundo estado de opera ção quando a tensão na sua entrada de sinais exceder significativamente o referido potencial limite;

   - meios de ligação (75; 163) para ligação do referido terminal de entrada de impulsos à referida entrada de sinal dos referidos segundos meios de comparação de tensões;

   - os referidos meios de controle (73; 160) respondem ao estado de operação dos referidos primeiros meios de comparação de tensões mantendo a tensão na referida entrada de sinal dos referidos segundos meios de comparação de tensões abaixo do referido segundo potencial limite, quando o referido trem de impulsos de três níveis apresenta o referido próximo mais elevado dos referidos níveis de tensão.
4. 4 - Equipamento de acordo com qualquer das Reivindicações anteriores caracterizado por os referidos segundos meios ds comparação de tensões (40; 120) inciuirem:

   - primeiro (41; 122) s segundo (42; 121) transístores do tipo de conductividade semelhante, tendo cada um eléctrodos de base, de emissor e de colector, sendo os eléctrodos dos emis sores doe referidos primeiro e segundo transístores ligados a uma fonte comum (43; 123) de corrente, sendo o electrodo de base do referido primeiro transístor (41; 122) ligado a um dos re

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   2

   -27feridos terminais de saída do divisor (U^; VR^) e o electrodo de base do referido segundo transístor (42; 121) está ligado, via referidos meios de ligação (75; 163) ao referido terminal de entrada de impulsos (i); s

   - por os referidos meios de controle incluírem um terceiro transístor (73; 160) com o mesmo tipo de condutividade do que os referidos primeiro e segundo transístores e tendo tambám 8lectrodos de base, emissor e colector, sendo o electrodo cole_ç tor do referido terceiro transístor ligado ao electrodo de base do referido segundo transístor (42; 12l) sendo o electrodo emis sor do referido terceiro transístor ligado a um ponto de potenci al fixo mais baixo do que o referido segundo potencial limite,

   e sendo o electrodo de base do referido terceiro transístor ligado aos referidos primeiros meios de comparação de tensões de tal modo que o referido terceiro transístor se torna condutor quando oe referidos primeiros meios de comparação de tensões apresentam o referido segundo estado de operação.
5. 5 - Equipamento de acordo com a Reivindicação 4, caracterizado por os referidos meios de ligação incluírem um quarto transístor (75; 163) com um tipo de condutividade opòsta à dos referidos primeiro s segundo transístores, dispostos em montagem de seguidor de emissor, com o seu electrodo de base ligado ao referido terminal de entrada de impulsos e o seu electrodo emis sor ligado ao referido electrodo de base do referido 8egundo transístor.
6. 6 - Equipamento de acordo com a Reivindicação 4, caracterizado por os referidos meios de controle (160) incluírem tam bém um condensador (162) ligado em paralelo com o percurso emis sor-colector do referido terceiro transístor (160) e uma resistência ligada entre o electrodo-colector do referido terceiro transístor (160) e um terminal de alimentação da tensão positiva +V_gl.
7. 7 - Equipamento de acordo com a Reivindicação 3, caracterizado por:

   - meios (155) que respondem ao estado de operação dos re feridos primeiros meios de comparação de tensões (140), para fo_r

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   -28-

   mar um primeiro trem da impulsos da um só nível (kn) abrangendo apenas os períodos de aparecimento dos referidos primeiros componentes de impulsos (Vqq)í ^θ

   - meios (132) que respondem ao estado de operação dos referidos segundos meios de comparação de tensões (120), para formar um segundo trem de impulso de um só nível (P) abrangendo apenas os períodos de aparecimento dos referidos terceiros componentes de impulsos.
8. 8 - Equipamento de acordo com a Reivindicação 7, caracterizado pcttMi saída da referida fonte de impulsos em castelo de areia apresentar um nível de base mais baixo (νθ) do que o segundo nível de tensão (U_RB), durante o período em que estão ausentas os referidos primeiro (Vgg)» segundo (V_RR) e terceiro (U_AK) componentes de impulsos}

   - terceiros meios de comparação de tensões (100) tendo uma entrada de referência e uma entrada de sinal, sendo a referida entrada de referência ligada a um outro (l/R^) dos referidos terminais ds saída do divisor para receber uma outra das re feridas tensões de referência; apresentando os referidos terceiros meios de comparação de tensões um primeiro estado de ope. ração quando a tensão na sua entrada de sinal astâ abaixo de um terceiro limite de potencial relacionado com a referida outra tensão de referência, e apresentando um segundo estado de opera ção quando a tensão na sua entrada de sinal exceder significati vamente o referido terceiro potencial limite, excedendo signifi cativamenta todos os referidos primeiro (Vg^), segundo (t/_Rg) θ terceiro (Uníveis de tensão o referido terceiro potencial limita ao passo qua o referido nível de base (l/θ) estâ abaixo do referido terceiro potencial limita;

   - em que o referido terminal de entrada de impulso é li gado à referida entrada de sinal (BASE DE 101) dos referidos terceiros meios de comparação de tensões; e

   - meios (115) que respondem ao estado de operação dos referidos terceiros meios de comparação de tensões, para produzir um terceiro trem (brn) de impulsos ds um só nível abrangendo os períodos de aparecimento dos referidos primeiro (Vgg),

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   -29segundo (ν^θ) β terceiro componentes ds impulsos.
9. 9 - Equipamento de acordo com a Reivindicação 8, caracterizado por:

   - meios (137) que respondem ao estado de operação dos referidos segundo (120) a terceiro (100) meios de comparação, para formar um quarto trem (rb) de impulsos de um só nivel abrangendo os períodos de aparecimento dos referidos primeiro (νθ^) e segundo (ν^θ) componentes de impulsos mas ausente durajn te os períodos ds aparecimento dos referidos terceiros componer: tes de impulsos.
10. 10 - Equipamento de acordo com a Reivindicação 9, carajç terizado por os referidos meios de formação do quarto trem de impulsos (137) incluir uma carga (l26)í meios (126) que respo£ de ao estado de operação dos referidos segundos meios de comparação de tensões, para fornecimento de corrente à referida carga apenas quando os referidos segundos meios de comparação de tensões apresentarem o referido primeiro estado de operação; e meios (106) que respondem ao estado de operação dos referidos terceiros meios de comparação de tensões, para desviar corrente da referida carga quando os referidos meios de comparação de tensões apresentarem o referido primeiro estado de operação.
11. 11 - Equipamento de acordo com a Reivindicação 9, cara£ terizado por o referido equipamento ser utilizado num receptor de televisão a cores o qual visualiza imagens a cor em resposta aos sinais de video compostos inclusivé de componentes de sinal representativos de imagens, estando os referidos componentes de sinal representativo da imagem ausentes durante ae porções de apagamento horizontal dos intervalos de linhas sucessivas nos intervalos de campo periódicos e também ausente durante a porção de apagamento vertical de cada intervalo de campo;

    - cada um dos referidos componentes de impulsos (V^) do referido trem de impulsos com três níveis abrange uma variedade de intervalos de linha sucessivos (7H) dentro de cada uma das referidas porções de apagamento vertical;

    - os referidos primeiros componentes de impulso (Vgç) do

    63 210

    RCA 76.343

    -30referido trem de impulsos ds três níveis repetem-se normalmente & cadência de linha, mas cada um des referidos primeiros componentes de impulsos é localizado no tempo de modo a coincidir com a porção de segmento do pedestal ds apagamento, atrás do impulso de sincronismo (Backporch) da porção ds apagamento hori zontal do intervalo de linha; e

    - os referidos segundos componentes de impulsos (ν^θ) do referido trem de impulsos com 3 níveis ocorrem durante segmentos dae referidas porções ds apagamento horizontal e vertical não sobrepostos com os referidos primeiro e terceiro componentes de impulsos.