LU84541A1 - Dispositif d'interface entre un ordinateur et une ligne de telex ou une teleimprimante - Google Patents
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Description
r * ·
DISPOSITIF D'INTERFACE ENTRE UN ORDINATEUR
ET UNE LIGNE DE TELEX OU UNE TELEIMPRIMANTE.
la présente invention concerne un dispositif conçu de façon à remplir la fonction d'interface entre un ordinateur - 5 et une ligne de télex et/ou un téléimprim.antelocale,pour l'im pression pour le service du télex.
Dans les systèmes de génération et de transmission d'information, on rencontre le problème.· consistant à surmonter les difficultés liées aux différents types d'information que 10 peuvent fournir ou recevoir d'une part un ordinateur et d'autre part un système de télex. Oette information appartient à des types différents du fait, tout d'abord, que l'ordinateur émet et reçoit dans le mode de transmission binaire synchrone (BSC), tandis que la ligne de télex émet et reçoit des données série 15 asynchrones à cinq niveaux (procédé Baudot). Secondement, la cadence d'émission et de réception de l'information est différente et elle est beaucoup plus élevée pour l'ordinateur, par exemple 1200 bauds, tandis que la ligne de télex émet et reçoit à la cadence de 50 bauds, ou même 75 bauds selon une tendance 20 plus récente. De telles différences rendent impossible une communication directe entre l'ordinateur et la ligne de télex ou une téléimprimante locale émettant et reçevant des communications de télex, ce qui nécessite l'intervention d'un opérateur, dans la solution la plus élémentaire au problème. Il existe 25 ainsi un besoin, dans l'industrie des télécommunications, en ce qui concerne des moyens réalisant automatiquement la transmission de messages de télex, en dépit des difficultés précitées.
L'invention résout le problème en procurant un dis-i 50 positif destiné à être connecté d'une part à l'ordinateur et d'autre part à la ligne de télex et/ou à la téléimprimante locale, i a » > 2 ' et capable de remplir la fonction d*interface entre eux et de permettre la transmission automatique d'information entre eux, dans un sens comme dans l’autre.
Sous sa forme générale, le dispositif de l’invention 5 est caractérisé par la combinaison des éléments de circuit suivants : 1 ) des circuits de conversion de niveau destinés à effectuer la conversion du niveau normalisé de l’ordinateur au niveau de l’unité centrale, définie ci-après, soit 10 pratiquement du niveau normalisé V24 au niveau TTL (niveau de la famille logique dite "Transistor Transistor Logic”) ; 2) des circuits de conversion série-parallèle ; 3) iine unité centrale (microprocesseur) comprenant ï 3A) un processeur central ayant au moins 8 bits ; 15 3B) une mémoire permanente (mémoire morte program mable) construite (programmée) pour effectuer la traduction faisant passer du code EBCDIC au code Baudot, et destinée à mettre en oeuvre les procédures de connexion et de transmission de l’extré-20 mité "ordinateur" et de l’extrémité "télex" ; 3C) une mémoire de données réversible (mémoire vive) ; 3D) des lignes (bus) de données, d’adresse et de .commande , qui interconnectent les composants 2, 25 3A, 3B, 3C et 4 ; 4) des circuits de conversion parallèle-série ; et 5) des circuits de conversion destinés à effectuer la conversion du niveau de l’unité centrale vers le niveau normalisé de la ligne de télex, soit en pratique du niveau TTL 30 vers le niveau de boucle de courant conforme à la norme CCITT, de préférence avec un dispositif d’aiguillage télégraphique pour uiEtéléimprimante locale.
Le composant 3A) est de préférence un processeur central à 8 bits.
35 Plus précisément, les caractéristiques et les fonc- O.
J
« % 3 - tions des composants du dispositif de l'invention, ainsi que leurs relations structurelles et fonctionnelles, sont celles indiquées ci-après.
les circuits 1) remplissent la fonction qui consiste 5 à convertir les impulsions ou l'information qu'ils reçoivent, à partir de l'ordinateur, sous d'autres formes correspondant à un niveau de tension permettant la réception et le traitement par les circuits suivants, c'est-à-dire en pratique un niveau qui convient pour l'un des microprocesseurs courants tels qu'un 10 Z80, un INTEL 8085, etc.
les impulsions qui sont amenées au niveau TT1 sont toujours transmises en série et doivent être converties en parallèle pour être enregistrées dans les mémoires de l'unité centrale et traitées de façon appropriée. Ceci est accompli par 15 l'élément de circuit 2), connecté en série au précédent.
l'information qui sort de l'élément de circuit 2) est prête pour le traitement par l'unité centrale. Cette dernière comprend un processeur central, une mémoire de programme (se présentant de façon caractéristique sous la forme d'une ou 20 plusieurs mémoires mortes programmables), une mémoire de données (se présentant de façon caractéristique sous la forme d'une ou plusieurs mémoires vives) et les divers bus (de données, d'adresse et de commande) ,et constitue un microprocesseur lorsqu'on la considère dans son ensemble.
25 l'unité centrale est de préférence un microprocesseur ; à 8 bits ; une unité centrale comportant un plus grand nombre de bits serait utilisable, mais surabondante en pratique.
5 l'unité centrale reçoit l'information série qui est émise vers elle par l'ordinateur ou la ligne de télex (la téléimprimante 50 locale eventuellen'émettrait normalement pas d'information). Naturellement, cette unité centrale a une capacité de mémoire finie et une fois que cette capacité est entièrement utilisée, elle signale ce fait de manières bien connues et évidentes qu'il n'est pas nécessaire de décrire ici. Par conséquent,dans | 55. les limites de sa capacité de mémoire, l'unité centrale traite ' / i "H» ' r 4 l'information de la manière nécessaire pour son utilisation par la ligne de télex ou la téléimprimante locale, lorsque l'information provient de l'ordinateur, et par l'ordinateur lorsque l'information provient de la ligne de télex.
5 A ce stade, du fait que le télex travaille également sur l'information série et a un niveau différent de celui du microprocesseur, l'information doit être reconvertie de la forme série à la forme parallèle et amenée à un niveau approprié. Geci est accompli par les éléments de circuit 4) et 5)· 10 L'ordre dans lequel sont envisagés les composants du dispositif de l'invention et l'ordre suivi dans la description de leurs fonctions s'appliquent au cas dans lequel l'information est transmise de 1'ordinateur vers le télex, mais si au contraire l'information est transmise de la ligne de télex 15 vers l'ordinateur, on peut considérer les mêmes composants dans l'ordre inverse, du fait que leur fonctionnement est réversible. Ainsi, les convertisseurs de niveau effectuent une conversion réversible et les convertisseurs série-parallèle peuvent également convertir de la forme parallèle à la forme 20 série.
Tous les composants du dispositif de l'invention, considérés individuellement, sont connus de l'homme de l'art et celui-ci pourra se les procurer sans difficulté dans le commerce, leur combinaison en un seul dispositif, pour attein-25 dre les buts et remplir les fonctions spécifiés ci-dessus, présente un caractère original et constitue un progrès important dans le domaine technique particulier considéré.
L'invention sera mieux comprise à la lecture de la description qui va suivre d'un mode de réalisation, donné à 50 titre d'exemple non limitatif. La suite de la description se réfère aux dessins annexés sur lesquels : la figure 1 est un schéma montrant les connexions entre le dispositif d'interface de l'invention et l’ordinateur, d'une part, et la ligne télégraphique et/ou la téléimprimante 55 locale,d'autre part ; .1 ! & 5 ' la figure 2 est une représentation schématique de la structure interne du dispositif de l’invention, conformément à un mode de réalisation préféré de celui-ci ; la figure 3 représente schématiquement un organi-5 gramme ou un diagramme de fonctionnement possible pour le dispositif conforme à l’invention ; les figures 4a, 41 et 4c représentent schématiquement une procédure d'échange d'information possible entre le dispositif de l'invention et un ordinateur fonctionnant conformé-10 ment à la procédure BSC (transmission binaire synchrone), qui représente un mode de réalisation préféré de l'invention ; et les figures 5 à 9 représentent un schéma des circuits électroniques d'un dispositif d'interface conforme à un exemple de réalisation de l'invention et, plus précisément, 15 la figure 5 montre une unité d'adaptation de niveau, la figure 6 une -unité de génération de fréquence, la figure 7 une unité de microprocesseur, la figure 8 une unité d'alimentation et la figure 9 un schéma des interconnexions des -unités des figures 5 à 8.
20 On va maintenant considérer la figure 1, sur laquel le la référence 10 désigne de façon générale le dispositif d'interface de l'invention, qui communique avec l'ordinateur 13 par l'accès 11 et la ligne 12, l'ordinateur étant de préférence un ordinateur de taille moyenne ou grande, par exemple 25 du type IBM S/34.
l'unité 10 est connectée par un accès 14, une ligne 15 et un dispositif de protection de ligne 16, à la ligne télégraphique 17 qui conduit au poste de télex, l'unité 10 communique avec la téléimprimante locale 20 par l'intermédiaire de 30 l'accès 18 et de la ligne 19. la ligne en pointillés 21 indique la communication entre le poste de télex et la téléimprimante locale..
En considérant maintenant la figure 2, on voit que le dispositif de l'invention comprend les composants décrits 3^ spécialement ci-après, en partant de l'accès 11 et en allant ί i/ 6 vers les accès 14 et 18.
la référence 30 désigne l'adaptateur de niveau, qui consiste en un élément de circuit destiné à la conversion de niveau pour passer du niveau de la norme V24 au niveau TT1, 5 et cet élément de circuit est celui qu'on a appelé composant 1) dans la définition générale du dispositif, donnée précédemment.
Des adaptateurs de niveau de ce genre existent dans le commerce, par exemple sous les références IM 1488,LM 1489, 10 75188 ou 75189.
le composant 31 est un convertisseur série-parallèle qui reçoit et convertit l'information à une cadence identique à celle de l'information synchrone de l'ordinateur, soit en pratique à 1200 bauds. Ce type de composant est connu dans le 15 commerce sous l'appellation USART (émetteur-récepteur synchro-ne-asynchrone universel), et il peut être fourni sous une forme adaptée à la conversion en mode synchrone ou asynchrone, et pour les diverses fréquences utilisées dans l'industrie, le composant 31 sera ainsi un USART synchrone à 1200 bauds.
20 l'information provenant du composant 31 est appli quée au bus de l’unité centrale, l'unité centrale comprend tous les éléments d'un microprocesseur, à savoir : un processeur central 32, une mémoire programmée 33, comprenant de façon caractéristique une ou plusieurs mémoires mortes program-25 mables ; une mémoire d'enregistrement de données 34, comprenant de façon caractéristique une ou plusieurs mémoires vives; un bus de données 35 ; un bus d'adresse 36 ; et un bus de commande 37. l'utilisation de mémoires de différents types n'est pas à exclure, en principe, la structure et le fonctionnement 30. de ces composants sont trop bien connus pour nécessiter une explication. Il suffit de dire que le programme d'entrée contenu dans la mémoire 33 permet le traitement des données provenant de l'ordinateur, de façon que ces données puissent être reçues et utilisées par la ligne de télex ou la téléim-35 téléimprimante locale.
X
> 7 r A ce stade, les données doivent être reconverties de la forme parallèle à la forme série, d’une manière appropriée pour le télex et, par conséquent, le dispositif comprend un convertisseur parallèle-série 38 qui comporte un 5 USART asynchrone à 50 bauds (ou ayant une fréquence légèrement supérieure, comme 75 bauds, comme mentionné précédemment).
la référence 39 désigne l'adaptateur de niveau qui fait passer du niveau TTL au.niveau de boucle de courant, conformément à la norme CCITT. L'information qui provient du com-10 posant 39 peut passer de préférence par un dispositif d'aiguillage 40 qui, selon le cas, la dirige soit vers la ligne de télex, par l'accès 14, soit vers 1 a téléimpr liante locale, par l'accès 18. Cependant, la possibilité de transmission vers une téléimprimante localeou une ligne de télex pourrait ne pas exis-15 ter.
Comme on l'a mentionné, le dispositif est réversible. Les flèches sur le schéma de la figure 2 font ressortir cette caractéristique de réversibilité. La circulation des données dans n'importe quel sens entre les divers composants de l'unité 20 centrale est caractéristique de n'importe quel microprocesseur et apparaîtra aisément à l'homme de l'art. La circulation dans les deux sens entre l'unité centrale et les USART et entre ces derniers et les adaptateurs de niveau ressort de l'examen du schéma et ne nécessite pas d'explication supplémentaire.
25 L'organigramme ou le diagramme de fonctionnement re présenté à titre d'exemple sur la figure 3 ne nécessite pas d'explication supplémentaire, en plus des renseignements donnés . ‘ par les légendes de la figure.
la figure 4a illustre la communication entre l'ordi-30 nateur et le dispositif d'interface de l'invention, conformément à la procédure BSG (transmission binaire synchrone). Sur cette figure, les caractères de référence C et I désignent respectivement l'ordinateur et l'interface.
1'ordinateur émet une demande de contrôle de la li-35;;gne en émettant les caractères ENQ (demande) (1), précédés par '£> 6 u 0 8 les caractères de synchronisation ψ (spécifiés sur la figure 4c), L'interface répond à cette demande par ACK 0 (2), ce qui indique que la réception est correcte et que l'émission peut se poursuivre. 1'ordinateur reprend le fonctionnement en four-5 nissant le premier bloc de données (3) (préfixe du pays, nom du destinataire, nom de réponse), précédé par les caractères STX (début du texte) et terminé par ETB (fin de bloc). On trouve ensuite les caractères de commande W (spécifiés sur la figure 4b). L'interface calcule de façon interne les caractè-10 res de commande (BCC, BOC) et elle les compare aux caractères reçus. Si les deux caractères sont identiques (absence d'erreurs dans la réception des données), l'interface répond avec un ACK (bloc (4))· L'ordinateur reprend l'émission pour émet- « tre le second bloc de données (5) qui est représenté dans ce 15 cas particulier par 69 points d'exclamation, auxquels l'interface répond par le bloc (6), suivi par la terminaison du texte (bloc (7)) par l'ordinateur. A ce stade, l'interface libère les lignes de transmission synchrone et déclenche la procédure de connexion vers la ligne de télex en accomplissant les opé-20 rations qui consistent à donner le nom et à contrôler la réponse. Après avoir demandé et comparé deux fois le nom de l'utilisateur sélectionné, l'interface reprend la transmission synchrone en émettant vers 1'ordinateur une demande de contrôle de ligne, avec le bloc (8), et, lorsqu’ elle reçoit une ré-25 ponse affirmative de la part de l'ordinateur (bloc (9)), elle émet le symbole ITC (bloc (10)) suivi par vin chiffre indiquant le résultat de la connexion à la ligne de télex (dans l'exem-- ' pie de la figure, 0 indique une sélection correcte). Après la réponse de l'ordinateur (bloc (11)), l'interface termine la 30 transmission avec EOT (bloc (12)). A ce stade, l'ordinateur reprend la commande de la ligne (blocs (13) et (14)) et il transmet le texte, ligne par ligne (blocs (15) et (16)), ceci étant répété N fois, si on désigne par K le nombre de lignes dans le texte. Après avoir transmis la dernière ligne du texte * 35j (soit MMMMM dans ce cas particulier), l'ordinateur termine le i 1 / ! • 4 9 texte (bloc (17)) et, lorsqu'il reçoit une réponse affirmative (18), il termine la transmission (19). L'interface libère également les lignes synchrones et effectue l'échange et le contrôle des noms avec l'utilisateur appelé, puis elle se recon-5 necte aux lignes synchrones (bloc 20)) et, lorsque l'ordinateur répond (bloc (21)), elle émet le symbole ITC (bloc (22)), suivi par un chiffre, comme décrit ci-dessus. Lorsque l'interface reçoit la réponse provenant de l'ordinateur (bloc (23)), elle termine la communication (bloc (24)) et elle retourne à l'éta-10 pe initiale, prête à traiter une nouvelle demande issue de l'ordinateur, concernant l'émission d'un message suivant.
Les figures 5 à 8 représentent les circuits élec-. troniques du dispositif d'interface et des circuits auxiliai res, conformes à un mode de réalisation préféré de l'invention. 15 Ces circuits ne sont pas représentés conformément à la disposition fonctionnelle suivie par la description, mais sous la forme selon laquelle ils sont matérieHement associés sur les cartes individuelles, c'est-à-dire sous forme d'unités indivi-. duelles.
20 La figure 5 montre le schéma de câblage de l'unité d'adaptation de niveau. Cette unité comprend l'adaptateur de niveau 30 et l'accès 11 destiné à la transmission de l'information entre le microprocesseur et l'ordinateur, ainsi que l'adaptateur 39, le dispositif d'aiguillage 40 et les accès 14 25 et 18 destinés à la transmission entre le microprocesseur et la ligne de télex ou le téléimprimeur local.
A titre d'exemple pour 2a description, le schéma de • ' la figure 5 a été divisé en 6 sous-ensembles, chaque sous-en semble comprenant les composants qui accomplissent une fonc-30 tion respective.
Le tableau ci-dessous résume les fonctions et les j niveaux de fonctionnement des sous-ensembles individuels.
t « ' ψ 10
Sous-ensemble Fonction Niveau de signal
1 Ligne de télex vers le Entrée = + 20 mA
microprocesseur Sortie = 0,+5V
2 Microprocesseur vers la Entrée = 0,+5V
5 téléimprimante locale Sortie = + 20 mA
3 Microprocesseur vers la Entrée = 0,5V
ligne de télex Sortie = + 20 mA
4 Téléimprimeur local vers Entrée = + 20 mA
le microprocesseur Sortie = 0,+5V
10 .5 Microprocesseur vers Entrée = 0,+5V
l'ordinateur Sortie = + 12V
6 Ordinateur vers le Entrée = + 12V
microprocesseur Sortie = 0,+5V
L'unité d'adaptation de niveau comprend en outre un 15 relais, désigné par la référence RLA, qui a pour fonction de connecter de façon galvanique la ligne de télex au téléimprimeur local dans l'état inactif.
Le circuit de la figure 6 remplit la fonction consistant à générer les fréquences nécessaires au fonctionnement 20 de l'ensemble du dispositif.
En partant d'un seul oscillateur à quartz ayant une fréquence de 4915,2 kHz, on peut obtenir les fréquences nécessaires par des chaînes de division indépendantes, d'une manière qu'on peut résumer de la façon suivante : 25 Symbole Fréquence Fonction USART 0 1 228,8 kHz Signal d'horloge des convertisseurs série/parallèle (USART) Z80 0 2 457,6 kHz Signal d'horloge du processeur central Z80 30 CL 0 1,2 kHz Fréquence d'émission du signal, du côté synchrone (1 200 bauds) 4 » j CL1 800,0 kHz Fréquence d'émission du signal, du côté asynchrone (x 16) r « t 11 ' les circuits représentés sur les figures 5 et 6 sont connectés, conformément au schéma d'interconnexion de la figure 9, à l'unité de microprocesseur dont le schéma électrique est représenté sur la figure 7.
^ la carte de microprocesseur de la figure 7 comporte en réalité également les deux convertisseurs série/parallèle (USARI) 2) et 4), en plus du microprocesseur ou de l'unité centrale 3).
Sur cette carte, le processeur central (Z80) est 10 connecté par les bus d'adresse et de données aux mémoires de programme (mémoire morte programmable effapable 2716), aux mémoires de données (mémoire vive 2114) et aux deux convertisseurs série/parallèle, dont l'un (8251a) assure la connexion synchrone avec l'ordinateur, tandis que l'autre (8251b) reçoit 15 et émet d'une manière synchrone vers la ligne de télex et le téléimprimeur local.
les trois unités décrites ci-dessus nécessitent des tensions d'alimentation différentes, en fonction des fonctions qu'elles remplissent, à savoir î 20 Carte ou unité'de microprocesseur Alimentation = -5V , + 5V (figure 7)
Unité de génération de fréquences Alimentation = —5V , + 5V (figure 6)
Unité d'adaptation de niveau Alimentation = -5V , + 5 V
25 (figure 5) (côté processeur central) = +12V , -12V (côté ordinateur) = +60V , -60V (côté télex) 50 Toutes les tensions d'alimentation indiquées ci-des sus sont produites par le circuit de la figure 8.
Il va de soi que de nombreuses modifications peu— f vent être apportées au dispositif décrit et représente, sans sortir du cadre de l'invention.
î s
Claims (5)
1. Dispositif d’interface entre un ordinateur (13) et une ligne de télex (17) et/ou unetéléimprimante locale (20), pour l’impression du service du télex, caractérisé en ce 5 qu’il comprend, en combinaison, les éléments suivants : 1) des circuits de conversion de niveau (30) faisant passer du niveau normalisé de l’ordinateur au niveau de l’imité centrale définie en 3) ; 2) des circuits de conversion série-parallèle (31) ; 3) une unité centrale comprenant : 3A) un proces-10 seur central (32) ayant au moins.8 bits ; 3B) une mémoire permanente (mémoire morte programmable)(33) conçue de façon à traduire les codes EBCDIC en codes Baudot et à mettre en oeuvre les procédures de connexion et de communication du « côté ordinateur et du côté télex ; 30) -une mémoire de données 15 réversible (mémoire vive) (34) ; 3D) des lignes (bus) de données (35), d’adresse (36) et décommandé (37) qui connectent les composants 2), 3A), 3B), 30) et 4); 4) des circuits de conversion parallèle-série (38) ; et 5) des circuits de conversion (39) faisant passer du niveau de l’imité centrale au 20 niveau normalisé de la ligne de télex.
2. Dispositif selon la revendication 1, caractérisé en ce que le composant 3A) consiste en un processeur central à 8 bits (32).
3. Dispositif selon la revendication 1, caractérisé 25 en ce que le composant 1) comprend des circuits de conversion de niveau (30) faisant passer du niveau normalisé V24 au niveau TTL, et en ce que le composant 5) comprend des circuits de conversion de niveau (39) faisant passer du niveau TTL au niveau de boucle de courant, conformément à la norme CCITT.
4. Dispositif selon la revendication 1, caractérisé en ce qu’il comprend un dispositif d’aiguillage (40) qui est conçu de façon à faire communiquer alternativement le dispositif d’interface avec une ligne de télex (17) et une téléimprimante locale (20) . p5
5» Dispositif selon la revendication 1, caractérisé £. ψ ; 13 en ce que l'unité centrale consiste en un microprocesseur Z80 à 8 bits. ~—jL. /^~ i - i ~'T 1 ' r; I /- ti·; f i l \ \ f ï \ t | ! II i,· . - L P: Ιί 1 t a .
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1982
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