KR970055371A - 클럭의 유무 판별 회로 - Google Patents

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KR970055371A
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윤용석
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유기범
대우통신 주식회사
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
    • H03K5/125—Discriminating pulses

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  • Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Manipulation Of Pulses (AREA)

Abstract

본 발명은 디지탈 소자로 클럭 신호의 유무를 판별할 수 있도록 한 클럭의 유무 판별 회로에 관한 것으로서, D-플립플럽과 오아 게이트를 이용하여 감시하고자 하는 클럭 신호의 유무를 판별할 수 있으므로 판별 회로의 구성을 간단히 함과 동시에 부피를 줄일 수 있고 판별 결과의 신뢰가 높아지는 효과가 있는 것이다.

Description

클럭의 유무 판별 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명에 의한 클럭의 유무 판별 회로의 구성 회로도.

Claims (2)

  1. '하이' 레벨의 신호가 D단자(D)로 입력되고, 감시하고자 하는 클럭 신호(ⓑ)가 클럭 단자(CK)로 입력되며, 중앙 처리 장치에서 출력되는 '하이' 레벨에서 '로우' 레벨로 천이되는 크리어 신호(ⓒ)에 의해 크리어되는 D-플립플롭(11)과; 상기 D-플립플롭(11)의 비반전 출력 단자(Q)와 제1 입력 단자가 접속되고, 제2 입력 단자로는 중앙 처리 장치에서 출력되는 클럭 유무 판별 신호(ⓔ)가 입력되는 오아 게이트(12)로 구성된 것을 특징으로 하는 클럭의 유무 판별 회로.
  2. '로우' 레벨의 신호가 D단자(D′)로 입력되고, 감시하고자 하는 클럭 신호(ⓑ′)가 클럭 단자(CK′)로 입력되며, 중앙 처리 장치에서 출력되는 '하이' 레벨에서 '로우' 레벨로 천이되는 프리셋 신호(ⓒ′)에 의해 크리어되는 D-플립플롭(11′)과; 상기 D-플립플롭(11′)의 반전 출력 단자(＊Q′)와 제1 입력 단자가 접속되고, 제2 입력 단자로는 중앙 처리 장치에서 출력되는 클럭 유무 판별 신호(ⓔ′)가 입력되는 오아 게이트(12′)로 구성된 것을 특징으로 하는 클럭의 유무 판별 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950069198A 1995-12-30 1995-12-30 클럭의 유무 판별 회로 KR0163138B1 (ko)

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