KR970005810B1 - Automatic type error detection system - Google Patents
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Abstract
Description
제1도는 본 발명의 제1실시예 따른 오류 판정 장치의 요부 구성을 나타낸 기능 블럭도.1 is a functional block diagram showing a main configuration of an error determining apparatus according to a first embodiment of the present invention.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
1 : 캡션 IC 2,4 :A/D 변환기1: Caption IC 2,4: A / D Converter
3 : 음성 IC 5 : 입력부3: voice IC 5: input unit
6 : 마이크로 프로세서 7 : 에러 표시부6: microprocessor 7: error display
61 : 제1연산부 62 : 제2연산부61: first operation unit 62: second operation unit
63 : 에러 판정부 64 : NVM(Non Volatile Memory)63: error determination unit 64: NVM (Non Volatile Memory)
65 : 제어부 66 : RAM65 control unit 66 RAM
67 : 제3연산부(MAX) 68 : 제4연산부(MIN)67: third operation unit (MAX) 68: fourth operation unit (MIN)
본 발명은 정상 동작시 소정 레벨의 균일한 출력 신호를 갖는 회로 및 장치에 있어서 그 오동작 여부를 자체적으로 진단 표시할 수 있도록 된 자체 오류 판정 장치에 관한 것이다.The present invention relates to a self-error determining apparatus that is capable of diagnostically displaying a malfunction thereof in a circuit and an apparatus having a uniform level of uniform output signal during normal operation.
가정에서 사용되고 있는 가전기기는 각각의 기능을 가진 회로 및 장치들이 유기적으로 결합되어 특정한 기능을 수행하는 결합 구조로 볼 수 있으며 이 각각의 구성 요소 가운데는 정상 동작시 소정 레벨의 균일한 출력 신호를 갖는 것들이 있다.The home appliances used in the home can be seen as a coupling structure in which circuits and devices having respective functions are organically combined to perform specific functions, and each of these components has a uniform level of a uniform output signal during normal operation. There are things.
하편 이러한 일부 구성 요소에 이상이 발생하여 오동작 되는 경우 장치 전반에 관련한 전문 지식이 없는 일반 사용자는 말할 나위도 없고 수리 및 보수를 위해 파견되는 요원들에 있어서도 고장 부분을 찾기 위해 의심이 가느 여러 곳을 점검해 보아야 하는 불편이 있었다.On the other hand, if some of these components malfunction and malfunction, not only the general user who does not have the expertise of the whole device, but also the personnel who are dispatched for repair and repair, may be able to search for many suspected faults. There was a inconvenience to check.
본 고안은 상기한 사정을 감안하여 창출된 것으로서, 정상 동작시 소정 레벨의 균일한 출력 신호를 갖는 회로 및 장치에 대해서 그 오동작 여부를 자체적으로 진단 표시할 수 있도록 된 자체 오류 판정 장치를 제공함에 목적이 있다.The present invention was created in view of the above circumstances, and an object of the present invention is to provide a self-error determination device capable of diagnosing and displaying a malfunction of a circuit and a device having a uniform level of uniform output signal during normal operation. There is this.
상기 목적을 실현하기 위한 본 발명에 따른 자체 오류 판정 장치는 소정 레벨의 출력 신호를 갖는 다수의 회로부를 구비한 장치에 있어서, 상기 각 회로부로부터 출력되는 신호의 레벨을 디지탈 데이터로 변환하는 다수의 A/D 변환기와, 상기 각 A/D 변환기의 출력과 결합되는 다수의 입력 포트를 갖추어 상기 A/D 변환기로부터 출력 데이터를 순차적으로 입력하는 입력부, 상기 입력부에 의해 입력되는 데이터를 가산하는 제1연산부, 상기 제1연산부에서의 연산 결과를 저장하는 제1메모리, 상기 제1메모리에 저장된 데이터를 소정 기간 단위로 평균하는 제2연산부, 상기 각 회로부의 정상 동작시 소정 출력값을 데이터로 저장하고 있는 제2메모리, 상기 제2메모리에 저장된 기준 데이터와 상기 제2연산부에서 얻어진 평균을 소정의 오차범위를 갖고서 에러 유무를 판정하는 에러 판정부, 및 상기 에러 판정부의 판정 결과에 따라 에러 표시를 발생하는 에러 표시부를 포함하여 구성된 것을 특징으로 한다.A self error determining apparatus according to the present invention for realizing the above object comprises a plurality of circuit sections having output signals of a predetermined level, comprising: a plurality of As for converting the levels of signals output from the respective circuit sections into digital data; An input unit for sequentially inputting output data from the A / D converter, having a plurality of input ports coupled to the outputs of the respective A / D converters, and a first operation unit for adding data input by the input unit. A second memory for averaging data stored in the first memory in a predetermined period unit, and a second output unit storing a predetermined output value during normal operation of each circuit unit. 2 memory, the reference data stored in the second memory and the average obtained by the second operation unit have an error range with a predetermined error range. And an error display unit for generating an error display in accordance with the determination result of the error determination unit.
또한 연산부를 2개 더 두어 MAX와 MIN을 계산함으로써 신호의 Vp-p(peak to peak voltage)을 체크하는 구조로 구성된다.In addition, it has a structure that checks the peak to peak voltage (Vp-p) of the signal by calculating two MAX and MIN.
상기한 구성으로 된 본 발명에 의하면, 정상 동작시 소정 레벨의 균일한 출력 신호를 갖는 회로 및 장치에 대하여 그 오동작 여부를 자체적으로 진단 표시할 수 있게 된다.According to the present invention having the above-described configuration, it is possible to self-diagnose and display the malfunction of circuits and devices having a uniform level of uniform output signal during normal operation.
이하 도면을 참조하여 본 발명의 실시예를 설명한다.Hereinafter, embodiments of the present invention will be described with reference to the drawings.
제1도는 본 발명의 1실시예에 따른 자체 오류 판정 장치의 요부 구성을 나타낸 기능 블럭도로, 도면에서 참조 번호 1은 CVI(Composite Video Input) 신호를 인가 받아 이 신호를 근거로 OSD 발생 장치로 소정 문자 표시에 관한 신호를 출력하는 캡션 IC이고, 2는 이 캡션 IC로 인가되는 CVI 신호의 데이터 오류를 판별하기 위해 CVI 신호를 디지탈 신호로 변환하는 A/D 변환기, 3은 크로마(CHROMA) IC에서 분리된 음성 신호를 처리하는 음성 IC, 4는 이 음성 IC로 인가되는 음성 신호의 오류를 판별하기 위해 이 음성 신호를 디지탈 신호로 변환하는 A/D 변환기, 5는 상기 A/D 변환기(2,4)로부터 출력되는 디지탈 신호를 인가받는 인터페이스로서의 입력부이다.1 is a functional block diagram showing the main configuration of the self error determination apparatus according to an embodiment of the present invention, the reference numeral 1 in the drawing is a CVI (Composite Video Input) signal is received based on the signal to the OSD generating device A caption IC that outputs a signal related to character display, 2 is an A / D converter that converts a CVI signal into a digital signal to determine a data error of the CVI signal applied to the caption IC, and 3 is a CHROMA IC. A voice IC for processing the separated voice signal, 4 is an A / D converter for converting the voice signal into a digital signal to determine the error of the voice signal applied to the voice IC, and 5 is the A / D converter 2, An input unit serving as an interface for receiving a digital signal output from 4).
또한 참조 번호 6은 마이크로 프로세서로서, 이 마이크로 프로세서(6)는 장치 전반을 제어하는 제어부(65)와 이 제어부(65)의 제어 신호에 따라 상기 입력부(5)로부터 순차적으로 인가되는 데이터를 가산하는 제1연산부 및 이 제1연산부에서의 연산된 결과를 저장하는 RAM(66), 제어부(65)의 제어 신호에 따라 상기 RAM(66)에 저장되어 있는 가산 결과에 소정 데이터 간격마다 평균값을 산출해 내는 제2연산부(62), 정상 동작시의 출력값을 기준 데이터로 저장하고 있는 NVM(Non Volatile Memory)(64), NVM에 저장된 기준 데이터와 상기 제2연산부(62)에서 얻어진 평균값과의 오차 범위를 근거로 회로 바이어스 전압의 에러 유무를 판정하는 에러 판정부(63)로 구성되어 있다.Also, reference numeral 6 denotes a microprocessor, which adds data sequentially applied from the input unit 5 according to a control unit 65 for controlling the overall apparatus and a control signal of the control unit 65. The average value is calculated for every predetermined data interval to the addition result stored in the RAM 66 according to the control signal of the RAM 66 and the control unit 65 storing the first operation unit and the result calculated by the first operation unit. The second calculation section 62, Non Volatile Memory (NVM) 64 which stores the output value in normal operation as reference data, and the error range between the reference data stored in the NVM and the average value obtained by the second calculation section 62. The error determination unit 63 determines whether or not an error exists in the circuit bias voltage.
또한 참조 번호 7은 상기 에러 판정부(63)의 판정 결과에 따라 사용자에게 이를 인지시키기 위한 에러 표시부이다.Reference numeral 7 denotes an error display unit for recognizing the user according to the determination result of the error determination unit 63.
이어 상기한 구성으로 된 장치의 동작을 설명한다.Next, the operation of the device having the above configuration will be described.
우선 캡션 IC(1)로 인가되는 CVI 신호 및 음성 IC로 인가되는 음성신호는 그 이상 유무 유무 판별을 위해 상기 A/D 변환기(2)에서 디지탈 신호로 변환된 후 입력부(5)에 인가되는데, 이 입력부에 인가된 신호는 상기 제어부(65)로부터의 제어 신호에 따라 제1연산부(61)로 전송되어 가산된 후 RAM(66)에 저장되게 된다.First, the CVI signal applied to the caption IC 1 and the audio signal applied to the voice IC are converted into a digital signal by the A / D converter 2 and then applied to the input unit 5 to determine whether or not there is more. The signal applied to the input unit is transmitted to the first operation unit 61 according to the control signal from the control unit 65, added to the signal, and then stored in the RAM 66.
한편 RAM에 저장된 가산 결과는 소정 개수의 어드레스가 채워졌음을 감지한 제어부(65)의 제어 신호에 따라 제2연산부(62)로 전송되어 소정 데이터 간격에 대한 평균값이 산출되게 되고 산출된 평균값은 회로 바이어스 에러 판정부(63)로 보내져 NVM(64)에 저장되어 있는 정상 동작시 출력값과의 오차 범위를 근거로 유무를 판정하여 제어부(65)는 에러 판정부(63)의 판정 결과에 따라 OSD 발생장치(도시되지 않음)와 같은 에러 표시부(7)를 구동, 사용자에게 이를 인지시키게 된다.On the other hand, the addition result stored in the RAM is transmitted to the second operation unit 62 according to the control signal of the control unit 65 that detects that the predetermined number of addresses are filled, and the average value for the predetermined data interval is calculated, and the calculated average value is a circuit. The controller 65 determines whether the OSD is generated according to the determination result of the error determination unit 63 by determining whether the bias error determination unit 63 is present or not based on an error range with the output value during normal operation stored in the NVM 64. An error display 7 such as a device (not shown) is driven to make the user aware of it.
즉 상기 실시예에 의하면 정상 동작시의 입력 평균값을 근거로 그 오동작 여부를 자체적으로 진단 표시할 수 있게 된다.That is, according to the above embodiment, it is possible to self-diagnose and display the malfunction on the basis of the input average value in the normal operation.
본 발명은 상기 실시예에 한정되지 않고 본 발명의 기술적 요지를 벗어나지 않는 범위 내에서 다양하게 변형 실시할 수 있는 바, 예컨데 상기 NVM에 회로의 정상 동작에 필요한 정격 전원 레벨을 기준 데이타로 저장하고, 이 저장된 기준 데이터를 근거로 회로에 인가되는 전원을 검지함으로써 오류 여부를 판정하도록 구성할 수도 있다.The present invention is not limited to the above embodiments and can be variously modified without departing from the technical gist of the present invention. For example, the rated power level required for the normal operation of the circuit is stored in the NVM as reference data. It may be configured to determine whether or not an error is detected by detecting a power applied to the circuit based on the stored reference data.
이상 설명한 바와 같이, 본 발명에 의하면 정상 동작시 소정 레벨의 균일한 출력 신호를 갖는 회로 및 장치에 있어서 그 오동작 여부를 자체적으로 진단 표시할 수 있도록 된 자체 오류 판정 장치를 실현할 수 있게 된다.As described above, according to the present invention, it is possible to realize a self error determining device that can diagnose and display the malfunction itself in a circuit and a device having a uniform level of uniform output signal during normal operation.
Claims (1)
Priority Applications (1)
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KR1019940021268A KR970005810B1 (en) | 1994-08-27 | 1994-08-27 | Automatic type error detection system |
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KR1019940021268A KR970005810B1 (en) | 1994-08-27 | 1994-08-27 | Automatic type error detection system |
Publications (2)
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KR960008644A KR960008644A (en) | 1996-03-22 |
KR970005810B1 true KR970005810B1 (en) | 1997-04-21 |
Family
ID=19391283
Family Applications (1)
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KR1019940021268A KR970005810B1 (en) | 1994-08-27 | 1994-08-27 | Automatic type error detection system |
Country Status (1)
Country | Link |
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KR (1) | KR970005810B1 (en) |
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1994
- 1994-08-27 KR KR1019940021268A patent/KR970005810B1/en not_active IP Right Cessation
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KR960008644A (en) | 1996-03-22 |
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