KR960032833A - 3상 회로의 전압 제한 및 감쇠 회로 - Google Patents
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Abstract
본 발명은 피드백으로부터 제너레이터를 보호하기 위해, 파워 회로의 각 위상라인(L1, L2, L3)에 대해 리액터(D1, D2, D3,)가 직렬로 접속되고, 대칭의 간섭을 필터링하기 위해, 간섭 제거 커패시터(C12, C23, C13)가 위상라인 사이에 델타 결선으로 접속되며, 비대칭의 간섭을 필터링하기 위해, 부가의 간섭 제거 커패시터(C1, C2, C3)가 성형 결선으로 위상라인에 접속되고, 대칭의 간섭을 필터링하기 위해, 배리스터(V12, V23, V13)가 위상라인 사이에 델타 결선으로 접속되며, 비대칭의 간섭을 필터링하기 위해, 부가의 배리스터(V1, V2, V3)가 성형 결선으로 위상라인에 접속되는 것을 특징으로 하는 3상 회로의 전압 제한 및 감쇠 회로에 관한 것이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 3상 서플라이 회로에서 전압을 제한 및 감쇠시키기 위한 본 발명에 따른 회로의 회로도.
Claims (4)
- -피드백으로부터 제너레이터를 보호하기 위해, 파워 회로의 각 위상라인(L1, L2, L3)에 대해 리액터(D1, D2, D3)가 직렬로 접속되고, -대칭의 간섭을 필터링하기 위해, 간겁 제거 커패시터(C12, C23, C13)가 위상라인 사이에 델타 결선으로 접속되며, -비대칭의 간섭을 필터링하기 위해, 부가의 간섭 제거 커패시터(C1, C2, C3)가 성형 결선으로 위상라인에 접속되고, -대칭의 간섭을 필터링하기 위해, 배리스터(V12, V23, V13)가 위상라인 사이에 델타결선으로 접속되며, -비대칭의 간섭을 필터링하기 위해, 부가의 배리스터(V1, V2, V3)가 성형 결선으로 위상라인에 접속되는 것을 특징으로 하는 3상 회로의 전압 제한 및 감쇠 회로.
- 제1항에 있어서, 블리더 저항(RA)이 간섭 제거 커패시터에 대해 병렬로 접속되는 것을 특징으로 하는 3상 회로의 전압 제한 및 감쇠 회로.
- 제1항 또는 2항에 있어서, 제동 저항(R12, R23, R13)이 델타결선의 간섭 제거 커패시터(C12, C23, C13)에 대해 직렬로 접속되는 것을 특징으로 하는 3상 회로의 전압 제한 및 감쇠 회로.
- 제1항, 2항 또는 3항에 있어서, 간섭 제거 커패시터 및 배리스터의 결선이 보호장치(S1, S2, S3)를 통해 각 리액터(D1, D2, D3)로 이루어지는 것을 특징으로 하는 3상 회로의 전압 제한 및 감쇠 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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