KR960027705A - 프로토콜 분석기 정합장치 - Google Patents
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Abstract
본 발명은 전전자 교환기에 있어서, 서부 하이웨이의 타임 슬롯을 통해 수행되어지는 각 블록간의 통신 프로토콜을 모니터하거나 에뮬레이션하는 프로토콜 분석기를 해당 블럭에 정합시켜 주는 프로토콜 분석기 정합장치에 관한 것으로서, 특히 패킷 교환에 관련된 블럭간의 프로토콜 수행이 제대로 이루어지는지에 대해 모니터 및 에뮬레이션을 통해 알 수 있도로 서부 하이웨이가 인입하는 관련 블럭의 해당 슬롯과 크로토콜 분석기간의 정합 기능을 수행하는 프로토콜 분석기 정합장치에 관한 것이다. 따라서 본 발명은 전전자 교환기의 서부 하이웨이를 통해 데이타를 송수신하는 회로팩에서 임의의타임 슬롯을 지정하여 데이타를 서브 하이웨이로부터 추출하거나 서부 하이웨이에 인입하므로, 시스템 개발 및 유지 보수 측면에서 중요한 역할을 수행할 수 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 의한 프로토콜 분석기 정합장치의 구성도.
Claims (6)
- 서부 하이웨이 신호가 입력되는 블럭에 선택적으로 정합할 수 있도록 하는 정합 블럭 선택부와, PBA 자체루프백 시험시 블럭과 프레임 동기신호 및 송신 데이타 라인을 수신 데이타 라인에 루프백 시켜주는 접속장치를 성택적으로 제공해주기 위한 루프백 기능 선택부와 상기 정합 블럭 선택부에 연결되어 RS422 방식의 신호와 TTL레벨 신호로 상호변환해 주는 RS422 변환부와 상기 서브 하이웨이의 32타임 슬롯 가운데 한 개의 타임 슬롯을 지정하여 해당 타임 슬롯의데이타를 추출 또는 인입하기 위한 타임 슬롯 선택부와 상기 RS422변환부로부터 출력되고 타임 슬롯 선택부에서 선택된타임 슬롯의 2Mbps 데이타를 64Kps 데이타로 변환하고 프로토콜 분석기에서 생성된 64Kps 데이타를 지정된 타임 슬롯에인입시키기 위해 2Mbps 데이타로 변환하는 신호 변환부와 상기 신호 변환부와 프로토콜 분석기에 연결되어 TTL레벨 신호와 RS232C신호로 상호 변환해 주는 RS232C 변환부와 츠로토콜 분석기의 모니터 기능과 에뮬레이션 기능 중에서 하나를 선택하기 위한 모드 선택부와 상기 모드 선택부의 제어에 따라 오프 라인에거 실시되는 에뮬레이션 기능 시험시 요구되는클럭 및 프레임 동기신호를 생성하는 클럭 생성부를 포함하는 프로토콜 분석기 정합장치.
- 제1항에 있어서, 상기 정합 블럭 선택부는 서브 하이웨이 신호가 입력되는 블럭의 각 슬롯에 연결된 4개의8비트 DIP 수위치로 구성되는 포로토콜 분석기 정합장치.
- 제2항에 있어서, 상기 8비트 DIP 스위치는 하나의 PHM 블럭 정합용 8비트 DIP스위치, 하나의 FMXP 블럭 정합용 DIP 스위치 및 2개의 TSL 블럭 정합용 DIP 스위치로 구성되는 프로토콜 분석기 정합장치.
- 제1항에 있어서, 상기 타임 슬롯 선택부는 사용자에 의해 입력되는 5비트 데이타와 인가되는 분주된128KHZ클럭, 64KHZ클럭, 32KHZ클럭,16KHZ클럭 및 8KHZ클럭을 비교하여 같은 경우 타임 슬롯 인에이블 신호를 발생하는 비교기로 구성되는 프로토콜 분석기 정합장치.
- 제1항에 있어서, 상기 신호 변환부는 상기 RS422변환부로부터 출력되고 타임 슬롯 선택부에서 선택된 타임슬롯의 2Mbps 직렬 데이타를 8비트 병렬 데이타로 변환하는 제1쉬프트 레지스터와 상기 제1쉬프트 레지스터로부터 출력되는 데이타 중에서 해단 타임 슬롯의 데이타만을 래치하는 제1래치와 상기 제1래치로부터 출력되는 데이타를 64Kbps 직렬데이타로 변환하여 상기 RS232C 변환부로 출력하는 제2쉬프트 레지스터와, 상기 프로토콜 분석기에서 생성되어 상기RS232C 변환부로부터 출력되는 64Kbps 직렬데이타를 8비트 병렬 데이타로 변환하는 제3쉬프트 레지스터와 상기 제3쉬프트레지스터로부터 출력되는 8비트 병렬 데이타를 해당 타임슬롯에 인입시키기 위해 래치하는 제2래치와 상기 제2래치로부터출력되는 8비트 병렬 데이타를 2Mbps의 직렬 데이타로 변환하여 상기 RS422변환부로 출력하는 제4쉬프트 레지스터로 구성되는 프로토콜 분석기 정합장치.
- 제1항에 있어서, 상기 클럭 생성부는 4.096MHZ클럭을 발생하는 오실레이터와, 상기 오실레이터로부터 출력되는 4.096MHZ클럭을 분주하여 2MHZ클럭과 8KHZ클럭을 생성하는 분주회로와 상기 분주회로로부터 출력되는 8KHZ클럭을 데이타 입력으로 하고 2KHZ클럭을 클럭 입력으로 하는 제1D블립플롭과 상기 제1D플립플롭으로부터 출력되는 신호를 데이타입력으로 하고 2MHZ클럭을 입력으로 하는 제 2D플립플롭과 상기 제2D플립플롭으로부터 출력되는 신호를 반전시키는 인버터와 상기 제1플립플롭과 인버터로부터 출력되는 신호를 논리곱하는 앤드 게이트로 구성되는 프로토콜 분석기 정합장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019940037261A KR0140304B1 (ko) | 1994-12-27 | 1994-12-27 | 프로토콜 분석기 정합장치 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019940037261A KR0140304B1 (ko) | 1994-12-27 | 1994-12-27 | 프로토콜 분석기 정합장치 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR960027705A true KR960027705A (ko) | 1996-07-22 |
| KR0140304B1 KR0140304B1 (ko) | 1998-07-01 |
Family
ID=19403831
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019940037261A KR0140304B1 (ko) | 1994-12-27 | 1994-12-27 | 프로토콜 분석기 정합장치 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR0140304B1 (ko) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100474884B1 (ko) * | 1997-07-25 | 2005-06-16 | 엘지전자 주식회사 | 에이치디티브이의데이터입력장치 |
-
1994
- 1994-12-27 KR KR1019940037261A patent/KR0140304B1/ko not_active IP Right Cessation
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100474884B1 (ko) * | 1997-07-25 | 2005-06-16 | 엘지전자 주식회사 | 에이치디티브이의데이터입력장치 |
Also Published As
| Publication number | Publication date |
|---|---|
| KR0140304B1 (ko) | 1998-07-01 |
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