KR960008791A - 디지탈 데이타 샘플링 위상 변환 회로 및 변환 방법 - Google Patents

디지탈 데이타 샘플링 위상 변환 회로 및 변환 방법 Download PDF

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Abstract

[목적] 디지탈 데이타의 샘플링 위상을 변환한다.
[구성] 제1클럭 CK에 동일한 제1디지탈 데이타 DIN를 제1클럭 CK과 비동기적인 제2클럭 XCK에 동기한 제2디지탈 데이타 Dout로 변환하는 변환 회로를 대상으로 한다. 제1클럭 CK의 1주기를 N개(N≥2)의 기간으로 분할한다. 이 각각의 분할기간마다 제1 및 제2의 보간 계수 KA, KB를 정한다. 이 분할기간마다의 제1 및 제2보간 계수 KA, KB중 제2클럭 XCK이 위치하는 분할기간에 있어서 제1 및 제2의 보간 계수 KA, KB를 사용하여, 제1의 디지탈 데이타 DIN중, 어느 한 클럭 기간에 데이타와, 그 다음 클럭기간의 데이타로부터, 제2디지탈 데이마 Dout를 생성한다.

Description

디지탈 데이타 샘플링 위상 변환 회로 및 변환 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 1예를 도시하는 계통도.

Claims (7)

  1. 제1클럭에 동기한 제1디지탈 데이타를, 상기 제1클럭과 비동기의 제2클럭에 동기한 제2디지탈 데이타로 변환하는 변환 회로에 있어서, 상기 제1클럭의 1주기를 N개(N≥2)의 기간으로 분할하는 분할 회로와; 상기 각각의 분할기간마다 제1 및 제2보간 계수를 정하는 계수 설정 회로와; 상기 분할기간마다의 제1 및 제2보간계수중, 상기 제2클럭이 위치하는 분할기간에 있어서의 상기 제1 및 제2보간 계수를 사용하고, 상기 제1디지탈 데이타중, 어느 한 클럭기간의 데이타와 그 다음 클럭기간의 데이타로부터 상기 제2디지탈 데이타를 생성하는 데이타 생성 회로를 구비하는 것을 특징으로 하는 디지탈 데이타 샘플링 위상 변환 회로.
  2. 제1항에 있어서, 상기 분할기간마다, 그 분할기간에 있어서의 상기 제1 및 제2의 보간 계수를 사용하고, 상기 제1의 디지탈 데이타중, 어느 한 클럭기간의 데이타와, 그 다음 클럭기간의 데이타로부터 N배의 클럭주파수의 디지탈 데이타를 생성하여, 상기 생성한 디지탈 데이다중, 상기 제2클럭이 위치하는 상기 분할기간의 데이타를 꺼낸 상기 제2디지탈 데이타를 생성하는 것을 특징으로 하는 디지탈 데이타 샘플링 위상 변환 회로.
  3. 제1항에 있어서, 상기 분할기간중, 상기 제2클럭이 위치하는 분할 기간에 있어서의 상기 제1 및 제2의 보간 계수를 꺼내고, 상기 꺼낸 제1 및 제2의 보간계수를 사용하여, 상기 제1디지탈 데이타중, 어느 한 클럭기간의 데이타와, 그 다음 클럭기간의 데이타로부터 상기 제2디지탈 데이타를 생성하는 것을 특징으로 하는 디지탈 데이타 샘플링 위상 변환 회로.
  4. 제1 내지 3항중 어느 한 항에 있어서, N=4인 것을 특징으로 하는 디지탈 데이타 샘플링 위상 변환 회로.
  5. 제1의 클럭에 동기한 제1디지탈 데이타를 상기 제1클럭과 비동기의 제2클럭에 동기한 제2의 디지탈 데이타로 변환하는 변환방법에 있어서, 상기 제1클럭의 1주기를 N개(N≥2)의 기간으로 분할하는 단계와; 상기 각각의 분할기간마다 제1 및 제2의 보간계수를 정하는 단계와; 상기 분할기간마다의 제1 및 제2의 보간계수중, 상기 제2의 클럭이 위치하는 분할기간에 있어서의 상기 제1 및 제2의 보간 계수를 사용하고, 상기 제1의 디지탈 데이타중, 어느 한 클럭기간의 데이타와 그 다음 클럭기간의 데이타로부터 상기 제2디지탈 데이타를 생성하는 단계를 포함하는 것을 특징으로 하는 디지탈 데이타 샘플링 위상 변환 방법.
  6. 제5항에 있어서, 상기 분할기간마다, 그 분할기간에 있어서의 상기 제1 및 제2의 보간 계수를 사용하고, 상기 제1디지탈 데이타중, 어느 한 클럭기간의 데이타와 그 다음 클럭기간의 데이타로부터 N배의 클럭 주파수의 디지탈 데이타를 생성하며, 상기 생성된 디지탈 데이타중, 상기 제2클럭이 위치하는 상기 분할기간의 데이타를 꺼내어 상기 제2디지탈 데이타를 생성하는 것을 특징으로 하는 디지탈 데이타 샘플링 위상 변환 방법.
  7. 제5항에 있어서, 상기 분할기간중, 상기 제2의 클럭이 위치하는 분할 기간에 있어서의 상기 제1 및 제2의 보간계수를 꺼내고 상기 꺼낸 제1 및 제2의 보간 계수를 사용하여, 상기 제1디지탈 데이타중, 어느 한 클럭기간의 데이타와 그 다음 클럭 기간의 데이타로부터 상기 제2디지탈 데이타를 생성하는 것을 특징으로 하는 디지탈 데이타 샘플링 위상 변환 방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950024770A 1994-08-12 1995-08-11 디지탈데이타샘플링위상변환회로및변환방법 KR100353098B1 (ko)

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Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6097879A (en) * 1996-04-04 2000-08-01 Hitachi, Ltd. Video camera apparatus of digital recording type
KR100541053B1 (ko) * 2003-02-11 2006-01-10 삼성전자주식회사 프로세스들간의 출력 동기가 보정된 다중 프로세스 a/d컨버터
US6809664B1 (en) * 2003-06-26 2004-10-26 International Business Machines Corporation Double width data bus, single rate to single width data bus, double rate converter circuit
CA2614604A1 (en) * 2005-07-08 2007-06-28 Med-El Elektromedizinische Geraete Gmbh Cmos full wave rectifier
US8248141B2 (en) 2005-07-08 2012-08-21 Med-El Elekromedizinische Geraete Gmbh Data and power system based on CMOS bridge

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE3852570T2 (de) * 1987-04-10 1995-05-04 Sony Corp Zeitfehler-Korrigiervorrichtung für Bildsignalen.
JP2731151B2 (ja) * 1987-09-18 1998-03-25 株式会社東芝 位相情報検出回路
US5301196A (en) * 1992-03-16 1994-04-05 International Business Machines Corporation Half-speed clock recovery and demultiplexer circuit
US5774080A (en) * 1994-12-15 1998-06-30 Analog Devices, Incorporated Reduced transistor-count data storage and multiplexing system

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KR100353098B1 (ko) 2003-01-06
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