KR950029835A - 초 전기 및 유사한 검출기의 출력에서 dc 바이어스를 제거하기 위한 디지탈 신호 처리 시스템 - Google Patents

초 전기 및 유사한 검출기의 출력에서 dc 바이어스를 제거하기 위한 디지탈 신호 처리 시스템 Download PDF

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에스. 헤이즈 로버트
엔. 청 프랭크
더블류. 클래트 로버트
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완다 케이. 덴슨-로우
휴우즈 에어크라프트 캄파니
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Abstract

본 발명은 초 전기 검출기 및 유사한 형태의 검출기의 출력에서 DC 바이어스를 제거하기 위한 디지탈 신호처리 시스템(100)에 관한 것이다. 또한 이 시스템은 검출기와 시스템(100)간의 전자 회로(판독기, 증폭기, 구동기 등)에 의해 유도되는 검출기 신호에서 오프셋을 제거한다.

Description

초 전기 및 유사한 검출기의 출력에서 DC 바이어스를 제거하기 위한 디지탈 신호 처리 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 신호 처리 시스템의 블럭도, 제2a도는 본 발명의 신호 처리 시스템의 아날로그 입력부의 블럭도, 제2b도는 아날로그 입력부 및 디지탈 신호 처리부의 간단한 블럭도, 제3도는 발명의 신호 처리 시스템의 아날로그부의 제1디지탈 대 아날로그 변환기의 예시 구성의 블럭도, 제4도는 본 발명의 신호 처리 시스템의 아날로그부의 제1적분 회로의 예시 구성의 블럭도, 제4(a)도는 일반적인 초전기 검출기의 출력을 나타내는 파형, 제4(b)도는 본 교시에 따른 필드 대 필드 이득 역(inversion)후의 제4(a)도의 파형을 도시하는 파형, 제4(c)도는 초 전기 검출기로부터의 이전의 출력 필드를 나타내는 도면, 제4(d)도는 제4(b)도 및 제4(c)도에 도시된 파형의 합 후의 출력을 나타내는 파형, 제5도는 본 발명의 신호 처리 시스템의 아날로그부의 제2디지탈 대 아날로그 예시 구성을 나타내는 블럭도.

Claims (10)

  1. 제1시간 간격동안에 제1출력을 제공하고 제2시간 간격동안에 제2출력을 제공하는 초 전기 검출기의 출력에서 DC 바이어스를 제거하기 위한 디지탈 신호 처리 시스템(100)에 있어서, 제1출력 신호를 역전하기 위한 제1회로(240); 상기 역전된 제1출력 신호를 기억하기 위한 제2회로(308); 및 바이어스 보정 출력 신호를 제공하기 위해 기억된 역전된 제1출력 신호를 제2출력 신호에 부가하기 위한 제3회로(310)를 구비하는 것을 특징으로 하는 디지탈 신호 처리 시스템.
  2. 제1항에 있어서, 상기 바이어스 보정 출력 신호에 보정된 신호 크기를 제공하기 위해 상기 바이어스 보정 출력 신호를 둘로 스케일하기 위한 회로(312)를 구비하는 것을 특징으로 하는 디지탈 신호 처리 시스템.
  3. 제1항에 있어서, 초 전기 검출기의 어레이(20)의 각 검출기의 출력에 보정된 신호를 제공하기 위한 회로(240, 308, 310)를 구비하는 것을 특징으로 하는 디지탈 신호 처리 시스템.
  4. 제3항에 있어서, 상기 어레이(20)의 각 검출기에 의해 발생되는 신호에서 DC 오프셋을 보정하기 위한 신호를 제공하는 회로(302, 220, 212)를 구비하는 것을 특징으로 하는 디지탈 신호 처리 시스템.
  5. 제4항에 있어서, 상기 어레이(20)의 각 검출기에 의해 발생되는 신호에서 DC 오프셋을 보정하기 위해 신호들 각각을 기억하기 위한 회로(302)를 구비하는 것을 특징으로 하는 디지탈 신호 처리 시스템.
  6. 제5항에 있어서, 상기 어레이(20)의 결합된 검출기에 의해 발생되는 순간 신호로부터 상기 기억된 DC오프셋 신호를 감산하기 위한 회로(220, 212)를 구비하는 것을 특징으로 하는 디지탈 신호 처리 시스템.
  7. 제3항에 있어서, 상기 어레이(20)의 각 검출기에 의해 발생된 신호에서 이득을 보정하기 위한 신호를 제공하는 회로(250, 260, 304)를 구비하는 것을 특징으로 하는 디지탈 신호 처리 시스템.
  8. 제7항에 있어서, 이득 보정 신호의 각각을 기억하기 위한 회로(304)를 구비하는 것을 특징으로 하는 디지탈 신호 처리 시스템.
  9. 제8항에 있어서, 상기 어레이(20)에 결합된 검출기에 의해 발생된 순간 신호를 상기 기억된 이득 보정신호의 각각에 승산하기 위한 회로(250)를 구비하는 것을 특징으로 하는 디지탈 신호 처리 시스템.
  10. 제3항에 있어서, 상기 어레이(20)를 따라 글로벌 이득 제어 및 자동 레벨 제어를 제공하기 위한 회로(306)를 구비하는 것을 특징으로 하는 디지탈 신호 처리 시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950008467A 1994-04-12 1995-04-12 초 전기 및 유사한 검출기의 출력에서 dc 바이어스를 제거하기 위한 디지탈 신호 처리 시스템 KR0173825B1 (ko)

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