KR950010382A - ROM Table Selection Circuit in Variable Length Code Decoder - Google Patents

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KR950010382A
KR950010382A KR1019930018028A KR930018028A KR950010382A KR 950010382 A KR950010382 A KR 950010382A KR 1019930018028 A KR1019930018028 A KR 1019930018028A KR 930018028 A KR930018028 A KR 930018028A KR 950010382 A KR950010382 A KR 950010382A
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KR
South Korea
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rom table
variable length
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code decoder
selection circuit
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Application number
KR1019930018028A
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Korean (ko)
Inventor
신현기
Original Assignee
배순훈
대우전자 주식회사
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Abstract

본 발명은 가변 길이 코드 디코더에서 코드 워드에 해당하는 값을 롬 테이블에서 찾는 롬 테이블 선택회로에 관한 것이다.The present invention relates to a ROM table selection circuit for finding a value corresponding to a code word in a ROM table in a variable length code decoder.

본 발명은 코드 워드에 따라 해당 값을 찾는 롬 테이블을 코드 워드의 비트수에 따라 제1롬 테이블(25) 및 제2롬 테이블(26)로 나눔으로써 롬의 사이즈를 줄여 가격을 다운시키고, 또한, 전체적으로는 롬이 차지하는 면적을 줄일 수 있다.The present invention reduces the size of the ROM by dividing the ROM table that finds the corresponding value according to the code word into the first ROM table 25 and the second ROM table 26 according to the number of bits of the code word. As a whole, the area of ROM can be reduced.

Description

가변 길이코드 디코더에서의 롬 테이블 선택 회로ROM Table Selection Circuit in Variable Length Code Decoder

본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음Since this is an open matter, no full text was included.

제2도는 본 발명에 따른 VLC디코더에서의 롬 테이블 선택 회로를 나타낸 블럭도,2 is a block diagram showing a ROM table selecting circuit in a VLC decoder according to the present invention;

제3도는 상기 제2도의 어드레스 로직부의 상세 회로도이다.3 is a detailed circuit diagram of the address logic unit of FIG. 2.

Claims (2)

전송되는 소정 비트의 데이타를 입력받는 제1바렐 쉬프트(21)와, 상기 제1바렐 쉬프트(21)의 출력을 제공받아 소정 비트의 데이타를 출력하는 제2바렐 쉬프트(22)와, 상기 제1, 제2바렐 쉬프트(21,22)로부터 출력되는 코드 워드의 전체 길이를 판별하여 선택신호 및 데이타를 출력하는 어드레스 로직부(23)와, 상기 어드레스 로직부(23)의 선택신호에 따라 제1출력단(A) 또는 제2출력단(B)을 통해 상기 어드레스 로직부(23)의 데이타를 출력하는 멀티플렉서(24)와, 상기 멀티플렉서(24)의 제1출력단(A)에 연결되고 소정 비트이하의 코드 워드에 해당하는 값을 갖고 있는 제1롬 테이블(25)과, 상기 멀티플렉서(24)의 제2출력단(B)에 연결되고 소정 비트 이상의 코드 워드에 해당하는 값을 갖고 있는 제2롬 테이블(26)로 이루어지는 가변 길이 코드 디코더에서의 롬 테이블 선택회로.A first barrel shifter 21 receiving a predetermined bit of data to be transmitted, a second barrel shifter 22 receiving an output of the first barrel shifter 21 and outputting a predetermined bit of data, and the first An address logic unit 23 for outputting a selection signal and data by determining the total length of the code words output from the second barrel shifts 21 and 22; and a first signal according to the selection signal of the address logic unit 23; A multiplexer 24 for outputting data of the address logic section 23 through an output terminal A or a second output terminal B, and a first output terminal A of the multiplexer 24, A first ROM table 25 having a value corresponding to a code word, and a second ROM table having a value corresponding to a code word of a predetermined bit or more, connected to the second output terminal B of the multiplexer 24 ( ROM Table Selection in Variable Length Code Decoder A. 제1항에 있어서, 상기 어드레스 로직부(23)는, 상기 제1바렐 쉬프터(21)의 소정 비트를 논리 조합하여 선택신호로 출력하는 오와 게이트로 구성됨을 특징으로 하는 가변 길이 코드 디코더에서의 롬 테이블 선택회로.2. The variable length code decoder of claim 1, wherein the address logic section 23 comprises a gate and a gate which output a selection signal by logically combining a predetermined bit of the first barrel shifter 21. ROM table selection circuit. ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.※ Note: The disclosure is based on the initial application.
KR1019930018028A 1993-09-08 1993-09-08 ROM Table Selection Circuit in Variable Length Code Decoder KR950010382A (en)

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