KR940000972A - 메모리 관리 유니트에서의 입출력 버퍼 - Google Patents

메모리 관리 유니트에서의 입출력 버퍼 Download PDF

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KR940000972A
KR940000972A KR1019920009719A KR920009719A KR940000972A KR 940000972 A KR940000972 A KR 940000972A KR 1019920009719 A KR1019920009719 A KR 1019920009719A KR 920009719 A KR920009719 A KR 920009719A KR 940000972 A KR940000972 A KR 940000972A
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KR
South Korea
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buffer
management unit
memory management
input
buffers
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Application number
KR1019920009719A
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Inventor
이문기
이광엽
정상규
Original Assignee
이문기
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  • Memory System Of A Hierarchy Structure (AREA)

Abstract

본 발명은 단일 버퍼로 4가지의 캐쉬 메모리 동작 모드를 지원하는 메모리 관리 유니트에서의 입출력 버퍼에 관한 것이다.
본 발명은 상기 목적을 달성하기 위해 메모리 관리 유니트내의 입출력 버퍼가 4가지의 캐쉬 메모리 동작 모드를 지원하기 위해 입력버퍼 및 출력버퍼로 분리설계되지 않고 단일 버퍼에서 동작 모드에 따라 버퍼의 사용영역을 변형하도록 설계한다. 따라서 메모리 관리 유니트(Memoryhfanagement Unit)내의 버퍼 크기를 축소시키면서 버퍼의 효율을 유지할 수 있는 단일버퍼의 설계방법을 제안한다.

Description

메모리 관리 유니트에서의 입출력 버퍼
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 구성도,
제2도 내지 제3도는 본 발명의 타이밍도.

Claims (2)

  1. 캐쉬 메모리와 메인 메모리간의 데이타 교환을 지원하는 메모리 관리 유니트 내의 입출력 버퍼 기능을 수행하기 위한 단일 버퍼를 구비하고 있는 것을 특징으로 하는 입출력 버퍼.
  2. 제1항에 있어서, 상기 단일 버퍼는 제1버퍼 레지스터 그룹(AO 내지 An) 및 제1버퍼 레지스터 그룹(Bl 내지 Bn), 및 상기 각 버퍼 레지스터에 연결된 인에이블 신호 전송라인, 읽기신호 전송라인 및 쓰기 신호 전송라인을 구비하고 있는 것을 특징으로 하는 입출력 버퍼.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019920009719A 1992-06-05 1992-06-05 메모리 관리 유니트에서의 입출력 버퍼 KR940000972A (ko)

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