KR920019113A - 페이징 수신기의 바이어스 안정화 회로 - Google Patents

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Abstract

내용 없음

Description

페이징 수신기의 바이어스 안정화 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제8도는 본 발명의 페이징 수신기 구성도,
제10도는 제8도의 제1실시예도.

Claims (21)

  1. 주기적으로 제1 및 제2 주기동안 RF구성부를 측으로 전원을 공급하는 전원스위치 수단을 구비하여 제1 주기동안 기준 바이어스를 안정화하고 이후 제2주기동안 수신 데이타를 분석 처리하는 페이징 수신기에 있어서, 상기 제1 주기동안 발진 제어신호를 출력하는 제어부와, 상기 발진 제어신호에 의해 스위칭되어 소정 주파수를 발진하는 발진수단과, 상기 제1 주기동안 상기 발진부의 출력을 수신하여 기준신호의 전위를 갖는 복조신호를 발생하는 복조수단과, 상기 제1 주기동안 상기 복조부의 출력을 수신하여 기준신호로 바이어스를 안정화하는 파형정형 수단으로 구성됨을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  2. 제1항에 있어서, 상기 발진 수단이 상기 전원스위치 수단에 의해 전원을 공급받아 수신변조신호의 중심 주파수를 발진하는 발진부와, 입력단이 상기 발진부에 연결되고 출력단이 상기 복조부에 연결되며, 상기 발진 제어신호에 의해 상기 제1 주기 동안 스위칭되어 상기 발진부의 출력을 상기 복조부로 인가하는 발진 스위치로 구성됨을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  3. 제2항에 있어서, 상기 복조 수단이 상기 제1 주기 동안 상기 발진부의 출력을 복조하여 수신 데이타의 중간 전위를 갖는 기준신호 레벨의 복조신호를 발생하고, 상기 제2 주기 동안 수신되는 RF변조신호의 논리 상태에 따른 복조신호를 발생하도록 동작함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  4. 제3항에 있어서, 상기 파형정형 수단이 신호 입력단과 기준 입력단을 갖는 차동증폭기를 구비하며, 상기 제1 주기 동안 상기 복조수단을 출력하는 복조신호를 수신하여 기준 입력단의 전위를 기준신호 레벨로 바이어스 안정화 하고, 상기 제2 주기 동안 상기 복조수단을 출력하는 복조신호를 신호 입력단으로 수신하여 상기 기준 신호에 따른 디지탈 데이타를 발생하도록 동작함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  5. 제1항에 있어서, 상기 발진수단이 입력단이 상기 전원 스위치 수단에 연결되어 상기 제어부로 부터 출력하는 발진 제어신호에 의해 전원 통로를 형성하는 발진스위치와, 전원 공급단이 상기 발진스위치에 연결되고 출력단이 상기 복조단에 연결되어 상기 제1 주기동안 상기 중심주파수를 발진하여 상기 복조 수단으로 출력하는 발진부로 구성됨을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  6. 제5항에 있어서, 상기 복조 수단이 상기 제1 주기 동안 상기 발진부의 출력을 복조하여 수신 데이타의 중간 전위를 갖는 기준신호의 복조신호를 발생하고, 상기 제2 주기 동안 수신되는 RF변조신호의 논리 상태에 따른 복조신호를 발생하도록 동작함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  7. 제6항에 있어서, 상기 파형정형 수단이 신호 입력단과 기준 입력단을 갖는 차동증폭기를 구비하며, 상기 제1 주기 동안 상기 복조수단을 출력하는 복조신호를 수신하여 기준 입력단이 전위를 기준 전위로 바이어스 안정화 하고, 상기 제2 주기 동안 상기 복조수단을 출력하는 복조신호를 신호 입력단으로 수신하여 기준전위에 따른 디지탈 데이타를 발생하도록 동작함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  8. 페이징 수신기에 있어서, 주기적으로 제1 및 제2 주기 동안 전원 제어신호를 출력하는 동시에 제1 주기동안 발진 제어신호를 출력하는 제어부와, 전원에 연결되어 상기 전원 제어신호에 의해 각 RF 구성부들로 전원을 공급하는 전원스위치부와, 상기 발진 제어신호에 의해 스위칭되어 소정 주파수를 발생하는 발진수단과, RF변조신호를 수신하여 중간주파수 대역의 변조신호로 주파수 변환하는 RF수신부, 입력단이 상기 발진수단 및 주파수 변환부의 출력단에 연결되며, 상기 제1 주기 동안 발생되는 발진수단의 출력을 수신하여 기준전위 레벨의 복조신호를 발생하고, 상기 제2 주기 동안 발생되는 주파수 변환부의 출력을 수신하여 중간주파수 대역의 변조신호의 논리상태에 따른 복조신호를 발생하는 복조부와 상기 복조부의 출력을 수신하며, 상기 제1 주기에서 출력되는 기준전위의 복조신호에 의해 기준신호의 바이어스를 안정화 하고, 상기 제2주기에서 출력되는 복조신호의 논리상태를 기준 바이어스 신호에 의해 판정하는 파형정형부로 구성됨을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  9. 제8항에 있어서, 발진 수단이 상기 전원스위치부에 의해 전원을 공급받아 상기 변조신호의 중심 주파수를 발생하는 발진부와, 입력단이 상기 발진부에 연결되고 출력단이 상기 복조부에 연결되며, 상기 발진 제어신호에 의해 제1주기동안 스위칭되어 상기 발진부의출력을 복조부로 인가하는 발진스위치로 구성됨을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  10. 제9항에 있어서, 복조부가 상기 제1주기에서 상기 발진부를 출력하는 중심 주파수를 기준전위의 제2 전압크기로 복조하고, 상기 제2주기에서 상기 주파수 변환부를 출력하는 변조신호를 논리 상태에 따라 제1 또는 제3 전압크기로 복조함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  11. 제10항에 있어서, 파형정형부가 신호 입력단과 기준신호 입력단을 갖는 차동증폭기를 구비하며, 상기 제1주기에서 수신되는 제2전압으로 상기 기준신호 입력단의 바이어스를 안정화 시키고, 상기 제2 주기에서 수신되는 제1 또는 제3 전압의 복조신호의 논리를 판정하여 디지탈 신호를 발생함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  12. 제8항에 있어서, 발진 수단이 상기 전원스위치부에 입력단이 연결되어 상기 발진 제어신호에 의해 스위칭되어 상기 전원의 통로를 형성하는 발진스위치와, 전원단이 상기 발진스위치의 출력단에 연결되고 출력단이 상기 복조부에 연결되어, 상기 제1 주기동안 상기 중간주파수 대역의 변조신호의 중심 주파수를 발생하는 발진부로 구성됨을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  13. 제12항에 있어서, 복조부가 상기 제1주기에서 상기 발진부를 출력하는 중심 주파수를 기준전위의 제2전압 크기를 복조하고, 상기 제2 주기에서 상기 주파수 변환부를 출력하는 변조신호를 논리 상태에 따라 제1 또는 제3 전압크기로 복조함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  14. 제13항에 있어서, 파형정형부가 신호 입력단과 기준 신호 입력단을 갖는 차동증폭기를 구비하며, 상기 제1주기에서 수신되는 제2 전압으로 상기 기준신호 입력단의 바이어스를 안정화 시키고, 상기 제2 주기에서 수신되는 제1 또는 제3 전압의 복조신호의 논리를 판정하여 디지탈 신호를 발생함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  15. 페이징 수신기에 있어서, 주기적으로 제1주기동안 제1 전원 제어신호 및 발진 제어신호를 발생하며, 제2주기동안 상기 제1전원 제어신호 및 제2전원 제어신호를 발생하는 제어부와, 전원 소스에 연결된 제1 및 제2 전원스위치를 구비하며, 상기 제1 또는 제2 전원 제어신호에 의해 스위칭되어 각 RF구성부로 전원을 공급하는 전원 스위치부와, 상기 발진 제어신호에 의해 스위칭되어 소정 주파수를 발생하는 발진수단과, 상기 제2 전원스위치에 전원단이 연결되어 상기 제2 주기 동안 RF변조신호를 수신하여 중간주파수 대역의 변조신호로 주파수 변환하는 RF수신부와, 상기 제1 전원스위치에 전원단이 연결되며, 상기 제1 주기 동안 발생되는 상기 발진수단의 출력을 수신하여 기준전위의 복조신호를 발생하고, 상기 제2 주기동안 발생되는 상기 주파수 변환부의 출력을 수신하여 변조신호의 논리 상태에 따른 복조신호를 발생하는 복조부와, 상기 제1 전원스위치에 전원단이 연결되고, 입력단이 상기 발진수단 및 주파수 변환부의 출력단에 연결되며, 상기 제1 주기동안 상기 발진수단의 출력을 수신하여 기준전위의 복조신호를 발생하고, 상기 제2 주기 동안 상기 주파수 변환부의 출력을 수신하여 변조신호의 논리상태에 따른 복조신호를 발생하는 복조부와, 상기 제1 전원스위치에 전원단이 연결되고 입력단이 상기 복조부의 출력단에 연결되며, 상기 제1주기에서 출력되는 기준전위의 복조신호에 의해 기준신호의 바이어스를 안정화하고 상기 제2주기에서 출력되는 복조신호의 논리상태를 기준 바이어스 신호에 의해 판정하는 파형정형부를 구성됨을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  16. 제15항에 있어서, 발진 수단이 상기 전원스위치부에 의해 전원을 공급받아 상기 중간주파수 대역의 변조신호의 중심 주파수를 발생하는 발진부와, 입력단이 상기 발진부에 연결되고 출력단이 상기 복조부에 연결되며, 상기 발진 제어신호에 의해 스위칭되어 상기 발진부의 출력을 복조부로 인가하는 발진스위치로 구성됨을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  17. 제16항에 있어서, 복조부가 상기 제1 주기에서 상기 발진부를 출력하는 중심 주파수를 기준 전위의 제2전압 크기를 복조하고, 상기 제2 주기에서 상기 주파수 변환부를 출력하는 변조신호를 논리 상태에 따라 제1 또는 제3 전압 크기로 복조함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  18. 제17항에 있어서, 파형정형부가 신호 입력단과 기준 신호 입력단을 갖는 차동증폭기를 구비하며, 상기 제1주기에서 수신되는 제2 전압으로 상기 기준신호 입력단의 바이어스를 안정화 시키고, 상기 제2 주기에서 수신되는 제1 또는 제3전압의 복조신호의 논리를 판정하여 디지탈 신호를 발생함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  19. 제15항에 있어서, 발진 수단이 상기 전원스위치부에 입력단이 연결되어 상기 발진 제어신호에 의해 스위칭되어 상기 전원의 통로를 형성하는 발진스위치와, 전원단이 상기 발진스위치의 출력단에 연결되고 출력단이 상기 복조부와 연결되어, 상기 제1 주기동안 상기 중간주파수 대역의 변조신호의 중심 주파수를 발생하는 발진부로 구성됨을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  20. 제19항에 있어서, 복조부가 상기 제1 주기에서 상기 발진부를 출력하는 중심 주파수를 기준 전위의 제2전압 크기를 복조하고, 상기 제2 주기에서 상기 주파수 변환부를 출력하는 변조신호를 논리 상태에 따라 제1 또는 제3 전압크기로 복조함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
  21. 제20항에 있어서, 파형정형부가 신호 입력단과 기준 신호 입력단을 갖는 차동증폭기를 구비하며, 상기 제1주기에서 수신되는 제2 전압으로 상기 기준신호 입력단의 바이어스를 안정화 시키고, 상기 제2 주기에서 수신되는 제1 또는 제3 전압의 복조신호의 논리를 판정하여 디지탈 신호를 발생함을 특징으로 하는 페이징 수신기의 바이어스 안정화 회로.
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