KR920013887A - 증폭기용 오프셋 진성 리커버리 회로 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 이 발명에 따른 리커버리 회로를 구비한 연산증폭기의 회로도이다
Claims (3)
- 제1PNP트랜지스터(1), 제2PNP트랜지스터(2), 제3NPN트랜지스터(3),제4NPN트랜지스터(4)및 제1정전류원(8)으로된 입력 차동증폭기와, 유니터리게인 출력단(10)으로 구성된 진성 오프셋 리커버리 회로에 있어서, 입력 차동증폭기와 유니터리 게인 출력단 사이의 연결부로서 입력 차동증폭기의 출력, 제6트랜지스터(7)및 제7트랜지스터(11)와 연결된 제5NPN트랜지스터로 이루어진 게인단을 구비하며, 상기 제7트랜지스터(11)는 상기 제6트랜지스터(7)에 연결되고, 상기 상기 제7트랜지스터(11)및 상기 제6트랜지스터(7)는 상기 단일개인 출력단(10)에 연결되는 것을 특징으로 하는 진성 오프셋 리커버리 회로.
- 제2항에 있어서, 상기 제7트랜지스터(11)의 에미터단자가 제2정전류원(9), 상기 제6트랜지스터(7)의 컬렉터단자 및 상기 단일 게인 출력단(10)과 연결되는 것을 특징으로 하는 진성 오프셋 리커버리 회로.
- 제2항에 있어서, 제5트랜지스터(6)의 베이스단자가 상기 제1트랜지스터(1)와 제3트랜지스터(3)의 컬렉터 단자와 연결되고, 상기 제5트랜지스터(6)의 에미터 단자는 저항(5)을 통하여 상기 제3트랜지스터(3), 제4트랜지스터(4)및 제6트랜지스터(7)의 에미터단자, 상기 제6트랜지스터(7)의 베이스단자 및 상기 제7트랜지스터(11)의 컬렉터 단자에 연결되며, 상기 제5트랜지스터(6)의 콜렉터 단자는 상기 제7트랜지스터(11)의 베이스단자와 제3정전류원(12)에 연결되는 것을 특징으로 하는 진성 오프셋 리커버리 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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