KR920001919B1 - Vertical oscillation detecting circuit - Google Patents
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Abstract
Description
제1도는 본 발명에 따른 회로도.1 is a circuit diagram according to the present invention.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
10 : 주파수/전압 변환기 20 : 주파수판별부10: frequency / voltage converter 20: frequency discriminating unit
30 : 드라이브부 40 : 주파수선택부30: drive part 40: frequency selector
50 : 수직발진부50: vertical oscillation unit
본 발명은 영상신호를 모니터링하는 디스플레이장치의 수직발진회로에 관한 것으로서 특히 수직주파수가 변화해도 주파수 변화를 판별하여 안정된 수직발진을 할 수 있도록 하는 회로에 관한 것이다.The present invention relates to a vertical oscillation circuit of a display apparatus for monitoring an image signal, and more particularly, to a circuit for stably oscillating by determining a frequency change even when a vertical frequency changes.
현재의영상신호 모니터링 기기는 크게 컴퓨터 모니터, TV, 방송기기 모니터로 구분되어지는데, 컴퓨터 모니터와 TV 영상신호겸용 모니터로 빌전되는 있다. 상기와 같은 모니터가 TV 모니터에 있어서, 수신되는 수직주파수가 50HZ 또는 60HZ, 60HZ이상의 주파수가 수신되는 경우 수직발진회로의 폴터-인 레인지(HOder-In Range)로서 이를 커버하였으나 하기와 같은 문제가 있었다. 수신되는 수직주파수가 수직발전회로의 홀더인 레인지를 벗어날 경우 수직동기가 동기되지 않아 화상의 동기가 잡히지 않는 문제가 발생하였다.Current video signal monitoring devices are largely divided into computer monitors, TVs, and broadcast device monitors, which are used as computer monitors and TV video signal monitors. In the case of a TV monitor as described above, when the received vertical frequency is received at a frequency of 50HZ, 60HZ, 60HZ or more, the monitor covers this as a fault-in range of the vertical oscillation circuit, but has the following problems. . If the received vertical frequency is out of the range of the holder of the vertical power generation circuit, there is a problem that the image is not synchronized because the vertical synchronization is not synchronized.
종래에는 상기와 같은 문제점을 해소하기 위하여 수직발진회로의 발진부분의 발진시정수를 외부에서 가변저항등을 통해 임의로 가변하여 수직동기를 동기시켰으므로 사용하기에 불편하였다.Conventionally, in order to solve the above problems, since the oscillation time constant of the oscillation part of the vertical oscillation circuit is arbitrarily varied through a variable resistor, etc., it is inconvenient to use.
따라서 본 발명의 목적은 수신되는 수직주파수를 판별하여 수신돈 주파수에 상응하는 발진주파수를 방진토록 하는 제어신호를 출력토록하는 회로를 제공함에 있다.Accordingly, an object of the present invention is to provide a circuit for determining a vertical frequency to be received and outputting a control signal for oscillating the oscillation frequency corresponding to the received frequency.
이하 본 발명을 첨부된 도면을 참조하여 상세히 설명한다.Hereinafter, the present invention will be described in detail with reference to the accompanying drawings.
제1도는 본 발명에 따른 회로도로서 수직주파수를 입력하여 주파수를 전압으로변환출력하는 주파수/전압변환기(10)와, 상기 주파수/전압 변환기(10)에서 출력된 전압과 소정레벨의 기준전압(V2)을 비교하여 수직주파수 판별논리를 출력하는 주파수 판별부(20)와, 상기 주파수 판별부(20)의 출력논리상태에 따라 드라이브되는 드라이브부(30)와, 상기 드라이브부(30)의 상태에 따라 발진시정수에 의해 록킹되어 수직주파수를 발진할 수 있도록 수직주파수를 선택하는 주파수선택부(40)와, 상기 주파수선택부(40)의 주파수선택에 의해 수신 입력된 수직주파수에 상응하는 수직주파수를 발진하는 수직발진부(50)로 구성된다. 상기 구성중 주파수 판별수(20)는 저항(R1)(R2)(R4)(R5)로 구성된 기준전압 설정수단과 저항(R3)(R6)(R7)(R8), 비교기(OP1-OP2)로 구성되어 상기 주파수/전압 변환기(10)의 출력레벨을 비교하여 수직주파수 판별신호를 출력하는 비교수단으로 구성되고 드라이브부(30)는 저항(R9-R10), 제너다이오드(D1-D2), 트랜지스터(Q2)로 구성되며 주파수발진부(40)는 저항(R11-R12), 가변저항(VR1), 케패시터(C1-C3)로 구성된다.1 is a circuit diagram according to an embodiment of the present invention. A frequency / voltage converter 10 converts a frequency into a voltage by inputting a vertical frequency, and a voltage output from the frequency / voltage converter 10 and a reference voltage V2 of a predetermined level. ) Is compared with the frequency discriminating unit 20 for outputting the vertical frequency discrimination logic, the drive unit 30 driven according to the output logic state of the frequency discriminating unit 20, and the state of the drive unit 30. The frequency selector 40 selects a vertical frequency to lock the oscillation time constant so as to oscillate the vertical frequency, and a vertical frequency corresponding to the vertical frequency received by the frequency selection of the frequency selector 40. The oscillation comprises a vertical oscillation unit 50. The frequency discrimination number 20 in the above configuration includes reference voltage setting means composed of resistors R1, R2, R4, and R5, resistors R3, R6, R7, R8, and comparators OP1-OP2. Comprising a comparison means for outputting the vertical frequency discrimination signal by comparing the output level of the frequency / voltage converter 10 and the drive unit 30 is a resistor (R9-R10), Zener diode (D1-D2), The frequency oscillator 40 includes a resistor R11-R12, a variable resistor VR1, and a capacitor C1-C3.
상술한 구성에 의거 본 발명을 상세히 설명한다. 동기분리호로(도시하지 않음)로부터 동기신호를 입력하는 주파수/전압 변환기(10)는 수직동기신호를 전압으로 변환출력하게 된다. 상기 주파수/전압 변환기(10)에서 출력되는 전압은 수직주파수가 낮을 수록 크게 된다. 이로인해 수직주파수 입력에 따라 저항(R4-R5)에 의해 기준전압(V1)이설정되어 비교기(OP1)의 반전단자(-)로 입력되고 저항(R1-R2)에 의해 기준전압(V2)이 설정되어 비교기(OP2)의 비반전단자로 입력되며 비교기(OP1)의 비반전단자와 비교기(OP2)의 반전단자로 상기 주파수/전압 변환기(10)의 출력전압이 각각 입력되면 상기 비교기(OP1-OP2)는 기준전압과 상기 주파수/전압 변환기(10)의 출력전압을 비교하여 수직주파수의 판별논리를 각각 출력한다.The present invention will be described in detail based on the above configuration. The frequency / voltage converter 10 which inputs a synchronous signal from the synchronous separation arc (not shown) converts and outputs the vertical synchronous signal into a voltage. The voltage output from the frequency / voltage converter 10 becomes larger as the vertical frequency is lower. Due to this, the reference voltage V1 is set by the resistors R4-R5 according to the vertical frequency input and is input to the inverting terminal (-) of the comparator OP1, and the reference voltage V2 is set by the resistors R1-R2. When the output voltage of the frequency / voltage converter 10 is input to the non-inverting terminal of the comparator OP1 and the inverting terminal of the comparator OP2, respectively, the comparators OP1-OP2 are input. ) Compares the reference voltage with the output voltage of the frequency / voltage converter 10 and outputs a logic for discriminating the vertical frequency.
즉 입력되는 수직주파수가 43-45HZ이면 저항(R1-R2), (R4-R5)에 의해 설정된 기준전압이 상기 주파수/전압 변환기(10)의 출력전압보다 낮게 되므로 상기 비교기(OP1)는 논리 ″하이″를 출력하고 비교기(OP2)는 논리 ″로우″신호를 출력하게 된다. 상기 비교기(OP1)가 논리 ″하이″를 출력하므로 제너다이오드(D1)가 도통되어 트랜지스터(Q1)가 턴온된다. 상기 트랜지스터(Q1)가 턴온되므로 캐패시터(C1-C3) 저항(R12)및 가변저항 (VR1)의 수직발진 시정수에 의해 수직 주파수를 선택하며 상기 비교기(OP2)는 논리 ″로우″을 출력하므로 제너다이오드(D2) 및 트랜지스터(Q2)가 오프된다. 또한 입력수직주파수가 54-62HZ이면 저항(R4-R5)에 의해 설정된 기준전압(V1)은 상기 주파수/전압 변환기(10)의 출력전압보다 높고 저항(R1-R2)에 의해 설정된 기준전압(V2)은 상기 주파수/전압 변환기(10)의 출력전압보다 낮으므로 상기 비교기(OP1-OP2)는 모두 논리 ″로우″를 출력하게 되어 제너다이오드(D1-D2) 및 트랜지스터(Q1-Q2)가 오프되어 캐패시터(C2-C3) 저항(R12) 가변저항 (VR1)의 수직발진시정수에 의해 수직 주파수를 선택하게 된다. 그러나 입력수직주파수 65-72HZ이면 저항(R1-R2) 및 (R4-R5)에 의해 설정된 기준전압(V1-V2)이 상기 주파수/전압 변환기(10)의 출력전압보다 높게 되므로 상기 비교기(OP1)는 논리 ″로우″를 출력하게 되어 제너다이오드(D1) 및 트랜지스터(Q1)은 오프시킨다. 이와 반대로 상기 비교기(OP2)는 논리 ″하이″를 출력하게 되어 제너다이오드(D2)를 도통시켜 트랜지스터(Q2)가 턴온된다. 상기 트랜지스터(Q2)가 턴온되면 캐패시트(C2), 저항(R12), 가변저항 (VR1)의 수직발진 시정수에 의해 주파수를 선택출력하여 수직발진부(50)을 구동시켜 수진 입력된 수직주파수에 상응하는 수직발진을 하여 출력하게 된다. 따라서 입력되는 주파수가 변하더라도 안정된 수직동기를 발진할 수 있다.That is, if the input vertical frequency is 43-45HZ, the reference voltage set by the resistors R1-R2 and R4-R5 is lower than the output voltage of the frequency / voltage converter 10, so that the comparator OP1 is logic ″. High " and the comparator OP2 outputs a logical " low " signal. Since the comparator OP1 outputs a logic " high ", the zener diode D1 is conducted so that the transistor Q1 is turned on. Since the transistor Q1 is turned on, the vertical frequency is selected by the vertical oscillation time constants of the capacitors C1-C3 and the resistor R12 and the variable resistor VR1, and the comparator OP2 outputs a logic ″ low ″ so that the zener Diode D2 and transistor Q2 are turned off. Also, if the input vertical frequency is 54-62HZ, the reference voltage V1 set by the resistors R4-R5 is higher than the output voltage of the frequency / voltage converter 10 and the reference voltage V2 set by the resistors R1-R2. ) Is lower than the output voltage of the frequency / voltage converter 10, so that all of the comparators OP1-OP2 output logic ″ low ″ so that the zener diodes D1-D2 and transistors Q1-Q2 are turned off. The vertical frequency is selected by the vertical oscillation time constant of the capacitor C2-C3 resistor R12 and the variable resistor VR1. However, if the input vertical frequency is 65-72HZ, the reference voltage V1-V2 set by the resistors R1-R2 and R4-R5 becomes higher than the output voltage of the frequency / voltage converter 10, so that the comparator OP1 Outputs a logic " low " to turn off zener diode D1 and transistor Q1. On the contrary, the comparator OP2 outputs a logic " high " to conduct the zener diode D2 to turn on the transistor Q2. When the transistor Q2 is turned on, the frequency is selected and output by the vertical oscillation time constant of the capacitor C2, the resistor R12, and the variable resistor VR1 to drive the vertical oscillator 50 to the vertical input frequency. The corresponding vertical oscillation is output. Therefore, stable vertical synchronization can be generated even if the input frequency changes.
상술한 바와 같이 수신수직 주파수를 자동으로 판별하여 판별신호를 수직발진 주파수선택부의 제어신호로서 출력함으로서 사용자의 편리함을 도모할 수 있는 동시에 모니터의 기능을 향상기킬 수 있는 이점이 있다.As described above, by automatically determining the reception vertical frequency and outputting the discrimination signal as a control signal of the vertical oscillation frequency selection unit, the user's convenience can be enhanced and the function of the monitor can be improved.
Claims (1)
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| KR1019890015043A KR920001919B1 (en) | 1989-10-19 | 1989-10-19 | Vertical oscillation detecting circuit |
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Families Citing this family (1)
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1989
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