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유지보수 및 디버깅용 터미널 접속회로Terminal connection circuit for maintenance and debugging
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음Since this is an open matter, no full text was included.
제 1도는 본 발명의 회로도.1 is a circuit diagram of the present invention.
Claims (1)
마이크로 프로세서를 구비한 대상 시스템과 디버깅용 터미널을 구비한 유지보수 및 디버깅용 터미널 접속회로에 있어서, 목적하는 대상 시스템과 터미널과의 데이터 통신을 중계하기 위한 유니버샬 비동기 송수신부와, 상기 UART를 목적하는 대상 시스템에 접속하기 위한 점퍼회로와, 상기 UART를 터미널과 접속하기 위한 RS-232C와, 상기 UART와 상기 RS-232C사이에 접속되어 상기 RS-232C로부터 상기 UART로의 데이터를 전송하기 위한 입력부와, 상기 UART의 출력데이터를 상기 RS-232C로 전송하기 위한 출력부와, 상기 UART에 필요한 클럭열을 공급하기 위한 클럭발생부로 구성함을 특징으로 하는 회로.A maintenance and debugging terminal connection circuit including a target system having a microprocessor and a debugging terminal, comprising: a universal asynchronous transceiver for relaying data communication between a target system and a terminal, and a target for the UART. A jumper circuit for connecting to a target system, an RS-232C for connecting the UART to a terminal, an input unit connected between the UART and the RS-232C for transmitting data from the RS-232C to the UART; And an output unit for transmitting the output data of the UART to the RS-232C, and a clock generator for supplying a clock string necessary for the UART.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.※ Note: The disclosure is based on the initial application.
KR1019890009087A1989-06-291989-06-29
Terminal connection circuit for maintenance and debugging
KR910001559A
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