KR900019355A - 디지탈 고역통과 필터 - Google Patents
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- H04N23/67—Focus control based on electronic image sensor signals
- H04N23/675—Focus control based on electronic image sensor signals comprising setting of focusing regions
Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 제1실시예의 블럭도, 제6도는 본 발명의 제5실시예의 블럭도, 제8도는 평균화 디지탈 지역통과 필터의 일예의 블럭도.
Claims (3)
- m 샘플의 지연 회로와 (m+1) 샘플의 지연 회로의 종속 접속과 입력 신호와, 상기 샘플의 지연 회로와 상기(m+1) 샘플의 지연 회로의 종속 접속을 거쳐 지연시킨 입력 신호를 감산하는 제1감산 회로와, 상기 m 샘플의 지연회로와 상기(m+1) 샘플의 지연 회로의 접속점에서의 출력 신호에 계수2m를 승산한 계수2m 승산 회로와, 상기 m 샘플의 지연 회로와 상기 (m+1) 샘플의 지연 회로의 접속점에서 출력 신호와, 상기 계수 2m 승산 회로의 출력 신호를 가산하는 제1가산 회로와, 그 출력 신호를 1샘플 지연시켜 귀환시키고, 상기 제1감산 회로의 출력신호와, 가산하는 제1의 샘플 지연 회로 및 제2가산 회로와, 상기 제1가산 회로의 출력 신호와, 상기 제2가산회로의 출력 신호를 감산하는 제2감산 회로를 가지고, 상기 제2감산 회로의 출력에서 출력 신호를 얻도록 한 디지탈 고역 통과 필터.
- m 샘플의 지연 회로와 (m+1) 샘플의 지연 회로의 종속 접속과, 입력 신호와, 상기 m 샘플의 지연 회로와 (m+1) 샘플의 지연 회로의 종속 접속을 거쳐 지연된 입력 신호를 감산하는 제3감산 회로와, 상기 제3감산 회로의 출력 신호를 래치하는 제2의 1샘플 지연 회로와, 상기 m 샘플의 지연 회로와 상기 (m+1) 샘플의 지연 회로의 접속점에서 출력 신호에 계수 2m를 승산하는 계수 2m 승산 회로와, 상기 m 샘플의 지연 회로와 (m+1) 샘플의 지연 회로의 접속점에서의 출력 신호와, 상기 계수 2m 승산 회로의 출력 신호를 가산하는 제3가산 회로와, 상기 제3의 가산 회로의 출력 신호를 래치하는 제3의 1샘플 지연회로와, 그 출력 신호를 1샘플 지연시켜 귀환시키고, 상기 제2의 1샘플 지연 회로의 출력 신호와 가산하는 제4의 1샘플 지연 회로 및 제3의 가산 회로와, 상기 제4의 1샘플 지연 회로의 출력 신호와, 상기 제3의 1샘플 지연 회로의 출력 신호를 감산하는 제4감산 회로를 가지고, 상기 제4감산 회로의 출력에서 출력 신호를 얻도록한 디지탈 고역 통과 필터.
- (m-1) 샘플의 지연 회로와 제5의 1샘플 지연 회로와 m 샘플의 지연 회로의 종속 접속과, 상기 (m-1)샘플의 지연 회로와 상기 제5의 1샘플 지연 회로의 접속점에 접속되는 제1의 계수 m 승산 회로와, 상기 제5의 1샘플 지연 회로와 상기 m 샘플의 지연 회로의 접속점에 접속되는 제2계수 m 승산 회로와 입력 신호와, 상기 (m-1) 샘플의 지연 회로와 상기 제5의 1샘플 지연 회로와, m 샘플의 지연 회로를 거쳐 지연된 입력 신호를 감산하는 제5감산 회로와, 상기 제1계수 m 승산 회로의 출력 신호와, 상기 제2계수 m 승산 회로의 출력 신호를 가산하는 제5 가산 회로와, 그 출력 신호를 1 샘플 지연시켜 복귀시키고, 상기 제5감산 회로의 출력 신호와 가산하는 제6의 1샘플 지연 회로 및 제6의 가산 회로와, 상기 제5의 가산 회로의 출력 신호와 상기 제6의 가산 회로의 출력신호를 감산하는 제6의 감산 회로를 가지고, 상기 제6의 감산 회로의 출력에서 출력 신호를 얻도록 한 디지탈 교역통과 필터.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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1989
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1990
- 1990-05-16 KR KR1019900006970A patent/KR0151147B1/ko not_active IP Right Cessation
Also Published As
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